1a2b0a27dSPhilippe Mathieu-Daudé /* 2a2b0a27dSPhilippe Mathieu-Daudé * MIPS SIMD Architecture (MSA) translation routines 3a2b0a27dSPhilippe Mathieu-Daudé * 4a2b0a27dSPhilippe Mathieu-Daudé * Copyright (c) 2004-2005 Jocelyn Mayer 5a2b0a27dSPhilippe Mathieu-Daudé * Copyright (c) 2006 Marius Groeger (FPU operations) 6a2b0a27dSPhilippe Mathieu-Daudé * Copyright (c) 2006 Thiemo Seufer (MIPS32R2 support) 7a2b0a27dSPhilippe Mathieu-Daudé * Copyright (c) 2009 CodeSourcery (MIPS16 and microMIPS support) 8a2b0a27dSPhilippe Mathieu-Daudé * Copyright (c) 2012 Jia Liu & Dongxue Zhang (MIPS ASE DSP support) 9a2b0a27dSPhilippe Mathieu-Daudé * Copyright (c) 2020 Philippe Mathieu-Daudé 10a2b0a27dSPhilippe Mathieu-Daudé * 11a2b0a27dSPhilippe Mathieu-Daudé * SPDX-License-Identifier: LGPL-2.1-or-later 12a2b0a27dSPhilippe Mathieu-Daudé */ 13a2b0a27dSPhilippe Mathieu-Daudé #include "qemu/osdep.h" 14a2b0a27dSPhilippe Mathieu-Daudé #include "tcg/tcg-op.h" 15a2b0a27dSPhilippe Mathieu-Daudé #include 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Mathieu-Daudé OPC_CEQI_df = (0x0 << 23) | OPC_MSA_I5_07, 65a2b0a27dSPhilippe Mathieu-Daudé OPC_SUBVI_df = (0x1 << 23) | OPC_MSA_I5_06, 66a2b0a27dSPhilippe Mathieu-Daudé OPC_MAXI_S_df = (0x2 << 23) | OPC_MSA_I5_06, 67a2b0a27dSPhilippe Mathieu-Daudé OPC_CLTI_S_df = (0x2 << 23) | OPC_MSA_I5_07, 68a2b0a27dSPhilippe Mathieu-Daudé OPC_MAXI_U_df = (0x3 << 23) | OPC_MSA_I5_06, 69a2b0a27dSPhilippe Mathieu-Daudé OPC_CLTI_U_df = (0x3 << 23) | OPC_MSA_I5_07, 70a2b0a27dSPhilippe Mathieu-Daudé OPC_MINI_S_df = (0x4 << 23) | OPC_MSA_I5_06, 71a2b0a27dSPhilippe Mathieu-Daudé OPC_CLEI_S_df = (0x4 << 23) | OPC_MSA_I5_07, 72a2b0a27dSPhilippe Mathieu-Daudé OPC_MINI_U_df = (0x5 << 23) | OPC_MSA_I5_06, 73a2b0a27dSPhilippe Mathieu-Daudé OPC_CLEI_U_df = (0x5 << 23) | OPC_MSA_I5_07, 74a2b0a27dSPhilippe Mathieu-Daudé OPC_LDI_df = (0x6 << 23) | OPC_MSA_I5_07, 75a2b0a27dSPhilippe Mathieu-Daudé 76a2b0a27dSPhilippe Mathieu-Daudé /* I8 instruction */ 77a2b0a27dSPhilippe Mathieu-Daudé OPC_ANDI_B = (0x0 << 24) | OPC_MSA_I8_00, 78a2b0a27dSPhilippe Mathieu-Daudé OPC_BMNZI_B = (0x0 << 24) | OPC_MSA_I8_01, 79a2b0a27dSPhilippe Mathieu-Daudé OPC_SHF_B = (0x0 << 24) | OPC_MSA_I8_02, 80a2b0a27dSPhilippe Mathieu-Daudé OPC_ORI_B = (0x1 << 24) | OPC_MSA_I8_00, 81a2b0a27dSPhilippe Mathieu-Daudé OPC_BMZI_B = (0x1 << 24) | OPC_MSA_I8_01, 82a2b0a27dSPhilippe Mathieu-Daudé OPC_SHF_H = (0x1 << 24) | OPC_MSA_I8_02, 83a2b0a27dSPhilippe Mathieu-Daudé OPC_NORI_B = (0x2 << 24) | OPC_MSA_I8_00, 84a2b0a27dSPhilippe Mathieu-Daudé OPC_BSELI_B = (0x2 << 24) | OPC_MSA_I8_01, 85a2b0a27dSPhilippe Mathieu-Daudé OPC_SHF_W = (0x2 << 24) | OPC_MSA_I8_02, 86a2b0a27dSPhilippe Mathieu-Daudé OPC_XORI_B = (0x3 << 24) | OPC_MSA_I8_00, 87a2b0a27dSPhilippe Mathieu-Daudé 88a2b0a27dSPhilippe Mathieu-Daudé /* VEC/2R/2RF instruction */ 89a2b0a27dSPhilippe Mathieu-Daudé OPC_AND_V = (0x00 << 21) | OPC_MSA_VEC, 90a2b0a27dSPhilippe Mathieu-Daudé OPC_OR_V = (0x01 << 21) | OPC_MSA_VEC, 91a2b0a27dSPhilippe Mathieu-Daudé OPC_NOR_V = (0x02 << 21) | OPC_MSA_VEC, 92a2b0a27dSPhilippe Mathieu-Daudé OPC_XOR_V = (0x03 << 21) | OPC_MSA_VEC, 93a2b0a27dSPhilippe Mathieu-Daudé OPC_BMNZ_V = (0x04 << 21) | OPC_MSA_VEC, 94a2b0a27dSPhilippe Mathieu-Daudé OPC_BMZ_V = (0x05 << 21) | OPC_MSA_VEC, 95a2b0a27dSPhilippe Mathieu-Daudé OPC_BSEL_V = (0x06 << 21) | OPC_MSA_VEC, 96a2b0a27dSPhilippe Mathieu-Daudé 97a2b0a27dSPhilippe Mathieu-Daudé OPC_MSA_2R = (0x18 << 21) | OPC_MSA_VEC, 98a2b0a27dSPhilippe Mathieu-Daudé OPC_MSA_2RF = (0x19 << 21) | OPC_MSA_VEC, 99a2b0a27dSPhilippe Mathieu-Daudé 100a2b0a27dSPhilippe Mathieu-Daudé /* 2R instruction df(bits 17..16) = _b, _h, _w, _d */ 101a2b0a27dSPhilippe Mathieu-Daudé OPC_FILL_df = (0x00 << 18) | OPC_MSA_2R, 102a2b0a27dSPhilippe Mathieu-Daudé OPC_PCNT_df = (0x01 << 18) | OPC_MSA_2R, 103a2b0a27dSPhilippe Mathieu-Daudé OPC_NLOC_df = (0x02 << 18) | OPC_MSA_2R, 104a2b0a27dSPhilippe Mathieu-Daudé OPC_NLZC_df = (0x03 << 18) | OPC_MSA_2R, 105a2b0a27dSPhilippe Mathieu-Daudé 106a2b0a27dSPhilippe Mathieu-Daudé /* 2RF instruction df(bit 16) = _w, _d */ 107a2b0a27dSPhilippe Mathieu-Daudé OPC_FCLASS_df = (0x00 << 17) | OPC_MSA_2RF, 108a2b0a27dSPhilippe Mathieu-Daudé OPC_FTRUNC_S_df = (0x01 << 17) | OPC_MSA_2RF, 109a2b0a27dSPhilippe Mathieu-Daudé OPC_FTRUNC_U_df = (0x02 << 17) | OPC_MSA_2RF, 110a2b0a27dSPhilippe Mathieu-Daudé OPC_FSQRT_df = (0x03 << 17) | OPC_MSA_2RF, 111a2b0a27dSPhilippe Mathieu-Daudé OPC_FRSQRT_df = (0x04 << 17) | OPC_MSA_2RF, 112a2b0a27dSPhilippe Mathieu-Daudé OPC_FRCP_df = (0x05 << 17) | OPC_MSA_2RF, 113a2b0a27dSPhilippe Mathieu-Daudé OPC_FRINT_df = (0x06 << 17) | OPC_MSA_2RF, 114a2b0a27dSPhilippe Mathieu-Daudé OPC_FLOG2_df = (0x07 << 17) | OPC_MSA_2RF, 115a2b0a27dSPhilippe Mathieu-Daudé OPC_FEXUPL_df = (0x08 << 17) | OPC_MSA_2RF, 116a2b0a27dSPhilippe Mathieu-Daudé OPC_FEXUPR_df = (0x09 << 17) | OPC_MSA_2RF, 117a2b0a27dSPhilippe Mathieu-Daudé OPC_FFQL_df = (0x0A << 17) | OPC_MSA_2RF, 118a2b0a27dSPhilippe Mathieu-Daudé OPC_FFQR_df = (0x0B << 17) | OPC_MSA_2RF, 119a2b0a27dSPhilippe Mathieu-Daudé OPC_FTINT_S_df = (0x0C << 17) | OPC_MSA_2RF, 120a2b0a27dSPhilippe Mathieu-Daudé OPC_FTINT_U_df = (0x0D << 17) | OPC_MSA_2RF, 121a2b0a27dSPhilippe Mathieu-Daudé OPC_FFINT_S_df = (0x0E << 17) | OPC_MSA_2RF, 122a2b0a27dSPhilippe Mathieu-Daudé OPC_FFINT_U_df = (0x0F << 17) | OPC_MSA_2RF, 123a2b0a27dSPhilippe Mathieu-Daudé 124a2b0a27dSPhilippe Mathieu-Daudé /* 3R instruction df(bits 22..21) = _b, _h, _w, d */ 125a2b0a27dSPhilippe Mathieu-Daudé OPC_SLL_df = (0x0 << 23) | OPC_MSA_3R_0D, 126a2b0a27dSPhilippe Mathieu-Daudé OPC_ADDV_df = (0x0 << 23) | OPC_MSA_3R_0E, 127a2b0a27dSPhilippe Mathieu-Daudé OPC_CEQ_df = (0x0 << 23) | OPC_MSA_3R_0F, 128a2b0a27dSPhilippe Mathieu-Daudé OPC_ADD_A_df = (0x0 << 23) | OPC_MSA_3R_10, 129a2b0a27dSPhilippe Mathieu-Daudé OPC_SUBS_S_df = (0x0 << 23) | OPC_MSA_3R_11, 130a2b0a27dSPhilippe Mathieu-Daudé OPC_MULV_df = (0x0 << 23) | OPC_MSA_3R_12, 131a2b0a27dSPhilippe Mathieu-Daudé OPC_DOTP_S_df = (0x0 << 23) | OPC_MSA_3R_13, 132a2b0a27dSPhilippe Mathieu-Daudé OPC_SLD_df = (0x0 << 23) | OPC_MSA_3R_14, 133a2b0a27dSPhilippe Mathieu-Daudé OPC_VSHF_df = (0x0 << 23) | OPC_MSA_3R_15, 134a2b0a27dSPhilippe Mathieu-Daudé OPC_SRA_df = (0x1 << 23) | OPC_MSA_3R_0D, 135a2b0a27dSPhilippe Mathieu-Daudé OPC_SUBV_df = (0x1 << 23) | OPC_MSA_3R_0E, 136a2b0a27dSPhilippe Mathieu-Daudé OPC_ADDS_A_df = (0x1 << 23) | OPC_MSA_3R_10, 137a2b0a27dSPhilippe Mathieu-Daudé OPC_SUBS_U_df = (0x1 << 23) | OPC_MSA_3R_11, 138a2b0a27dSPhilippe Mathieu-Daudé OPC_MADDV_df = (0x1 << 23) | OPC_MSA_3R_12, 139a2b0a27dSPhilippe Mathieu-Daudé OPC_DOTP_U_df = (0x1 << 23) | OPC_MSA_3R_13, 140a2b0a27dSPhilippe Mathieu-Daudé OPC_SPLAT_df = (0x1 << 23) | OPC_MSA_3R_14, 141a2b0a27dSPhilippe Mathieu-Daudé OPC_SRAR_df = (0x1 << 23) | OPC_MSA_3R_15, 142a2b0a27dSPhilippe Mathieu-Daudé OPC_SRL_df = (0x2 << 23) | OPC_MSA_3R_0D, 143a2b0a27dSPhilippe Mathieu-Daudé OPC_MAX_S_df = (0x2 << 23) | OPC_MSA_3R_0E, 144a2b0a27dSPhilippe Mathieu-Daudé OPC_CLT_S_df = (0x2 << 23) | OPC_MSA_3R_0F, 145a2b0a27dSPhilippe Mathieu-Daudé OPC_ADDS_S_df = (0x2 << 23) | OPC_MSA_3R_10, 146a2b0a27dSPhilippe Mathieu-Daudé OPC_SUBSUS_U_df = (0x2 << 23) | OPC_MSA_3R_11, 147a2b0a27dSPhilippe Mathieu-Daudé OPC_MSUBV_df = (0x2 << 23) | OPC_MSA_3R_12, 148a2b0a27dSPhilippe Mathieu-Daudé OPC_DPADD_S_df = (0x2 << 23) | OPC_MSA_3R_13, 149a2b0a27dSPhilippe Mathieu-Daudé OPC_PCKEV_df = (0x2 << 23) | OPC_MSA_3R_14, 150a2b0a27dSPhilippe Mathieu-Daudé OPC_SRLR_df = (0x2 << 23) | OPC_MSA_3R_15, 151a2b0a27dSPhilippe Mathieu-Daudé OPC_BCLR_df = (0x3 << 23) | OPC_MSA_3R_0D, 152a2b0a27dSPhilippe Mathieu-Daudé OPC_MAX_U_df = (0x3 << 23) | OPC_MSA_3R_0E, 153a2b0a27dSPhilippe Mathieu-Daudé OPC_CLT_U_df = (0x3 << 23) | OPC_MSA_3R_0F, 154a2b0a27dSPhilippe Mathieu-Daudé OPC_ADDS_U_df = (0x3 << 23) | OPC_MSA_3R_10, 155a2b0a27dSPhilippe Mathieu-Daudé OPC_SUBSUU_S_df = (0x3 << 23) | OPC_MSA_3R_11, 156a2b0a27dSPhilippe Mathieu-Daudé OPC_DPADD_U_df = (0x3 << 23) | OPC_MSA_3R_13, 157a2b0a27dSPhilippe Mathieu-Daudé OPC_PCKOD_df = (0x3 << 23) | OPC_MSA_3R_14, 158a2b0a27dSPhilippe Mathieu-Daudé OPC_BSET_df = (0x4 << 23) | OPC_MSA_3R_0D, 159a2b0a27dSPhilippe Mathieu-Daudé OPC_MIN_S_df = (0x4 << 23) | OPC_MSA_3R_0E, 160a2b0a27dSPhilippe Mathieu-Daudé OPC_CLE_S_df = (0x4 << 23) | OPC_MSA_3R_0F, 161a2b0a27dSPhilippe Mathieu-Daudé OPC_AVE_S_df = (0x4 << 23) | OPC_MSA_3R_10, 162a2b0a27dSPhilippe Mathieu-Daudé OPC_ASUB_S_df = (0x4 << 23) | OPC_MSA_3R_11, 163a2b0a27dSPhilippe Mathieu-Daudé OPC_DIV_S_df = (0x4 << 23) | OPC_MSA_3R_12, 164a2b0a27dSPhilippe Mathieu-Daudé OPC_DPSUB_S_df = (0x4 << 23) | OPC_MSA_3R_13, 165a2b0a27dSPhilippe Mathieu-Daudé OPC_ILVL_df = (0x4 << 23) | OPC_MSA_3R_14, 166a2b0a27dSPhilippe Mathieu-Daudé OPC_HADD_S_df = (0x4 << 23) | OPC_MSA_3R_15, 167a2b0a27dSPhilippe Mathieu-Daudé OPC_BNEG_df = (0x5 << 23) | OPC_MSA_3R_0D, 168a2b0a27dSPhilippe Mathieu-Daudé OPC_MIN_U_df = (0x5 << 23) | OPC_MSA_3R_0E, 169a2b0a27dSPhilippe Mathieu-Daudé OPC_CLE_U_df = (0x5 << 23) | OPC_MSA_3R_0F, 170a2b0a27dSPhilippe Mathieu-Daudé OPC_AVE_U_df = (0x5 << 23) | OPC_MSA_3R_10, 171a2b0a27dSPhilippe Mathieu-Daudé OPC_ASUB_U_df = (0x5 << 23) | OPC_MSA_3R_11, 172a2b0a27dSPhilippe Mathieu-Daudé OPC_DIV_U_df = (0x5 << 23) | OPC_MSA_3R_12, 173a2b0a27dSPhilippe Mathieu-Daudé OPC_DPSUB_U_df = (0x5 << 23) | OPC_MSA_3R_13, 174a2b0a27dSPhilippe Mathieu-Daudé OPC_ILVR_df = (0x5 << 23) | OPC_MSA_3R_14, 175a2b0a27dSPhilippe Mathieu-Daudé OPC_HADD_U_df = (0x5 << 23) | OPC_MSA_3R_15, 176a2b0a27dSPhilippe Mathieu-Daudé OPC_BINSL_df = (0x6 << 23) | OPC_MSA_3R_0D, 177a2b0a27dSPhilippe Mathieu-Daudé OPC_MAX_A_df = (0x6 << 23) | OPC_MSA_3R_0E, 178a2b0a27dSPhilippe Mathieu-Daudé OPC_AVER_S_df = (0x6 << 23) | OPC_MSA_3R_10, 179a2b0a27dSPhilippe Mathieu-Daudé OPC_MOD_S_df = (0x6 << 23) | OPC_MSA_3R_12, 180a2b0a27dSPhilippe Mathieu-Daudé OPC_ILVEV_df = (0x6 << 23) | OPC_MSA_3R_14, 181a2b0a27dSPhilippe Mathieu-Daudé OPC_HSUB_S_df = (0x6 << 23) | OPC_MSA_3R_15, 182a2b0a27dSPhilippe Mathieu-Daudé OPC_BINSR_df = (0x7 << 23) | OPC_MSA_3R_0D, 183a2b0a27dSPhilippe Mathieu-Daudé OPC_MIN_A_df = (0x7 << 23) | OPC_MSA_3R_0E, 184a2b0a27dSPhilippe Mathieu-Daudé OPC_AVER_U_df = (0x7 << 23) | OPC_MSA_3R_10, 185a2b0a27dSPhilippe Mathieu-Daudé OPC_MOD_U_df = (0x7 << 23) | OPC_MSA_3R_12, 186a2b0a27dSPhilippe Mathieu-Daudé OPC_ILVOD_df = (0x7 << 23) | OPC_MSA_3R_14, 187a2b0a27dSPhilippe Mathieu-Daudé OPC_HSUB_U_df = (0x7 << 23) | OPC_MSA_3R_15, 188a2b0a27dSPhilippe Mathieu-Daudé 189a2b0a27dSPhilippe Mathieu-Daudé /* ELM instructions df(bits 21..16) = _b, _h, _w, _d */ 190a2b0a27dSPhilippe Mathieu-Daudé OPC_SLDI_df = (0x0 << 22) | (0x00 << 16) | OPC_MSA_ELM, 191a2b0a27dSPhilippe Mathieu-Daudé OPC_CTCMSA = (0x0 << 22) | (0x3E << 16) | OPC_MSA_ELM, 192a2b0a27dSPhilippe Mathieu-Daudé OPC_SPLATI_df = (0x1 << 22) | (0x00 << 16) | OPC_MSA_ELM, 193a2b0a27dSPhilippe Mathieu-Daudé OPC_CFCMSA = (0x1 << 22) | (0x3E << 16) | OPC_MSA_ELM, 194a2b0a27dSPhilippe Mathieu-Daudé OPC_COPY_S_df = (0x2 << 22) | (0x00 << 16) | OPC_MSA_ELM, 195a2b0a27dSPhilippe Mathieu-Daudé OPC_MOVE_V = (0x2 << 22) | (0x3E << 16) | OPC_MSA_ELM, 196a2b0a27dSPhilippe Mathieu-Daudé OPC_COPY_U_df = (0x3 << 22) | (0x00 << 16) | OPC_MSA_ELM, 197a2b0a27dSPhilippe Mathieu-Daudé OPC_INSERT_df = (0x4 << 22) | (0x00 << 16) | OPC_MSA_ELM, 198a2b0a27dSPhilippe Mathieu-Daudé OPC_INSVE_df = (0x5 << 22) | (0x00 << 16) | OPC_MSA_ELM, 199a2b0a27dSPhilippe Mathieu-Daudé 200a2b0a27dSPhilippe Mathieu-Daudé /* 3RF instruction _df(bit 21) = _w, _d */ 201a2b0a27dSPhilippe Mathieu-Daudé OPC_FCAF_df = (0x0 << 22) | OPC_MSA_3RF_1A, 202a2b0a27dSPhilippe Mathieu-Daudé OPC_FADD_df = (0x0 << 22) | OPC_MSA_3RF_1B, 203a2b0a27dSPhilippe Mathieu-Daudé OPC_FCUN_df = (0x1 << 22) | OPC_MSA_3RF_1A, 204a2b0a27dSPhilippe Mathieu-Daudé OPC_FSUB_df = (0x1 << 22) | OPC_MSA_3RF_1B, 205a2b0a27dSPhilippe Mathieu-Daudé OPC_FCOR_df = (0x1 << 22) | OPC_MSA_3RF_1C, 206a2b0a27dSPhilippe Mathieu-Daudé OPC_FCEQ_df = (0x2 << 22) | OPC_MSA_3RF_1A, 207a2b0a27dSPhilippe Mathieu-Daudé OPC_FMUL_df = (0x2 << 22) | OPC_MSA_3RF_1B, 208a2b0a27dSPhilippe Mathieu-Daudé OPC_FCUNE_df = (0x2 << 22) | OPC_MSA_3RF_1C, 209a2b0a27dSPhilippe Mathieu-Daudé OPC_FCUEQ_df = (0x3 << 22) | OPC_MSA_3RF_1A, 210a2b0a27dSPhilippe Mathieu-Daudé OPC_FDIV_df = (0x3 << 22) | OPC_MSA_3RF_1B, 211a2b0a27dSPhilippe Mathieu-Daudé OPC_FCNE_df = (0x3 << 22) | OPC_MSA_3RF_1C, 212a2b0a27dSPhilippe Mathieu-Daudé OPC_FCLT_df = (0x4 << 22) | OPC_MSA_3RF_1A, 213a2b0a27dSPhilippe Mathieu-Daudé OPC_FMADD_df = (0x4 << 22) | OPC_MSA_3RF_1B, 214a2b0a27dSPhilippe Mathieu-Daudé OPC_MUL_Q_df = (0x4 << 22) | OPC_MSA_3RF_1C, 215a2b0a27dSPhilippe Mathieu-Daudé OPC_FCULT_df = (0x5 << 22) | OPC_MSA_3RF_1A, 216a2b0a27dSPhilippe Mathieu-Daudé OPC_FMSUB_df = (0x5 << 22) | OPC_MSA_3RF_1B, 217a2b0a27dSPhilippe Mathieu-Daudé OPC_MADD_Q_df = (0x5 << 22) | OPC_MSA_3RF_1C, 218a2b0a27dSPhilippe Mathieu-Daudé OPC_FCLE_df = (0x6 << 22) | OPC_MSA_3RF_1A, 219a2b0a27dSPhilippe Mathieu-Daudé OPC_MSUB_Q_df = (0x6 << 22) | OPC_MSA_3RF_1C, 220a2b0a27dSPhilippe Mathieu-Daudé OPC_FCULE_df = (0x7 << 22) | OPC_MSA_3RF_1A, 221a2b0a27dSPhilippe Mathieu-Daudé OPC_FEXP2_df = (0x7 << 22) | OPC_MSA_3RF_1B, 222a2b0a27dSPhilippe Mathieu-Daudé OPC_FSAF_df = (0x8 << 22) | OPC_MSA_3RF_1A, 223a2b0a27dSPhilippe Mathieu-Daudé OPC_FEXDO_df = (0x8 << 22) | OPC_MSA_3RF_1B, 224a2b0a27dSPhilippe Mathieu-Daudé OPC_FSUN_df = (0x9 << 22) | OPC_MSA_3RF_1A, 225a2b0a27dSPhilippe Mathieu-Daudé OPC_FSOR_df = (0x9 << 22) | OPC_MSA_3RF_1C, 226a2b0a27dSPhilippe Mathieu-Daudé OPC_FSEQ_df = (0xA << 22) | OPC_MSA_3RF_1A, 227a2b0a27dSPhilippe Mathieu-Daudé OPC_FTQ_df = (0xA << 22) | OPC_MSA_3RF_1B, 228a2b0a27dSPhilippe Mathieu-Daudé OPC_FSUNE_df = (0xA << 22) | OPC_MSA_3RF_1C, 229a2b0a27dSPhilippe Mathieu-Daudé OPC_FSUEQ_df = (0xB << 22) | OPC_MSA_3RF_1A, 230a2b0a27dSPhilippe Mathieu-Daudé OPC_FSNE_df = (0xB << 22) | OPC_MSA_3RF_1C, 231a2b0a27dSPhilippe Mathieu-Daudé OPC_FSLT_df = (0xC << 22) | OPC_MSA_3RF_1A, 232a2b0a27dSPhilippe Mathieu-Daudé OPC_FMIN_df = (0xC << 22) | OPC_MSA_3RF_1B, 233a2b0a27dSPhilippe Mathieu-Daudé OPC_MULR_Q_df = (0xC << 22) | OPC_MSA_3RF_1C, 234a2b0a27dSPhilippe Mathieu-Daudé OPC_FSULT_df = (0xD << 22) | OPC_MSA_3RF_1A, 235a2b0a27dSPhilippe Mathieu-Daudé OPC_FMIN_A_df = (0xD << 22) | OPC_MSA_3RF_1B, 236a2b0a27dSPhilippe Mathieu-Daudé OPC_MADDR_Q_df = (0xD << 22) | OPC_MSA_3RF_1C, 237a2b0a27dSPhilippe Mathieu-Daudé OPC_FSLE_df = (0xE << 22) | OPC_MSA_3RF_1A, 238a2b0a27dSPhilippe Mathieu-Daudé OPC_FMAX_df = (0xE << 22) | OPC_MSA_3RF_1B, 239a2b0a27dSPhilippe Mathieu-Daudé OPC_MSUBR_Q_df = (0xE << 22) | OPC_MSA_3RF_1C, 240a2b0a27dSPhilippe Mathieu-Daudé OPC_FSULE_df = (0xF << 22) | OPC_MSA_3RF_1A, 241a2b0a27dSPhilippe Mathieu-Daudé OPC_FMAX_A_df = (0xF << 22) | OPC_MSA_3RF_1B, 242a2b0a27dSPhilippe Mathieu-Daudé 243a2b0a27dSPhilippe Mathieu-Daudé /* BIT instruction df(bits 22..16) = _B _H _W _D */ 244a2b0a27dSPhilippe Mathieu-Daudé OPC_SLLI_df = (0x0 << 23) | OPC_MSA_BIT_09, 245a2b0a27dSPhilippe Mathieu-Daudé OPC_SAT_S_df = (0x0 << 23) | OPC_MSA_BIT_0A, 246a2b0a27dSPhilippe Mathieu-Daudé OPC_SRAI_df = (0x1 << 23) | OPC_MSA_BIT_09, 247a2b0a27dSPhilippe Mathieu-Daudé OPC_SAT_U_df = (0x1 << 23) | OPC_MSA_BIT_0A, 248a2b0a27dSPhilippe Mathieu-Daudé OPC_SRLI_df = (0x2 << 23) | OPC_MSA_BIT_09, 249a2b0a27dSPhilippe Mathieu-Daudé OPC_SRARI_df = (0x2 << 23) | OPC_MSA_BIT_0A, 250a2b0a27dSPhilippe Mathieu-Daudé OPC_BCLRI_df = (0x3 << 23) | OPC_MSA_BIT_09, 251a2b0a27dSPhilippe Mathieu-Daudé OPC_SRLRI_df = (0x3 << 23) | OPC_MSA_BIT_0A, 252a2b0a27dSPhilippe Mathieu-Daudé OPC_BSETI_df = (0x4 << 23) | OPC_MSA_BIT_09, 253a2b0a27dSPhilippe Mathieu-Daudé OPC_BNEGI_df = (0x5 << 23) | OPC_MSA_BIT_09, 254a2b0a27dSPhilippe Mathieu-Daudé OPC_BINSLI_df = (0x6 << 23) | OPC_MSA_BIT_09, 255a2b0a27dSPhilippe Mathieu-Daudé OPC_BINSRI_df = (0x7 << 23) | OPC_MSA_BIT_09, 256a2b0a27dSPhilippe Mathieu-Daudé }; 257a2b0a27dSPhilippe Mathieu-Daudé 258*06106772SPhilippe Mathieu-Daudé static const char msaregnames[][6] = { 259a2b0a27dSPhilippe Mathieu-Daudé "w0.d0", "w0.d1", "w1.d0", "w1.d1", 260a2b0a27dSPhilippe Mathieu-Daudé "w2.d0", "w2.d1", "w3.d0", "w3.d1", 261a2b0a27dSPhilippe Mathieu-Daudé "w4.d0", "w4.d1", "w5.d0", "w5.d1", 262a2b0a27dSPhilippe Mathieu-Daudé "w6.d0", "w6.d1", "w7.d0", "w7.d1", 263a2b0a27dSPhilippe Mathieu-Daudé "w8.d0", "w8.d1", "w9.d0", "w9.d1", 264a2b0a27dSPhilippe Mathieu-Daudé "w10.d0", "w10.d1", "w11.d0", "w11.d1", 265a2b0a27dSPhilippe Mathieu-Daudé "w12.d0", "w12.d1", "w13.d0", "w13.d1", 266a2b0a27dSPhilippe Mathieu-Daudé "w14.d0", "w14.d1", "w15.d0", "w15.d1", 267a2b0a27dSPhilippe Mathieu-Daudé "w16.d0", "w16.d1", "w17.d0", "w17.d1", 268a2b0a27dSPhilippe Mathieu-Daudé "w18.d0", "w18.d1", "w19.d0", "w19.d1", 269a2b0a27dSPhilippe Mathieu-Daudé "w20.d0", "w20.d1", "w21.d0", "w21.d1", 270a2b0a27dSPhilippe Mathieu-Daudé "w22.d0", "w22.d1", "w23.d0", "w23.d1", 271a2b0a27dSPhilippe Mathieu-Daudé "w24.d0", "w24.d1", "w25.d0", "w25.d1", 272a2b0a27dSPhilippe Mathieu-Daudé "w26.d0", "w26.d1", "w27.d0", "w27.d1", 273a2b0a27dSPhilippe Mathieu-Daudé "w28.d0", "w28.d1", "w29.d0", "w29.d1", 274a2b0a27dSPhilippe Mathieu-Daudé "w30.d0", "w30.d1", "w31.d0", "w31.d1", 275a2b0a27dSPhilippe Mathieu-Daudé }; 276a2b0a27dSPhilippe Mathieu-Daudé 277a2b0a27dSPhilippe Mathieu-Daudé static TCGv_i64 msa_wr_d[64]; 278a2b0a27dSPhilippe Mathieu-Daudé 279a2b0a27dSPhilippe Mathieu-Daudé void msa_translate_init(void) 280a2b0a27dSPhilippe Mathieu-Daudé { 281a2b0a27dSPhilippe Mathieu-Daudé int i; 282a2b0a27dSPhilippe Mathieu-Daudé 283a2b0a27dSPhilippe Mathieu-Daudé for (i = 0; i < 32; i++) { 284a2b0a27dSPhilippe Mathieu-Daudé int off = offsetof(CPUMIPSState, active_fpu.fpr[i].wr.d[0]); 285a2b0a27dSPhilippe Mathieu-Daudé 286a2b0a27dSPhilippe Mathieu-Daudé /* 287a2b0a27dSPhilippe Mathieu-Daudé * The MSA vector registers are mapped on the 288a2b0a27dSPhilippe Mathieu-Daudé * scalar floating-point unit (FPU) registers. 289a2b0a27dSPhilippe Mathieu-Daudé */ 290a2b0a27dSPhilippe Mathieu-Daudé msa_wr_d[i * 2] = fpu_f64[i]; 291a2b0a27dSPhilippe Mathieu-Daudé off = offsetof(CPUMIPSState, active_fpu.fpr[i].wr.d[1]); 292a2b0a27dSPhilippe Mathieu-Daudé msa_wr_d[i * 2 + 1] = 293a2b0a27dSPhilippe Mathieu-Daudé tcg_global_mem_new_i64(cpu_env, off, msaregnames[i * 2 + 1]); 294a2b0a27dSPhilippe Mathieu-Daudé } 295a2b0a27dSPhilippe Mathieu-Daudé } 296a2b0a27dSPhilippe Mathieu-Daudé 297a2b0a27dSPhilippe Mathieu-Daudé static inline int check_msa_access(DisasContext *ctx) 298a2b0a27dSPhilippe Mathieu-Daudé { 299a2b0a27dSPhilippe Mathieu-Daudé if (unlikely((ctx->hflags & MIPS_HFLAG_FPU) && 300a2b0a27dSPhilippe Mathieu-Daudé !(ctx->hflags & MIPS_HFLAG_F64))) { 301a2b0a27dSPhilippe Mathieu-Daudé gen_reserved_instruction(ctx); 302a2b0a27dSPhilippe Mathieu-Daudé return 0; 303a2b0a27dSPhilippe Mathieu-Daudé } 304a2b0a27dSPhilippe Mathieu-Daudé 305a2b0a27dSPhilippe Mathieu-Daudé if (unlikely(!(ctx->hflags & MIPS_HFLAG_MSA))) { 306a2b0a27dSPhilippe Mathieu-Daudé generate_exception_end(ctx, EXCP_MSADIS); 307a2b0a27dSPhilippe Mathieu-Daudé return 0; 308a2b0a27dSPhilippe Mathieu-Daudé } 309a2b0a27dSPhilippe Mathieu-Daudé return 1; 310a2b0a27dSPhilippe Mathieu-Daudé } 311a2b0a27dSPhilippe Mathieu-Daudé 312a2b0a27dSPhilippe Mathieu-Daudé static void gen_check_zero_element(TCGv tresult, uint8_t df, uint8_t wt, 313a2b0a27dSPhilippe Mathieu-Daudé TCGCond cond) 314a2b0a27dSPhilippe Mathieu-Daudé { 315a2b0a27dSPhilippe Mathieu-Daudé /* generates tcg ops to check if any element is 0 */ 316a2b0a27dSPhilippe Mathieu-Daudé /* Note this function only works with MSA_WRLEN = 128 */ 317a2b0a27dSPhilippe Mathieu-Daudé uint64_t eval_zero_or_big = 0; 318a2b0a27dSPhilippe Mathieu-Daudé uint64_t eval_big = 0; 319a2b0a27dSPhilippe Mathieu-Daudé TCGv_i64 t0 = tcg_temp_new_i64(); 320a2b0a27dSPhilippe Mathieu-Daudé TCGv_i64 t1 = tcg_temp_new_i64(); 321a2b0a27dSPhilippe Mathieu-Daudé switch (df) { 322a2b0a27dSPhilippe Mathieu-Daudé case DF_BYTE: 323a2b0a27dSPhilippe Mathieu-Daudé eval_zero_or_big = 0x0101010101010101ULL; 324a2b0a27dSPhilippe Mathieu-Daudé eval_big = 0x8080808080808080ULL; 325a2b0a27dSPhilippe Mathieu-Daudé break; 326a2b0a27dSPhilippe Mathieu-Daudé case DF_HALF: 327a2b0a27dSPhilippe Mathieu-Daudé eval_zero_or_big = 0x0001000100010001ULL; 328a2b0a27dSPhilippe Mathieu-Daudé eval_big = 0x8000800080008000ULL; 329a2b0a27dSPhilippe Mathieu-Daudé break; 330a2b0a27dSPhilippe Mathieu-Daudé case DF_WORD: 331a2b0a27dSPhilippe Mathieu-Daudé eval_zero_or_big = 0x0000000100000001ULL; 332a2b0a27dSPhilippe Mathieu-Daudé eval_big = 0x8000000080000000ULL; 333a2b0a27dSPhilippe Mathieu-Daudé break; 334a2b0a27dSPhilippe Mathieu-Daudé case DF_DOUBLE: 335a2b0a27dSPhilippe Mathieu-Daudé eval_zero_or_big = 0x0000000000000001ULL; 336a2b0a27dSPhilippe Mathieu-Daudé eval_big = 0x8000000000000000ULL; 337a2b0a27dSPhilippe Mathieu-Daudé break; 338a2b0a27dSPhilippe Mathieu-Daudé } 339a2b0a27dSPhilippe Mathieu-Daudé tcg_gen_subi_i64(t0, msa_wr_d[wt << 1], eval_zero_or_big); 340a2b0a27dSPhilippe Mathieu-Daudé tcg_gen_andc_i64(t0, t0, msa_wr_d[wt << 1]); 341a2b0a27dSPhilippe Mathieu-Daudé tcg_gen_andi_i64(t0, t0, eval_big); 342a2b0a27dSPhilippe Mathieu-Daudé tcg_gen_subi_i64(t1, msa_wr_d[(wt << 1) + 1], eval_zero_or_big); 343a2b0a27dSPhilippe Mathieu-Daudé tcg_gen_andc_i64(t1, t1, msa_wr_d[(wt << 1) + 1]); 344a2b0a27dSPhilippe Mathieu-Daudé tcg_gen_andi_i64(t1, t1, eval_big); 345a2b0a27dSPhilippe Mathieu-Daudé tcg_gen_or_i64(t0, t0, t1); 346a2b0a27dSPhilippe Mathieu-Daudé /* if all bits are zero then all elements are not zero */ 347a2b0a27dSPhilippe Mathieu-Daudé /* if some bit is non-zero then some element is zero */ 348a2b0a27dSPhilippe Mathieu-Daudé tcg_gen_setcondi_i64(cond, t0, t0, 0); 349a2b0a27dSPhilippe Mathieu-Daudé tcg_gen_trunc_i64_tl(tresult, t0); 350a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i64(t0); 351a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i64(t1); 352a2b0a27dSPhilippe Mathieu-Daudé } 353a2b0a27dSPhilippe Mathieu-Daudé 354a2b0a27dSPhilippe Mathieu-Daudé static bool gen_msa_BxZ_V(DisasContext *ctx, int wt, int s16, TCGCond cond) 355a2b0a27dSPhilippe Mathieu-Daudé { 356a2b0a27dSPhilippe Mathieu-Daudé TCGv_i64 t0; 357a2b0a27dSPhilippe Mathieu-Daudé 358a2b0a27dSPhilippe Mathieu-Daudé check_msa_access(ctx); 359a2b0a27dSPhilippe Mathieu-Daudé 360a2b0a27dSPhilippe Mathieu-Daudé if (ctx->hflags & MIPS_HFLAG_BMASK) { 361a2b0a27dSPhilippe Mathieu-Daudé gen_reserved_instruction(ctx); 362a2b0a27dSPhilippe Mathieu-Daudé return true; 363a2b0a27dSPhilippe Mathieu-Daudé } 364a2b0a27dSPhilippe Mathieu-Daudé t0 = tcg_temp_new_i64(); 365a2b0a27dSPhilippe Mathieu-Daudé tcg_gen_or_i64(t0, msa_wr_d[wt << 1], msa_wr_d[(wt << 1) + 1]); 366a2b0a27dSPhilippe Mathieu-Daudé tcg_gen_setcondi_i64(cond, t0, t0, 0); 367a2b0a27dSPhilippe Mathieu-Daudé tcg_gen_trunc_i64_tl(bcond, t0); 368a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i64(t0); 369a2b0a27dSPhilippe Mathieu-Daudé 370a2b0a27dSPhilippe Mathieu-Daudé ctx->btarget = ctx->base.pc_next + (s16 << 2) + 4; 371a2b0a27dSPhilippe Mathieu-Daudé 372a2b0a27dSPhilippe Mathieu-Daudé ctx->hflags |= MIPS_HFLAG_BC; 373a2b0a27dSPhilippe Mathieu-Daudé ctx->hflags |= MIPS_HFLAG_BDS32; 374a2b0a27dSPhilippe Mathieu-Daudé 375a2b0a27dSPhilippe Mathieu-Daudé return true; 376a2b0a27dSPhilippe Mathieu-Daudé } 377a2b0a27dSPhilippe Mathieu-Daudé 378a2b0a27dSPhilippe Mathieu-Daudé static bool trans_BZ_V(DisasContext *ctx, arg_msa_bz *a) 379a2b0a27dSPhilippe Mathieu-Daudé { 380a2b0a27dSPhilippe Mathieu-Daudé return gen_msa_BxZ_V(ctx, a->wt, a->s16, TCG_COND_EQ); 381a2b0a27dSPhilippe Mathieu-Daudé } 382a2b0a27dSPhilippe Mathieu-Daudé 383a2b0a27dSPhilippe Mathieu-Daudé static bool trans_BNZ_V(DisasContext *ctx, arg_msa_bz *a) 384a2b0a27dSPhilippe Mathieu-Daudé { 385a2b0a27dSPhilippe Mathieu-Daudé return gen_msa_BxZ_V(ctx, a->wt, a->s16, TCG_COND_NE); 386a2b0a27dSPhilippe Mathieu-Daudé } 387a2b0a27dSPhilippe Mathieu-Daudé 388a2b0a27dSPhilippe Mathieu-Daudé static bool gen_msa_BxZ(DisasContext *ctx, int df, int wt, int s16, bool if_not) 389a2b0a27dSPhilippe Mathieu-Daudé { 390a2b0a27dSPhilippe Mathieu-Daudé check_msa_access(ctx); 391a2b0a27dSPhilippe Mathieu-Daudé 392a2b0a27dSPhilippe Mathieu-Daudé if (ctx->hflags & MIPS_HFLAG_BMASK) { 393a2b0a27dSPhilippe Mathieu-Daudé gen_reserved_instruction(ctx); 394a2b0a27dSPhilippe Mathieu-Daudé return true; 395a2b0a27dSPhilippe Mathieu-Daudé } 396a2b0a27dSPhilippe Mathieu-Daudé 397a2b0a27dSPhilippe Mathieu-Daudé gen_check_zero_element(bcond, df, wt, if_not ? TCG_COND_EQ : TCG_COND_NE); 398a2b0a27dSPhilippe Mathieu-Daudé 399a2b0a27dSPhilippe Mathieu-Daudé ctx->btarget = ctx->base.pc_next + (s16 << 2) + 4; 400a2b0a27dSPhilippe Mathieu-Daudé ctx->hflags |= MIPS_HFLAG_BC; 401a2b0a27dSPhilippe Mathieu-Daudé ctx->hflags |= MIPS_HFLAG_BDS32; 402a2b0a27dSPhilippe Mathieu-Daudé 403a2b0a27dSPhilippe Mathieu-Daudé return true; 404a2b0a27dSPhilippe Mathieu-Daudé } 405a2b0a27dSPhilippe Mathieu-Daudé 406a2b0a27dSPhilippe Mathieu-Daudé static bool trans_BZ_x(DisasContext *ctx, arg_msa_bz *a) 407a2b0a27dSPhilippe Mathieu-Daudé { 408a2b0a27dSPhilippe Mathieu-Daudé return gen_msa_BxZ(ctx, a->df, a->wt, a->s16, false); 409a2b0a27dSPhilippe Mathieu-Daudé } 410a2b0a27dSPhilippe Mathieu-Daudé 411a2b0a27dSPhilippe Mathieu-Daudé static bool trans_BNZ_x(DisasContext *ctx, arg_msa_bz *a) 412a2b0a27dSPhilippe Mathieu-Daudé { 413a2b0a27dSPhilippe Mathieu-Daudé return gen_msa_BxZ(ctx, a->df, a->wt, a->s16, true); 414a2b0a27dSPhilippe Mathieu-Daudé } 415a2b0a27dSPhilippe Mathieu-Daudé 416a2b0a27dSPhilippe Mathieu-Daudé static void gen_msa_i8(DisasContext *ctx) 417a2b0a27dSPhilippe Mathieu-Daudé { 418a2b0a27dSPhilippe Mathieu-Daudé #define MASK_MSA_I8(op) (MASK_MSA_MINOR(op) | (op & (0x03 << 24))) 419a2b0a27dSPhilippe Mathieu-Daudé uint8_t i8 = (ctx->opcode >> 16) & 0xff; 420a2b0a27dSPhilippe Mathieu-Daudé uint8_t ws = (ctx->opcode >> 11) & 0x1f; 421a2b0a27dSPhilippe Mathieu-Daudé uint8_t wd = (ctx->opcode >> 6) & 0x1f; 422a2b0a27dSPhilippe Mathieu-Daudé 423a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 twd = tcg_const_i32(wd); 424a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 tws = tcg_const_i32(ws); 425a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 ti8 = tcg_const_i32(i8); 426a2b0a27dSPhilippe Mathieu-Daudé 427a2b0a27dSPhilippe Mathieu-Daudé switch (MASK_MSA_I8(ctx->opcode)) { 428a2b0a27dSPhilippe Mathieu-Daudé case OPC_ANDI_B: 429a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_andi_b(cpu_env, twd, tws, ti8); 430a2b0a27dSPhilippe Mathieu-Daudé break; 431a2b0a27dSPhilippe Mathieu-Daudé case OPC_ORI_B: 432a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_ori_b(cpu_env, twd, tws, ti8); 433a2b0a27dSPhilippe Mathieu-Daudé break; 434a2b0a27dSPhilippe Mathieu-Daudé case OPC_NORI_B: 435a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_nori_b(cpu_env, twd, tws, ti8); 436a2b0a27dSPhilippe Mathieu-Daudé break; 437a2b0a27dSPhilippe Mathieu-Daudé case OPC_XORI_B: 438a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_xori_b(cpu_env, twd, tws, ti8); 439a2b0a27dSPhilippe Mathieu-Daudé break; 440a2b0a27dSPhilippe Mathieu-Daudé case OPC_BMNZI_B: 441a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_bmnzi_b(cpu_env, twd, tws, ti8); 442a2b0a27dSPhilippe Mathieu-Daudé break; 443a2b0a27dSPhilippe Mathieu-Daudé case OPC_BMZI_B: 444a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_bmzi_b(cpu_env, twd, tws, ti8); 445a2b0a27dSPhilippe Mathieu-Daudé break; 446a2b0a27dSPhilippe Mathieu-Daudé case OPC_BSELI_B: 447a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_bseli_b(cpu_env, twd, tws, ti8); 448a2b0a27dSPhilippe Mathieu-Daudé break; 449a2b0a27dSPhilippe Mathieu-Daudé case OPC_SHF_B: 450a2b0a27dSPhilippe Mathieu-Daudé case OPC_SHF_H: 451a2b0a27dSPhilippe Mathieu-Daudé case OPC_SHF_W: 452a2b0a27dSPhilippe Mathieu-Daudé { 453a2b0a27dSPhilippe Mathieu-Daudé uint8_t df = (ctx->opcode >> 24) & 0x3; 454a2b0a27dSPhilippe Mathieu-Daudé if (df == DF_DOUBLE) { 455a2b0a27dSPhilippe Mathieu-Daudé gen_reserved_instruction(ctx); 456a2b0a27dSPhilippe Mathieu-Daudé } else { 457a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 tdf = tcg_const_i32(df); 458a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_shf_df(cpu_env, tdf, twd, tws, ti8); 459a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i32(tdf); 460a2b0a27dSPhilippe Mathieu-Daudé } 461a2b0a27dSPhilippe Mathieu-Daudé } 462a2b0a27dSPhilippe Mathieu-Daudé break; 463a2b0a27dSPhilippe Mathieu-Daudé default: 464a2b0a27dSPhilippe Mathieu-Daudé MIPS_INVAL("MSA instruction"); 465a2b0a27dSPhilippe Mathieu-Daudé gen_reserved_instruction(ctx); 466a2b0a27dSPhilippe Mathieu-Daudé break; 467a2b0a27dSPhilippe Mathieu-Daudé } 468a2b0a27dSPhilippe Mathieu-Daudé 469a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i32(twd); 470a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i32(tws); 471a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i32(ti8); 472a2b0a27dSPhilippe Mathieu-Daudé } 473a2b0a27dSPhilippe Mathieu-Daudé 474a2b0a27dSPhilippe Mathieu-Daudé static void gen_msa_i5(DisasContext *ctx) 475a2b0a27dSPhilippe Mathieu-Daudé { 476a2b0a27dSPhilippe Mathieu-Daudé #define MASK_MSA_I5(op) (MASK_MSA_MINOR(op) | (op & (0x7 << 23))) 477a2b0a27dSPhilippe Mathieu-Daudé uint8_t df = (ctx->opcode >> 21) & 0x3; 478a2b0a27dSPhilippe Mathieu-Daudé int8_t s5 = (int8_t) sextract32(ctx->opcode, 16, 5); 479a2b0a27dSPhilippe Mathieu-Daudé uint8_t u5 = (ctx->opcode >> 16) & 0x1f; 480a2b0a27dSPhilippe Mathieu-Daudé uint8_t ws = (ctx->opcode >> 11) & 0x1f; 481a2b0a27dSPhilippe Mathieu-Daudé uint8_t wd = (ctx->opcode >> 6) & 0x1f; 482a2b0a27dSPhilippe Mathieu-Daudé 483a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 tdf = tcg_const_i32(df); 484a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 twd = tcg_const_i32(wd); 485a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 tws = tcg_const_i32(ws); 486a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 timm = tcg_temp_new_i32(); 487a2b0a27dSPhilippe Mathieu-Daudé tcg_gen_movi_i32(timm, u5); 488a2b0a27dSPhilippe Mathieu-Daudé 489a2b0a27dSPhilippe Mathieu-Daudé switch (MASK_MSA_I5(ctx->opcode)) { 490a2b0a27dSPhilippe Mathieu-Daudé case OPC_ADDVI_df: 491a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_addvi_df(cpu_env, tdf, twd, tws, timm); 492a2b0a27dSPhilippe Mathieu-Daudé break; 493a2b0a27dSPhilippe Mathieu-Daudé case OPC_SUBVI_df: 494a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_subvi_df(cpu_env, tdf, twd, tws, timm); 495a2b0a27dSPhilippe Mathieu-Daudé break; 496a2b0a27dSPhilippe Mathieu-Daudé case OPC_MAXI_S_df: 497a2b0a27dSPhilippe Mathieu-Daudé tcg_gen_movi_i32(timm, s5); 498a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_maxi_s_df(cpu_env, tdf, twd, tws, timm); 499a2b0a27dSPhilippe Mathieu-Daudé break; 500a2b0a27dSPhilippe Mathieu-Daudé case OPC_MAXI_U_df: 501a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_maxi_u_df(cpu_env, tdf, twd, tws, timm); 502a2b0a27dSPhilippe Mathieu-Daudé break; 503a2b0a27dSPhilippe Mathieu-Daudé case OPC_MINI_S_df: 504a2b0a27dSPhilippe Mathieu-Daudé tcg_gen_movi_i32(timm, s5); 505a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_mini_s_df(cpu_env, tdf, twd, tws, timm); 506a2b0a27dSPhilippe Mathieu-Daudé break; 507a2b0a27dSPhilippe Mathieu-Daudé case OPC_MINI_U_df: 508a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_mini_u_df(cpu_env, tdf, twd, tws, timm); 509a2b0a27dSPhilippe Mathieu-Daudé break; 510a2b0a27dSPhilippe Mathieu-Daudé case OPC_CEQI_df: 511a2b0a27dSPhilippe Mathieu-Daudé tcg_gen_movi_i32(timm, s5); 512a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_ceqi_df(cpu_env, tdf, twd, tws, timm); 513a2b0a27dSPhilippe Mathieu-Daudé break; 514a2b0a27dSPhilippe Mathieu-Daudé case OPC_CLTI_S_df: 515a2b0a27dSPhilippe Mathieu-Daudé tcg_gen_movi_i32(timm, s5); 516a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_clti_s_df(cpu_env, tdf, twd, tws, timm); 517a2b0a27dSPhilippe Mathieu-Daudé break; 518a2b0a27dSPhilippe Mathieu-Daudé case OPC_CLTI_U_df: 519a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_clti_u_df(cpu_env, tdf, twd, tws, timm); 520a2b0a27dSPhilippe Mathieu-Daudé break; 521a2b0a27dSPhilippe Mathieu-Daudé case OPC_CLEI_S_df: 522a2b0a27dSPhilippe Mathieu-Daudé tcg_gen_movi_i32(timm, s5); 523a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_clei_s_df(cpu_env, tdf, twd, tws, timm); 524a2b0a27dSPhilippe Mathieu-Daudé break; 525a2b0a27dSPhilippe Mathieu-Daudé case OPC_CLEI_U_df: 526a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_clei_u_df(cpu_env, tdf, twd, tws, timm); 527a2b0a27dSPhilippe Mathieu-Daudé break; 528a2b0a27dSPhilippe Mathieu-Daudé case OPC_LDI_df: 529a2b0a27dSPhilippe Mathieu-Daudé { 530a2b0a27dSPhilippe Mathieu-Daudé int32_t s10 = sextract32(ctx->opcode, 11, 10); 531a2b0a27dSPhilippe Mathieu-Daudé tcg_gen_movi_i32(timm, s10); 532a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_ldi_df(cpu_env, tdf, twd, timm); 533a2b0a27dSPhilippe Mathieu-Daudé } 534a2b0a27dSPhilippe Mathieu-Daudé break; 535a2b0a27dSPhilippe Mathieu-Daudé default: 536a2b0a27dSPhilippe Mathieu-Daudé MIPS_INVAL("MSA instruction"); 537a2b0a27dSPhilippe Mathieu-Daudé gen_reserved_instruction(ctx); 538a2b0a27dSPhilippe Mathieu-Daudé break; 539a2b0a27dSPhilippe Mathieu-Daudé } 540a2b0a27dSPhilippe Mathieu-Daudé 541a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i32(tdf); 542a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i32(twd); 543a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i32(tws); 544a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i32(timm); 545a2b0a27dSPhilippe Mathieu-Daudé } 546a2b0a27dSPhilippe Mathieu-Daudé 547a2b0a27dSPhilippe Mathieu-Daudé static void gen_msa_bit(DisasContext *ctx) 548a2b0a27dSPhilippe Mathieu-Daudé { 549a2b0a27dSPhilippe Mathieu-Daudé #define MASK_MSA_BIT(op) (MASK_MSA_MINOR(op) | (op & (0x7 << 23))) 550a2b0a27dSPhilippe Mathieu-Daudé uint8_t dfm = (ctx->opcode >> 16) & 0x7f; 551a2b0a27dSPhilippe Mathieu-Daudé uint32_t df = 0, m = 0; 552a2b0a27dSPhilippe Mathieu-Daudé uint8_t ws = (ctx->opcode >> 11) & 0x1f; 553a2b0a27dSPhilippe Mathieu-Daudé uint8_t wd = (ctx->opcode >> 6) & 0x1f; 554a2b0a27dSPhilippe Mathieu-Daudé 555a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 tdf; 556a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 tm; 557a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 twd; 558a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 tws; 559a2b0a27dSPhilippe Mathieu-Daudé 560a2b0a27dSPhilippe Mathieu-Daudé if ((dfm & 0x40) == 0x00) { 561a2b0a27dSPhilippe Mathieu-Daudé m = dfm & 0x3f; 562a2b0a27dSPhilippe Mathieu-Daudé df = DF_DOUBLE; 563a2b0a27dSPhilippe Mathieu-Daudé } else if ((dfm & 0x60) == 0x40) { 564a2b0a27dSPhilippe Mathieu-Daudé m = dfm & 0x1f; 565a2b0a27dSPhilippe Mathieu-Daudé df = DF_WORD; 566a2b0a27dSPhilippe Mathieu-Daudé } else if ((dfm & 0x70) == 0x60) { 567a2b0a27dSPhilippe Mathieu-Daudé m = dfm & 0x0f; 568a2b0a27dSPhilippe Mathieu-Daudé df = DF_HALF; 569a2b0a27dSPhilippe Mathieu-Daudé } else if ((dfm & 0x78) == 0x70) { 570a2b0a27dSPhilippe Mathieu-Daudé m = dfm & 0x7; 571a2b0a27dSPhilippe Mathieu-Daudé df = DF_BYTE; 572a2b0a27dSPhilippe Mathieu-Daudé } else { 573a2b0a27dSPhilippe Mathieu-Daudé gen_reserved_instruction(ctx); 574a2b0a27dSPhilippe Mathieu-Daudé return; 575a2b0a27dSPhilippe Mathieu-Daudé } 576a2b0a27dSPhilippe Mathieu-Daudé 577a2b0a27dSPhilippe Mathieu-Daudé tdf = tcg_const_i32(df); 578a2b0a27dSPhilippe Mathieu-Daudé tm = tcg_const_i32(m); 579a2b0a27dSPhilippe Mathieu-Daudé twd = tcg_const_i32(wd); 580a2b0a27dSPhilippe Mathieu-Daudé tws = tcg_const_i32(ws); 581a2b0a27dSPhilippe Mathieu-Daudé 582a2b0a27dSPhilippe Mathieu-Daudé switch (MASK_MSA_BIT(ctx->opcode)) { 583a2b0a27dSPhilippe Mathieu-Daudé case OPC_SLLI_df: 584a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_slli_df(cpu_env, tdf, twd, tws, tm); 585a2b0a27dSPhilippe Mathieu-Daudé break; 586a2b0a27dSPhilippe Mathieu-Daudé case OPC_SRAI_df: 587a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_srai_df(cpu_env, tdf, twd, tws, tm); 588a2b0a27dSPhilippe Mathieu-Daudé break; 589a2b0a27dSPhilippe Mathieu-Daudé case OPC_SRLI_df: 590a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_srli_df(cpu_env, tdf, twd, tws, tm); 591a2b0a27dSPhilippe Mathieu-Daudé break; 592a2b0a27dSPhilippe Mathieu-Daudé case OPC_BCLRI_df: 593a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_bclri_df(cpu_env, tdf, twd, tws, tm); 594a2b0a27dSPhilippe Mathieu-Daudé break; 595a2b0a27dSPhilippe Mathieu-Daudé case OPC_BSETI_df: 596a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_bseti_df(cpu_env, tdf, twd, tws, tm); 597a2b0a27dSPhilippe Mathieu-Daudé break; 598a2b0a27dSPhilippe Mathieu-Daudé case OPC_BNEGI_df: 599a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_bnegi_df(cpu_env, tdf, twd, tws, tm); 600a2b0a27dSPhilippe Mathieu-Daudé break; 601a2b0a27dSPhilippe Mathieu-Daudé case OPC_BINSLI_df: 602a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_binsli_df(cpu_env, tdf, twd, tws, tm); 603a2b0a27dSPhilippe Mathieu-Daudé break; 604a2b0a27dSPhilippe Mathieu-Daudé case OPC_BINSRI_df: 605a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_binsri_df(cpu_env, tdf, twd, tws, tm); 606a2b0a27dSPhilippe Mathieu-Daudé break; 607a2b0a27dSPhilippe Mathieu-Daudé case OPC_SAT_S_df: 608a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_sat_s_df(cpu_env, tdf, twd, tws, tm); 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627a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i32(twd); 628a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i32(tws); 629a2b0a27dSPhilippe Mathieu-Daudé } 630a2b0a27dSPhilippe Mathieu-Daudé 631a2b0a27dSPhilippe Mathieu-Daudé static void gen_msa_3r(DisasContext *ctx) 632a2b0a27dSPhilippe Mathieu-Daudé { 633a2b0a27dSPhilippe Mathieu-Daudé #define MASK_MSA_3R(op) (MASK_MSA_MINOR(op) | (op & (0x7 << 23))) 634a2b0a27dSPhilippe Mathieu-Daudé uint8_t df = (ctx->opcode >> 21) & 0x3; 635a2b0a27dSPhilippe Mathieu-Daudé uint8_t wt = (ctx->opcode >> 16) & 0x1f; 636a2b0a27dSPhilippe Mathieu-Daudé uint8_t ws = (ctx->opcode >> 11) & 0x1f; 637a2b0a27dSPhilippe Mathieu-Daudé uint8_t wd = (ctx->opcode >> 6) & 0x1f; 638a2b0a27dSPhilippe Mathieu-Daudé 639a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 tdf = tcg_const_i32(df); 640a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 twd = tcg_const_i32(wd); 641a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 tws = tcg_const_i32(ws); 642a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 twt = tcg_const_i32(wt); 643a2b0a27dSPhilippe Mathieu-Daudé 644a2b0a27dSPhilippe Mathieu-Daudé switch (MASK_MSA_3R(ctx->opcode)) { 645a2b0a27dSPhilippe Mathieu-Daudé case OPC_BINSL_df: 646a2b0a27dSPhilippe Mathieu-Daudé switch (df) { 647a2b0a27dSPhilippe Mathieu-Daudé case DF_BYTE: 648a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_binsl_b(cpu_env, twd, tws, twt); 649a2b0a27dSPhilippe Mathieu-Daudé break; 650a2b0a27dSPhilippe Mathieu-Daudé case DF_HALF: 651a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_binsl_h(cpu_env, twd, tws, twt); 652a2b0a27dSPhilippe Mathieu-Daudé break; 653a2b0a27dSPhilippe Mathieu-Daudé case DF_WORD: 654a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_binsl_w(cpu_env, twd, tws, twt); 655a2b0a27dSPhilippe Mathieu-Daudé break; 656a2b0a27dSPhilippe Mathieu-Daudé case DF_DOUBLE: 657a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_binsl_d(cpu_env, twd, tws, twt); 658a2b0a27dSPhilippe Mathieu-Daudé break; 659a2b0a27dSPhilippe Mathieu-Daudé } 660a2b0a27dSPhilippe Mathieu-Daudé break; 661a2b0a27dSPhilippe Mathieu-Daudé case OPC_BINSR_df: 662a2b0a27dSPhilippe Mathieu-Daudé switch (df) { 663a2b0a27dSPhilippe Mathieu-Daudé case DF_BYTE: 664a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_binsr_b(cpu_env, twd, tws, twt); 665a2b0a27dSPhilippe Mathieu-Daudé break; 666a2b0a27dSPhilippe Mathieu-Daudé case DF_HALF: 667a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_binsr_h(cpu_env, twd, tws, twt); 668a2b0a27dSPhilippe Mathieu-Daudé break; 669a2b0a27dSPhilippe Mathieu-Daudé case DF_WORD: 670a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_binsr_w(cpu_env, twd, tws, twt); 671a2b0a27dSPhilippe Mathieu-Daudé break; 672a2b0a27dSPhilippe Mathieu-Daudé case DF_DOUBLE: 673a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_binsr_d(cpu_env, twd, tws, twt); 674a2b0a27dSPhilippe Mathieu-Daudé break; 675a2b0a27dSPhilippe Mathieu-Daudé } 676a2b0a27dSPhilippe Mathieu-Daudé break; 677a2b0a27dSPhilippe Mathieu-Daudé case OPC_BCLR_df: 678a2b0a27dSPhilippe Mathieu-Daudé switch (df) { 679a2b0a27dSPhilippe Mathieu-Daudé case DF_BYTE: 680a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_bclr_b(cpu_env, twd, tws, twt); 681a2b0a27dSPhilippe Mathieu-Daudé break; 682a2b0a27dSPhilippe Mathieu-Daudé case DF_HALF: 683a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_bclr_h(cpu_env, twd, tws, twt); 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722a2b0a27dSPhilippe Mathieu-Daudé break; 723a2b0a27dSPhilippe Mathieu-Daudé } 724a2b0a27dSPhilippe Mathieu-Daudé break; 725a2b0a27dSPhilippe Mathieu-Daudé case OPC_ADD_A_df: 726a2b0a27dSPhilippe Mathieu-Daudé switch (df) { 727a2b0a27dSPhilippe Mathieu-Daudé case DF_BYTE: 728a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_add_a_b(cpu_env, twd, tws, twt); 729a2b0a27dSPhilippe Mathieu-Daudé break; 730a2b0a27dSPhilippe Mathieu-Daudé case DF_HALF: 731a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_add_a_h(cpu_env, twd, tws, twt); 732a2b0a27dSPhilippe Mathieu-Daudé break; 733a2b0a27dSPhilippe Mathieu-Daudé case DF_WORD: 734a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_add_a_w(cpu_env, twd, tws, twt); 735a2b0a27dSPhilippe Mathieu-Daudé break; 736a2b0a27dSPhilippe Mathieu-Daudé case DF_DOUBLE: 737a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_add_a_d(cpu_env, twd, tws, twt); 738a2b0a27dSPhilippe Mathieu-Daudé break; 739a2b0a27dSPhilippe Mathieu-Daudé } 740a2b0a27dSPhilippe Mathieu-Daudé break; 741a2b0a27dSPhilippe Mathieu-Daudé case OPC_ADDS_A_df: 742a2b0a27dSPhilippe Mathieu-Daudé switch (df) { 743a2b0a27dSPhilippe Mathieu-Daudé case DF_BYTE: 744a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_adds_a_b(cpu_env, twd, tws, twt); 745a2b0a27dSPhilippe Mathieu-Daudé break; 746a2b0a27dSPhilippe Mathieu-Daudé case DF_HALF: 747a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_adds_a_h(cpu_env, twd, tws, twt); 748a2b0a27dSPhilippe Mathieu-Daudé break; 749a2b0a27dSPhilippe Mathieu-Daudé case DF_WORD: 750a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_adds_a_w(cpu_env, twd, tws, twt); 751a2b0a27dSPhilippe Mathieu-Daudé break; 752a2b0a27dSPhilippe Mathieu-Daudé case DF_DOUBLE: 753a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_adds_a_d(cpu_env, twd, tws, twt); 754a2b0a27dSPhilippe Mathieu-Daudé break; 755a2b0a27dSPhilippe Mathieu-Daudé } 756a2b0a27dSPhilippe Mathieu-Daudé break; 757a2b0a27dSPhilippe Mathieu-Daudé case OPC_ADDS_S_df: 758a2b0a27dSPhilippe Mathieu-Daudé switch (df) { 759a2b0a27dSPhilippe Mathieu-Daudé case DF_BYTE: 760a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_adds_s_b(cpu_env, twd, tws, twt); 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1552a2b0a27dSPhilippe Mathieu-Daudé break; 1553a2b0a27dSPhilippe Mathieu-Daudé case DF_WORD: 1554a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_dpadd_s_w(cpu_env, twd, tws, twt); 1555a2b0a27dSPhilippe Mathieu-Daudé break; 1556a2b0a27dSPhilippe Mathieu-Daudé case DF_DOUBLE: 1557a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_dpadd_s_d(cpu_env, twd, tws, twt); 1558a2b0a27dSPhilippe Mathieu-Daudé break; 1559a2b0a27dSPhilippe Mathieu-Daudé } 1560a2b0a27dSPhilippe Mathieu-Daudé break; 1561a2b0a27dSPhilippe Mathieu-Daudé case OPC_DPADD_U_df: 1562a2b0a27dSPhilippe Mathieu-Daudé switch (df) { 1563a2b0a27dSPhilippe Mathieu-Daudé case DF_HALF: 1564a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_dpadd_u_h(cpu_env, twd, tws, twt); 1565a2b0a27dSPhilippe Mathieu-Daudé break; 1566a2b0a27dSPhilippe Mathieu-Daudé case DF_WORD: 1567a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_dpadd_u_w(cpu_env, twd, tws, twt); 1568a2b0a27dSPhilippe Mathieu-Daudé break; 1569a2b0a27dSPhilippe Mathieu-Daudé case DF_DOUBLE: 1570a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_dpadd_u_d(cpu_env, twd, tws, twt); 1571a2b0a27dSPhilippe Mathieu-Daudé break; 1572a2b0a27dSPhilippe Mathieu-Daudé } 1573a2b0a27dSPhilippe Mathieu-Daudé break; 1574a2b0a27dSPhilippe Mathieu-Daudé case OPC_DPSUB_S_df: 1575a2b0a27dSPhilippe Mathieu-Daudé switch (df) { 1576a2b0a27dSPhilippe Mathieu-Daudé case DF_HALF: 1577a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_dpsub_s_h(cpu_env, twd, tws, twt); 1578a2b0a27dSPhilippe Mathieu-Daudé break; 1579a2b0a27dSPhilippe Mathieu-Daudé case DF_WORD: 1580a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_dpsub_s_w(cpu_env, twd, tws, twt); 1581a2b0a27dSPhilippe Mathieu-Daudé break; 1582a2b0a27dSPhilippe Mathieu-Daudé case DF_DOUBLE: 1583a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_dpsub_s_d(cpu_env, twd, tws, twt); 1584a2b0a27dSPhilippe Mathieu-Daudé break; 1585a2b0a27dSPhilippe Mathieu-Daudé } 1586a2b0a27dSPhilippe Mathieu-Daudé break; 1587a2b0a27dSPhilippe Mathieu-Daudé case OPC_DPSUB_U_df: 1588a2b0a27dSPhilippe Mathieu-Daudé switch (df) { 1589a2b0a27dSPhilippe Mathieu-Daudé case DF_HALF: 1590a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_dpsub_u_h(cpu_env, twd, tws, twt); 1591a2b0a27dSPhilippe Mathieu-Daudé break; 1592a2b0a27dSPhilippe Mathieu-Daudé case DF_WORD: 1593a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_dpsub_u_w(cpu_env, twd, tws, twt); 1594a2b0a27dSPhilippe Mathieu-Daudé break; 1595a2b0a27dSPhilippe Mathieu-Daudé case DF_DOUBLE: 1596a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_dpsub_u_d(cpu_env, twd, tws, twt); 1597a2b0a27dSPhilippe Mathieu-Daudé break; 1598a2b0a27dSPhilippe Mathieu-Daudé } 1599a2b0a27dSPhilippe Mathieu-Daudé break; 1600a2b0a27dSPhilippe Mathieu-Daudé } 1601a2b0a27dSPhilippe Mathieu-Daudé break; 1602a2b0a27dSPhilippe Mathieu-Daudé default: 1603a2b0a27dSPhilippe Mathieu-Daudé MIPS_INVAL("MSA instruction"); 1604a2b0a27dSPhilippe Mathieu-Daudé gen_reserved_instruction(ctx); 1605a2b0a27dSPhilippe Mathieu-Daudé break; 1606a2b0a27dSPhilippe Mathieu-Daudé } 1607a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i32(twd); 1608a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i32(tws); 1609a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i32(twt); 1610a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i32(tdf); 1611a2b0a27dSPhilippe Mathieu-Daudé } 1612a2b0a27dSPhilippe Mathieu-Daudé 1613a2b0a27dSPhilippe Mathieu-Daudé static void gen_msa_elm_3e(DisasContext *ctx) 1614a2b0a27dSPhilippe Mathieu-Daudé { 1615a2b0a27dSPhilippe Mathieu-Daudé #define MASK_MSA_ELM_DF3E(op) (MASK_MSA_MINOR(op) | (op & (0x3FF << 16))) 1616a2b0a27dSPhilippe Mathieu-Daudé uint8_t source = (ctx->opcode >> 11) & 0x1f; 1617a2b0a27dSPhilippe Mathieu-Daudé uint8_t dest = (ctx->opcode >> 6) & 0x1f; 1618a2b0a27dSPhilippe Mathieu-Daudé TCGv telm = tcg_temp_new(); 1619a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 tsr = tcg_const_i32(source); 1620a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 tdt = tcg_const_i32(dest); 1621a2b0a27dSPhilippe Mathieu-Daudé 1622a2b0a27dSPhilippe Mathieu-Daudé switch (MASK_MSA_ELM_DF3E(ctx->opcode)) { 1623a2b0a27dSPhilippe Mathieu-Daudé case OPC_CTCMSA: 1624a2b0a27dSPhilippe Mathieu-Daudé gen_load_gpr(telm, source); 1625a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_ctcmsa(cpu_env, telm, tdt); 1626a2b0a27dSPhilippe Mathieu-Daudé break; 1627a2b0a27dSPhilippe Mathieu-Daudé case OPC_CFCMSA: 1628a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_cfcmsa(telm, cpu_env, tsr); 1629a2b0a27dSPhilippe Mathieu-Daudé gen_store_gpr(telm, dest); 1630a2b0a27dSPhilippe Mathieu-Daudé break; 1631a2b0a27dSPhilippe Mathieu-Daudé case OPC_MOVE_V: 1632a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_move_v(cpu_env, tdt, tsr); 1633a2b0a27dSPhilippe Mathieu-Daudé break; 1634a2b0a27dSPhilippe Mathieu-Daudé default: 1635a2b0a27dSPhilippe Mathieu-Daudé MIPS_INVAL("MSA instruction"); 1636a2b0a27dSPhilippe Mathieu-Daudé gen_reserved_instruction(ctx); 1637a2b0a27dSPhilippe Mathieu-Daudé break; 1638a2b0a27dSPhilippe Mathieu-Daudé } 1639a2b0a27dSPhilippe Mathieu-Daudé 1640a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free(telm); 1641a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i32(tdt); 1642a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i32(tsr); 1643a2b0a27dSPhilippe Mathieu-Daudé } 1644a2b0a27dSPhilippe Mathieu-Daudé 1645a2b0a27dSPhilippe Mathieu-Daudé static void gen_msa_elm_df(DisasContext *ctx, uint32_t df, uint32_t n) 1646a2b0a27dSPhilippe Mathieu-Daudé { 1647a2b0a27dSPhilippe Mathieu-Daudé #define MASK_MSA_ELM(op) (MASK_MSA_MINOR(op) | (op & (0xf << 22))) 1648a2b0a27dSPhilippe Mathieu-Daudé uint8_t ws = (ctx->opcode >> 11) & 0x1f; 1649a2b0a27dSPhilippe Mathieu-Daudé uint8_t wd = (ctx->opcode >> 6) & 0x1f; 1650a2b0a27dSPhilippe Mathieu-Daudé 1651a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 tws = tcg_const_i32(ws); 1652a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 twd = tcg_const_i32(wd); 1653a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 tn = tcg_const_i32(n); 1654a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 tdf = tcg_const_i32(df); 1655a2b0a27dSPhilippe Mathieu-Daudé 1656a2b0a27dSPhilippe Mathieu-Daudé switch (MASK_MSA_ELM(ctx->opcode)) { 1657a2b0a27dSPhilippe Mathieu-Daudé case OPC_SLDI_df: 1658a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_sldi_df(cpu_env, tdf, twd, tws, tn); 1659a2b0a27dSPhilippe Mathieu-Daudé break; 1660a2b0a27dSPhilippe Mathieu-Daudé case OPC_SPLATI_df: 1661a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_splati_df(cpu_env, tdf, twd, tws, tn); 1662a2b0a27dSPhilippe Mathieu-Daudé break; 1663a2b0a27dSPhilippe Mathieu-Daudé case OPC_INSVE_df: 1664a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_insve_df(cpu_env, tdf, twd, tws, tn); 1665a2b0a27dSPhilippe Mathieu-Daudé break; 1666a2b0a27dSPhilippe Mathieu-Daudé case OPC_COPY_S_df: 1667a2b0a27dSPhilippe Mathieu-Daudé case OPC_COPY_U_df: 1668a2b0a27dSPhilippe Mathieu-Daudé case OPC_INSERT_df: 1669a2b0a27dSPhilippe Mathieu-Daudé #if !defined(TARGET_MIPS64) 1670a2b0a27dSPhilippe Mathieu-Daudé /* Double format valid only for MIPS64 */ 1671a2b0a27dSPhilippe Mathieu-Daudé if (df == DF_DOUBLE) { 1672a2b0a27dSPhilippe Mathieu-Daudé gen_reserved_instruction(ctx); 1673a2b0a27dSPhilippe Mathieu-Daudé break; 1674a2b0a27dSPhilippe Mathieu-Daudé } 1675a2b0a27dSPhilippe Mathieu-Daudé if ((MASK_MSA_ELM(ctx->opcode) == OPC_COPY_U_df) && 1676a2b0a27dSPhilippe Mathieu-Daudé (df == DF_WORD)) { 1677a2b0a27dSPhilippe Mathieu-Daudé gen_reserved_instruction(ctx); 1678a2b0a27dSPhilippe Mathieu-Daudé break; 1679a2b0a27dSPhilippe Mathieu-Daudé } 1680a2b0a27dSPhilippe Mathieu-Daudé #endif 1681a2b0a27dSPhilippe Mathieu-Daudé switch (MASK_MSA_ELM(ctx->opcode)) { 1682a2b0a27dSPhilippe Mathieu-Daudé case OPC_COPY_S_df: 1683a2b0a27dSPhilippe Mathieu-Daudé if (likely(wd != 0)) { 1684a2b0a27dSPhilippe Mathieu-Daudé switch (df) { 1685a2b0a27dSPhilippe Mathieu-Daudé case DF_BYTE: 1686a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_copy_s_b(cpu_env, twd, tws, tn); 1687a2b0a27dSPhilippe Mathieu-Daudé break; 1688a2b0a27dSPhilippe Mathieu-Daudé case DF_HALF: 1689a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_copy_s_h(cpu_env, twd, tws, tn); 1690a2b0a27dSPhilippe Mathieu-Daudé break; 1691a2b0a27dSPhilippe Mathieu-Daudé case DF_WORD: 1692a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_copy_s_w(cpu_env, twd, tws, tn); 1693a2b0a27dSPhilippe Mathieu-Daudé break; 1694a2b0a27dSPhilippe Mathieu-Daudé #if defined(TARGET_MIPS64) 1695a2b0a27dSPhilippe Mathieu-Daudé case DF_DOUBLE: 1696a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_copy_s_d(cpu_env, twd, tws, tn); 1697a2b0a27dSPhilippe Mathieu-Daudé break; 1698a2b0a27dSPhilippe Mathieu-Daudé #endif 1699a2b0a27dSPhilippe Mathieu-Daudé default: 1700a2b0a27dSPhilippe Mathieu-Daudé assert(0); 1701a2b0a27dSPhilippe Mathieu-Daudé } 1702a2b0a27dSPhilippe Mathieu-Daudé } 1703a2b0a27dSPhilippe Mathieu-Daudé break; 1704a2b0a27dSPhilippe Mathieu-Daudé case OPC_COPY_U_df: 1705a2b0a27dSPhilippe Mathieu-Daudé if (likely(wd != 0)) { 1706a2b0a27dSPhilippe Mathieu-Daudé switch (df) { 1707a2b0a27dSPhilippe Mathieu-Daudé case DF_BYTE: 1708a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_copy_u_b(cpu_env, twd, tws, tn); 1709a2b0a27dSPhilippe Mathieu-Daudé break; 1710a2b0a27dSPhilippe Mathieu-Daudé case DF_HALF: 1711a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_copy_u_h(cpu_env, twd, tws, tn); 1712a2b0a27dSPhilippe Mathieu-Daudé break; 1713a2b0a27dSPhilippe Mathieu-Daudé #if defined(TARGET_MIPS64) 1714a2b0a27dSPhilippe Mathieu-Daudé case DF_WORD: 1715a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_copy_u_w(cpu_env, twd, tws, tn); 1716a2b0a27dSPhilippe Mathieu-Daudé break; 1717a2b0a27dSPhilippe Mathieu-Daudé #endif 1718a2b0a27dSPhilippe Mathieu-Daudé default: 1719a2b0a27dSPhilippe Mathieu-Daudé assert(0); 1720a2b0a27dSPhilippe Mathieu-Daudé } 1721a2b0a27dSPhilippe Mathieu-Daudé } 1722a2b0a27dSPhilippe Mathieu-Daudé break; 1723a2b0a27dSPhilippe Mathieu-Daudé case OPC_INSERT_df: 1724a2b0a27dSPhilippe Mathieu-Daudé switch (df) { 1725a2b0a27dSPhilippe Mathieu-Daudé case DF_BYTE: 1726a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_insert_b(cpu_env, twd, tws, tn); 1727a2b0a27dSPhilippe Mathieu-Daudé break; 1728a2b0a27dSPhilippe Mathieu-Daudé case DF_HALF: 1729a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_insert_h(cpu_env, twd, tws, tn); 1730a2b0a27dSPhilippe Mathieu-Daudé break; 1731a2b0a27dSPhilippe Mathieu-Daudé case DF_WORD: 1732a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_insert_w(cpu_env, twd, tws, tn); 1733a2b0a27dSPhilippe Mathieu-Daudé break; 1734a2b0a27dSPhilippe Mathieu-Daudé #if defined(TARGET_MIPS64) 1735a2b0a27dSPhilippe Mathieu-Daudé case DF_DOUBLE: 1736a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_insert_d(cpu_env, twd, tws, tn); 1737a2b0a27dSPhilippe Mathieu-Daudé break; 1738a2b0a27dSPhilippe Mathieu-Daudé #endif 1739a2b0a27dSPhilippe Mathieu-Daudé default: 1740a2b0a27dSPhilippe Mathieu-Daudé assert(0); 1741a2b0a27dSPhilippe Mathieu-Daudé } 1742a2b0a27dSPhilippe Mathieu-Daudé break; 1743a2b0a27dSPhilippe Mathieu-Daudé } 1744a2b0a27dSPhilippe Mathieu-Daudé break; 1745a2b0a27dSPhilippe Mathieu-Daudé default: 1746a2b0a27dSPhilippe Mathieu-Daudé MIPS_INVAL("MSA instruction"); 1747a2b0a27dSPhilippe Mathieu-Daudé gen_reserved_instruction(ctx); 1748a2b0a27dSPhilippe Mathieu-Daudé } 1749a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i32(twd); 1750a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i32(tws); 1751a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i32(tn); 1752a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i32(tdf); 1753a2b0a27dSPhilippe Mathieu-Daudé } 1754a2b0a27dSPhilippe Mathieu-Daudé 1755a2b0a27dSPhilippe Mathieu-Daudé static void gen_msa_elm(DisasContext *ctx) 1756a2b0a27dSPhilippe Mathieu-Daudé { 1757a2b0a27dSPhilippe Mathieu-Daudé uint8_t dfn = (ctx->opcode >> 16) & 0x3f; 1758a2b0a27dSPhilippe Mathieu-Daudé uint32_t df = 0, n = 0; 1759a2b0a27dSPhilippe Mathieu-Daudé 1760a2b0a27dSPhilippe Mathieu-Daudé if ((dfn & 0x30) == 0x00) { 1761a2b0a27dSPhilippe Mathieu-Daudé n = dfn & 0x0f; 1762a2b0a27dSPhilippe Mathieu-Daudé df = DF_BYTE; 1763a2b0a27dSPhilippe Mathieu-Daudé } else if ((dfn & 0x38) == 0x20) { 1764a2b0a27dSPhilippe Mathieu-Daudé n = dfn & 0x07; 1765a2b0a27dSPhilippe Mathieu-Daudé df = DF_HALF; 1766a2b0a27dSPhilippe Mathieu-Daudé } else if ((dfn & 0x3c) == 0x30) { 1767a2b0a27dSPhilippe Mathieu-Daudé n = dfn & 0x03; 1768a2b0a27dSPhilippe Mathieu-Daudé df = DF_WORD; 1769a2b0a27dSPhilippe Mathieu-Daudé } else if ((dfn & 0x3e) == 0x38) { 1770a2b0a27dSPhilippe Mathieu-Daudé n = dfn & 0x01; 1771a2b0a27dSPhilippe Mathieu-Daudé df = DF_DOUBLE; 1772a2b0a27dSPhilippe Mathieu-Daudé } else if (dfn == 0x3E) { 1773a2b0a27dSPhilippe Mathieu-Daudé /* CTCMSA, CFCMSA, MOVE.V */ 1774a2b0a27dSPhilippe Mathieu-Daudé gen_msa_elm_3e(ctx); 1775a2b0a27dSPhilippe Mathieu-Daudé return; 1776a2b0a27dSPhilippe Mathieu-Daudé } else { 1777a2b0a27dSPhilippe Mathieu-Daudé gen_reserved_instruction(ctx); 1778a2b0a27dSPhilippe Mathieu-Daudé return; 1779a2b0a27dSPhilippe Mathieu-Daudé } 1780a2b0a27dSPhilippe Mathieu-Daudé 1781a2b0a27dSPhilippe Mathieu-Daudé gen_msa_elm_df(ctx, df, n); 1782a2b0a27dSPhilippe Mathieu-Daudé } 1783a2b0a27dSPhilippe Mathieu-Daudé 1784a2b0a27dSPhilippe Mathieu-Daudé static void gen_msa_3rf(DisasContext *ctx) 1785a2b0a27dSPhilippe Mathieu-Daudé { 1786a2b0a27dSPhilippe Mathieu-Daudé #define MASK_MSA_3RF(op) (MASK_MSA_MINOR(op) | (op & (0xf << 22))) 1787a2b0a27dSPhilippe Mathieu-Daudé uint8_t df = (ctx->opcode >> 21) & 0x1; 1788a2b0a27dSPhilippe Mathieu-Daudé uint8_t wt = (ctx->opcode >> 16) & 0x1f; 1789a2b0a27dSPhilippe Mathieu-Daudé uint8_t ws = (ctx->opcode >> 11) & 0x1f; 1790a2b0a27dSPhilippe Mathieu-Daudé uint8_t wd = (ctx->opcode >> 6) & 0x1f; 1791a2b0a27dSPhilippe Mathieu-Daudé 1792a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 twd = tcg_const_i32(wd); 1793a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 tws = tcg_const_i32(ws); 1794a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 twt = tcg_const_i32(wt); 1795a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 tdf = tcg_temp_new_i32(); 1796a2b0a27dSPhilippe Mathieu-Daudé 1797a2b0a27dSPhilippe Mathieu-Daudé /* adjust df value for floating-point instruction */ 1798a2b0a27dSPhilippe Mathieu-Daudé tcg_gen_movi_i32(tdf, df + 2); 1799a2b0a27dSPhilippe Mathieu-Daudé 1800a2b0a27dSPhilippe Mathieu-Daudé switch (MASK_MSA_3RF(ctx->opcode)) { 1801a2b0a27dSPhilippe Mathieu-Daudé case OPC_FCAF_df: 1802a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fcaf_df(cpu_env, tdf, twd, tws, twt); 1803a2b0a27dSPhilippe Mathieu-Daudé break; 1804a2b0a27dSPhilippe Mathieu-Daudé case OPC_FADD_df: 1805a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fadd_df(cpu_env, tdf, twd, tws, twt); 1806a2b0a27dSPhilippe Mathieu-Daudé break; 1807a2b0a27dSPhilippe Mathieu-Daudé case OPC_FCUN_df: 1808a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fcun_df(cpu_env, tdf, twd, tws, twt); 1809a2b0a27dSPhilippe Mathieu-Daudé break; 1810a2b0a27dSPhilippe Mathieu-Daudé case OPC_FSUB_df: 1811a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fsub_df(cpu_env, tdf, twd, tws, twt); 1812a2b0a27dSPhilippe Mathieu-Daudé break; 1813a2b0a27dSPhilippe Mathieu-Daudé case OPC_FCOR_df: 1814a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fcor_df(cpu_env, tdf, twd, tws, twt); 1815a2b0a27dSPhilippe Mathieu-Daudé break; 1816a2b0a27dSPhilippe Mathieu-Daudé case OPC_FCEQ_df: 1817a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fceq_df(cpu_env, tdf, twd, tws, twt); 1818a2b0a27dSPhilippe Mathieu-Daudé break; 1819a2b0a27dSPhilippe Mathieu-Daudé case OPC_FMUL_df: 1820a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fmul_df(cpu_env, tdf, twd, tws, twt); 1821a2b0a27dSPhilippe Mathieu-Daudé break; 1822a2b0a27dSPhilippe Mathieu-Daudé case OPC_FCUNE_df: 1823a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fcune_df(cpu_env, tdf, twd, tws, twt); 1824a2b0a27dSPhilippe Mathieu-Daudé break; 1825a2b0a27dSPhilippe Mathieu-Daudé case OPC_FCUEQ_df: 1826a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fcueq_df(cpu_env, tdf, twd, tws, twt); 1827a2b0a27dSPhilippe Mathieu-Daudé break; 1828a2b0a27dSPhilippe Mathieu-Daudé case OPC_FDIV_df: 1829a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fdiv_df(cpu_env, tdf, twd, tws, twt); 1830a2b0a27dSPhilippe Mathieu-Daudé break; 1831a2b0a27dSPhilippe Mathieu-Daudé case OPC_FCNE_df: 1832a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fcne_df(cpu_env, tdf, twd, tws, twt); 1833a2b0a27dSPhilippe Mathieu-Daudé break; 1834a2b0a27dSPhilippe Mathieu-Daudé case OPC_FCLT_df: 1835a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fclt_df(cpu_env, tdf, twd, tws, twt); 1836a2b0a27dSPhilippe Mathieu-Daudé break; 1837a2b0a27dSPhilippe Mathieu-Daudé case OPC_FMADD_df: 1838a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fmadd_df(cpu_env, tdf, twd, tws, twt); 1839a2b0a27dSPhilippe Mathieu-Daudé break; 1840a2b0a27dSPhilippe Mathieu-Daudé case OPC_MUL_Q_df: 1841a2b0a27dSPhilippe Mathieu-Daudé tcg_gen_movi_i32(tdf, df + 1); 1842a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_mul_q_df(cpu_env, tdf, twd, tws, twt); 1843a2b0a27dSPhilippe Mathieu-Daudé break; 1844a2b0a27dSPhilippe Mathieu-Daudé case OPC_FCULT_df: 1845a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fcult_df(cpu_env, tdf, twd, tws, twt); 1846a2b0a27dSPhilippe Mathieu-Daudé break; 1847a2b0a27dSPhilippe Mathieu-Daudé case OPC_FMSUB_df: 1848a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fmsub_df(cpu_env, tdf, twd, tws, twt); 1849a2b0a27dSPhilippe Mathieu-Daudé break; 1850a2b0a27dSPhilippe Mathieu-Daudé case OPC_MADD_Q_df: 1851a2b0a27dSPhilippe Mathieu-Daudé tcg_gen_movi_i32(tdf, df + 1); 1852a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_madd_q_df(cpu_env, tdf, twd, tws, twt); 1853a2b0a27dSPhilippe Mathieu-Daudé break; 1854a2b0a27dSPhilippe Mathieu-Daudé case OPC_FCLE_df: 1855a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fcle_df(cpu_env, tdf, twd, tws, twt); 1856a2b0a27dSPhilippe Mathieu-Daudé break; 1857a2b0a27dSPhilippe Mathieu-Daudé case OPC_MSUB_Q_df: 1858a2b0a27dSPhilippe Mathieu-Daudé tcg_gen_movi_i32(tdf, df + 1); 1859a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_msub_q_df(cpu_env, tdf, twd, tws, twt); 1860a2b0a27dSPhilippe Mathieu-Daudé break; 1861a2b0a27dSPhilippe Mathieu-Daudé case OPC_FCULE_df: 1862a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fcule_df(cpu_env, tdf, twd, tws, twt); 1863a2b0a27dSPhilippe Mathieu-Daudé break; 1864a2b0a27dSPhilippe Mathieu-Daudé case OPC_FEXP2_df: 1865a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fexp2_df(cpu_env, tdf, twd, tws, twt); 1866a2b0a27dSPhilippe Mathieu-Daudé break; 1867a2b0a27dSPhilippe Mathieu-Daudé case OPC_FSAF_df: 1868a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fsaf_df(cpu_env, tdf, twd, tws, twt); 1869a2b0a27dSPhilippe Mathieu-Daudé break; 1870a2b0a27dSPhilippe Mathieu-Daudé case OPC_FEXDO_df: 1871a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fexdo_df(cpu_env, tdf, twd, tws, twt); 1872a2b0a27dSPhilippe Mathieu-Daudé break; 1873a2b0a27dSPhilippe Mathieu-Daudé case OPC_FSUN_df: 1874a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fsun_df(cpu_env, tdf, twd, tws, twt); 1875a2b0a27dSPhilippe Mathieu-Daudé break; 1876a2b0a27dSPhilippe Mathieu-Daudé case OPC_FSOR_df: 1877a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fsor_df(cpu_env, tdf, twd, tws, twt); 1878a2b0a27dSPhilippe Mathieu-Daudé break; 1879a2b0a27dSPhilippe Mathieu-Daudé case OPC_FSEQ_df: 1880a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fseq_df(cpu_env, tdf, twd, tws, twt); 1881a2b0a27dSPhilippe Mathieu-Daudé break; 1882a2b0a27dSPhilippe Mathieu-Daudé case OPC_FTQ_df: 1883a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_ftq_df(cpu_env, tdf, twd, tws, twt); 1884a2b0a27dSPhilippe Mathieu-Daudé break; 1885a2b0a27dSPhilippe Mathieu-Daudé case OPC_FSUNE_df: 1886a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fsune_df(cpu_env, tdf, twd, tws, twt); 1887a2b0a27dSPhilippe Mathieu-Daudé break; 1888a2b0a27dSPhilippe Mathieu-Daudé case OPC_FSUEQ_df: 1889a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fsueq_df(cpu_env, tdf, twd, tws, twt); 1890a2b0a27dSPhilippe Mathieu-Daudé break; 1891a2b0a27dSPhilippe Mathieu-Daudé case OPC_FSNE_df: 1892a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fsne_df(cpu_env, tdf, twd, tws, twt); 1893a2b0a27dSPhilippe Mathieu-Daudé break; 1894a2b0a27dSPhilippe Mathieu-Daudé case OPC_FSLT_df: 1895a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fslt_df(cpu_env, tdf, twd, tws, twt); 1896a2b0a27dSPhilippe Mathieu-Daudé break; 1897a2b0a27dSPhilippe Mathieu-Daudé case OPC_FMIN_df: 1898a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fmin_df(cpu_env, tdf, twd, tws, twt); 1899a2b0a27dSPhilippe Mathieu-Daudé break; 1900a2b0a27dSPhilippe Mathieu-Daudé case OPC_MULR_Q_df: 1901a2b0a27dSPhilippe Mathieu-Daudé tcg_gen_movi_i32(tdf, df + 1); 1902a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_mulr_q_df(cpu_env, tdf, twd, tws, twt); 1903a2b0a27dSPhilippe Mathieu-Daudé break; 1904a2b0a27dSPhilippe Mathieu-Daudé case OPC_FSULT_df: 1905a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fsult_df(cpu_env, tdf, twd, tws, twt); 1906a2b0a27dSPhilippe Mathieu-Daudé break; 1907a2b0a27dSPhilippe Mathieu-Daudé case OPC_FMIN_A_df: 1908a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fmin_a_df(cpu_env, tdf, twd, tws, twt); 1909a2b0a27dSPhilippe Mathieu-Daudé break; 1910a2b0a27dSPhilippe Mathieu-Daudé case OPC_MADDR_Q_df: 1911a2b0a27dSPhilippe Mathieu-Daudé tcg_gen_movi_i32(tdf, df + 1); 1912a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_maddr_q_df(cpu_env, tdf, twd, tws, twt); 1913a2b0a27dSPhilippe Mathieu-Daudé break; 1914a2b0a27dSPhilippe Mathieu-Daudé case OPC_FSLE_df: 1915a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fsle_df(cpu_env, tdf, twd, tws, twt); 1916a2b0a27dSPhilippe Mathieu-Daudé break; 1917a2b0a27dSPhilippe Mathieu-Daudé case OPC_FMAX_df: 1918a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fmax_df(cpu_env, tdf, twd, tws, twt); 1919a2b0a27dSPhilippe Mathieu-Daudé break; 1920a2b0a27dSPhilippe Mathieu-Daudé case OPC_MSUBR_Q_df: 1921a2b0a27dSPhilippe Mathieu-Daudé tcg_gen_movi_i32(tdf, df + 1); 1922a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_msubr_q_df(cpu_env, tdf, twd, tws, twt); 1923a2b0a27dSPhilippe Mathieu-Daudé break; 1924a2b0a27dSPhilippe Mathieu-Daudé case OPC_FSULE_df: 1925a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fsule_df(cpu_env, tdf, twd, tws, twt); 1926a2b0a27dSPhilippe Mathieu-Daudé break; 1927a2b0a27dSPhilippe Mathieu-Daudé case OPC_FMAX_A_df: 1928a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fmax_a_df(cpu_env, tdf, twd, tws, twt); 1929a2b0a27dSPhilippe Mathieu-Daudé break; 1930a2b0a27dSPhilippe Mathieu-Daudé default: 1931a2b0a27dSPhilippe Mathieu-Daudé MIPS_INVAL("MSA instruction"); 1932a2b0a27dSPhilippe Mathieu-Daudé gen_reserved_instruction(ctx); 1933a2b0a27dSPhilippe Mathieu-Daudé break; 1934a2b0a27dSPhilippe Mathieu-Daudé } 1935a2b0a27dSPhilippe Mathieu-Daudé 1936a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i32(twd); 1937a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i32(tws); 1938a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i32(twt); 1939a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i32(tdf); 1940a2b0a27dSPhilippe Mathieu-Daudé } 1941a2b0a27dSPhilippe Mathieu-Daudé 1942a2b0a27dSPhilippe Mathieu-Daudé static void gen_msa_2r(DisasContext *ctx) 1943a2b0a27dSPhilippe Mathieu-Daudé { 1944a2b0a27dSPhilippe Mathieu-Daudé #define MASK_MSA_2R(op) (MASK_MSA_MINOR(op) | (op & (0x1f << 21)) | \ 1945a2b0a27dSPhilippe Mathieu-Daudé (op & (0x7 << 18))) 1946a2b0a27dSPhilippe Mathieu-Daudé uint8_t wt = (ctx->opcode >> 16) & 0x1f; 1947a2b0a27dSPhilippe Mathieu-Daudé uint8_t ws = (ctx->opcode >> 11) & 0x1f; 1948a2b0a27dSPhilippe Mathieu-Daudé uint8_t wd = (ctx->opcode >> 6) & 0x1f; 1949a2b0a27dSPhilippe Mathieu-Daudé uint8_t df = (ctx->opcode >> 16) & 0x3; 1950a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 twd = tcg_const_i32(wd); 1951a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 tws = tcg_const_i32(ws); 1952a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 twt = tcg_const_i32(wt); 1953a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 tdf = tcg_const_i32(df); 1954a2b0a27dSPhilippe Mathieu-Daudé 1955a2b0a27dSPhilippe Mathieu-Daudé switch (MASK_MSA_2R(ctx->opcode)) { 1956a2b0a27dSPhilippe Mathieu-Daudé case OPC_FILL_df: 1957a2b0a27dSPhilippe Mathieu-Daudé #if !defined(TARGET_MIPS64) 1958a2b0a27dSPhilippe Mathieu-Daudé /* Double format valid only for MIPS64 */ 1959a2b0a27dSPhilippe Mathieu-Daudé if (df == DF_DOUBLE) { 1960a2b0a27dSPhilippe Mathieu-Daudé gen_reserved_instruction(ctx); 1961a2b0a27dSPhilippe Mathieu-Daudé break; 1962a2b0a27dSPhilippe Mathieu-Daudé } 1963a2b0a27dSPhilippe Mathieu-Daudé #endif 1964a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fill_df(cpu_env, tdf, twd, tws); /* trs */ 1965a2b0a27dSPhilippe Mathieu-Daudé break; 1966a2b0a27dSPhilippe Mathieu-Daudé case OPC_NLOC_df: 1967a2b0a27dSPhilippe Mathieu-Daudé switch (df) { 1968a2b0a27dSPhilippe Mathieu-Daudé case DF_BYTE: 1969a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_nloc_b(cpu_env, twd, tws); 1970a2b0a27dSPhilippe Mathieu-Daudé break; 1971a2b0a27dSPhilippe Mathieu-Daudé case DF_HALF: 1972a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_nloc_h(cpu_env, twd, tws); 1973a2b0a27dSPhilippe Mathieu-Daudé break; 1974a2b0a27dSPhilippe Mathieu-Daudé case DF_WORD: 1975a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_nloc_w(cpu_env, twd, tws); 1976a2b0a27dSPhilippe Mathieu-Daudé break; 1977a2b0a27dSPhilippe Mathieu-Daudé case DF_DOUBLE: 1978a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_nloc_d(cpu_env, twd, tws); 1979a2b0a27dSPhilippe Mathieu-Daudé break; 1980a2b0a27dSPhilippe Mathieu-Daudé } 1981a2b0a27dSPhilippe Mathieu-Daudé break; 1982a2b0a27dSPhilippe Mathieu-Daudé case OPC_NLZC_df: 1983a2b0a27dSPhilippe Mathieu-Daudé switch (df) { 1984a2b0a27dSPhilippe Mathieu-Daudé case DF_BYTE: 1985a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_nlzc_b(cpu_env, twd, tws); 1986a2b0a27dSPhilippe Mathieu-Daudé break; 1987a2b0a27dSPhilippe Mathieu-Daudé case DF_HALF: 1988a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_nlzc_h(cpu_env, twd, tws); 1989a2b0a27dSPhilippe Mathieu-Daudé break; 1990a2b0a27dSPhilippe Mathieu-Daudé case DF_WORD: 1991a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_nlzc_w(cpu_env, twd, tws); 1992a2b0a27dSPhilippe Mathieu-Daudé break; 1993a2b0a27dSPhilippe Mathieu-Daudé case DF_DOUBLE: 1994a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_nlzc_d(cpu_env, twd, tws); 1995a2b0a27dSPhilippe Mathieu-Daudé break; 1996a2b0a27dSPhilippe Mathieu-Daudé } 1997a2b0a27dSPhilippe Mathieu-Daudé break; 1998a2b0a27dSPhilippe Mathieu-Daudé case OPC_PCNT_df: 1999a2b0a27dSPhilippe Mathieu-Daudé switch (df) { 2000a2b0a27dSPhilippe Mathieu-Daudé case DF_BYTE: 2001a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_pcnt_b(cpu_env, twd, tws); 2002a2b0a27dSPhilippe Mathieu-Daudé break; 2003a2b0a27dSPhilippe Mathieu-Daudé case DF_HALF: 2004a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_pcnt_h(cpu_env, twd, tws); 2005a2b0a27dSPhilippe Mathieu-Daudé break; 2006a2b0a27dSPhilippe Mathieu-Daudé case DF_WORD: 2007a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_pcnt_w(cpu_env, twd, tws); 2008a2b0a27dSPhilippe Mathieu-Daudé break; 2009a2b0a27dSPhilippe Mathieu-Daudé case DF_DOUBLE: 2010a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_pcnt_d(cpu_env, twd, tws); 2011a2b0a27dSPhilippe Mathieu-Daudé break; 2012a2b0a27dSPhilippe Mathieu-Daudé } 2013a2b0a27dSPhilippe Mathieu-Daudé break; 2014a2b0a27dSPhilippe Mathieu-Daudé default: 2015a2b0a27dSPhilippe Mathieu-Daudé MIPS_INVAL("MSA instruction"); 2016a2b0a27dSPhilippe Mathieu-Daudé gen_reserved_instruction(ctx); 2017a2b0a27dSPhilippe Mathieu-Daudé break; 2018a2b0a27dSPhilippe Mathieu-Daudé } 2019a2b0a27dSPhilippe Mathieu-Daudé 2020a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i32(twd); 2021a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i32(tws); 2022a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i32(twt); 2023a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i32(tdf); 2024a2b0a27dSPhilippe Mathieu-Daudé } 2025a2b0a27dSPhilippe Mathieu-Daudé 2026a2b0a27dSPhilippe Mathieu-Daudé static void gen_msa_2rf(DisasContext *ctx) 2027a2b0a27dSPhilippe Mathieu-Daudé { 2028a2b0a27dSPhilippe Mathieu-Daudé #define MASK_MSA_2RF(op) (MASK_MSA_MINOR(op) | (op & (0x1f << 21)) | \ 2029a2b0a27dSPhilippe Mathieu-Daudé (op & (0xf << 17))) 2030a2b0a27dSPhilippe Mathieu-Daudé uint8_t wt = (ctx->opcode >> 16) & 0x1f; 2031a2b0a27dSPhilippe Mathieu-Daudé uint8_t ws = (ctx->opcode >> 11) & 0x1f; 2032a2b0a27dSPhilippe Mathieu-Daudé uint8_t wd = (ctx->opcode >> 6) & 0x1f; 2033a2b0a27dSPhilippe Mathieu-Daudé uint8_t df = (ctx->opcode >> 16) & 0x1; 2034a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 twd = tcg_const_i32(wd); 2035a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 tws = tcg_const_i32(ws); 2036a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 twt = tcg_const_i32(wt); 2037a2b0a27dSPhilippe Mathieu-Daudé /* adjust df value for floating-point instruction */ 2038a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 tdf = tcg_const_i32(df + 2); 2039a2b0a27dSPhilippe Mathieu-Daudé 2040a2b0a27dSPhilippe Mathieu-Daudé switch (MASK_MSA_2RF(ctx->opcode)) { 2041a2b0a27dSPhilippe Mathieu-Daudé case OPC_FCLASS_df: 2042a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fclass_df(cpu_env, tdf, twd, tws); 2043a2b0a27dSPhilippe Mathieu-Daudé break; 2044a2b0a27dSPhilippe Mathieu-Daudé case OPC_FTRUNC_S_df: 2045a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_ftrunc_s_df(cpu_env, tdf, twd, tws); 2046a2b0a27dSPhilippe Mathieu-Daudé break; 2047a2b0a27dSPhilippe Mathieu-Daudé case OPC_FTRUNC_U_df: 2048a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_ftrunc_u_df(cpu_env, tdf, twd, tws); 2049a2b0a27dSPhilippe Mathieu-Daudé break; 2050a2b0a27dSPhilippe Mathieu-Daudé case OPC_FSQRT_df: 2051a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fsqrt_df(cpu_env, tdf, twd, tws); 2052a2b0a27dSPhilippe Mathieu-Daudé break; 2053a2b0a27dSPhilippe Mathieu-Daudé case OPC_FRSQRT_df: 2054a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_frsqrt_df(cpu_env, tdf, twd, tws); 2055a2b0a27dSPhilippe Mathieu-Daudé break; 2056a2b0a27dSPhilippe Mathieu-Daudé case OPC_FRCP_df: 2057a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_frcp_df(cpu_env, tdf, twd, tws); 2058a2b0a27dSPhilippe Mathieu-Daudé break; 2059a2b0a27dSPhilippe Mathieu-Daudé case OPC_FRINT_df: 2060a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_frint_df(cpu_env, tdf, twd, tws); 2061a2b0a27dSPhilippe Mathieu-Daudé break; 2062a2b0a27dSPhilippe Mathieu-Daudé case OPC_FLOG2_df: 2063a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_flog2_df(cpu_env, tdf, twd, tws); 2064a2b0a27dSPhilippe Mathieu-Daudé break; 2065a2b0a27dSPhilippe Mathieu-Daudé case OPC_FEXUPL_df: 2066a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fexupl_df(cpu_env, tdf, twd, tws); 2067a2b0a27dSPhilippe Mathieu-Daudé break; 2068a2b0a27dSPhilippe Mathieu-Daudé case OPC_FEXUPR_df: 2069a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_fexupr_df(cpu_env, tdf, twd, tws); 2070a2b0a27dSPhilippe Mathieu-Daudé break; 2071a2b0a27dSPhilippe Mathieu-Daudé case OPC_FFQL_df: 2072a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_ffql_df(cpu_env, tdf, twd, tws); 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2092a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i32(tws); 2093a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i32(twt); 2094a2b0a27dSPhilippe Mathieu-Daudé tcg_temp_free_i32(tdf); 2095a2b0a27dSPhilippe Mathieu-Daudé } 2096a2b0a27dSPhilippe Mathieu-Daudé 2097a2b0a27dSPhilippe Mathieu-Daudé static void gen_msa_vec_v(DisasContext *ctx) 2098a2b0a27dSPhilippe Mathieu-Daudé { 2099a2b0a27dSPhilippe Mathieu-Daudé #define MASK_MSA_VEC(op) (MASK_MSA_MINOR(op) | (op & (0x1f << 21))) 2100a2b0a27dSPhilippe Mathieu-Daudé uint8_t wt = (ctx->opcode >> 16) & 0x1f; 2101a2b0a27dSPhilippe Mathieu-Daudé uint8_t ws = (ctx->opcode >> 11) & 0x1f; 2102a2b0a27dSPhilippe Mathieu-Daudé uint8_t wd = (ctx->opcode >> 6) & 0x1f; 2103a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 twd = tcg_const_i32(wd); 2104a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 tws = tcg_const_i32(ws); 2105a2b0a27dSPhilippe Mathieu-Daudé TCGv_i32 twt = tcg_const_i32(wt); 2106a2b0a27dSPhilippe Mathieu-Daudé 2107a2b0a27dSPhilippe Mathieu-Daudé switch (MASK_MSA_VEC(ctx->opcode)) { 2108a2b0a27dSPhilippe Mathieu-Daudé case OPC_AND_V: 2109a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_and_v(cpu_env, twd, tws, twt); 2110a2b0a27dSPhilippe Mathieu-Daudé break; 2111a2b0a27dSPhilippe Mathieu-Daudé case OPC_OR_V: 2112a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_or_v(cpu_env, twd, tws, twt); 2113a2b0a27dSPhilippe Mathieu-Daudé break; 2114a2b0a27dSPhilippe Mathieu-Daudé case OPC_NOR_V: 2115a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_nor_v(cpu_env, twd, tws, twt); 2116a2b0a27dSPhilippe Mathieu-Daudé break; 2117a2b0a27dSPhilippe Mathieu-Daudé case OPC_XOR_V: 2118a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_xor_v(cpu_env, twd, tws, twt); 2119a2b0a27dSPhilippe Mathieu-Daudé break; 2120a2b0a27dSPhilippe Mathieu-Daudé case OPC_BMNZ_V: 2121a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_bmnz_v(cpu_env, twd, tws, twt); 2122a2b0a27dSPhilippe Mathieu-Daudé break; 2123a2b0a27dSPhilippe Mathieu-Daudé case OPC_BMZ_V: 2124a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_bmz_v(cpu_env, twd, tws, twt); 2125a2b0a27dSPhilippe Mathieu-Daudé break; 2126a2b0a27dSPhilippe Mathieu-Daudé case OPC_BSEL_V: 2127a2b0a27dSPhilippe Mathieu-Daudé gen_helper_msa_bsel_v(cpu_env, twd, tws, twt); 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2151a2b0a27dSPhilippe Mathieu-Daudé break; 2152a2b0a27dSPhilippe Mathieu-Daudé case OPC_MSA_2R: 2153a2b0a27dSPhilippe Mathieu-Daudé gen_msa_2r(ctx); 2154a2b0a27dSPhilippe Mathieu-Daudé break; 2155a2b0a27dSPhilippe Mathieu-Daudé case OPC_MSA_2RF: 2156a2b0a27dSPhilippe Mathieu-Daudé gen_msa_2rf(ctx); 2157a2b0a27dSPhilippe Mathieu-Daudé break; 2158a2b0a27dSPhilippe Mathieu-Daudé default: 2159a2b0a27dSPhilippe Mathieu-Daudé MIPS_INVAL("MSA instruction"); 2160a2b0a27dSPhilippe Mathieu-Daudé gen_reserved_instruction(ctx); 2161a2b0a27dSPhilippe Mathieu-Daudé break; 2162a2b0a27dSPhilippe Mathieu-Daudé } 2163a2b0a27dSPhilippe Mathieu-Daudé } 2164a2b0a27dSPhilippe Mathieu-Daudé 2165a2b0a27dSPhilippe Mathieu-Daudé static void gen_msa(DisasContext *ctx) 2166a2b0a27dSPhilippe Mathieu-Daudé { 2167a2b0a27dSPhilippe Mathieu-Daudé uint32_t opcode = ctx->opcode; 2168a2b0a27dSPhilippe Mathieu-Daudé 2169a2b0a27dSPhilippe Mathieu-Daudé check_msa_access(ctx); 2170a2b0a27dSPhilippe Mathieu-Daudé 2171a2b0a27dSPhilippe Mathieu-Daudé switch (MASK_MSA_MINOR(opcode)) { 2172a2b0a27dSPhilippe Mathieu-Daudé case OPC_MSA_I8_00: 2173a2b0a27dSPhilippe Mathieu-Daudé case OPC_MSA_I8_01: 2174a2b0a27dSPhilippe Mathieu-Daudé case OPC_MSA_I8_02: 2175a2b0a27dSPhilippe Mathieu-Daudé gen_msa_i8(ctx); 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