Home
last modified time | relevance | path

Searched refs:regPWRSEQ0_DC_GPIO_PWRSEQ_MASK_BASE_IDX (Results 1 – 8 of 8) sorted by relevance

/openbmc/linux/drivers/gpu/drm/amd/include/asic_reg/dpcs/
H A Ddpcs_3_1_4_offset.h7155 #define regPWRSEQ0_DC_GPIO_PWRSEQ_MASK_BASE_IDX … macro
H A Ddpcs_4_2_0_offset.h73 #define regPWRSEQ0_DC_GPIO_PWRSEQ_MASK_BASE_IDX … macro
H A Ddpcs_4_2_2_offset.h60 #define regPWRSEQ0_DC_GPIO_PWRSEQ_MASK_BASE_IDX … macro
H A Ddpcs_4_2_3_offset.h77 #define regPWRSEQ0_DC_GPIO_PWRSEQ_MASK_BASE_IDX … macro
/openbmc/linux/drivers/gpu/drm/amd/include/asic_reg/dcn/
H A Ddcn_3_1_2_offset.h12408 #define regPWRSEQ0_DC_GPIO_PWRSEQ_MASK_BASE_IDX … macro
H A Ddcn_3_1_5_offset.h12273 #define regPWRSEQ0_DC_GPIO_PWRSEQ_MASK_BASE_IDX … macro
H A Ddcn_3_1_4_offset.h11521 #define regPWRSEQ0_DC_GPIO_PWRSEQ_MASK_BASE_IDX … macro
H A Ddcn_3_1_6_offset.h13004 #define regPWRSEQ0_DC_GPIO_PWRSEQ_MASK_BASE_IDX … macro