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Searched refs:regPWRSEQ0_DC_GPIO_PWRSEQ_A_Y_BASE_IDX (Results 1 – 8 of 8) sorted by relevance

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H A Ddpcs_3_1_4_offset.h7157 #define regPWRSEQ0_DC_GPIO_PWRSEQ_A_Y_BASE_IDX … macro
H A Ddpcs_4_2_0_offset.h75 #define regPWRSEQ0_DC_GPIO_PWRSEQ_A_Y_BASE_IDX … macro
H A Ddpcs_4_2_2_offset.h62 #define regPWRSEQ0_DC_GPIO_PWRSEQ_A_Y_BASE_IDX … macro
H A Ddpcs_4_2_3_offset.h79 #define regPWRSEQ0_DC_GPIO_PWRSEQ_A_Y_BASE_IDX … macro
/openbmc/linux/drivers/gpu/drm/amd/include/asic_reg/dcn/
H A Ddcn_3_1_2_offset.h12410 #define regPWRSEQ0_DC_GPIO_PWRSEQ_A_Y_BASE_IDX … macro
H A Ddcn_3_1_5_offset.h12275 #define regPWRSEQ0_DC_GPIO_PWRSEQ_A_Y_BASE_IDX … macro
H A Ddcn_3_1_4_offset.h11523 #define regPWRSEQ0_DC_GPIO_PWRSEQ_A_Y_BASE_IDX … macro
H A Ddcn_3_1_6_offset.h13006 #define regPWRSEQ0_DC_GPIO_PWRSEQ_A_Y_BASE_IDX … macro