1 /*
2  * am3517evm.h - Header file for the AM3517 EVM.
3  *
4  * Author: Vaibhav Hiremath <hvaibhav@ti.com>
5  *
6  * Based on ti/evm/evm.h
7  *
8  * Copyright (C) 2010
9  * Texas Instruments Incorporated - http://www.ti.com/
10  *
11  * SPDX-License-Identifier:	GPL-2.0+
12  */
13 
14 #ifndef _AM3517EVM_H_
15 #define _AM3517EVM_H_
16 
17 const omap3_sysinfo sysinfo = {
18 	DDR_DISCRETE,
19 	"AM3517EVM Board",
20 	"NAND",
21 };
22 
23 /*
24  * IEN  - Input Enable
25  * IDIS - Input Disable
26  * PTD  - Pull type Down
27  * PTU  - Pull type Up
28  * DIS  - Pull type selection is inactive
29  * EN   - Pull type selection is active
30  * M0   - Mode 0
31  * The commented string gives the final mux configuration for that pin
32  */
33 #define MUX_AM3517EVM() \
34 	/* SDRC */\
35 	MUX_VAL(CP(SDRC_D0),		(IEN  | PTD | DIS | M0)) \
36 	MUX_VAL(CP(SDRC_D1),		(IEN  | PTD | DIS | M0)) \
37 	MUX_VAL(CP(SDRC_D2),		(IEN  | PTD | DIS | M0)) \
38 	MUX_VAL(CP(SDRC_D3),		(IEN  | PTD | DIS | M0)) \
39 	MUX_VAL(CP(SDRC_D4),		(IEN  | PTD | DIS | M0)) \
40 	MUX_VAL(CP(SDRC_D5),		(IEN  | PTD | DIS | M0)) \
41 	MUX_VAL(CP(SDRC_D6),		(IEN  | PTD | DIS | M0)) \
42 	MUX_VAL(CP(SDRC_D7),		(IEN  | PTD | DIS | M0)) \
43 	MUX_VAL(CP(SDRC_D8),		(IEN  | PTD | DIS | M0)) \
44 	MUX_VAL(CP(SDRC_D9),		(IEN  | PTD | DIS | M0)) \
45 	MUX_VAL(CP(SDRC_D10),		(IEN  | PTD | DIS | M0)) \
46 	MUX_VAL(CP(SDRC_D11),		(IEN  | PTD | DIS | M0)) \
47 	MUX_VAL(CP(SDRC_D12),		(IEN  | PTD | DIS | M0)) \
48 	MUX_VAL(CP(SDRC_D13),		(IEN  | PTD | DIS | M0)) \
49 	MUX_VAL(CP(SDRC_D14),		(IEN  | PTD | DIS | M0)) \
50 	MUX_VAL(CP(SDRC_D15),		(IEN  | PTD | DIS | M0)) \
51 	MUX_VAL(CP(SDRC_D16),		(IEN  | PTD | DIS | M0)) \
52 	MUX_VAL(CP(SDRC_D17),		(IEN  | PTD | DIS | M0)) \
53 	MUX_VAL(CP(SDRC_D18),		(IEN  | PTD | DIS | M0)) \
54 	MUX_VAL(CP(SDRC_D19),		(IEN  | PTD | DIS | M0)) \
55 	MUX_VAL(CP(SDRC_D20),		(IEN  | PTD | DIS | M0)) \
56 	MUX_VAL(CP(SDRC_D21),		(IEN  | PTD | DIS | M0)) \
57 	MUX_VAL(CP(SDRC_D22),		(IEN  | PTD | DIS | M0)) \
58 	MUX_VAL(CP(SDRC_D23),		(IEN  | PTD | DIS | M0)) \
59 	MUX_VAL(CP(SDRC_D24),		(IEN  | PTD | DIS | M0)) \
60 	MUX_VAL(CP(SDRC_D25),		(IEN  | PTD | DIS | M0)) \
61 	MUX_VAL(CP(SDRC_D26),		(IEN  | PTD | DIS | M0)) \
62 	MUX_VAL(CP(SDRC_D27),		(IEN  | PTD | DIS | M0)) \
63 	MUX_VAL(CP(SDRC_D28),		(IEN  | PTD | DIS | M0)) \
64 	MUX_VAL(CP(SDRC_D29),		(IEN  | PTD | DIS | M0)) \
65 	MUX_VAL(CP(SDRC_D30),		(IEN  | PTD | DIS | M0)) \
66 	MUX_VAL(CP(SDRC_D31),		(IEN  | PTD | DIS | M0)) \
67 	MUX_VAL(CP(SDRC_CLK),		(IEN  | PTD | DIS | M0)) \
68 	MUX_VAL(CP(SDRC_DQS0),		(IEN  | PTD | DIS | M0)) \
69 	MUX_VAL(CP(SDRC_DQS1),		(IEN  | PTD | DIS | M0)) \
70 	MUX_VAL(CP(SDRC_DQS2),		(IEN  | PTD | DIS | M0)) \
71 	MUX_VAL(CP(SDRC_DQS3),		(IEN  | PTD | DIS | M0)) \
72 	MUX_VAL(CP(SDRC_DQS0N),		(IEN  | PTD | EN  | M0)) \
73 	MUX_VAL(CP(SDRC_DQS1N),		(IEN  | PTD | EN  | M0)) \
74 	MUX_VAL(CP(SDRC_DQS2N),		(IEN  | PTD | EN  | M0)) \
75 	MUX_VAL(CP(SDRC_DQS3N),		(IEN  | PTD | EN  | M0)) \
76 	MUX_VAL(CP(SDRC_CKE0),		(M0)) \
77 	MUX_VAL(CP(SDRC_CKE1),		(M0)) \
78 	/*sdrc_strben_dly0*/\
79 	MUX_VAL(CP(STRBEN_DLY0),	(IEN  | PTD | EN  | M0)) \
80 	 /*sdrc_strben_dly1*/\
81 	MUX_VAL(CP(STRBEN_DLY1),	(IEN  | PTD | EN  | M0)) \
82 	/* GPMC */\
83 	MUX_VAL(CP(GPMC_A1),		(IDIS | PTU | EN  | M0)) \
84 	MUX_VAL(CP(GPMC_A2),		(IDIS | PTU | EN  | M0)) \
85 	MUX_VAL(CP(GPMC_A3),		(IDIS | PTU | EN  | M0)) \
86 	MUX_VAL(CP(GPMC_A4),		(IDIS | PTU | EN  | M0)) \
87 	MUX_VAL(CP(GPMC_A5),		(IDIS | PTU | EN  | M0)) \
88 	MUX_VAL(CP(GPMC_A6),		(IDIS | PTU | EN  | M0)) \
89 	MUX_VAL(CP(GPMC_A7),		(IDIS | PTU | EN  | M0)) \
90 	MUX_VAL(CP(GPMC_A8),		(IDIS | PTU | EN  | M0)) \
91 	MUX_VAL(CP(GPMC_A9),		(IDIS | PTU | EN  | M0)) \
92 	MUX_VAL(CP(GPMC_A10),		(IDIS | PTU | EN  | M0)) \
93 	MUX_VAL(CP(GPMC_D0),		(IEN  | PTU | EN  | M0)) \
94 	MUX_VAL(CP(GPMC_D1),		(IEN  | PTU | EN  | M0)) \
95 	MUX_VAL(CP(GPMC_D2),		(IEN  | PTU | EN  | M0)) \
96 	MUX_VAL(CP(GPMC_D3),		(IEN  | PTU | EN  | M0)) \
97 	MUX_VAL(CP(GPMC_D4),		(IEN  | PTU | EN  | M0)) \
98 	MUX_VAL(CP(GPMC_D5),		(IEN  | PTU | EN  | M0)) \
99 	MUX_VAL(CP(GPMC_D6),		(IEN  | PTU | EN  | M0)) \
100 	MUX_VAL(CP(GPMC_D7),		(IEN  | PTU | EN  | M0)) \
101 	MUX_VAL(CP(GPMC_D8),		(IEN  | PTU | EN  | M0)) \
102 	MUX_VAL(CP(GPMC_D9),		(IEN  | PTU | EN  | M0)) \
103 	MUX_VAL(CP(GPMC_D10),		(IEN  | PTU | EN  | M0)) \
104 	MUX_VAL(CP(GPMC_D11),		(IEN  | PTU | EN  | M0)) \
105 	MUX_VAL(CP(GPMC_D12),		(IEN  | PTU | EN  | M0)) \
106 	MUX_VAL(CP(GPMC_D13),		(IEN  | PTU | EN  | M0)) \
107 	MUX_VAL(CP(GPMC_D14),		(IEN  | PTU | EN  | M0)) \
108 	MUX_VAL(CP(GPMC_D15),		(IEN  | PTU | EN  | M0)) \
109 	MUX_VAL(CP(GPMC_NCS0),		(IDIS | PTU | EN  | M0)) \
110 	MUX_VAL(CP(GPMC_NCS1),		(IDIS | PTU | EN  | M0)) \
111 	MUX_VAL(CP(GPMC_NCS2),		(IDIS | PTU | EN  | M0)) \
112 	MUX_VAL(CP(GPMC_NCS3),		(IDIS | PTU | EN  | M0)) \
113 	MUX_VAL(CP(GPMC_NCS4),		(IEN  | PTU | EN  | M0)) \
114 	MUX_VAL(CP(GPMC_NCS5),		(IDIS | PTU | EN  | M0)) \
115 	MUX_VAL(CP(GPMC_NCS6),		(IEN  | PTD | DIS | M0)) \
116 	MUX_VAL(CP(GPMC_NCS7),		(IEN  | PTU | EN  | M0)) \
117 	MUX_VAL(CP(GPMC_CLK),		(IDIS | PTU | EN  | M0)) \
118 	MUX_VAL(CP(GPMC_NADV_ALE),	(IDIS | PTD | DIS | M0)) \
119 	MUX_VAL(CP(GPMC_NOE),		(IDIS | PTD | DIS | M0)) \
120 	MUX_VAL(CP(GPMC_NWE),		(IDIS | PTD | DIS | M0)) \
121 	MUX_VAL(CP(GPMC_NBE0_CLE),	(IDIS | PTU | EN  | M0)) \
122 	MUX_VAL(CP(GPMC_NBE1),		(IEN  | PTU | EN  | M0)) \
123 	MUX_VAL(CP(GPMC_NWP),		(IEN  | PTD | DIS | M0)) \
124 	MUX_VAL(CP(GPMC_WAIT0),		(IEN  | PTU | EN  | M0)) \
125 	MUX_VAL(CP(GPMC_WAIT1),		(IEN  | PTU | EN  | M0)) \
126 	MUX_VAL(CP(GPMC_WAIT2),		(IEN  | PTU | EN  | M4)) /*GPIO_64*/\
127 							 /* - ETH_nRESET*/\
128 	MUX_VAL(CP(GPMC_WAIT3),		(IEN  | PTU | EN  | M0)) \
129 	/* DSS */\
130 	MUX_VAL(CP(DSS_PCLK),		(IDIS | PTD | DIS | M0)) \
131 	MUX_VAL(CP(DSS_HSYNC),		(IDIS | PTD | DIS | M0)) \
132 	MUX_VAL(CP(DSS_VSYNC),		(IDIS | PTD | DIS | M0)) \
133 	MUX_VAL(CP(DSS_ACBIAS),		(IDIS | PTD | DIS | M0)) \
134 	MUX_VAL(CP(DSS_DATA0),		(IDIS | PTD | DIS | M0)) \
135 	MUX_VAL(CP(DSS_DATA1),		(IDIS | PTD | DIS | M0)) \
136 	MUX_VAL(CP(DSS_DATA2),		(IDIS | PTD | DIS | M0)) \
137 	MUX_VAL(CP(DSS_DATA3),		(IDIS | PTD | DIS | M0)) \
138 	MUX_VAL(CP(DSS_DATA4),		(IDIS | PTD | DIS | M0)) \
139 	MUX_VAL(CP(DSS_DATA5),		(IDIS | PTD | DIS | M0)) \
140 	MUX_VAL(CP(DSS_DATA6),		(IDIS | PTD | DIS | M0)) \
141 	MUX_VAL(CP(DSS_DATA7),		(IDIS | PTD | DIS | M0)) \
142 	MUX_VAL(CP(DSS_DATA8),		(IDIS | PTD | DIS | M0)) \
143 	MUX_VAL(CP(DSS_DATA9),		(IDIS | PTD | DIS | M0)) \
144 	MUX_VAL(CP(DSS_DATA10),		(IDIS | PTD | DIS | M0)) \
145 	MUX_VAL(CP(DSS_DATA11),		(IDIS | PTD | DIS | M0)) \
146 	MUX_VAL(CP(DSS_DATA12),		(IDIS | PTD | DIS | M0)) \
147 	MUX_VAL(CP(DSS_DATA13),		(IDIS | PTD | DIS | M0)) \
148 	MUX_VAL(CP(DSS_DATA14),		(IDIS | PTD | DIS | M0)) \
149 	MUX_VAL(CP(DSS_DATA15),		(IDIS | PTD | DIS | M0)) \
150 	MUX_VAL(CP(DSS_DATA16),		(IDIS | PTD | DIS | M0)) \
151 	MUX_VAL(CP(DSS_DATA17),		(IDIS | PTD | DIS | M0)) \
152 	MUX_VAL(CP(DSS_DATA18),		(IDIS | PTD | DIS | M0)) \
153 	MUX_VAL(CP(DSS_DATA19),		(IDIS | PTD | DIS | M0)) \
154 	MUX_VAL(CP(DSS_DATA20),		(IDIS | PTD | DIS | M0)) \
155 	MUX_VAL(CP(DSS_DATA21),		(IDIS | PTD | DIS | M0)) \
156 	MUX_VAL(CP(DSS_DATA22),		(IDIS | PTD | DIS | M0)) \
157 	MUX_VAL(CP(DSS_DATA23),		(IDIS | PTD | DIS | M0)) \
158 	/* CAMERA */\
159 	MUX_VAL(CP(CAM_HS),		(IEN  | PTU | EN  | M0)) \
160 	MUX_VAL(CP(CAM_VS),		(IEN  | PTU | EN  | M0)) \
161 	MUX_VAL(CP(CAM_XCLKA),		(IDIS | PTD | DIS | M0)) \
162 	MUX_VAL(CP(CAM_PCLK),		(IEN  | PTU | EN  | M0)) \
163 	MUX_VAL(CP(CAM_FLD),		(IDIS | PTD | DIS | M4)) /*GPIO_98*/\
164 							 /* - CAM_RESET*/\
165 	MUX_VAL(CP(CAM_D0),		(IEN  | PTD | DIS | M0)) \
166 	MUX_VAL(CP(CAM_D1),		(IEN  | PTD | DIS | M0)) \
167 	MUX_VAL(CP(CAM_D2),		(IEN  | PTD | DIS | M0)) \
168 	MUX_VAL(CP(CAM_D3),		(IEN  | PTD | DIS | M0)) \
169 	MUX_VAL(CP(CAM_D4),		(IEN  | PTD | DIS | M0)) \
170 	MUX_VAL(CP(CAM_D5),		(IEN  | PTD | DIS | M0)) \
171 	MUX_VAL(CP(CAM_D6),		(IEN  | PTD | DIS | M0)) \
172 	MUX_VAL(CP(CAM_D7),		(IEN  | PTD | DIS | M0)) \
173 	MUX_VAL(CP(CAM_D8),		(IEN  | PTD | DIS | M0)) \
174 	MUX_VAL(CP(CAM_D9),		(IEN  | PTD | DIS | M0)) \
175 	MUX_VAL(CP(CAM_D10),		(IEN  | PTD | DIS | M0)) \
176 	MUX_VAL(CP(CAM_D11),		(IEN  | PTD | DIS | M0)) \
177 	MUX_VAL(CP(CAM_XCLKB),		(IDIS | PTD | DIS | M0)) \
178 	MUX_VAL(CP(CAM_WEN),		(IEN  | PTD | DIS | M4)) /*GPIO_167*/\
179 	MUX_VAL(CP(CAM_STROBE),		(IDIS | PTD | DIS | M0)) \
180 	MUX_VAL(CP(CSI2_DX0),		(IEN  | PTD | DIS | M0)) \
181 	MUX_VAL(CP(CSI2_DY0),		(IEN  | PTD | DIS | M0)) \
182 	MUX_VAL(CP(CSI2_DX1),		(IEN  | PTD | DIS | M0)) \
183 	MUX_VAL(CP(CSI2_DY1),		(IEN  | PTD | DIS | M0)) \
184 	/* MMC */\
185 	MUX_VAL(CP(MMC1_CLK),		(IEN  | PTU | EN  | M0)) \
186 	MUX_VAL(CP(MMC1_CMD),		(IEN  | PTU | DIS | M0)) \
187 	MUX_VAL(CP(MMC1_DAT0),		(IEN  | PTU | DIS | M0)) \
188 	MUX_VAL(CP(MMC1_DAT1),		(IEN  | PTU | DIS | M0)) \
189 	MUX_VAL(CP(MMC1_DAT2),		(IEN  | PTU | DIS | M0)) \
190 	MUX_VAL(CP(MMC1_DAT3),		(IEN  | PTU | DIS | M0)) \
191 	/* WriteProtect */\
192 	MUX_VAL(CP(MMC1_DAT4),		(IEN  | PTU | EN  | M4)) \
193 	MUX_VAL(CP(MMC1_DAT5),		(IEN  | PTU | EN  | M4)) /*CardDetect*/\
194 	MUX_VAL(CP(MMC1_DAT6),		(IEN  | PTU | EN  | M4)) \
195 	MUX_VAL(CP(MMC1_DAT7),		(IEN  | PTU | EN  | M4)) \
196 	\
197 	MUX_VAL(CP(MMC2_CLK),		(IEN  | PTD | EN  | M0)) \
198 	MUX_VAL(CP(MMC2_CMD),		(IEN  | PTD | DIS | M0)) \
199 	MUX_VAL(CP(MMC2_DAT0),		(IEN  | PTD | DIS | M0)) \
200 	MUX_VAL(CP(MMC2_DAT1),		(IEN  | PTD | DIS | M0)) \
201 	MUX_VAL(CP(MMC2_DAT2),		(IEN  | PTD | DIS | M0)) \
202 	MUX_VAL(CP(MMC2_DAT3),		(IEN  | PTD | DIS | M0)) \
203 	/* McBSP */\
204 	MUX_VAL(CP(MCBSP_CLKS),		(IEN  | PTU | DIS | M0)) \
205 	MUX_VAL(CP(MCBSP1_CLKR),	(IEN  | PTD | DIS | M0)) \
206 	MUX_VAL(CP(MCBSP1_FSR),		(IDIS | PTU | EN  | M0)) \
207 	MUX_VAL(CP(MCBSP1_DX),		(IDIS | PTD | DIS | M0)) \
208 	MUX_VAL(CP(MCBSP1_DR),		(IEN  | PTD | DIS | M0)) \
209 	MUX_VAL(CP(MCBSP1_FSX),		(IEN  | PTD | DIS | M0)) \
210 	MUX_VAL(CP(MCBSP1_CLKX),	(IEN  | PTD | DIS | M0)) \
211 	\
212 	MUX_VAL(CP(MCBSP2_FSX),		(IEN  | PTD | DIS | M0)) \
213 	MUX_VAL(CP(MCBSP2_CLKX),	(IEN  | PTD | DIS | M0)) \
214 	MUX_VAL(CP(MCBSP2_DR),		(IEN  | PTD | DIS | M0)) \
215 	MUX_VAL(CP(MCBSP2_DX),		(IDIS | PTD | DIS | M0)) \
216 	\
217 	MUX_VAL(CP(MCBSP3_DX),		(IDIS | PTD | DIS | M0)) \
218 	MUX_VAL(CP(MCBSP3_DR),		(IEN  | PTD | DIS | M0)) \
219 	MUX_VAL(CP(MCBSP3_CLKX),	(IEN  | PTD | DIS | M0)) \
220 	MUX_VAL(CP(MCBSP3_FSX),		(IEN  | PTD | DIS | M0)) \
221 	\
222 	MUX_VAL(CP(MCBSP4_CLKX),	(IDIS | PTD | DIS | M4)) /*GPIO_152*/\
223 							 /* - LCD_INI*/\
224 	MUX_VAL(CP(MCBSP4_DR),		(IDIS | PTD | DIS | M4)) /*GPIO_153*/\
225 							 /* - LCD_ENVDD */\
226 	MUX_VAL(CP(MCBSP4_DX),		(IDIS | PTD | DIS | M4)) /*GPIO_154*/\
227 							 /* - LCD_QVGA/nVGA */\
228 	MUX_VAL(CP(MCBSP4_FSX),		(IDIS | PTD | DIS | M4)) /*GPIO_155*/\
229 							 /* - LCD_RESB */\
230 	/* UART */\
231 	MUX_VAL(CP(UART1_TX),		(IDIS | PTD | DIS | M0)) \
232 	MUX_VAL(CP(UART1_RTS),		(IDIS | PTD | DIS | M0)) \
233 	MUX_VAL(CP(UART1_CTS),		(IEN  | PTU | DIS | M0)) \
234 	\
235 	MUX_VAL(CP(UART1_RX),		(IEN  | PTD | DIS | M0)) \
236 	MUX_VAL(CP(UART2_CTS),		(IEN  | PTU | EN  | M0)) \
237 	MUX_VAL(CP(UART2_RTS),		(IDIS | PTD | DIS | M0)) \
238 	MUX_VAL(CP(UART2_TX),		(IDIS | PTD | DIS | M0)) \
239 	MUX_VAL(CP(UART2_RX),		(IEN  | PTD | DIS | M0)) \
240 	\
241 	MUX_VAL(CP(UART3_CTS_RCTX),	(IEN  | PTU | DIS | M0)) \
242 	MUX_VAL(CP(UART3_RTS_SD),	(IDIS | PTD | DIS | M0)) \
243 	MUX_VAL(CP(UART3_RX_IRRX),	(IEN  | PTD | DIS | M0)) \
244 	MUX_VAL(CP(UART3_TX_IRTX),	(IDIS | PTD | DIS | M0)) \
245 	/* I2C */\
246 	MUX_VAL(CP(I2C1_SCL),		(IEN  | PTU | EN  | M0)) \
247 	MUX_VAL(CP(I2C1_SDA),		(IEN  | PTU | EN  | M0)) \
248 	MUX_VAL(CP(I2C2_SCL),		(IEN  | PTU | EN  | M0)) \
249 	MUX_VAL(CP(I2C2_SDA),		(IEN  | PTU | EN  | M0)) \
250 	MUX_VAL(CP(I2C3_SCL),		(IEN  | PTU | EN  | M0)) \
251 	MUX_VAL(CP(I2C3_SDA),		(IEN  | PTU | EN  | M0)) \
252 	MUX_VAL(CP(I2C4_SCL),		(IEN  | PTU | EN  | M0)) \
253 	MUX_VAL(CP(I2C4_SDA),		(IEN  | PTU | EN  | M0)) \
254 	/* McSPI */\
255 	MUX_VAL(CP(MCSPI1_CLK),		(IEN  | PTD | DIS | M0)) \
256 	MUX_VAL(CP(MCSPI1_SIMO),	(IEN  | PTD | DIS | M0)) \
257 	MUX_VAL(CP(MCSPI1_SOMI),	(IEN  | PTD | DIS | M0)) \
258 	MUX_VAL(CP(MCSPI1_CS0),		(IEN  | PTD | EN  | M0)) \
259 	MUX_VAL(CP(MCSPI1_CS1),		(IEN  | PTD | EN  | M4)) /*GPIO_175*/\
260 	MUX_VAL(CP(MCSPI1_CS2),		(IEN  | PTU | DIS | M4)) /*GPIO_176*/\
261 							 /* - LAN_INTR*/\
262 	MUX_VAL(CP(MCSPI1_CS3),		(IEN  | PTD | EN  | M0)) \
263 	\
264 	MUX_VAL(CP(MCSPI2_CLK),		(IEN  | PTD | DIS | M0)) \
265 	MUX_VAL(CP(MCSPI2_SIMO),	(IEN  | PTD | DIS | M0)) \
266 	MUX_VAL(CP(MCSPI2_SOMI),	(IEN  | PTD | DIS | M0)) \
267 	MUX_VAL(CP(MCSPI2_CS0),		(IEN  | PTD | EN  | M4)) \
268 	MUX_VAL(CP(MCSPI2_CS1),		(IEN  | PTD | EN  | M4)) \
269 	/* CCDC */\
270 	MUX_VAL(CP(CCDC_PCLK),		(IEN  | PTU | EN  | M0)) \
271 	MUX_VAL(CP(CCDC_FIELD),		(IEN  | PTD | DIS | M1)) \
272 	MUX_VAL(CP(CCDC_HD),		(IEN  | PTU | EN  | M0)) \
273 	MUX_VAL(CP(CCDC_VD),		(IEN  | PTU | EN  | M0)) \
274 	MUX_VAL(CP(CCDC_WEN),		(IEN  | PTD | DIS | M1)) \
275 	MUX_VAL(CP(CCDC_DATA0),		(IEN  | PTD | DIS | M0)) \
276 	MUX_VAL(CP(CCDC_DATA1),		(IEN  | PTD | DIS | M0)) \
277 	MUX_VAL(CP(CCDC_DATA2),		(IEN  | PTD | DIS | M0)) \
278 	MUX_VAL(CP(CCDC_DATA3),		(IEN  | PTD | DIS | M0)) \
279 	MUX_VAL(CP(CCDC_DATA4),		(IEN  | PTD | DIS | M0)) \
280 	MUX_VAL(CP(CCDC_DATA5),		(IEN  | PTD | DIS | M0)) \
281 	MUX_VAL(CP(CCDC_DATA6),		(IEN  | PTD | DIS | M0)) \
282 	MUX_VAL(CP(CCDC_DATA7),		(IEN  | PTD | DIS | M0)) \
283 	/* RMII */\
284 	MUX_VAL(CP(RMII_MDIO_DATA),	(IEN  |  M0)) \
285 	MUX_VAL(CP(RMII_MDIO_CLK),	(M0)) \
286 	MUX_VAL(CP(RMII_RXD0)	,	(IEN  | PTD | M0)) \
287 	MUX_VAL(CP(RMII_RXD1),		(IEN  | PTD | M0)) \
288 	MUX_VAL(CP(RMII_CRS_DV),	(IEN  | PTD | M0)) \
289 	MUX_VAL(CP(RMII_RXER),		(PTD | M0)) \
290 	MUX_VAL(CP(RMII_TXD0),		(PTD | M0)) \
291 	MUX_VAL(CP(RMII_TXD1),		(PTD | M0)) \
292 	MUX_VAL(CP(RMII_TXEN),		(PTD | M0)) \
293 	MUX_VAL(CP(RMII_50MHZ_CLK),	(IEN  | PTD | EN  | M0)) \
294 	/* HECC */\
295 	MUX_VAL(CP(HECC1_TXD),		(IEN  | PTU | EN  | M0)) \
296 	MUX_VAL(CP(HECC1_RXD),		(IEN  | PTU | EN  | M0)) \
297 	/* HSUSB */\
298 	MUX_VAL(CP(HSUSB0_CLK),		(IEN  | PTD | DIS | M0)) \
299 	MUX_VAL(CP(HSUSB0_STP),		(IDIS | PTU | EN  | M0)) \
300 	MUX_VAL(CP(HSUSB0_DIR),		(IEN  | PTD | DIS | M0)) \
301 	MUX_VAL(CP(HSUSB0_NXT),		(IEN  | PTD | DIS | M0)) \
302 	MUX_VAL(CP(HSUSB0_DATA0),	(IEN  | PTD | DIS | M0)) \
303 	MUX_VAL(CP(HSUSB0_DATA1),	(IEN  | PTD | DIS | M0)) \
304 	MUX_VAL(CP(HSUSB0_DATA2),	(IEN  | PTD | DIS | M0)) \
305 	MUX_VAL(CP(HSUSB0_DATA3),	(IEN  | PTD | DIS | M0)) \
306 	MUX_VAL(CP(HSUSB0_DATA4),	(IEN  | PTD | DIS | M0)) \
307 	MUX_VAL(CP(HSUSB0_DATA5),	(IEN  | PTD | DIS | M0)) \
308 	MUX_VAL(CP(HSUSB0_DATA6),	(IEN  | PTD | DIS | M0)) \
309 	MUX_VAL(CP(HSUSB0_DATA7),	(IEN  | PTD | DIS | M0)) \
310 	MUX_VAL(CP(USB0_DRVBUS),	(IEN  | PTD | EN  | M0)) \
311 	/* HDQ */\
312 	MUX_VAL(CP(HDQ_SIO),		(IEN  | PTU | EN  | M0)) \
313 	/* Control and debug */\
314 	MUX_VAL(CP(SYS_32K),		(IEN  | PTD | DIS | M0)) \
315 	MUX_VAL(CP(SYS_CLKREQ),		(IEN  | PTD | DIS | M0)) \
316 	MUX_VAL(CP(SYS_NIRQ),		(IEN  | PTU | EN  | M0)) \
317 	/*SYS_nRESWARM */\
318 	MUX_VAL(CP(SYS_NRESWARM),     	(IDIS | PTU | DIS | M4)) \
319 							/* - GPIO30 */\
320 	MUX_VAL(CP(SYS_BOOT0),		(IEN  | PTD | DIS | M4)) /*GPIO_2*/\
321 							 /* - PEN_IRQ */\
322 	MUX_VAL(CP(SYS_BOOT1),		(IEN  | PTD | DIS | M4)) /*GPIO_3 */\
323 	MUX_VAL(CP(SYS_BOOT2),		(IEN  | PTD | DIS | M4)) /*GPIO_4*/\
324 	MUX_VAL(CP(SYS_BOOT3),		(IEN  | PTD | DIS | M4)) /*GPIO_5*/\
325 	MUX_VAL(CP(SYS_BOOT4),		(IEN  | PTD | DIS | M4)) /*GPIO_6*/\
326 	MUX_VAL(CP(SYS_BOOT5),		(IEN  | PTD | DIS | M4)) /*GPIO_7*/\
327 	MUX_VAL(CP(SYS_BOOT6),		(IDIS | PTD | DIS | M4)) /*GPIO_8*/\
328 							 /* - VIO_1V8*/\
329 	MUX_VAL(CP(SYS_BOOT7),		(IEN  | PTD | EN  | M0)) \
330 	MUX_VAL(CP(SYS_BOOT8),		(IEN  | PTD | EN  | M0)) \
331 	\
332 	MUX_VAL(CP(SYS_OFF_MODE),	(IEN  | PTD | DIS | M0)) \
333 	MUX_VAL(CP(SYS_CLKOUT1),	(IEN  | PTD | DIS | M0)) \
334 	MUX_VAL(CP(SYS_CLKOUT2),	(IEN  | PTU | EN  | M0)) \
335 	/* JTAG */\
336 	MUX_VAL(CP(JTAG_nTRST),		(IEN  | PTD | DIS | M0)) \
337 	MUX_VAL(CP(JTAG_TCK),		(IEN  | PTD | DIS | M0)) \
338 	MUX_VAL(CP(JTAG_TMS),		(IEN  | PTD | DIS | M0)) \
339 	MUX_VAL(CP(JTAG_TDI),		(IEN  | PTD | DIS | M0)) \
340 	MUX_VAL(CP(JTAG_EMU0),		(IEN  | PTD | DIS | M0)) \
341 	MUX_VAL(CP(JTAG_EMU1),		(IEN  | PTD | DIS | M0)) \
342 	/* ETK (ES2 onwards) */\
343 	MUX_VAL(CP(ETK_CLK_ES2),	(IDIS | PTU | EN  | M0)) \
344 	MUX_VAL(CP(ETK_CTL_ES2),	(IDIS | PTD | DIS | M0)) \
345 	MUX_VAL(CP(ETK_D0_ES2),		(IEN  | PTD | DIS | M0)) \
346 	MUX_VAL(CP(ETK_D1_ES2),		(IEN  | PTD | DIS | M0)) \
347 	MUX_VAL(CP(ETK_D2_ES2),		(IEN  | PTD | EN  | M0)) \
348 	MUX_VAL(CP(ETK_D3_ES2),		(IEN  | PTD | DIS | M0)) \
349 	MUX_VAL(CP(ETK_D4_ES2),		(IEN  | PTD | DIS | M0)) \
350 	MUX_VAL(CP(ETK_D5_ES2),		(IEN  | PTD | DIS | M0)) \
351 	MUX_VAL(CP(ETK_D6_ES2),		(IEN  | PTD | DIS | M0)) \
352 	MUX_VAL(CP(ETK_D7_ES2),		(IEN  | PTD | DIS | M0)) \
353 	MUX_VAL(CP(ETK_D8_ES2),		(IEN  | PTD | DIS | M0)) \
354 	MUX_VAL(CP(ETK_D9_ES2),		(IEN  | PTD | DIS | M0)) \
355 	MUX_VAL(CP(ETK_D10_ES2),	(IEN  | PTD | DIS | M0)) \
356 	MUX_VAL(CP(ETK_D11_ES2),	(IEN  | PTD | DIS | M0)) \
357 	MUX_VAL(CP(ETK_D12_ES2),	(IEN  | PTD | DIS | M0)) \
358 	MUX_VAL(CP(ETK_D13_ES2),	(IEN  | PTD | DIS | M0)) \
359 	MUX_VAL(CP(ETK_D14_ES2),	(IEN  | PTD | DIS | M0)) \
360 	MUX_VAL(CP(ETK_D15_ES2),	(IEN  | PTD | DIS | M0)) \
361 	/* Die to Die */\
362 	MUX_VAL(CP(D2D_MCAD34),		(IEN  | PTD | EN  | M0)) \
363 	MUX_VAL(CP(D2D_MCAD35),		(IEN  | PTD | EN  | M0)) \
364 	MUX_VAL(CP(D2D_MCAD36),		(IEN  | PTD | EN  | M0)) \
365 	MUX_VAL(CP(D2D_CLK26MI),	(IEN  | PTD | DIS | M0)) \
366 	MUX_VAL(CP(D2D_NRESPWRON),	(IEN  | PTD | EN  | M0)) \
367 	MUX_VAL(CP(D2D_NRESWARM),	(IEN  | PTU | EN  | M0)) \
368 	MUX_VAL(CP(D2D_ARM9NIRQ),	(IEN  | PTD | DIS | M0)) \
369 	MUX_VAL(CP(D2D_UMA2P6FIQ),	(IEN  | PTD | DIS | M0)) \
370 	MUX_VAL(CP(D2D_SPINT),		(IEN  | PTD | EN  | M0)) \
371 	MUX_VAL(CP(D2D_FRINT),		(IEN  | PTD | EN  | M0)) \
372 	MUX_VAL(CP(D2D_DMAREQ0),	(IEN  | PTD | DIS | M0)) \
373 	MUX_VAL(CP(D2D_DMAREQ1),	(IEN  | PTD | DIS | M0)) \
374 	MUX_VAL(CP(D2D_DMAREQ2),	(IEN  | PTD | DIS | M0)) \
375 	MUX_VAL(CP(D2D_DMAREQ3),	(IEN  | PTD | DIS | M0)) \
376 	MUX_VAL(CP(D2D_N3GTRST),	(IEN  | PTD | DIS | M0)) \
377 	MUX_VAL(CP(D2D_N3GTDI),		(IEN  | PTD | DIS | M0)) \
378 	MUX_VAL(CP(D2D_N3GTDO),		(IEN  | PTD | DIS | M0)) \
379 	MUX_VAL(CP(D2D_N3GTMS),		(IEN  | PTD | DIS | M0)) \
380 	MUX_VAL(CP(D2D_N3GTCK),		(IEN  | PTD | DIS | M0)) \
381 	MUX_VAL(CP(D2D_N3GRTCK),	(IEN  | PTD | DIS | M0)) \
382 	MUX_VAL(CP(D2D_MSTDBY),		(IEN  | PTU | EN  | M0)) \
383 	MUX_VAL(CP(D2D_SWAKEUP),	(IEN  | PTD | EN  | M0)) \
384 	MUX_VAL(CP(D2D_IDLEREQ),	(IEN  | PTD | DIS | M0)) \
385 	MUX_VAL(CP(D2D_IDLEACK),	(IEN  | PTU | EN  | M0)) \
386 	MUX_VAL(CP(D2D_MWRITE),		(IEN  | PTD | DIS | M0)) \
387 	MUX_VAL(CP(D2D_SWRITE),		(IEN  | PTD | DIS | M0)) \
388 	MUX_VAL(CP(D2D_MREAD),		(IEN  | PTD | DIS | M0)) \
389 	MUX_VAL(CP(D2D_SREAD),		(IEN  | PTD | DIS | M0)) \
390 	MUX_VAL(CP(D2D_MBUSFLAG),	(IEN  | PTD | DIS | M0)) \
391 	MUX_VAL(CP(D2D_SBUSFLAG),	(IEN  | PTD | DIS | M0)) \
392 
393 #endif
394