1# 2# Power ISA decode for 32-bit insns (opcode space 0) 3# 4# Copyright (c) 2021 Instituto de Pesquisas Eldorado (eldorado.org.br) 5# 6# This library is free software; you can redistribute it and/or 7# modify it under the terms of the GNU Lesser General Public 8# License as published by the Free Software Foundation; either 9# version 2.1 of the License, or (at your option) any later version. 10# 11# This library is distributed in the hope that it will be useful, 12# but WITHOUT ANY WARRANTY; without even the implied warranty of 13# MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE. See the GNU 14# Lesser General Public License for more details. 15# 16# You should have received a copy of the GNU Lesser General Public 17# License along with this library; if not, see <http://www.gnu.org/licenses/>. 18# 19 20&A frt fra frb frc rc:bool 21@A ...... frt:5 fra:5 frb:5 frc:5 ..... rc:1 &A 22 23&A_tb frt frb rc:bool 24@A_tb ...... frt:5 ..... frb:5 ..... ..... rc:1 &A_tb 25 26&D rt ra si:int64_t 27@D ...... rt:5 ra:5 si:s16 &D 28 29&D_bf bf l:bool ra imm 30@D_bfs ...... bf:3 . l:1 ra:5 imm:s16 &D_bf 31@D_bfu ...... bf:3 . l:1 ra:5 imm:16 &D_bf 32 33%dq_si 4:s12 !function=times_16 34%dq_rtp 22:4 !function=times_2 35@DQ_rtp ...... ....0 ra:5 ............ .... &D rt=%dq_rtp si=%dq_si 36 37%dq_rt_tsx 3:1 21:5 38@DQ_TSX ...... ..... ra:5 ............ .... &D si=%dq_si rt=%dq_rt_tsx 39 40%rt_tsxp 21:1 22:4 !function=times_2 41@DQ_TSXP ...... ..... ra:5 ............ .... &D si=%dq_si rt=%rt_tsxp 42 43%ds_si 2:s14 !function=times_4 44@DS ...... rt:5 ra:5 .............. .. &D si=%ds_si 45 46%ds_rtp 22:4 !function=times_2 47@DS_rtp ...... ....0 ra:5 .............. .. &D rt=%ds_rtp si=%ds_si 48 49&DX_b vrt b 50%dx_b 6:10 16:5 0:1 51@DX_b ...... vrt:5 ..... .......... ..... . &DX_b b=%dx_b 52 53&DX rt d 54%dx_d 6:s10 16:5 0:1 55@DX ...... rt:5 ..... .......... ..... . &DX d=%dx_d 56 57&VA vrt vra vrb rc 58@VA ...... vrt:5 vra:5 vrb:5 rc:5 ...... &VA 59 60&VC vrt vra vrb rc:bool 61@VC ...... vrt:5 vra:5 vrb:5 rc:1 .......... &VC 62 63&VN vrt vra vrb sh 64@VN ...... vrt:5 vra:5 vrb:5 .. sh:3 ...... &VN 65 66&VX vrt vra vrb 67@VX ...... vrt:5 vra:5 vrb:5 .......... . &VX 68 69&VX_bf bf vra vrb 70@VX_bf ...... bf:3 .. vra:5 vrb:5 ........... &VX_bf 71 72&VX_mp rt mp:bool vrb 73@VX_mp ...... rt:5 .... mp:1 vrb:5 ........... &VX_mp 74 75&VX_n rt vrb n 76@VX_n ...... rt:5 .. n:3 vrb:5 ........... &VX_n 77 78&VX_tb_rc vrt vrb rc:bool 79@VX_tb_rc ...... vrt:5 ..... vrb:5 rc:1 .......... &VX_tb_rc 80 81&VX_uim4 vrt uim vrb 82@VX_uim4 ...... vrt:5 . uim:4 vrb:5 ........... &VX_uim4 83 84&VX_tb vrt vrb 85@VX_tb ...... vrt:5 ..... vrb:5 ........... &VX_tb 86 87&X rt ra rb 88@X ...... rt:5 ra:5 rb:5 .......... . &X 89 90&X_rc rt ra rb rc:bool 91@X_rc ...... rt:5 ra:5 rb:5 .......... rc:1 &X_rc 92 93&X_sa rs ra 94@X_sa ...... rs:5 ra:5 ..... .......... . &X_sa 95 96%x_frtp 22:4 !function=times_2 97%x_frap 17:4 !function=times_2 98%x_frbp 12:4 !function=times_2 99@X_tp_ap_bp_rc ...... ....0 ....0 ....0 .......... rc:1 &X_rc rt=%x_frtp ra=%x_frap rb=%x_frbp 100 101@X_tp_a_bp_rc ...... ....0 ra:5 ....0 .......... rc:1 &X_rc rt=%x_frtp rb=%x_frbp 102 103&X_t rt 104@X_t ...... rt:5 ..... ..... .......... . &X_t 105 106&X_tb rt rb 107@X_tb ...... rt:5 ..... rb:5 .......... . &X_tb 108 109&X_t_rc rt rc:bool 110@X_t_rc ...... rt:5 ..... ..... .......... rc:1 &X_t_rc 111 112&X_tb_rc rt rb rc:bool 113@X_tb_rc ...... rt:5 ..... rb:5 .......... rc:1 &X_tb_rc 114 115@X_tbp_rc ...... ....0 ..... ....0 .......... rc:1 &X_tb_rc rt=%x_frtp rb=%x_frbp 116 117@X_tp_b_rc ...... ....0 ..... rb:5 .......... rc:1 &X_tb_rc rt=%x_frtp 118 119@X_t_bp_rc ...... rt:5 ..... ....0 .......... rc:1 &X_tb_rc rb=%x_frbp 120 121&X_bi rt bi 122@X_bi ...... rt:5 bi:5 ..... .......... . &X_bi 123 124&X_bf bf ra rb 125@X_bf ...... bf:3 .. ra:5 rb:5 .......... . &X_bf 126 127@X_bf_ap_bp ...... bf:3 .. ....0 ....0 .......... . &X_bf ra=%x_frap rb=%x_frbp 128 129@X_bf_a_bp ...... bf:3 .. ra:5 ....0 .......... . &X_bf rb=%x_frbp 130 131&X_bf_uim bf uim rb 132@X_bf_uim ...... bf:3 . uim:6 rb:5 .......... . &X_bf_uim 133 134@X_bf_uim_bp ...... bf:3 . uim:6 ....0 .......... . &X_bf_uim rb=%x_frbp 135 136&X_bfl bf l:bool ra rb 137@X_bfl ...... bf:3 . l:1 ra:5 rb:5 .......... . &X_bfl 138 139&X_imm2 rt imm 140@X_imm2 ...... rt:5 ..... ... imm:2 .......... . &X_imm2 141 142&X_imm3 rt imm 143@X_imm3 ...... rt:5 ..... .. imm:3 .......... . &X_imm3 144 145%x_xt 0:1 21:5 146&X_imm5 xt imm:uint8_t vrb 147@X_imm5 ...... ..... imm:5 vrb:5 .......... . &X_imm5 xt=%x_xt 148 149&X_imm8 xt imm:uint8_t 150@X_imm8 ...... ..... .. imm:8 .......... . &X_imm8 xt=%x_xt 151 152&X_ih ih:uint8_t 153@X_ih ...... .. ih:3 ..... ..... .......... . &X_ih 154 155&X_rb rb 156@X_rb ...... ..... ..... rb:5 .......... . &X_rb 157 158&X_rs_l rs l:bool 159@X_rs_l ...... rs:5 .... l:1 ..... .......... . &X_rs_l 160 161&X_uim5 xt uim:uint8_t 162@X_uim5 ...... ..... ..... uim:5 .......... . &X_uim5 xt=%x_xt 163 164&X_tb_sp_rc rt rb sp rc:bool 165@X_tb_sp_rc ...... rt:5 sp:2 ... rb:5 .......... rc:1 &X_tb_sp_rc 166 167@X_tbp_sp_rc ...... ....0 sp:2 ... ....0 .......... rc:1 &X_tb_sp_rc rt=%x_frtp rb=%x_frbp 168 169&X_tb_s_rc rt rb s:bool rc:bool 170@X_tb_s_rc ...... rt:5 s:1 .... rb:5 .......... rc:1 &X_tb_s_rc 171 172@X_tbp_s_rc ...... ....0 s:1 .... ....0 .......... rc:1 &X_tb_s_rc rt=%x_frtp rb=%x_frbp 173 174%x_rt_tsx 0:1 21:5 175@X_TSX ...... ..... ra:5 rb:5 .......... . &X rt=%x_rt_tsx 176@X_TSXP ...... ..... ra:5 rb:5 .......... . &X rt=%rt_tsxp 177 178%x_dw 0:1 21:5 !function=dw_compose_ea 179@X_DW ...... ..... ra:5 rb:5 .......... . &X rt=%x_dw 180 181&X_frtp_vrb frtp vrb 182@X_frtp_vrb ...... ....0 ..... vrb:5 .......... . &X_frtp_vrb frtp=%x_frtp 183 184&X_vrt_frbp vrt frbp 185@X_vrt_frbp ...... vrt:5 ..... ....0 .......... . &X_vrt_frbp frbp=%x_frbp 186 187&X_a ra 188@X_a ...... ra:3 .. ..... ..... .......... . &X_a 189 190&XO rt ra rb oe:bool rc:bool 191@XO ...... rt:5 ra:5 rb:5 oe:1 ......... rc:1 &XO 192 193&XO_ta rt ra oe:bool rc:bool 194@XO_ta ...... rt:5 ra:5 ..... oe:1 ......... rc:1 &XO_ta 195 196%xx_xt 0:1 21:5 197%xx_xb 1:1 11:5 198%xx_xa 2:1 16:5 199%xx_xc 3:1 6:5 200&XX2 xt xb 201@XX2 ...... ..... ..... ..... ......... .. &XX2 xt=%xx_xt xb=%xx_xb 202 203&XX2_uim xt xb uim:uint8_t 204@XX2_uim2 ...... ..... ... uim:2 ..... ......... .. &XX2_uim xt=%xx_xt xb=%xx_xb 205 206@XX2_uim4 ...... ..... . uim:4 ..... ......... .. &XX2_uim xt=%xx_xt xb=%xx_xb 207 208%xx_uim7 6:1 2:1 16:5 209@XX2_uim7 ...... ..... ..... ..... .... . ... . .. &XX2_uim xt=%xx_xt xb=%xx_xb uim=%xx_uim7 210 211&XX2_bf_uim bf xb uim 212@XX2_bf_uim ...... bf:3 uim:7 ..... ......... . . &XX2_bf_uim 213 214&XX2_bf_xb bf xb 215@XX2_bf_xb ...... bf:3 .. ..... ..... ......... . . &XX2_bf_xb xb=%xx_xb 216 217&XX3 xt xa xb 218@XX3 ...... ..... ..... ..... ........ ... &XX3 xt=%xx_xt xa=%xx_xa xb=%xx_xb 219 220# 32 bit GER instructions have all mask bits considered 1 221&MMIRR_XX3 xa xb xt pmsk xmsk ymsk 222%xx_at 23:3 223%xx_xa_pair 2:1 17:4 !function=times_2 224@XX3_at ...... ... .. ..... ..... ........ ... &MMIRR_XX3 xt=%xx_at xb=%xx_xb \ 225 pmsk=255 xmsk=15 ymsk=15 226 227&XX3_dm xt xa xb dm 228@XX3_dm ...... ..... ..... ..... . dm:2 ..... ... &XX3_dm xt=%xx_xt xa=%xx_xa xb=%xx_xb 229 230&XX4 xt xa xb xc 231@XX4 ...... ..... ..... ..... ..... .. .... &XX4 xt=%xx_xt xa=%xx_xa xb=%xx_xb xc=%xx_xc 232 233&Z22_bf_fra bf fra dm 234@Z22_bf_fra ...... bf:3 .. fra:5 dm:6 ......... . &Z22_bf_fra 235 236%z22_frap 17:4 !function=times_2 237@Z22_bf_frap ...... bf:3 .. ....0 dm:6 ......... . &Z22_bf_fra fra=%z22_frap 238 239&Z22_ta_sh_rc rt ra sh rc:bool 240@Z22_ta_sh_rc ...... rt:5 ra:5 sh:6 ......... rc:1 &Z22_ta_sh_rc 241 242%z22_frtp 22:4 !function=times_2 243@Z22_tap_sh_rc ...... ....0 ....0 sh:6 ......... rc:1 &Z22_ta_sh_rc rt=%z22_frtp ra=%z22_frap 244 245&Z23_tab frt fra frb rmc rc:bool 246@Z23_tab ...... frt:5 fra:5 frb:5 rmc:2 ........ rc:1 &Z23_tab 247 248%z23_frtp 22:4 !function=times_2 249%z23_frap 17:4 !function=times_2 250%z23_frbp 12:4 !function=times_2 251@Z23_tabp ...... ....0 ....0 ....0 rmc:2 ........ rc:1 &Z23_tab frt=%z23_frtp fra=%z23_frap frb=%z23_frbp 252 253@Z23_tp_a_bp ...... ....0 fra:5 ....0 rmc:2 ........ rc:1 &Z23_tab frt=%z23_frtp frb=%z23_frbp 254 255&Z23_tb frt frb r:bool rmc rc:bool 256@Z23_tb ...... frt:5 .... r:1 frb:5 rmc:2 ........ rc:1 &Z23_tb 257 258@Z23_tbp ...... ....0 .... r:1 ....0 rmc:2 ........ rc:1 &Z23_tb frt=%z23_frtp frb=%z23_frbp 259 260&Z23_te_tb te frt frb rmc rc:bool 261@Z23_te_tb ...... frt:5 te:5 frb:5 rmc:2 ........ rc:1 &Z23_te_tb 262 263@Z23_te_tbp ...... ....0 te:5 ....0 rmc:2 ........ rc:1 &Z23_te_tb frt=%z23_frtp frb=%z23_frbp 264 265### Fixed-Point Load Instructions 266 267LBZ 100010 ..... ..... ................ @D 268LBZU 100011 ..... ..... ................ @D 269LBZX 011111 ..... ..... ..... 0001010111 - @X 270LBZUX 011111 ..... ..... ..... 0001110111 - @X 271 272LHZ 101000 ..... ..... ................ @D 273LHZU 101001 ..... ..... ................ @D 274LHZX 011111 ..... ..... ..... 0100010111 - @X 275LHZUX 011111 ..... ..... ..... 0100110111 - @X 276 277LHA 101010 ..... ..... ................ @D 278LHAU 101011 ..... ..... ................ @D 279LHAX 011111 ..... ..... ..... 0101010111 - @X 280LHAXU 011111 ..... ..... ..... 0101110111 - @X 281 282LWZ 100000 ..... ..... ................ @D 283LWZU 100001 ..... ..... ................ @D 284LWZX 011111 ..... ..... ..... 0000010111 - @X 285LWZUX 011111 ..... ..... ..... 0000110111 - @X 286 287LWA 111010 ..... ..... ..............10 @DS 288LWAX 011111 ..... ..... ..... 0101010101 - @X 289LWAUX 011111 ..... ..... ..... 0101110101 - @X 290 291LD 111010 ..... ..... ..............00 @DS 292LDU 111010 ..... ..... ..............01 @DS 293LDX 011111 ..... ..... ..... 0000010101 - @X 294LDUX 011111 ..... ..... ..... 0000110101 - @X 295 296LQ 111000 ..... ..... ............ ---- @DQ_rtp 297 298### Fixed-Point Store Instructions 299 300STB 100110 ..... ..... ................ @D 301STBU 100111 ..... ..... ................ @D 302STBX 011111 ..... ..... ..... 0011010111 - @X 303STBUX 011111 ..... ..... ..... 0011110111 - @X 304 305STH 101100 ..... ..... ................ @D 306STHU 101101 ..... ..... ................ @D 307STHX 011111 ..... ..... ..... 0110010111 - @X 308STHUX 011111 ..... ..... ..... 0110110111 - @X 309 310STW 100100 ..... ..... ................ @D 311STWU 100101 ..... ..... ................ @D 312STWX 011111 ..... ..... ..... 0010010111 - @X 313STWUX 011111 ..... ..... ..... 0010110111 - @X 314 315STD 111110 ..... ..... ..............00 @DS 316STDU 111110 ..... ..... ..............01 @DS 317STDX 011111 ..... ..... ..... 0010010101 - @X 318STDUX 011111 ..... ..... ..... 0010110101 - @X 319 320STQ 111110 ..... ..... ..............10 @DS_rtp 321 322### Fixed-Point Compare Instructions 323 324CMP 011111 ... - . ..... ..... 0000000000 - @X_bfl 325CMPL 011111 ... - . ..... ..... 0000100000 - @X_bfl 326CMPI 001011 ... - . ..... ................ @D_bfs 327CMPLI 001010 ... - . ..... ................ @D_bfu 328 329### Fixed-Point Arithmetic Instructions 330 331ADD 011111 ..... ..... ..... . 100001010 . @XO 332ADDC 011111 ..... ..... ..... . 000001010 . @XO 333ADDE 011111 ..... ..... ..... . 010001010 . @XO 334 335# ADDEX is Z23-form, with CY=0; all other values for CY are reserved. 336# This works out the same as X-form. 337ADDEX 011111 ..... ..... ..... 00 10101010 - @X 338 339ADDI 001110 ..... ..... ................ @D 340ADDIS 001111 ..... ..... ................ @D 341ADDIC 001100 ..... ..... ................ @D 342ADDIC_ 001101 ..... ..... ................ @D 343 344ADDPCIS 010011 ..... ..... .......... 00010 . @DX 345ADDME 011111 ..... ..... ----- . 011101010 . @XO_ta 346ADDZE 011111 ..... ..... ----- . 011001010 . @XO_ta 347 348SUBF 011111 ..... ..... ..... . 000101000 . @XO 349SUBFIC 001000 ..... ..... ................ @D 350SUBFC 011111 ..... ..... ..... . 000001000 . @XO 351SUBFE 011111 ..... ..... ..... . 010001000 . @XO 352 353SUBFME 011111 ..... ..... ----- . 011101000 . @XO_ta 354SUBFZE 011111 ..... ..... ----- . 011001000 . @XO_ta 355 356## Fixed-Point Logical Instructions 357 358CFUGED 011111 ..... ..... ..... 0011011100 - @X 359CNTLZDM 011111 ..... ..... ..... 0000111011 - @X 360CNTTZDM 011111 ..... ..... ..... 1000111011 - @X 361PDEPD 011111 ..... ..... ..... 0010011100 - @X 362PEXTD 011111 ..... ..... ..... 0010111100 - @X 363 364# Fixed-Point Hash Instructions 365 366HASHST 011111 ..... ..... ..... 1011010010 . @X_DW 367HASHCHK 011111 ..... ..... ..... 1011110010 . @X_DW 368HASHSTP 011111 ..... ..... ..... 1010010010 . @X_DW 369HASHCHKP 011111 ..... ..... ..... 1010110010 . @X_DW 370 371## BCD Assist 372 373ADDG6S 011111 ..... ..... ..... - 001001010 - @X 374CDTBCD 011111 ..... ..... ----- 0100011010 - @X_sa 375CBCDTD 011111 ..... ..... ----- 0100111010 - @X_sa 376 377### Float-Point Load Instructions 378 379LFS 110000 ..... ..... ................ @D 380LFSU 110001 ..... ..... ................ @D 381LFSX 011111 ..... ..... ..... 1000010111 - @X 382LFSUX 011111 ..... ..... ..... 1000110111 - @X 383 384LFD 110010 ..... ..... ................ @D 385LFDU 110011 ..... ..... ................ @D 386LFDX 011111 ..... ..... ..... 1001010111 - @X 387LFDUX 011111 ..... ..... ..... 1001110111 - @X 388 389### Float-Point Store Instructions 390 391STFS 110100 ..... ...... ............... @D 392STFSU 110101 ..... ...... ............... @D 393STFSX 011111 ..... ...... .... 1010010111 - @X 394STFSUX 011111 ..... ...... .... 1010110111 - @X 395 396STFD 110110 ..... ...... ............... @D 397STFDU 110111 ..... ...... ............... @D 398STFDX 011111 ..... ...... .... 1011010111 - @X 399STFDUX 011111 ..... ...... .... 1011110111 - @X 400 401### Floating-Point Arithmetic Instructions 402 403FSQRT 111111 ..... ----- ..... ----- 10110 . @A_tb 404FSQRTS 111011 ..... ----- ..... ----- 10110 . @A_tb 405 406### Floating-Point Select Instruction 407 408FSEL 111111 ..... ..... ..... ..... 10111 . @A 409 410### Move To/From System Register Instructions 411 412SETBC 011111 ..... ..... ----- 0110000000 - @X_bi 413SETBCR 011111 ..... ..... ----- 0110100000 - @X_bi 414SETNBC 011111 ..... ..... ----- 0111000000 - @X_bi 415SETNBCR 011111 ..... ..... ----- 0111100000 - @X_bi 416 417### Move To/From FPSCR 418 419{ 420 # Before Power ISA v3.0, MFFS bits 11~15 were reserved and should be ignored 421 MFFS_ISA207 111111 ..... ----- ----- 1001000111 . @X_t_rc 422 [ 423 MFFS 111111 ..... 00000 ----- 1001000111 . @X_t_rc 424 MFFSCE 111111 ..... 00001 ----- 1001000111 - @X_t 425 MFFSCRN 111111 ..... 10110 ..... 1001000111 - @X_tb 426 MFFSCDRN 111111 ..... 10100 ..... 1001000111 - @X_tb 427 MFFSCRNI 111111 ..... 10111 ---.. 1001000111 - @X_imm2 428 MFFSCDRNI 111111 ..... 10101 --... 1001000111 - @X_imm3 429 MFFSL 111111 ..... 11000 ----- 1001000111 - @X_t 430 ] 431} 432 433### Decimal Floating-Point Arithmetic Instructions 434 435DADD 111011 ..... ..... ..... 0000000010 . @X_rc 436DADDQ 111111 ..... ..... ..... 0000000010 . @X_tp_ap_bp_rc 437 438DSUB 111011 ..... ..... ..... 1000000010 . @X_rc 439DSUBQ 111111 ..... ..... ..... 1000000010 . @X_tp_ap_bp_rc 440 441DMUL 111011 ..... ..... ..... 0000100010 . @X_rc 442DMULQ 111111 ..... ..... ..... 0000100010 . @X_tp_ap_bp_rc 443 444DDIV 111011 ..... ..... ..... 1000100010 . @X_rc 445DDIVQ 111111 ..... ..... ..... 1000100010 . @X_tp_ap_bp_rc 446 447### Decimal Floating-Point Compare Instructions 448 449DCMPU 111011 ... -- ..... ..... 1010000010 - @X_bf 450DCMPUQ 111111 ... -- ..... ..... 1010000010 - @X_bf_ap_bp 451 452DCMPO 111011 ... -- ..... ..... 0010000010 - @X_bf 453DCMPOQ 111111 ... -- ..... ..... 0010000010 - @X_bf_ap_bp 454 455### Decimal Floating-Point Test Instructions 456 457DTSTDC 111011 ... -- ..... ...... 011000010 - @Z22_bf_fra 458DTSTDCQ 111111 ... -- ..... ...... 011000010 - @Z22_bf_frap 459 460DTSTDG 111011 ... -- ..... ...... 011100010 - @Z22_bf_fra 461DTSTDGQ 111111 ... -- ..... ...... 011100010 - @Z22_bf_frap 462 463DTSTEX 111011 ... -- ..... ..... 0010100010 - @X_bf 464DTSTEXQ 111111 ... -- ..... ..... 0010100010 - @X_bf_ap_bp 465 466DTSTSF 111011 ... -- ..... ..... 1010100010 - @X_bf 467DTSTSFQ 111111 ... -- ..... ..... 1010100010 - @X_bf_a_bp 468 469DTSTSFI 111011 ... - ...... ..... 1010100011 - @X_bf_uim 470DTSTSFIQ 111111 ... - ...... ..... 1010100011 - @X_bf_uim_bp 471 472### Decimal Floating-Point Quantum Adjustment Instructions 473 474DQUAI 111011 ..... ..... ..... .. 01000011 . @Z23_te_tb 475DQUAIQ 111111 ..... ..... ..... .. 01000011 . @Z23_te_tbp 476 477DQUA 111011 ..... ..... ..... .. 00000011 . @Z23_tab 478DQUAQ 111111 ..... ..... ..... .. 00000011 . @Z23_tabp 479 480DRRND 111011 ..... ..... ..... .. 00100011 . @Z23_tab 481DRRNDQ 111111 ..... ..... ..... .. 00100011 . @Z23_tp_a_bp 482 483DRINTX 111011 ..... ---- . ..... .. 01100011 . @Z23_tb 484DRINTXQ 111111 ..... ---- . ..... .. 01100011 . @Z23_tbp 485 486DRINTN 111011 ..... ---- . ..... .. 11100011 . @Z23_tb 487DRINTNQ 111111 ..... ---- . ..... .. 11100011 . @Z23_tbp 488 489### Decimal Floating-Point Conversion Instructions 490 491DCTDP 111011 ..... ----- ..... 0100000010 . @X_tb_rc 492DCTQPQ 111111 ..... ----- ..... 0100000010 . @X_tp_b_rc 493 494DRSP 111011 ..... ----- ..... 1100000010 . @X_tb_rc 495DRDPQ 111111 ..... ----- ..... 1100000010 . @X_tbp_rc 496 497DCFFIX 111011 ..... ----- ..... 1100100010 . @X_tb_rc 498DCFFIXQ 111111 ..... ----- ..... 1100100010 . @X_tp_b_rc 499DCFFIXQQ 111111 ..... 00000 ..... 1111100010 - @X_frtp_vrb 500 501DCTFIX 111011 ..... ----- ..... 0100100010 . @X_tb_rc 502DCTFIXQ 111111 ..... ----- ..... 0100100010 . @X_t_bp_rc 503DCTFIXQQ 111111 ..... 00001 ..... 1111100010 - @X_vrt_frbp 504 505### Decimal Floating-Point Format Instructions 506 507DDEDPD 111011 ..... .. --- ..... 0101000010 . @X_tb_sp_rc 508DDEDPDQ 111111 ..... .. --- ..... 0101000010 . @X_tbp_sp_rc 509 510DENBCD 111011 ..... . ---- ..... 1101000010 . @X_tb_s_rc 511DENBCDQ 111111 ..... . ---- ..... 1101000010 . @X_tbp_s_rc 512 513DXEX 111011 ..... ----- ..... 0101100010 . @X_tb_rc 514DXEXQ 111111 ..... ----- ..... 0101100010 . @X_t_bp_rc 515 516DIEX 111011 ..... ..... ..... 1101100010 . @X_rc 517DIEXQ 111111 ..... ..... ..... 1101100010 . @X_tp_a_bp_rc 518 519DSCLI 111011 ..... ..... ...... 001000010 . @Z22_ta_sh_rc 520DSCLIQ 111111 ..... ..... ...... 001000010 . @Z22_tap_sh_rc 521 522DSCRI 111011 ..... ..... ...... 001100010 . @Z22_ta_sh_rc 523DSCRIQ 111111 ..... ..... ...... 001100010 . @Z22_tap_sh_rc 524 525## Vector Exclusive-OR-based Instructions 526 527VPMSUMD 000100 ..... ..... ..... 10011001000 @VX 528 529## Vector Integer Instructions 530 531VCMPEQUB 000100 ..... ..... ..... . 0000000110 @VC 532VCMPEQUH 000100 ..... ..... ..... . 0001000110 @VC 533VCMPEQUW 000100 ..... ..... ..... . 0010000110 @VC 534VCMPEQUD 000100 ..... ..... ..... . 0011000111 @VC 535VCMPEQUQ 000100 ..... ..... ..... . 0111000111 @VC 536 537VCMPGTSB 000100 ..... ..... ..... . 1100000110 @VC 538VCMPGTSH 000100 ..... ..... ..... . 1101000110 @VC 539VCMPGTSW 000100 ..... ..... ..... . 1110000110 @VC 540VCMPGTSD 000100 ..... ..... ..... . 1111000111 @VC 541VCMPGTSQ 000100 ..... ..... ..... . 1110000111 @VC 542 543VCMPGTUB 000100 ..... ..... ..... . 1000000110 @VC 544VCMPGTUH 000100 ..... ..... ..... . 1001000110 @VC 545VCMPGTUW 000100 ..... ..... ..... . 1010000110 @VC 546VCMPGTUD 000100 ..... ..... ..... . 1011000111 @VC 547VCMPGTUQ 000100 ..... ..... ..... . 1010000111 @VC 548 549VCMPNEB 000100 ..... ..... ..... . 0000000111 @VC 550VCMPNEH 000100 ..... ..... ..... . 0001000111 @VC 551VCMPNEW 000100 ..... ..... ..... . 0010000111 @VC 552 553VCMPNEZB 000100 ..... ..... ..... . 0100000111 @VC 554VCMPNEZH 000100 ..... ..... ..... . 0101000111 @VC 555VCMPNEZW 000100 ..... ..... ..... . 0110000111 @VC 556 557VCMPSQ 000100 ... -- ..... ..... 00101000001 @VX_bf 558VCMPUQ 000100 ... -- ..... ..... 00100000001 @VX_bf 559 560## Vector Integer Average Instructions 561 562VAVGSB 000100 ..... ..... ..... 10100000010 @VX 563VAVGSH 000100 ..... ..... ..... 10101000010 @VX 564VAVGSW 000100 ..... ..... ..... 10110000010 @VX 565VAVGUB 000100 ..... ..... ..... 10000000010 @VX 566VAVGUH 000100 ..... ..... ..... 10001000010 @VX 567VAVGUW 000100 ..... ..... ..... 10010000010 @VX 568 569## Vector Integer Absolute Difference Instructions 570 571VABSDUB 000100 ..... ..... ..... 10000000011 @VX 572VABSDUH 000100 ..... ..... ..... 10001000011 @VX 573VABSDUW 000100 ..... ..... ..... 10010000011 @VX 574 575## Vector Bit Manipulation Instruction 576 577VGNB 000100 ..... -- ... ..... 10011001100 @VX_n 578 579VCFUGED 000100 ..... ..... ..... 10101001101 @VX 580VCLZDM 000100 ..... ..... ..... 11110000100 @VX 581VCTZDM 000100 ..... ..... ..... 11111000100 @VX 582VPDEPD 000100 ..... ..... ..... 10111001101 @VX 583VPEXTD 000100 ..... ..... ..... 10110001101 @VX 584 585VPRTYBD 000100 ..... 01001 ..... 11000000010 @VX_tb 586VPRTYBQ 000100 ..... 01010 ..... 11000000010 @VX_tb 587VPRTYBW 000100 ..... 01000 ..... 11000000010 @VX_tb 588 589## Vector Permute and Formatting Instruction 590 591VEXTDUBVLX 000100 ..... ..... ..... ..... 011000 @VA 592VEXTDUBVRX 000100 ..... ..... ..... ..... 011001 @VA 593VEXTDUHVLX 000100 ..... ..... ..... ..... 011010 @VA 594VEXTDUHVRX 000100 ..... ..... ..... ..... 011011 @VA 595VEXTDUWVLX 000100 ..... ..... ..... ..... 011100 @VA 596VEXTDUWVRX 000100 ..... ..... ..... ..... 011101 @VA 597VEXTDDVLX 000100 ..... ..... ..... ..... 011110 @VA 598VEXTDDVRX 000100 ..... ..... ..... ..... 011111 @VA 599 600VINSERTB 000100 ..... - .... ..... 01100001101 @VX_uim4 601VINSERTH 000100 ..... - .... ..... 01101001101 @VX_uim4 602VINSERTW 000100 ..... - .... ..... 01110001101 @VX_uim4 603VINSERTD 000100 ..... - .... ..... 01111001101 @VX_uim4 604 605VINSBLX 000100 ..... ..... ..... 01000001111 @VX 606VINSBRX 000100 ..... ..... ..... 01100001111 @VX 607VINSHLX 000100 ..... ..... ..... 01001001111 @VX 608VINSHRX 000100 ..... ..... ..... 01101001111 @VX 609VINSWLX 000100 ..... ..... ..... 01010001111 @VX 610VINSWRX 000100 ..... ..... ..... 01110001111 @VX 611VINSDLX 000100 ..... ..... ..... 01011001111 @VX 612VINSDRX 000100 ..... ..... ..... 01111001111 @VX 613 614VINSW 000100 ..... - .... ..... 00011001111 @VX_uim4 615VINSD 000100 ..... - .... ..... 00111001111 @VX_uim4 616 617VINSBVLX 000100 ..... ..... ..... 00000001111 @VX 618VINSBVRX 000100 ..... ..... ..... 00100001111 @VX 619VINSHVLX 000100 ..... ..... ..... 00001001111 @VX 620VINSHVRX 000100 ..... ..... ..... 00101001111 @VX 621VINSWVLX 000100 ..... ..... ..... 00010001111 @VX 622VINSWVRX 000100 ..... ..... ..... 00110001111 @VX 623 624VSLDBI 000100 ..... ..... ..... 00 ... 010110 @VN 625VSRDBI 000100 ..... ..... ..... 01 ... 010110 @VN 626 627VPERM 000100 ..... ..... ..... ..... 101011 @VA 628VPERMR 000100 ..... ..... ..... ..... 111011 @VA 629 630VSEL 000100 ..... ..... ..... ..... 101010 @VA 631 632## Vector Integer Shift Instruction 633 634VSLB 000100 ..... ..... ..... 00100000100 @VX 635VSLH 000100 ..... ..... ..... 00101000100 @VX 636VSLW 000100 ..... ..... ..... 00110000100 @VX 637VSLD 000100 ..... ..... ..... 10111000100 @VX 638VSLQ 000100 ..... ..... ..... 00100000101 @VX 639 640VSRB 000100 ..... ..... ..... 01000000100 @VX 641VSRH 000100 ..... ..... ..... 01001000100 @VX 642VSRW 000100 ..... ..... ..... 01010000100 @VX 643VSRD 000100 ..... ..... ..... 11011000100 @VX 644VSRQ 000100 ..... ..... ..... 01000000101 @VX 645 646VSRAB 000100 ..... ..... ..... 01100000100 @VX 647VSRAH 000100 ..... ..... ..... 01101000100 @VX 648VSRAW 000100 ..... ..... ..... 01110000100 @VX 649VSRAD 000100 ..... ..... ..... 01111000100 @VX 650VSRAQ 000100 ..... ..... ..... 01100000101 @VX 651 652VRLB 000100 ..... ..... ..... 00000000100 @VX 653VRLH 000100 ..... ..... ..... 00001000100 @VX 654VRLW 000100 ..... ..... ..... 00010000100 @VX 655VRLD 000100 ..... ..... ..... 00011000100 @VX 656VRLQ 000100 ..... ..... ..... 00000000101 @VX 657 658VRLWMI 000100 ..... ..... ..... 00010000101 @VX 659VRLDMI 000100 ..... ..... ..... 00011000101 @VX 660VRLQMI 000100 ..... ..... ..... 00001000101 @VX 661 662VRLWNM 000100 ..... ..... ..... 00110000101 @VX 663VRLDNM 000100 ..... ..... ..... 00111000101 @VX 664VRLQNM 000100 ..... ..... ..... 00101000101 @VX 665 666## Vector Integer Arithmetic Instructions 667 668VADDCUW 000100 ..... ..... ..... 00110000000 @VX 669VADDCUQ 000100 ..... ..... ..... 00101000000 @VX 670VADDUQM 000100 ..... ..... ..... 00100000000 @VX 671 672VADDEUQM 000100 ..... ..... ..... ..... 111100 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