1 # 2 # Power ISA decode for 32-bit insns (opcode space 0) 3 # 4 # Copyright (c) 2021 Instituto de Pesquisas Eldorado (eldorado.org.br) 5 # 6 # This library is free software; you can redistribute it and/or 7 # modify it under the terms of the GNU Lesser General Public 8 # License as published by the Free Software Foundation; either 9 # version 2.1 of the License, or (at your option) any later version. 10 # 11 # This library is distributed in the hope that it will be useful, 12 # but WITHOUT ANY WARRANTY; without even the implied warranty of 13 # MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE. See the GNU 14 # Lesser General Public License for more details. 15 # 16 # You should have received a copy of the GNU Lesser General Public 17 # License along with this library; if not, see <http://www.gnu.org/licenses/>. 18 # 19 20 &A frt fra frb frc rc:bool 21 @A ...... frt:5 fra:5 frb:5 frc:5 ..... rc:1 &A 22 23 &A_tb frt frb rc:bool 24 @A_tb ...... frt:5 ..... frb:5 ..... ..... rc:1 &A_tb 25 26 &D rt ra si:int64_t 27 @D ...... rt:5 ra:5 si:s16 &D 28 29 &D_bf bf l:bool ra imm 30 @D_bfs ...... bf:3 . l:1 ra:5 imm:s16 &D_bf 31 @D_bfu ...... bf:3 . l:1 ra:5 imm:16 &D_bf 32 33 %dq_si 4:s12 !function=times_16 34 %dq_rtp 22:4 !function=times_2 35 @DQ_rtp ...... ....0 ra:5 ............ .... &D rt=%dq_rtp si=%dq_si 36 37 %dq_rt_tsx 3:1 21:5 38 @DQ_TSX ...... ..... ra:5 ............ .... &D si=%dq_si rt=%dq_rt_tsx 39 40 %rt_tsxp 21:1 22:4 !function=times_2 41 @DQ_TSXP ...... ..... ra:5 ............ .... &D si=%dq_si rt=%rt_tsxp 42 43 %ds_si 2:s14 !function=times_4 44 @DS ...... rt:5 ra:5 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82 @VX_uim4 ...... vrt:5 . uim:4 vrb:5 ........... &VX_uim4 83 84 &VX_tb vrt vrb 85 @VX_tb ...... vrt:5 ..... vrb:5 ........... &VX_tb 86 87 &X rt ra rb 88 @X ...... rt:5 ra:5 rb:5 .......... . &X 89 90 &X_rc rt ra rb rc:bool 91 @X_rc ...... rt:5 ra:5 rb:5 .......... rc:1 &X_rc 92 93 &X_sa rs ra 94 @X_sa ...... rs:5 ra:5 ..... .......... . &X_sa 95 96 %x_frtp 22:4 !function=times_2 97 %x_frap 17:4 !function=times_2 98 %x_frbp 12:4 !function=times_2 99 @X_tp_ap_bp_rc ...... ....0 ....0 ....0 .......... rc:1 &X_rc rt=%x_frtp ra=%x_frap rb=%x_frbp 100 101 @X_tp_a_bp_rc ...... ....0 ra:5 ....0 .......... rc:1 &X_rc rt=%x_frtp rb=%x_frbp 102 103 &X_t rt 104 @X_t ...... rt:5 ..... ..... .......... . &X_t 105 106 &X_tb rt rb 107 @X_tb ...... rt:5 ..... rb:5 .......... . &X_tb 108 109 &X_t_rc rt rc:bool 110 @X_t_rc ...... rt:5 ..... ..... .......... rc:1 &X_t_rc 111 112 &X_tb_rc rt rb rc:bool 113 @X_tb_rc ...... rt:5 ..... rb:5 .......... rc:1 &X_tb_rc 114 115 @X_tbp_rc ...... ....0 ..... ....0 .......... rc:1 &X_tb_rc rt=%x_frtp rb=%x_frbp 116 117 @X_tp_b_rc ...... ....0 ..... rb:5 .......... rc:1 &X_tb_rc rt=%x_frtp 118 119 @X_t_bp_rc ...... rt:5 ..... ....0 .......... rc:1 &X_tb_rc rb=%x_frbp 120 121 &X_bi rt bi 122 @X_bi ...... rt:5 bi:5 ..... .......... . &X_bi 123 124 &X_bf bf ra rb 125 @X_bf ...... bf:3 .. ra:5 rb:5 .......... . &X_bf 126 127 @X_bf_ap_bp ...... bf:3 .. ....0 ....0 .......... . &X_bf ra=%x_frap rb=%x_frbp 128 129 @X_bf_a_bp ...... bf:3 .. ra:5 ....0 .......... . &X_bf rb=%x_frbp 130 131 &X_bf_uim bf uim rb 132 @X_bf_uim ...... bf:3 . uim:6 rb:5 .......... . &X_bf_uim 133 134 @X_bf_uim_bp ...... bf:3 . uim:6 ....0 .......... . &X_bf_uim rb=%x_frbp 135 136 &X_bfl bf l:bool ra rb 137 @X_bfl ...... bf:3 . l:1 ra:5 rb:5 .......... . &X_bfl 138 139 &X_imm2 rt imm 140 @X_imm2 ...... rt:5 ..... ... imm:2 .......... . &X_imm2 141 142 &X_imm3 rt imm 143 @X_imm3 ...... rt:5 ..... .. imm:3 .......... . &X_imm3 144 145 %x_xt 0:1 21:5 146 &X_imm5 xt imm:uint8_t vrb 147 @X_imm5 ...... ..... imm:5 vrb:5 .......... . &X_imm5 xt=%x_xt 148 149 &X_imm8 xt imm:uint8_t 150 @X_imm8 ...... ..... .. imm:8 .......... . &X_imm8 xt=%x_xt 151 152 &X_ih ih:uint8_t 153 @X_ih ...... .. ih:3 ..... ..... .......... . &X_ih 154 155 &X_rb rb 156 @X_rb ...... ..... ..... rb:5 .......... . &X_rb 157 158 &X_rs_l rs l:bool 159 @X_rs_l ...... rs:5 .... l:1 ..... .......... . &X_rs_l 160 161 &X_uim5 xt uim:uint8_t 162 @X_uim5 ...... ..... ..... uim:5 .......... . &X_uim5 xt=%x_xt 163 164 &X_tb_sp_rc rt rb sp rc:bool 165 @X_tb_sp_rc ...... rt:5 sp:2 ... rb:5 .......... rc:1 &X_tb_sp_rc 166 167 @X_tbp_sp_rc ...... ....0 sp:2 ... ....0 .......... rc:1 &X_tb_sp_rc rt=%x_frtp rb=%x_frbp 168 169 &X_tb_s_rc rt rb s:bool rc:bool 170 @X_tb_s_rc ...... rt:5 s:1 .... rb:5 .......... rc:1 &X_tb_s_rc 171 172 @X_tbp_s_rc ...... ....0 s:1 .... ....0 .......... rc:1 &X_tb_s_rc rt=%x_frtp rb=%x_frbp 173 174 %x_rt_tsx 0:1 21:5 175 @X_TSX ...... ..... ra:5 rb:5 .......... . &X rt=%x_rt_tsx 176 @X_TSXP ...... ..... ra:5 rb:5 .......... . &X rt=%rt_tsxp 177 178 %x_dw 0:1 21:5 !function=dw_compose_ea 179 @X_DW ...... ..... ra:5 rb:5 .......... . &X rt=%x_dw 180 181 &X_frtp_vrb frtp vrb 182 @X_frtp_vrb ...... ....0 ..... vrb:5 .......... . &X_frtp_vrb frtp=%x_frtp 183 184 &X_vrt_frbp vrt frbp 185 @X_vrt_frbp ...... vrt:5 ..... ....0 .......... . &X_vrt_frbp frbp=%x_frbp 186 187 &X_a ra 188 @X_a ...... ra:3 .. ..... ..... .......... . &X_a 189 190 &XO rt ra rb oe:bool rc:bool 191 @XO ...... rt:5 ra:5 rb:5 oe:1 ......... rc:1 &XO 192 193 &XO_ta rt ra oe:bool rc:bool 194 @XO_ta ...... rt:5 ra:5 ..... oe:1 ......... rc:1 &XO_ta 195 196 %xx_xt 0:1 21:5 197 %xx_xb 1:1 11:5 198 %xx_xa 2:1 16:5 199 %xx_xc 3:1 6:5 200 &XX2 xt xb 201 @XX2 ...... ..... ..... ..... ......... .. &XX2 xt=%xx_xt xb=%xx_xb 202 203 &XX2_uim xt xb uim:uint8_t 204 @XX2_uim2 ...... ..... ... uim:2 ..... ......... .. &XX2_uim xt=%xx_xt xb=%xx_xb 205 206 @XX2_uim4 ...... ..... . uim:4 ..... ......... .. &XX2_uim xt=%xx_xt xb=%xx_xb 207 208 %xx_uim7 6:1 2:1 16:5 209 @XX2_uim7 ...... ..... ..... ..... .... . ... . .. &XX2_uim xt=%xx_xt xb=%xx_xb uim=%xx_uim7 210 211 &XX2_bf_uim bf xb uim 212 @XX2_bf_uim ...... bf:3 uim:7 ..... ......... . . &XX2_bf_uim 213 214 &XX2_bf_xb bf xb 215 @XX2_bf_xb ...... bf:3 .. ..... ..... ......... . . &XX2_bf_xb xb=%xx_xb 216 217 &XX3 xt xa xb 218 @XX3 ...... ..... ..... ..... ........ ... &XX3 xt=%xx_xt xa=%xx_xa xb=%xx_xb 219 220 # 32 bit GER instructions have all mask bits considered 1 221 &MMIRR_XX3 xa xb xt pmsk xmsk ymsk 222 %xx_at 23:3 223 %xx_xa_pair 2:1 17:4 !function=times_2 224 @XX3_at ...... ... .. ..... ..... ........ ... &MMIRR_XX3 xt=%xx_at xb=%xx_xb \ 225 pmsk=255 xmsk=15 ymsk=15 226 227 &XX3_dm xt xa xb dm 228 @XX3_dm ...... ..... ..... ..... . dm:2 ..... ... &XX3_dm xt=%xx_xt xa=%xx_xa xb=%xx_xb 229 230 &XX4 xt xa xb xc 231 @XX4 ...... ..... ..... ..... ..... .. .... &XX4 xt=%xx_xt xa=%xx_xa xb=%xx_xb xc=%xx_xc 232 233 &Z22_bf_fra bf fra dm 234 @Z22_bf_fra ...... bf:3 .. fra:5 dm:6 ......... . &Z22_bf_fra 235 236 %z22_frap 17:4 !function=times_2 237 @Z22_bf_frap ...... bf:3 .. ....0 dm:6 ......... . &Z22_bf_fra fra=%z22_frap 238 239 &Z22_ta_sh_rc rt ra sh rc:bool 240 @Z22_ta_sh_rc ...... rt:5 ra:5 sh:6 ......... rc:1 &Z22_ta_sh_rc 241 242 %z22_frtp 22:4 !function=times_2 243 @Z22_tap_sh_rc ...... ....0 ....0 sh:6 ......... rc:1 &Z22_ta_sh_rc rt=%z22_frtp ra=%z22_frap 244 245 &Z23_tab frt fra frb rmc rc:bool 246 @Z23_tab ...... frt:5 fra:5 frb:5 rmc:2 ........ rc:1 &Z23_tab 247 248 %z23_frtp 22:4 !function=times_2 249 %z23_frap 17:4 !function=times_2 250 %z23_frbp 12:4 !function=times_2 251 @Z23_tabp ...... ....0 ....0 ....0 rmc:2 ........ rc:1 &Z23_tab frt=%z23_frtp fra=%z23_frap frb=%z23_frbp 252 253 @Z23_tp_a_bp ...... ....0 fra:5 ....0 rmc:2 ........ rc:1 &Z23_tab frt=%z23_frtp frb=%z23_frbp 254 255 &Z23_tb frt frb r:bool rmc rc:bool 256 @Z23_tb ...... frt:5 .... r:1 frb:5 rmc:2 ........ rc:1 &Z23_tb 257 258 @Z23_tbp ...... ....0 .... r:1 ....0 rmc:2 ........ rc:1 &Z23_tb frt=%z23_frtp frb=%z23_frbp 259 260 &Z23_te_tb te frt frb rmc rc:bool 261 @Z23_te_tb ...... frt:5 te:5 frb:5 rmc:2 ........ rc:1 &Z23_te_tb 262 263 @Z23_te_tbp ...... ....0 te:5 ....0 rmc:2 ........ rc:1 &Z23_te_tb frt=%z23_frtp frb=%z23_frbp 264 265 ### Fixed-Point Load Instructions 266 267 LBZ 100010 ..... ..... ................ @D 268 LBZU 100011 ..... ..... ................ @D 269 LBZX 011111 ..... ..... ..... 0001010111 - @X 270 LBZUX 011111 ..... ..... ..... 0001110111 - @X 271 272 LHZ 101000 ..... ..... ................ @D 273 LHZU 101001 ..... ..... ................ @D 274 LHZX 011111 ..... ..... ..... 0100010111 - @X 275 LHZUX 011111 ..... ..... ..... 0100110111 - @X 276 277 LHA 101010 ..... ..... ................ @D 278 LHAU 101011 ..... ..... ................ @D 279 LHAX 011111 ..... ..... ..... 0101010111 - @X 280 LHAXU 011111 ..... ..... ..... 0101110111 - @X 281 282 LWZ 100000 ..... ..... ................ @D 283 LWZU 100001 ..... ..... ................ @D 284 LWZX 011111 ..... ..... ..... 0000010111 - @X 285 LWZUX 011111 ..... ..... ..... 0000110111 - @X 286 287 LWA 111010 ..... ..... ..............10 @DS 288 LWAX 011111 ..... ..... ..... 0101010101 - @X 289 LWAUX 011111 ..... ..... ..... 0101110101 - @X 290 291 LD 111010 ..... ..... ..............00 @DS 292 LDU 111010 ..... ..... ..............01 @DS 293 LDX 011111 ..... ..... ..... 0000010101 - @X 294 LDUX 011111 ..... ..... ..... 0000110101 - @X 295 296 LQ 111000 ..... ..... ............ ---- @DQ_rtp 297 298 ### Fixed-Point Store Instructions 299 300 STB 100110 ..... ..... ................ @D 301 STBU 100111 ..... ..... ................ @D 302 STBX 011111 ..... ..... ..... 0011010111 - @X 303 STBUX 011111 ..... ..... ..... 0011110111 - @X 304 305 STH 101100 ..... ..... ................ @D 306 STHU 101101 ..... ..... ................ @D 307 STHX 011111 ..... ..... ..... 0110010111 - @X 308 STHUX 011111 ..... ..... ..... 0110110111 - @X 309 310 STW 100100 ..... ..... ................ @D 311 STWU 100101 ..... ..... ................ @D 312 STWX 011111 ..... ..... ..... 0010010111 - @X 313 STWUX 011111 ..... ..... ..... 0010110111 - @X 314 315 STD 111110 ..... ..... ..............00 @DS 316 STDU 111110 ..... ..... ..............01 @DS 317 STDX 011111 ..... ..... ..... 0010010101 - @X 318 STDUX 011111 ..... ..... ..... 0010110101 - @X 319 320 STQ 111110 ..... ..... ..............10 @DS_rtp 321 322 ### Fixed-Point Compare Instructions 323 324 CMP 011111 ... - . ..... ..... 0000000000 - @X_bfl 325 CMPL 011111 ... - . ..... ..... 0000100000 - @X_bfl 326 CMPI 001011 ... - . ..... ................ @D_bfs 327 CMPLI 001010 ... - . ..... ................ @D_bfu 328 329 ### Fixed-Point Arithmetic Instructions 330 331 ADD 011111 ..... ..... ..... . 100001010 . @XO 332 ADDC 011111 ..... ..... ..... . 000001010 . @XO 333 ADDE 011111 ..... ..... ..... . 010001010 . @XO 334 335 # ADDEX is Z23-form, with CY=0; all other values for CY are reserved. 336 # This works out the same as X-form. 337 ADDEX 011111 ..... ..... ..... 00 10101010 - @X 338 339 ADDI 001110 ..... ..... ................ @D 340 ADDIS 001111 ..... ..... ................ @D 341 ADDIC 001100 ..... ..... ................ @D 342 ADDIC_ 001101 ..... ..... ................ @D 343 344 ADDPCIS 010011 ..... ..... .......... 00010 . @DX 345 ADDME 011111 ..... ..... ----- . 011101010 . @XO_ta 346 ADDZE 011111 ..... ..... ----- . 011001010 . @XO_ta 347 348 SUBF 011111 ..... ..... ..... . 000101000 . @XO 349 SUBFIC 001000 ..... ..... ................ @D 350 SUBFC 011111 ..... ..... ..... . 000001000 . @XO 351 SUBFE 011111 ..... ..... ..... . 010001000 . @XO 352 353 SUBFME 011111 ..... ..... ----- . 011101000 . @XO_ta 354 SUBFZE 011111 ..... ..... ----- . 011001000 . @XO_ta 355 356 ## Fixed-Point Logical Instructions 357 358 CFUGED 011111 ..... ..... ..... 0011011100 - @X 359 CNTLZDM 011111 ..... ..... ..... 0000111011 - @X 360 CNTTZDM 011111 ..... ..... ..... 1000111011 - @X 361 PDEPD 011111 ..... ..... ..... 0010011100 - @X 362 PEXTD 011111 ..... ..... ..... 0010111100 - @X 363 364 # Fixed-Point Hash Instructions 365 366 HASHST 011111 ..... ..... ..... 1011010010 . @X_DW 367 HASHCHK 011111 ..... ..... ..... 1011110010 . @X_DW 368 HASHSTP 011111 ..... ..... ..... 1010010010 . @X_DW 369 HASHCHKP 011111 ..... ..... ..... 1010110010 . @X_DW 370 371 ## BCD Assist 372 373 ADDG6S 011111 ..... ..... ..... - 001001010 - @X 374 CDTBCD 011111 ..... ..... ----- 0100011010 - @X_sa 375 CBCDTD 011111 ..... ..... ----- 0100111010 - @X_sa 376 377 ### Float-Point Load Instructions 378 379 LFS 110000 ..... ..... ................ @D 380 LFSU 110001 ..... ..... ................ @D 381 LFSX 011111 ..... ..... ..... 1000010111 - @X 382 LFSUX 011111 ..... ..... ..... 1000110111 - @X 383 384 LFD 110010 ..... ..... ................ @D 385 LFDU 110011 ..... ..... ................ @D 386 LFDX 011111 ..... ..... ..... 1001010111 - @X 387 LFDUX 011111 ..... ..... ..... 1001110111 - @X 388 389 ### Float-Point Store Instructions 390 391 STFS 110100 ..... ...... ............... @D 392 STFSU 110101 ..... ...... ............... @D 393 STFSX 011111 ..... ...... .... 1010010111 - @X 394 STFSUX 011111 ..... ...... .... 1010110111 - @X 395 396 STFD 110110 ..... ...... ............... @D 397 STFDU 110111 ..... ...... ............... @D 398 STFDX 011111 ..... ...... .... 1011010111 - @X 399 STFDUX 011111 ..... ...... .... 1011110111 - @X 400 401 ### Floating-Point Arithmetic Instructions 402 403 FSQRT 111111 ..... ----- ..... ----- 10110 . @A_tb 404 FSQRTS 111011 ..... ----- ..... ----- 10110 . @A_tb 405 406 ### Floating-Point Select Instruction 407 408 FSEL 111111 ..... ..... ..... ..... 10111 . @A 409 410 ### Move To/From System Register Instructions 411 412 SETBC 011111 ..... ..... ----- 0110000000 - @X_bi 413 SETBCR 011111 ..... ..... ----- 0110100000 - @X_bi 414 SETNBC 011111 ..... ..... ----- 0111000000 - @X_bi 415 SETNBCR 011111 ..... ..... ----- 0111100000 - @X_bi 416 417 ### Move To/From FPSCR 418 419 { 420 # Before Power ISA v3.0, MFFS bits 11~15 were reserved and should be ignored 421 MFFS_ISA207 111111 ..... ----- ----- 1001000111 . @X_t_rc 422 [ 423 MFFS 111111 ..... 00000 ----- 1001000111 . @X_t_rc 424 MFFSCE 111111 ..... 00001 ----- 1001000111 - @X_t 425 MFFSCRN 111111 ..... 10110 ..... 1001000111 - @X_tb 426 MFFSCDRN 111111 ..... 10100 ..... 1001000111 - @X_tb 427 MFFSCRNI 111111 ..... 10111 ---.. 1001000111 - @X_imm2 428 MFFSCDRNI 111111 ..... 10101 --... 1001000111 - @X_imm3 429 MFFSL 111111 ..... 11000 ----- 1001000111 - @X_t 430 ] 431 } 432 433 ### Decimal Floating-Point Arithmetic Instructions 434 435 DADD 111011 ..... ..... ..... 0000000010 . @X_rc 436 DADDQ 111111 ..... ..... ..... 0000000010 . @X_tp_ap_bp_rc 437 438 DSUB 111011 ..... ..... ..... 1000000010 . @X_rc 439 DSUBQ 111111 ..... ..... ..... 1000000010 . @X_tp_ap_bp_rc 440 441 DMUL 111011 ..... ..... ..... 0000100010 . @X_rc 442 DMULQ 111111 ..... ..... ..... 0000100010 . @X_tp_ap_bp_rc 443 444 DDIV 111011 ..... ..... ..... 1000100010 . @X_rc 445 DDIVQ 111111 ..... ..... ..... 1000100010 . @X_tp_ap_bp_rc 446 447 ### Decimal Floating-Point Compare Instructions 448 449 DCMPU 111011 ... -- ..... ..... 1010000010 - @X_bf 450 DCMPUQ 111111 ... -- ..... ..... 1010000010 - @X_bf_ap_bp 451 452 DCMPO 111011 ... -- ..... ..... 0010000010 - @X_bf 453 DCMPOQ 111111 ... -- ..... ..... 0010000010 - @X_bf_ap_bp 454 455 ### Decimal Floating-Point Test Instructions 456 457 DTSTDC 111011 ... -- ..... ...... 011000010 - @Z22_bf_fra 458 DTSTDCQ 111111 ... -- ..... ...... 011000010 - @Z22_bf_frap 459 460 DTSTDG 111011 ... -- ..... ...... 011100010 - @Z22_bf_fra 461 DTSTDGQ 111111 ... -- ..... ...... 011100010 - @Z22_bf_frap 462 463 DTSTEX 111011 ... -- ..... ..... 0010100010 - @X_bf 464 DTSTEXQ 111111 ... -- ..... ..... 0010100010 - @X_bf_ap_bp 465 466 DTSTSF 111011 ... -- ..... ..... 1010100010 - @X_bf 467 DTSTSFQ 111111 ... -- ..... ..... 1010100010 - @X_bf_a_bp 468 469 DTSTSFI 111011 ... - ...... ..... 1010100011 - @X_bf_uim 470 DTSTSFIQ 111111 ... - ...... ..... 1010100011 - @X_bf_uim_bp 471 472 ### Decimal Floating-Point Quantum Adjustment Instructions 473 474 DQUAI 111011 ..... ..... ..... .. 01000011 . @Z23_te_tb 475 DQUAIQ 111111 ..... ..... ..... .. 01000011 . @Z23_te_tbp 476 477 DQUA 111011 ..... ..... ..... .. 00000011 . @Z23_tab 478 DQUAQ 111111 ..... ..... ..... .. 00000011 . @Z23_tabp 479 480 DRRND 111011 ..... ..... ..... .. 00100011 . @Z23_tab 481 DRRNDQ 111111 ..... ..... ..... .. 00100011 . @Z23_tp_a_bp 482 483 DRINTX 111011 ..... ---- . ..... .. 01100011 . @Z23_tb 484 DRINTXQ 111111 ..... ---- . ..... .. 01100011 . @Z23_tbp 485 486 DRINTN 111011 ..... ---- . ..... .. 11100011 . @Z23_tb 487 DRINTNQ 111111 ..... ---- . ..... .. 11100011 . @Z23_tbp 488 489 ### Decimal Floating-Point Conversion Instructions 490 491 DCTDP 111011 ..... ----- ..... 0100000010 . @X_tb_rc 492 DCTQPQ 111111 ..... ----- ..... 0100000010 . @X_tp_b_rc 493 494 DRSP 111011 ..... ----- ..... 1100000010 . @X_tb_rc 495 DRDPQ 111111 ..... ----- ..... 1100000010 . @X_tbp_rc 496 497 DCFFIX 111011 ..... ----- ..... 1100100010 . @X_tb_rc 498 DCFFIXQ 111111 ..... ----- ..... 1100100010 . @X_tp_b_rc 499 DCFFIXQQ 111111 ..... 00000 ..... 1111100010 - @X_frtp_vrb 500 501 DCTFIX 111011 ..... ----- ..... 0100100010 . @X_tb_rc 502 DCTFIXQ 111111 ..... ----- ..... 0100100010 . @X_t_bp_rc 503 DCTFIXQQ 111111 ..... 00001 ..... 1111100010 - @X_vrt_frbp 504 505 ### Decimal Floating-Point Format Instructions 506 507 DDEDPD 111011 ..... .. --- ..... 0101000010 . @X_tb_sp_rc 508 DDEDPDQ 111111 ..... .. --- ..... 0101000010 . @X_tbp_sp_rc 509 510 DENBCD 111011 ..... . ---- ..... 1101000010 . @X_tb_s_rc 511 DENBCDQ 111111 ..... . ---- ..... 1101000010 . @X_tbp_s_rc 512 513 DXEX 111011 ..... ----- ..... 0101100010 . @X_tb_rc 514 DXEXQ 111111 ..... ----- ..... 0101100010 . @X_t_bp_rc 515 516 DIEX 111011 ..... ..... ..... 1101100010 . @X_rc 517 DIEXQ 111111 ..... ..... ..... 1101100010 . @X_tp_a_bp_rc 518 519 DSCLI 111011 ..... ..... ...... 001000010 . @Z22_ta_sh_rc 520 DSCLIQ 111111 ..... ..... ...... 001000010 . @Z22_tap_sh_rc 521 522 DSCRI 111011 ..... ..... ...... 001100010 . @Z22_ta_sh_rc 523 DSCRIQ 111111 ..... ..... ...... 001100010 . @Z22_tap_sh_rc 524 525 ## Vector Exclusive-OR-based Instructions 526 527 VPMSUMD 000100 ..... ..... ..... 10011001000 @VX 528 529 ## Vector Integer Instructions 530 531 VCMPEQUB 000100 ..... ..... ..... . 0000000110 @VC 532 VCMPEQUH 000100 ..... ..... ..... . 0001000110 @VC 533 VCMPEQUW 000100 ..... ..... ..... . 0010000110 @VC 534 VCMPEQUD 000100 ..... ..... ..... . 0011000111 @VC 535 VCMPEQUQ 000100 ..... ..... ..... . 0111000111 @VC 536 537 VCMPGTSB 000100 ..... ..... ..... . 1100000110 @VC 538 VCMPGTSH 000100 ..... ..... ..... . 1101000110 @VC 539 VCMPGTSW 000100 ..... ..... ..... . 1110000110 @VC 540 VCMPGTSD 000100 ..... ..... ..... . 1111000111 @VC 541 VCMPGTSQ 000100 ..... ..... ..... . 1110000111 @VC 542 543 VCMPGTUB 000100 ..... ..... ..... . 1000000110 @VC 544 VCMPGTUH 000100 ..... ..... ..... . 1001000110 @VC 545 VCMPGTUW 000100 ..... ..... ..... . 1010000110 @VC 546 VCMPGTUD 000100 ..... ..... ..... . 1011000111 @VC 547 VCMPGTUQ 000100 ..... ..... ..... . 1010000111 @VC 548 549 VCMPNEB 000100 ..... ..... ..... . 0000000111 @VC 550 VCMPNEH 000100 ..... ..... ..... . 0001000111 @VC 551 VCMPNEW 000100 ..... ..... ..... . 0010000111 @VC 552 553 VCMPNEZB 000100 ..... ..... ..... . 0100000111 @VC 554 VCMPNEZH 000100 ..... ..... ..... . 0101000111 @VC 555 VCMPNEZW 000100 ..... ..... ..... . 0110000111 @VC 556 557 VCMPSQ 000100 ... -- ..... ..... 00101000001 @VX_bf 558 VCMPUQ 000100 ... -- ..... ..... 00100000001 @VX_bf 559 560 ## Vector Integer Average Instructions 561 562 VAVGSB 000100 ..... ..... ..... 10100000010 @VX 563 VAVGSH 000100 ..... ..... ..... 10101000010 @VX 564 VAVGSW 000100 ..... ..... ..... 10110000010 @VX 565 VAVGUB 000100 ..... ..... ..... 10000000010 @VX 566 VAVGUH 000100 ..... ..... ..... 10001000010 @VX 567 VAVGUW 000100 ..... ..... ..... 10010000010 @VX 568 569 ## Vector Integer Absolute Difference Instructions 570 571 VABSDUB 000100 ..... ..... ..... 10000000011 @VX 572 VABSDUH 000100 ..... ..... ..... 10001000011 @VX 573 VABSDUW 000100 ..... ..... ..... 10010000011 @VX 574 575 ## Vector Bit Manipulation Instruction 576 577 VGNB 000100 ..... -- ... ..... 10011001100 @VX_n 578 579 VCFUGED 000100 ..... ..... ..... 10101001101 @VX 580 VCLZDM 000100 ..... ..... ..... 11110000100 @VX 581 VCTZDM 000100 ..... ..... ..... 11111000100 @VX 582 VPDEPD 000100 ..... ..... ..... 10111001101 @VX 583 VPEXTD 000100 ..... ..... ..... 10110001101 @VX 584 585 VPRTYBD 000100 ..... 01001 ..... 11000000010 @VX_tb 586 VPRTYBQ 000100 ..... 01010 ..... 11000000010 @VX_tb 587 VPRTYBW 000100 ..... 01000 ..... 11000000010 @VX_tb 588 589 ## Vector Permute and Formatting Instruction 590 591 VEXTDUBVLX 000100 ..... ..... ..... ..... 011000 @VA 592 VEXTDUBVRX 000100 ..... ..... ..... ..... 011001 @VA 593 VEXTDUHVLX 000100 ..... ..... ..... ..... 011010 @VA 594 VEXTDUHVRX 000100 ..... ..... ..... ..... 011011 @VA 595 VEXTDUWVLX 000100 ..... ..... ..... ..... 011100 @VA 596 VEXTDUWVRX 000100 ..... ..... ..... ..... 011101 @VA 597 VEXTDDVLX 000100 ..... ..... ..... ..... 011110 @VA 598 VEXTDDVRX 000100 ..... ..... ..... ..... 011111 @VA 599 600 VINSERTB 000100 ..... - .... ..... 01100001101 @VX_uim4 601 VINSERTH 000100 ..... - .... ..... 01101001101 @VX_uim4 602 VINSERTW 000100 ..... - .... ..... 01110001101 @VX_uim4 603 VINSERTD 000100 ..... - .... ..... 01111001101 @VX_uim4 604 605 VINSBLX 000100 ..... ..... ..... 01000001111 @VX 606 VINSBRX 000100 ..... ..... ..... 01100001111 @VX 607 VINSHLX 000100 ..... ..... ..... 01001001111 @VX 608 VINSHRX 000100 ..... ..... ..... 01101001111 @VX 609 VINSWLX 000100 ..... ..... ..... 01010001111 @VX 610 VINSWRX 000100 ..... ..... ..... 01110001111 @VX 611 VINSDLX 000100 ..... ..... ..... 01011001111 @VX 612 VINSDRX 000100 ..... ..... ..... 01111001111 @VX 613 614 VINSW 000100 ..... - .... ..... 00011001111 @VX_uim4 615 VINSD 000100 ..... - .... ..... 00111001111 @VX_uim4 616 617 VINSBVLX 000100 ..... ..... ..... 00000001111 @VX 618 VINSBVRX 000100 ..... ..... ..... 00100001111 @VX 619 VINSHVLX 000100 ..... ..... ..... 00001001111 @VX 620 VINSHVRX 000100 ..... ..... ..... 00101001111 @VX 621 VINSWVLX 000100 ..... ..... ..... 00010001111 @VX 622 VINSWVRX 000100 ..... ..... ..... 00110001111 @VX 623 624 VSLDBI 000100 ..... ..... ..... 00 ... 010110 @VN 625 VSRDBI 000100 ..... ..... ..... 01 ... 010110 @VN 626 627 VPERM 000100 ..... ..... ..... ..... 101011 @VA 628 VPERMR 000100 ..... ..... ..... ..... 111011 @VA 629 630 VSEL 000100 ..... ..... ..... ..... 101010 @VA 631 632 ## Vector Integer Shift Instruction 633 634 VSLB 000100 ..... ..... ..... 00100000100 @VX 635 VSLH 000100 ..... ..... ..... 00101000100 @VX 636 VSLW 000100 ..... ..... ..... 00110000100 @VX 637 VSLD 000100 ..... ..... ..... 10111000100 @VX 638 VSLQ 000100 ..... ..... ..... 00100000101 @VX 639 640 VSRB 000100 ..... ..... ..... 01000000100 @VX 641 VSRH 000100 ..... ..... ..... 01001000100 @VX 642 VSRW 000100 ..... ..... ..... 01010000100 @VX 643 VSRD 000100 ..... ..... ..... 11011000100 @VX 644 VSRQ 000100 ..... ..... ..... 01000000101 @VX 645 646 VSRAB 000100 ..... ..... ..... 01100000100 @VX 647 VSRAH 000100 ..... ..... ..... 01101000100 @VX 648 VSRAW 000100 ..... ..... ..... 01110000100 @VX 649 VSRAD 000100 ..... ..... ..... 01111000100 @VX 650 VSRAQ 000100 ..... ..... ..... 01100000101 @VX 651 652 VRLB 000100 ..... ..... ..... 00000000100 @VX 653 VRLH 000100 ..... ..... ..... 00001000100 @VX 654 VRLW 000100 ..... ..... ..... 00010000100 @VX 655 VRLD 000100 ..... ..... ..... 00011000100 @VX 656 VRLQ 000100 ..... ..... ..... 00000000101 @VX 657 658 VRLWMI 000100 ..... ..... ..... 00010000101 @VX 659 VRLDMI 000100 ..... ..... ..... 00011000101 @VX 660 VRLQMI 000100 ..... ..... ..... 00001000101 @VX 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VEXTSW2D 000100 ..... 11010 ..... 11000000010 @VX_tb 687 VEXTSD2Q 000100 ..... 11011 ..... 11000000010 @VX_tb 688 689 VNEGD 000100 ..... 00111 ..... 11000000010 @VX_tb 690 VNEGW 000100 ..... 00110 ..... 11000000010 @VX_tb 691 692 ## Vector Mask Manipulation Instructions 693 694 MTVSRBM 000100 ..... 10000 ..... 11001000010 @VX_tb 695 MTVSRHM 000100 ..... 10001 ..... 11001000010 @VX_tb 696 MTVSRWM 000100 ..... 10010 ..... 11001000010 @VX_tb 697 MTVSRDM 000100 ..... 10011 ..... 11001000010 @VX_tb 698 MTVSRQM 000100 ..... 10100 ..... 11001000010 @VX_tb 699 MTVSRBMI 000100 ..... ..... .......... 01010 . @DX_b 700 701 VEXPANDBM 000100 ..... 00000 ..... 11001000010 @VX_tb 702 VEXPANDHM 000100 ..... 00001 ..... 11001000010 @VX_tb 703 VEXPANDWM 000100 ..... 00010 ..... 11001000010 @VX_tb 704 VEXPANDDM 000100 ..... 00011 ..... 11001000010 @VX_tb 705 VEXPANDQM 000100 ..... 00100 ..... 11001000010 @VX_tb 706 707 VEXTRACTBM 000100 ..... 01000 ..... 11001000010 @VX_tb 708 VEXTRACTHM 000100 ..... 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