xref: /openbmc/qemu/target/mips/tcg/msa.decode (revision b83a80e8)
1# MIPS SIMD Architecture Module instruction set
2#
3# Copyright (C) 2020  Philippe Mathieu-Daudé
4#
5# SPDX-License-Identifier: LGPL-2.1-or-later
6#
7# Reference:
8#       MIPS Architecture for Programmers Volume IV-j
9#       - The MIPS32 SIMD Architecture Module, Revision 1.12
10#         (Document Number: MD00866-2B-MSA32-AFP-01.12)
11#       - The MIPS64 SIMD Architecture Module, Revision 1.12
12#         (Document Number: MD00868-1D-MSA64-AFP-01.12)
13
14&r                  rs rt rd sa
15
16&msa_r              df  wd ws wt
17&msa_bz             df        wt sa
18&msa_ldi            df  wd       sa
19&msa_i              df  wd ws    sa
20&msa_bit            df  wd ws       m
21&msa_elm_df         df  wd ws       n
22&msa_elm                wd ws
23
24%elm_df             16:6 !function=elm_df
25%elm_n              16:6 !function=elm_n
26%bit_df             16:7 !function=bit_df
27%bit_m              16:7 !function=bit_m
28%2r_df_w            16:1 !function=plus_2
29%3r_df_h            21:1 !function=plus_1
30%3r_df_w            21:1 !function=plus_2
31
32@lsa                ...... rs:5 rt:5 rd:5 ... sa:2 ......   &r
33@ldst               ...... sa:s10 ws:5 wd:5 .... df:2       &msa_i
34@bz_v               ...... ... ..    wt:5 sa:16             &msa_bz df=3
35@bz                 ...... ...  df:2 wt:5 sa:16             &msa_bz
36@elm_df             ...... .... ......    ws:5 wd:5 ......  &msa_elm_df df=%elm_df n=%elm_n
37@elm                ...... ..........     ws:5 wd:5 ......  &msa_elm
38@vec                ...... .....     wt:5 ws:5 wd:5 ......  &msa_r df=0
39@2r                 ...... ........  df:2 ws:5 wd:5 ......  &msa_r wt=0
40@2rf                ...... ......... .    ws:5 wd:5 ......  &msa_r wt=0 df=%2r_df_w
41@3r                 ...... ...  df:2 wt:5 ws:5 wd:5 ......  &msa_r
42@3rf_h              ...... .... .    wt:5 ws:5 wd:5 ......  &msa_r df=%3r_df_h
43@3rf_w              ...... .... .    wt:5 ws:5 wd:5 ......  &msa_r df=%3r_df_w
44@u5                 ...... ... df:2 sa:5  ws:5 wd:5 ......  &msa_i
45@s5                 ...... ... df:2 sa:s5 ws:5 wd:5 ......  &msa_i
46@i8_df              ......     df:2 sa:s8 ws:5 wd:5 ......  &msa_i
47@i8                 ...... ..       sa:s8 ws:5 wd:5 ......  &msa_i df=0
48@ldi                ...... ... df:2 sa:s10     wd:5 ......  &msa_ldi
49@bit                ...... ... .......    ws:5 wd:5 ......  &msa_bit df=%bit_df m=%bit_m
50
51LSA                 000000 ..... ..... ..... 000 .. 000101  @lsa
52DLSA                000000 ..... ..... ..... 000 .. 010101  @lsa
53
54BZ_V                010001 01011  ..... ................    @bz_v
55BNZ_V               010001 01111  ..... ................    @bz_v
56BZ                  010001 110 .. ..... ................    @bz
57BNZ                 010001 111 .. ..... ................    @bz
58
59ANDI                011110 00 ........ ..... .....  000000  @i8
60ORI                 011110 01 ........ ..... .....  000000  @i8
61NORI                011110 10 ........ ..... .....  000000  @i8
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63BMNZI               011110 00 ........ ..... .....  000001  @i8
64BMZI                011110 01 ........ ..... .....  000001  @i8
65BSELI               011110 10 ........ ..... .....  000001  @i8
66SHF                 011110 .. ........ ..... .....  000010  @i8_df
67
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74
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77CLTI_U              011110 011 .. ..... ..... ..... 000111  @u5
78CLEI_S              011110 100 .. ..... ..... ..... 000111  @s5
79CLEI_U              011110 101 .. ..... ..... ..... 000111  @u5
80
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82
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85SRLI                011110 010 ....... ..... .....  001001  @bit
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91
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93SAT_U               011110 001 ....... ..... .....  001010  @bit
94SRARI               011110 010 ....... ..... .....  001010  @bit
95SRLRI               011110 011 ....... ..... .....  001010  @bit
96
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104BINSR               011110 111.. ..... ..... .....  001101  @3r
105
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120
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129
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144
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157ILVR                011110 101 .. ..... ..... ..... 010100  @3r
158ILVEV               011110 110 .. ..... ..... ..... 010100  @3r
159ILVOD               011110 111 .. ..... ..... ..... 010100  @3r
160
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165HADD_U              011110 101.. ..... ..... .....  010101  @3r
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172}
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179  COPY_S            011110 0010 ...... ..... .....  011001  @elm_df
180}
181COPY_U              011110 0011 ...... ..... .....  011001  @elm_df
182INSERT              011110 0100 ...... ..... .....  011001  @elm_df
183INSVE               011110 0101 ...... ..... .....  011001  @elm_df
184
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197FSLT                011110 1100 . ..... ..... ..... 011010  @3rf_w
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199FSLE                011110 1110 . ..... ..... ..... 011010  @3rf_w
200FSULE               011110 1111 . ..... ..... ..... 011010  @3rf_w
201
202FADD                011110 0000 . ..... ..... ..... 011011  @3rf_w
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