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 * Copyright (c) 2021, The Linux Foundation. All rights reserved.
 * Copyright (c) 2022, Linaro Ltd.
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#define GCC_USB4_TMU_CLK				371
#define GCC_USB4_TMU_CLK_SRC				372
#define GCC_VIDEO_AHB_CLK				373
#define GCC_VIDEO_AXI0_CLK				374
#define GCC_VIDEO_AXI1_CLK				375
#define GCC_VIDEO_CVP_THROTTLE_CLK			376
#define GCC_VIDEO_VCODEC_THROTTLE_CLK			377
#define GCC_VIDEO_XO_CLK				378
#define GCC_AGGRE_UFS_CARD_AXI_HW_CTL_CLK		379
#define GCC_AGGRE_UFS_PHY_AXI_HW_CTL_CLK		380
#define GCC_UFS_CARD_AXI_HW_CTL_CLK			381
#define GCC_UFS_CARD_ICE_CORE_HW_CTL_CLK		382
#define GCC_UFS_CARD_PHY_AUX_HW_CTL_CLK			383
#define GCC_UFS_CARD_UNIPRO_CORE_HW_CTL_CLK		384
#define GCC_UFS_PHY_AXI_HW_CTL_CLK			385
#define GCC_UFS_PHY_ICE_CORE_HW_CTL_CLK			386
#define GCC_UFS_PHY_PHY_AUX_HW_CTL_CLK			387
#define GCC_UFS_PHY_UNIPRO_CORE_HW_CTL_CLK		388

/* GCC resets */
#define GCC_EMAC0_BCR					0
#define GCC_EMAC1_BCR					1
#define GCC_PCIE_0_LINK_DOWN_BCR			2
#define GCC_PCIE_0_NOCSR_COM_PHY_BCR			3
#define GCC_PCIE_0_PHY_BCR				4
#define GCC_PCIE_0_PHY_NOCSR_COM_PHY_BCR		5
#define GCC_PCIE_0_TUNNEL_BCR				6
#define GCC_PCIE_1_LINK_DOWN_BCR			7
#define GCC_PCIE_1_NOCSR_COM_PHY_BCR			8
#define GCC_PCIE_1_PHY_BCR				9
#define GCC_PCIE_1_PHY_NOCSR_COM_PHY_BCR		10
#define GCC_PCIE_1_TUNNEL_BCR				11
#define GCC_PCIE_2A_BCR					12
#define GCC_PCIE_2A_LINK_DOWN_BCR			13
#define GCC_PCIE_2A_NOCSR_COM_PHY_BCR			14
#define GCC_PCIE_2A_PHY_BCR				15
#define GCC_PCIE_2A_PHY_NOCSR_COM_PHY_BCR		16
#define GCC_PCIE_2B_BCR					17
#define GCC_PCIE_2B_LINK_DOWN_BCR			18
#define GCC_PCIE_2B_NOCSR_COM_PHY_BCR			19
#define GCC_PCIE_2B_PHY_BCR				20
#define GCC_PCIE_2B_PHY_NOCSR_COM_PHY_BCR		21
#define GCC_PCIE_3A_BCR					22
#define GCC_PCIE_3A_LINK_DOWN_BCR			23
#define GCC_PCIE_3A_NOCSR_COM_PHY_BCR			24
#define GCC_PCIE_3A_PHY_BCR				25
#define GCC_PCIE_3A_PHY_NOCSR_COM_PHY_BCR		26
#define GCC_PCIE_3B_BCR					27
#define GCC_PCIE_3B_LINK_DOWN_BCR			28
#define GCC_PCIE_3B_NOCSR_COM_PHY_BCR			29
#define GCC_PCIE_3B_PHY_BCR				30
#define GCC_PCIE_3B_PHY_NOCSR_COM_PHY_BCR		31
#define GCC_PCIE_4_BCR					32
#define GCC_PCIE_4_LINK_DOWN_BCR			33
#define GCC_PCIE_4_NOCSR_COM_PHY_BCR			34
#define GCC_PCIE_4_PHY_BCR				35
#define GCC_PCIE_4_PHY_NOCSR_COM_PHY_BCR		36
#define GCC_PCIE_PHY_CFG_AHB_BCR			37
#define GCC_PCIE_PHY_COM_BCR				38
#define GCC_PCIE_RSCC_BCR				39
#define GCC_QUSB2PHY_HS0_MP_BCR				40
#define GCC_QUSB2PHY_HS1_MP_BCR				41
#define GCC_QUSB2PHY_HS2_MP_BCR				42
#define GCC_QUSB2PHY_HS3_MP_BCR				43
#define GCC_QUSB2PHY_PRIM_BCR				44
#define GCC_QUSB2PHY_SEC_BCR				45
#define GCC_SDCC2_BCR					46
#define GCC_SDCC4_BCR					47
#define GCC_UFS_CARD_BCR				48
#define GCC_UFS_PHY_BCR					49
#define GCC_USB2_PHY_PRIM_BCR				50
#define GCC_USB2_PHY_SEC_BCR				51
#define GCC_USB30_MP_BCR				52
#define GCC_USB30_PRIM_BCR				53
#define GCC_USB30_SEC_BCR				54
#define GCC_USB3_DP_PHY_PRIM_BCR			55
#define GCC_USB3_DP_PHY_SEC_BCR				56
#define GCC_USB3_PHY_PRIM_BCR				57
#define GCC_USB3_PHY_SEC_BCR				58
#define GCC_USB3_UNIPHY_MP0_BCR				59
#define GCC_USB3_UNIPHY_MP1_BCR				60
#define GCC_USB3PHY_PHY_PRIM_BCR			61
#define GCC_USB3PHY_PHY_SEC_BCR				62
#define GCC_USB3UNIPHY_PHY_MP0_BCR			63
#define GCC_USB3UNIPHY_PHY_MP1_BCR			64
#define GCC_USB4_1_BCR					65
#define GCC_USB4_1_DP_PHY_PRIM_BCR			66
#define GCC_USB4_1_DPPHY_AUX_BCR			67
#define GCC_USB4_1_PHY_PRIM_BCR				68
#define GCC_USB4_BCR					69
#define GCC_USB4_DP_PHY_PRIM_BCR			70
#define GCC_USB4_DPPHY_AUX_BCR				71
#define GCC_USB4_PHY_PRIM_BCR				72
#define GCC_USB4PHY_1_PHY_PRIM_BCR			73
#define GCC_USB4PHY_PHY_PRIM_BCR			74
#define GCC_USB_PHY_CFG_AHB2PHY_BCR			75
#define GCC_VIDEO_BCR					76
#define GCC_VIDEO_AXI0_CLK_ARES				77
#define GCC_VIDEO_AXI1_CLK_ARES				78

/* GCC GDSCs */
#define PCIE_0_TUNNEL_GDSC				0
#define PCIE_1_TUNNEL_GDSC				1
#define PCIE_2A_GDSC					2
#define PCIE_2B_GDSC					3
#define PCIE_3A_GDSC					4
#define PCIE_3B_GDSC					5
#define PCIE_4_GDSC					6
#define UFS_CARD_GDSC					7
#define UFS_PHY_GDSC					8
#define USB30_MP_GDSC					9
#define USB30_PRIM_GDSC					10
#define USB30_SEC_GDSC					11
#define EMAC_0_GDSC					12
#define EMAC_1_GDSC					13
#define USB4_1_GDSC					14
#define USB4_GDSC					15
#define HLOS1_VOTE_MMNOC_MMU_TBU_HF0_GDSC		16
#define HLOS1_VOTE_MMNOC_MMU_TBU_HF1_GDSC		17
#define HLOS1_VOTE_MMNOC_MMU_TBU_SF0_GDSC		18
#define HLOS1_VOTE_MMNOC_MMU_TBU_SF1_GDSC		19
#define HLOS1_VOTE_TURING_MMU_TBU0_GDSC			20
#define HLOS1_VOTE_TURING_MMU_TBU1_GDSC			21
#define HLOS1_VOTE_TURING_MMU_TBU2_GDSC			22
#define HLOS1_VOTE_TURING_MMU_TBU3_GDSC			23

#endif