158391efdSNathan Chancellor // SPDX-License-Identifier: GPL-2.0 2554c0a3aSHans de Goede /****************************************************************************** 3554c0a3aSHans de Goede * 4554c0a3aSHans de Goede * Copyright(c) 2007 - 2013 Realtek Corporation. All rights reserved. 5554c0a3aSHans de Goede * 6554c0a3aSHans de Goede ******************************************************************************/ 7554c0a3aSHans de Goede #define _HAL_INIT_C_ 8554c0a3aSHans de Goede 9554c0a3aSHans de Goede #include <linux/firmware.h> 10554c0a3aSHans de Goede #include <linux/slab.h> 11554c0a3aSHans de Goede #include <drv_types.h> 12554c0a3aSHans de Goede #include <rtw_debug.h> 13554c0a3aSHans de Goede #include <rtl8723b_hal.h> 14554c0a3aSHans de Goede #include "hal_com_h2c.h" 15554c0a3aSHans de Goede 16554c0a3aSHans de Goede static void _FWDownloadEnable(struct adapter *padapter, bool enable) 17554c0a3aSHans de Goede { 18554c0a3aSHans de Goede u8 tmp, count = 0; 19554c0a3aSHans de Goede 20554c0a3aSHans de Goede if (enable) { 21554c0a3aSHans de Goede /* 8051 enable */ 22554c0a3aSHans de Goede tmp = rtw_read8(padapter, REG_SYS_FUNC_EN+1); 23554c0a3aSHans de Goede rtw_write8(padapter, REG_SYS_FUNC_EN+1, tmp|0x04); 24554c0a3aSHans de Goede 25554c0a3aSHans de Goede tmp = rtw_read8(padapter, REG_MCUFWDL); 26554c0a3aSHans de Goede rtw_write8(padapter, REG_MCUFWDL, tmp|0x01); 27554c0a3aSHans de Goede 28554c0a3aSHans de Goede do { 29554c0a3aSHans de Goede tmp = rtw_read8(padapter, REG_MCUFWDL); 30554c0a3aSHans de Goede if (tmp & 0x01) 31554c0a3aSHans de Goede break; 32554c0a3aSHans de Goede rtw_write8(padapter, REG_MCUFWDL, tmp|0x01); 33554c0a3aSHans de Goede msleep(1); 34554c0a3aSHans de Goede } while (count++ < 100); 35554c0a3aSHans de Goede 36554c0a3aSHans de Goede if (count > 0) 37554c0a3aSHans de Goede DBG_871X("%s: !!!!!!!!Write 0x80 Fail!: count = %d\n", __func__, count); 38554c0a3aSHans de Goede 39554c0a3aSHans de Goede /* 8051 reset */ 40554c0a3aSHans de Goede tmp = rtw_read8(padapter, REG_MCUFWDL+2); 41554c0a3aSHans de Goede rtw_write8(padapter, REG_MCUFWDL+2, tmp&0xf7); 42554c0a3aSHans de Goede } else { 43554c0a3aSHans de Goede /* MCU firmware download disable. */ 44554c0a3aSHans de Goede tmp = rtw_read8(padapter, REG_MCUFWDL); 45554c0a3aSHans de Goede rtw_write8(padapter, REG_MCUFWDL, tmp&0xfe); 46554c0a3aSHans de Goede } 47554c0a3aSHans de Goede } 48554c0a3aSHans de Goede 49554c0a3aSHans de Goede static int _BlockWrite(struct adapter *padapter, void *buffer, u32 buffSize) 50554c0a3aSHans de Goede { 51554c0a3aSHans de Goede int ret = _SUCCESS; 52554c0a3aSHans de Goede 53554c0a3aSHans de Goede u32 blockSize_p1 = 4; /* (Default) Phase #1 : PCI muse use 4-byte write to download FW */ 54554c0a3aSHans de Goede u32 blockSize_p2 = 8; /* Phase #2 : Use 8-byte, if Phase#1 use big size to write FW. */ 55554c0a3aSHans de Goede u32 blockSize_p3 = 1; /* Phase #3 : Use 1-byte, the remnant of FW image. */ 56554c0a3aSHans de Goede u32 blockCount_p1 = 0, blockCount_p2 = 0, blockCount_p3 = 0; 57554c0a3aSHans de Goede u32 remainSize_p1 = 0, remainSize_p2 = 0; 581b98ee33SHimanshu Jha u8 *bufferPtr = buffer; 59554c0a3aSHans de Goede u32 i = 0, offset = 0; 60554c0a3aSHans de Goede 61554c0a3aSHans de Goede /* printk("====>%s %d\n", __func__, __LINE__); */ 62554c0a3aSHans de Goede 63554c0a3aSHans de Goede /* 3 Phase #1 */ 64554c0a3aSHans de Goede blockCount_p1 = buffSize / blockSize_p1; 65554c0a3aSHans de Goede remainSize_p1 = buffSize % blockSize_p1; 66554c0a3aSHans de Goede 67554c0a3aSHans de Goede if (blockCount_p1) { 68554c0a3aSHans de Goede RT_TRACE( 69554c0a3aSHans de Goede _module_hal_init_c_, 70554c0a3aSHans de Goede _drv_notice_, 71554c0a3aSHans de Goede ( 72554c0a3aSHans de Goede "_BlockWrite: [P1] buffSize(%d) blockSize_p1(%d) blockCount_p1(%d) remainSize_p1(%d)\n", 73554c0a3aSHans de Goede buffSize, 74554c0a3aSHans de Goede blockSize_p1, 75554c0a3aSHans de Goede blockCount_p1, 76554c0a3aSHans de Goede remainSize_p1 77554c0a3aSHans de Goede ) 78554c0a3aSHans de Goede ); 79554c0a3aSHans de Goede } 80554c0a3aSHans de Goede 81554c0a3aSHans de Goede for (i = 0; i < blockCount_p1; i++) { 82554c0a3aSHans de Goede ret = rtw_write32(padapter, (FW_8723B_START_ADDRESS + i * blockSize_p1), *((u32 *)(bufferPtr + i * blockSize_p1))); 83554c0a3aSHans de Goede if (ret == _FAIL) { 84554c0a3aSHans de Goede printk("====>%s %d i:%d\n", __func__, __LINE__, i); 85554c0a3aSHans de Goede goto exit; 86554c0a3aSHans de Goede } 87554c0a3aSHans de Goede } 88554c0a3aSHans de Goede 89554c0a3aSHans de Goede /* 3 Phase #2 */ 90554c0a3aSHans de Goede if (remainSize_p1) { 91554c0a3aSHans de Goede offset = blockCount_p1 * blockSize_p1; 92554c0a3aSHans de Goede 93554c0a3aSHans de Goede blockCount_p2 = remainSize_p1/blockSize_p2; 94554c0a3aSHans de Goede remainSize_p2 = remainSize_p1%blockSize_p2; 95554c0a3aSHans de Goede 96554c0a3aSHans de Goede if (blockCount_p2) { 97554c0a3aSHans de Goede RT_TRACE( 98554c0a3aSHans de Goede _module_hal_init_c_, 99554c0a3aSHans de Goede _drv_notice_, 100554c0a3aSHans de Goede ( 101554c0a3aSHans de Goede "_BlockWrite: [P2] buffSize_p2(%d) blockSize_p2(%d) blockCount_p2(%d) remainSize_p2(%d)\n", 102554c0a3aSHans de Goede (buffSize-offset), 103554c0a3aSHans de Goede blockSize_p2, 104554c0a3aSHans de Goede blockCount_p2, 105554c0a3aSHans de Goede remainSize_p2 106554c0a3aSHans de Goede ) 107554c0a3aSHans de Goede ); 108554c0a3aSHans de Goede } 109554c0a3aSHans de Goede 110554c0a3aSHans de Goede } 111554c0a3aSHans de Goede 112554c0a3aSHans de Goede /* 3 Phase #3 */ 113554c0a3aSHans de Goede if (remainSize_p2) { 114554c0a3aSHans de Goede offset = (blockCount_p1 * blockSize_p1) + (blockCount_p2 * blockSize_p2); 115554c0a3aSHans de Goede 116554c0a3aSHans de Goede blockCount_p3 = remainSize_p2 / blockSize_p3; 117554c0a3aSHans de Goede 118554c0a3aSHans de Goede RT_TRACE(_module_hal_init_c_, _drv_notice_, 119554c0a3aSHans de Goede ("_BlockWrite: [P3] buffSize_p3(%d) blockSize_p3(%d) blockCount_p3(%d)\n", 120554c0a3aSHans de Goede (buffSize-offset), blockSize_p3, blockCount_p3)); 121554c0a3aSHans de Goede 122554c0a3aSHans de Goede for (i = 0; i < blockCount_p3; i++) { 123554c0a3aSHans de Goede ret = rtw_write8(padapter, (FW_8723B_START_ADDRESS + offset + i), *(bufferPtr + offset + i)); 124554c0a3aSHans de Goede 125554c0a3aSHans de Goede if (ret == _FAIL) { 126554c0a3aSHans de Goede printk("====>%s %d i:%d\n", __func__, __LINE__, i); 127554c0a3aSHans de Goede goto exit; 128554c0a3aSHans de Goede } 129554c0a3aSHans de Goede } 130554c0a3aSHans de Goede } 131554c0a3aSHans de Goede exit: 132554c0a3aSHans de Goede return ret; 133554c0a3aSHans de Goede } 134554c0a3aSHans de Goede 135554c0a3aSHans de Goede static int _PageWrite( 136554c0a3aSHans de Goede struct adapter *padapter, 137554c0a3aSHans de Goede u32 page, 138554c0a3aSHans de Goede void *buffer, 139554c0a3aSHans de Goede u32 size 140554c0a3aSHans de Goede ) 141554c0a3aSHans de Goede { 142554c0a3aSHans de Goede u8 value8; 143554c0a3aSHans de Goede u8 u8Page = (u8) (page & 0x07); 144554c0a3aSHans de Goede 145554c0a3aSHans de Goede value8 = (rtw_read8(padapter, REG_MCUFWDL+2) & 0xF8) | u8Page; 146554c0a3aSHans de Goede rtw_write8(padapter, REG_MCUFWDL+2, value8); 147554c0a3aSHans de Goede 148554c0a3aSHans de Goede return _BlockWrite(padapter, buffer, size); 149554c0a3aSHans de Goede } 150554c0a3aSHans de Goede 151554c0a3aSHans de Goede static int _WriteFW(struct adapter *padapter, void *buffer, u32 size) 152554c0a3aSHans de Goede { 153554c0a3aSHans de Goede /* Since we need dynamic decide method of dwonload fw, so we call this function to get chip version. */ 154554c0a3aSHans de Goede /* We can remove _ReadChipVersion from ReadpadapterInfo8192C later. */ 155554c0a3aSHans de Goede int ret = _SUCCESS; 156554c0a3aSHans de Goede u32 pageNums, remainSize; 157554c0a3aSHans de Goede u32 page, offset; 1581b98ee33SHimanshu Jha u8 *bufferPtr = buffer; 159554c0a3aSHans de Goede 160554c0a3aSHans de Goede pageNums = size / MAX_DLFW_PAGE_SIZE; 161554c0a3aSHans de Goede /* RT_ASSERT((pageNums <= 4), ("Page numbers should not greater then 4\n")); */ 162554c0a3aSHans de Goede remainSize = size % MAX_DLFW_PAGE_SIZE; 163554c0a3aSHans de Goede 164554c0a3aSHans de Goede for (page = 0; page < pageNums; page++) { 165554c0a3aSHans de Goede offset = page * MAX_DLFW_PAGE_SIZE; 166554c0a3aSHans de Goede ret = _PageWrite(padapter, page, bufferPtr+offset, MAX_DLFW_PAGE_SIZE); 167554c0a3aSHans de Goede 168554c0a3aSHans de Goede if (ret == _FAIL) { 169554c0a3aSHans de Goede printk("====>%s %d\n", __func__, __LINE__); 170554c0a3aSHans de Goede goto exit; 171554c0a3aSHans de Goede } 172554c0a3aSHans de Goede } 173554c0a3aSHans de Goede 174554c0a3aSHans de Goede if (remainSize) { 175554c0a3aSHans de Goede offset = pageNums * MAX_DLFW_PAGE_SIZE; 176554c0a3aSHans de Goede page = pageNums; 177554c0a3aSHans de Goede ret = _PageWrite(padapter, page, bufferPtr+offset, remainSize); 178554c0a3aSHans de Goede 179554c0a3aSHans de Goede if (ret == _FAIL) { 180554c0a3aSHans de Goede printk("====>%s %d\n", __func__, __LINE__); 181554c0a3aSHans de Goede goto exit; 182554c0a3aSHans de Goede } 183554c0a3aSHans de Goede } 184554c0a3aSHans de Goede RT_TRACE(_module_hal_init_c_, _drv_info_, ("_WriteFW Done- for Normal chip.\n")); 185554c0a3aSHans de Goede 186554c0a3aSHans de Goede exit: 187554c0a3aSHans de Goede return ret; 188554c0a3aSHans de Goede } 189554c0a3aSHans de Goede 190554c0a3aSHans de Goede void _8051Reset8723(struct adapter *padapter) 191554c0a3aSHans de Goede { 192554c0a3aSHans de Goede u8 cpu_rst; 193554c0a3aSHans de Goede u8 io_rst; 194554c0a3aSHans de Goede 195554c0a3aSHans de Goede 196554c0a3aSHans de Goede /* Reset 8051(WLMCU) IO wrapper */ 197554c0a3aSHans de Goede /* 0x1c[8] = 0 */ 198554c0a3aSHans de Goede /* Suggested by Isaac@SD1 and Gimmy@SD1, coding by Lucas@20130624 */ 199554c0a3aSHans de Goede io_rst = rtw_read8(padapter, REG_RSV_CTRL+1); 200554c0a3aSHans de Goede io_rst &= ~BIT(0); 201554c0a3aSHans de Goede rtw_write8(padapter, REG_RSV_CTRL+1, io_rst); 202554c0a3aSHans de Goede 203554c0a3aSHans de Goede cpu_rst = rtw_read8(padapter, REG_SYS_FUNC_EN+1); 204554c0a3aSHans de Goede cpu_rst &= ~BIT(2); 205554c0a3aSHans de Goede rtw_write8(padapter, REG_SYS_FUNC_EN+1, cpu_rst); 206554c0a3aSHans de Goede 207554c0a3aSHans de Goede /* Enable 8051 IO wrapper */ 208554c0a3aSHans de Goede /* 0x1c[8] = 1 */ 209554c0a3aSHans de Goede io_rst = rtw_read8(padapter, REG_RSV_CTRL+1); 210554c0a3aSHans de Goede io_rst |= BIT(0); 211554c0a3aSHans de Goede rtw_write8(padapter, REG_RSV_CTRL+1, io_rst); 212554c0a3aSHans de Goede 213554c0a3aSHans de Goede cpu_rst = rtw_read8(padapter, REG_SYS_FUNC_EN+1); 214554c0a3aSHans de Goede cpu_rst |= BIT(2); 215554c0a3aSHans de Goede rtw_write8(padapter, REG_SYS_FUNC_EN+1, cpu_rst); 216554c0a3aSHans de Goede 217554c0a3aSHans de Goede DBG_8192C("%s: Finish\n", __func__); 218554c0a3aSHans de Goede } 219554c0a3aSHans de Goede 220dfa6cbbfSHariprasad Kelam u8 g_fwdl_chksum_fail; 221f55a6d45SArnd Bergmann 222554c0a3aSHans de Goede static s32 polling_fwdl_chksum( 223554c0a3aSHans de Goede struct adapter *adapter, u32 min_cnt, u32 timeout_ms 224554c0a3aSHans de Goede ) 225554c0a3aSHans de Goede { 226554c0a3aSHans de Goede s32 ret = _FAIL; 227554c0a3aSHans de Goede u32 value32; 228554c0a3aSHans de Goede unsigned long start = jiffies; 229554c0a3aSHans de Goede u32 cnt = 0; 230554c0a3aSHans de Goede 231554c0a3aSHans de Goede /* polling CheckSum report */ 232554c0a3aSHans de Goede do { 233554c0a3aSHans de Goede cnt++; 234554c0a3aSHans de Goede value32 = rtw_read32(adapter, REG_MCUFWDL); 235554c0a3aSHans de Goede if (value32 & FWDL_ChkSum_rpt || adapter->bSurpriseRemoved || adapter->bDriverStopped) 236554c0a3aSHans de Goede break; 237554c0a3aSHans de Goede yield(); 238554c0a3aSHans de Goede } while (jiffies_to_msecs(jiffies-start) < timeout_ms || cnt < min_cnt); 239554c0a3aSHans de Goede 240554c0a3aSHans de Goede if (!(value32 & FWDL_ChkSum_rpt)) { 241554c0a3aSHans de Goede goto exit; 242554c0a3aSHans de Goede } 243554c0a3aSHans de Goede 244554c0a3aSHans de Goede if (g_fwdl_chksum_fail) { 245554c0a3aSHans de Goede DBG_871X("%s: fwdl test case: fwdl_chksum_fail\n", __func__); 246554c0a3aSHans de Goede g_fwdl_chksum_fail--; 247554c0a3aSHans de Goede goto exit; 248554c0a3aSHans de Goede } 249554c0a3aSHans de Goede 250554c0a3aSHans de Goede ret = _SUCCESS; 251554c0a3aSHans de Goede 252554c0a3aSHans de Goede exit: 253554c0a3aSHans de Goede DBG_871X( 254554c0a3aSHans de Goede "%s: Checksum report %s! (%u, %dms), REG_MCUFWDL:0x%08x\n", 255554c0a3aSHans de Goede __func__, 256554c0a3aSHans de Goede (ret == _SUCCESS) ? "OK" : "Fail", 257554c0a3aSHans de Goede cnt, 258554c0a3aSHans de Goede jiffies_to_msecs(jiffies-start), 259554c0a3aSHans de Goede value32 260554c0a3aSHans de Goede ); 261554c0a3aSHans de Goede 262554c0a3aSHans de Goede return ret; 263554c0a3aSHans de Goede } 264554c0a3aSHans de Goede 265dfa6cbbfSHariprasad Kelam u8 g_fwdl_wintint_rdy_fail; 266f55a6d45SArnd Bergmann 267554c0a3aSHans de Goede static s32 _FWFreeToGo(struct adapter *adapter, u32 min_cnt, u32 timeout_ms) 268554c0a3aSHans de Goede { 269554c0a3aSHans de Goede s32 ret = _FAIL; 270554c0a3aSHans de Goede u32 value32; 271554c0a3aSHans de Goede unsigned long start = jiffies; 272554c0a3aSHans de Goede u32 cnt = 0; 273554c0a3aSHans de Goede 274554c0a3aSHans de Goede value32 = rtw_read32(adapter, REG_MCUFWDL); 275554c0a3aSHans de Goede value32 |= MCUFWDL_RDY; 276554c0a3aSHans de Goede value32 &= ~WINTINI_RDY; 277554c0a3aSHans de Goede rtw_write32(adapter, REG_MCUFWDL, value32); 278554c0a3aSHans de Goede 279554c0a3aSHans de Goede _8051Reset8723(adapter); 280554c0a3aSHans de Goede 281554c0a3aSHans de Goede /* polling for FW ready */ 282554c0a3aSHans de Goede do { 283554c0a3aSHans de Goede cnt++; 284554c0a3aSHans de Goede value32 = rtw_read32(adapter, REG_MCUFWDL); 285554c0a3aSHans de Goede if (value32 & WINTINI_RDY || adapter->bSurpriseRemoved || adapter->bDriverStopped) 286554c0a3aSHans de Goede break; 287554c0a3aSHans de Goede yield(); 288554c0a3aSHans de Goede } while (jiffies_to_msecs(jiffies - start) < timeout_ms || cnt < min_cnt); 289554c0a3aSHans de Goede 290554c0a3aSHans de Goede if (!(value32 & WINTINI_RDY)) { 291554c0a3aSHans de Goede goto exit; 292554c0a3aSHans de Goede } 293554c0a3aSHans de Goede 294554c0a3aSHans de Goede if (g_fwdl_wintint_rdy_fail) { 295554c0a3aSHans de Goede DBG_871X("%s: fwdl test case: wintint_rdy_fail\n", __func__); 296554c0a3aSHans de Goede g_fwdl_wintint_rdy_fail--; 297554c0a3aSHans de Goede goto exit; 298554c0a3aSHans de Goede } 299554c0a3aSHans de Goede 300554c0a3aSHans de Goede ret = _SUCCESS; 301554c0a3aSHans de Goede 302554c0a3aSHans de Goede exit: 303554c0a3aSHans de Goede DBG_871X( 304554c0a3aSHans de Goede "%s: Polling FW ready %s! (%u, %dms), REG_MCUFWDL:0x%08x\n", 305554c0a3aSHans de Goede __func__, 306554c0a3aSHans de Goede (ret == _SUCCESS) ? "OK" : "Fail", 307554c0a3aSHans de Goede cnt, 308554c0a3aSHans de Goede jiffies_to_msecs(jiffies-start), 309554c0a3aSHans de Goede value32 310554c0a3aSHans de Goede ); 311554c0a3aSHans de Goede 312554c0a3aSHans de Goede return ret; 313554c0a3aSHans de Goede } 314554c0a3aSHans de Goede 315554c0a3aSHans de Goede #define IS_FW_81xxC(padapter) (((GET_HAL_DATA(padapter))->FirmwareSignature & 0xFFF0) == 0x88C0) 316554c0a3aSHans de Goede 317554c0a3aSHans de Goede void rtl8723b_FirmwareSelfReset(struct adapter *padapter) 318554c0a3aSHans de Goede { 319554c0a3aSHans de Goede struct hal_com_data *pHalData = GET_HAL_DATA(padapter); 320554c0a3aSHans de Goede u8 u1bTmp; 321554c0a3aSHans de Goede u8 Delay = 100; 322554c0a3aSHans de Goede 323554c0a3aSHans de Goede if ( 324554c0a3aSHans de Goede !(IS_FW_81xxC(padapter) && ((pHalData->FirmwareVersion < 0x21) || (pHalData->FirmwareVersion == 0x21 && pHalData->FirmwareSubVersion < 0x01))) 325554c0a3aSHans de Goede ) { /* after 88C Fw v33.1 */ 326554c0a3aSHans de Goede /* 0x1cf = 0x20. Inform 8051 to reset. 2009.12.25. tynli_test */ 327554c0a3aSHans de Goede rtw_write8(padapter, REG_HMETFR+3, 0x20); 328554c0a3aSHans de Goede 329554c0a3aSHans de Goede u1bTmp = rtw_read8(padapter, REG_SYS_FUNC_EN+1); 330554c0a3aSHans de Goede while (u1bTmp & BIT2) { 331554c0a3aSHans de Goede Delay--; 332554c0a3aSHans de Goede if (Delay == 0) 333554c0a3aSHans de Goede break; 334554c0a3aSHans de Goede udelay(50); 335554c0a3aSHans de Goede u1bTmp = rtw_read8(padapter, REG_SYS_FUNC_EN+1); 336554c0a3aSHans de Goede } 337554c0a3aSHans de Goede RT_TRACE(_module_hal_init_c_, _drv_notice_, ("-%s: 8051 reset success (%d)\n", __func__, Delay)); 338554c0a3aSHans de Goede 339554c0a3aSHans de Goede if (Delay == 0) { 340554c0a3aSHans de Goede RT_TRACE(_module_hal_init_c_, _drv_notice_, ("%s: Force 8051 reset!!!\n", __func__)); 341554c0a3aSHans de Goede /* force firmware reset */ 342554c0a3aSHans de Goede u1bTmp = rtw_read8(padapter, REG_SYS_FUNC_EN+1); 343554c0a3aSHans de Goede rtw_write8(padapter, REG_SYS_FUNC_EN+1, u1bTmp&(~BIT2)); 344554c0a3aSHans de Goede } 345554c0a3aSHans de Goede } 346554c0a3aSHans de Goede } 347554c0a3aSHans de Goede 348554c0a3aSHans de Goede /* */ 349554c0a3aSHans de Goede /* Description: */ 350554c0a3aSHans de Goede /* Download 8192C firmware code. */ 351554c0a3aSHans de Goede /* */ 352554c0a3aSHans de Goede /* */ 353554c0a3aSHans de Goede s32 rtl8723b_FirmwareDownload(struct adapter *padapter, bool bUsedWoWLANFw) 354554c0a3aSHans de Goede { 355554c0a3aSHans de Goede s32 rtStatus = _SUCCESS; 356554c0a3aSHans de Goede u8 write_fw = 0; 357554c0a3aSHans de Goede unsigned long fwdl_start_time; 358554c0a3aSHans de Goede struct hal_com_data *pHalData = GET_HAL_DATA(padapter); 359554c0a3aSHans de Goede struct rt_firmware *pFirmware; 360554c0a3aSHans de Goede struct rt_firmware *pBTFirmware; 361554c0a3aSHans de Goede struct rt_firmware_hdr *pFwHdr = NULL; 362554c0a3aSHans de Goede u8 *pFirmwareBuf; 363554c0a3aSHans de Goede u32 FirmwareLen; 364554c0a3aSHans de Goede const struct firmware *fw; 365554c0a3aSHans de Goede struct device *device = dvobj_to_dev(padapter->dvobj); 366554c0a3aSHans de Goede u8 *fwfilepath; 367554c0a3aSHans de Goede struct dvobj_priv *psdpriv = padapter->dvobj; 368554c0a3aSHans de Goede struct debug_priv *pdbgpriv = &psdpriv->drv_dbg; 369554c0a3aSHans de Goede u8 tmp_ps; 370554c0a3aSHans de Goede 371554c0a3aSHans de Goede RT_TRACE(_module_hal_init_c_, _drv_info_, ("+%s\n", __func__)); 372554c0a3aSHans de Goede pFirmware = kzalloc(sizeof(struct rt_firmware), GFP_KERNEL); 3737e2b0aaeSLarry Finger if (!pFirmware) 3747e2b0aaeSLarry Finger return _FAIL; 375554c0a3aSHans de Goede pBTFirmware = kzalloc(sizeof(struct rt_firmware), GFP_KERNEL); 3767e2b0aaeSLarry Finger if (!pBTFirmware) { 3777e2b0aaeSLarry Finger kfree(pFirmware); 3787e2b0aaeSLarry Finger return _FAIL; 379554c0a3aSHans de Goede } 380554c0a3aSHans de Goede tmp_ps = rtw_read8(padapter, 0xa3); 381554c0a3aSHans de Goede tmp_ps &= 0xf8; 382554c0a3aSHans de Goede tmp_ps |= 0x02; 383554c0a3aSHans de Goede /* 1. write 0xA3[:2:0] = 3b'010 */ 384554c0a3aSHans de Goede rtw_write8(padapter, 0xa3, tmp_ps); 385554c0a3aSHans de Goede /* 2. read power_state = 0xA0[1:0] */ 386554c0a3aSHans de Goede tmp_ps = rtw_read8(padapter, 0xa0); 387554c0a3aSHans de Goede tmp_ps &= 0x03; 388554c0a3aSHans de Goede if (tmp_ps != 0x01) { 389554c0a3aSHans de Goede DBG_871X(FUNC_ADPT_FMT" tmp_ps =%x\n", FUNC_ADPT_ARG(padapter), tmp_ps); 390554c0a3aSHans de Goede pdbgpriv->dbg_downloadfw_pwr_state_cnt++; 391554c0a3aSHans de Goede } 392554c0a3aSHans de Goede 393554c0a3aSHans de Goede fwfilepath = "rtlwifi/rtl8723bs_nic.bin"; 394554c0a3aSHans de Goede 395b3882852SColin Ian King pr_info("rtl8723bs: acquire FW from file:%s\n", fwfilepath); 396554c0a3aSHans de Goede 397554c0a3aSHans de Goede rtStatus = request_firmware(&fw, fwfilepath, device); 398554c0a3aSHans de Goede if (rtStatus) { 399554c0a3aSHans de Goede pr_err("Request firmware failed with error 0x%x\n", rtStatus); 400554c0a3aSHans de Goede rtStatus = _FAIL; 401554c0a3aSHans de Goede goto exit; 402554c0a3aSHans de Goede } 403554c0a3aSHans de Goede 404554c0a3aSHans de Goede if (!fw) { 405554c0a3aSHans de Goede pr_err("Firmware %s not available\n", fwfilepath); 406554c0a3aSHans de Goede rtStatus = _FAIL; 407554c0a3aSHans de Goede goto exit; 408554c0a3aSHans de Goede } 409554c0a3aSHans de Goede 410554c0a3aSHans de Goede if (fw->size > FW_8723B_SIZE) { 411554c0a3aSHans de Goede rtStatus = _FAIL; 412554c0a3aSHans de Goede RT_TRACE( 413554c0a3aSHans de Goede _module_hal_init_c_, 414554c0a3aSHans de Goede _drv_err_, 415554c0a3aSHans de Goede ("Firmware size exceed 0x%X. Check it.\n", FW_8188E_SIZE) 416554c0a3aSHans de Goede ); 417554c0a3aSHans de Goede goto exit; 418554c0a3aSHans de Goede } 419554c0a3aSHans de Goede 42093998817SQuytelda Kahja pFirmware->fw_buffer_sz = kmemdup(fw->data, fw->size, GFP_KERNEL); 42193998817SQuytelda Kahja if (!pFirmware->fw_buffer_sz) { 422554c0a3aSHans de Goede rtStatus = _FAIL; 423554c0a3aSHans de Goede goto exit; 424554c0a3aSHans de Goede } 425554c0a3aSHans de Goede 42693998817SQuytelda Kahja pFirmware->fw_length = fw->size; 427554c0a3aSHans de Goede release_firmware(fw); 42893998817SQuytelda Kahja if (pFirmware->fw_length > FW_8723B_SIZE) { 429554c0a3aSHans de Goede rtStatus = _FAIL; 43093998817SQuytelda Kahja DBG_871X_LEVEL(_drv_emerg_, "Firmware size:%u exceed %u\n", pFirmware->fw_length, FW_8723B_SIZE); 4317e2b0aaeSLarry Finger goto release_fw1; 432554c0a3aSHans de Goede } 433554c0a3aSHans de Goede 43493998817SQuytelda Kahja pFirmwareBuf = pFirmware->fw_buffer_sz; 43593998817SQuytelda Kahja FirmwareLen = pFirmware->fw_length; 436554c0a3aSHans de Goede 437554c0a3aSHans de Goede /* To Check Fw header. Added by tynli. 2009.12.04. */ 438554c0a3aSHans de Goede pFwHdr = (struct rt_firmware_hdr *)pFirmwareBuf; 439554c0a3aSHans de Goede 440699ad734SQuytelda Kahja pHalData->FirmwareVersion = le16_to_cpu(pFwHdr->version); 441699ad734SQuytelda Kahja pHalData->FirmwareSubVersion = le16_to_cpu(pFwHdr->subversion); 442699ad734SQuytelda Kahja pHalData->FirmwareSignature = le16_to_cpu(pFwHdr->signature); 443554c0a3aSHans de Goede 444554c0a3aSHans de Goede DBG_871X( 445554c0a3aSHans de Goede "%s: fw_ver =%x fw_subver =%04x sig = 0x%x, Month =%02x, Date =%02x, Hour =%02x, Minute =%02x\n", 446554c0a3aSHans de Goede __func__, 447554c0a3aSHans de Goede pHalData->FirmwareVersion, 448554c0a3aSHans de Goede pHalData->FirmwareSubVersion, 449554c0a3aSHans de Goede pHalData->FirmwareSignature, 450699ad734SQuytelda Kahja pFwHdr->month, 451699ad734SQuytelda Kahja pFwHdr->date, 452699ad734SQuytelda Kahja pFwHdr->hour, 453699ad734SQuytelda Kahja pFwHdr->minute 454554c0a3aSHans de Goede ); 455554c0a3aSHans de Goede 456554c0a3aSHans de Goede if (IS_FW_HEADER_EXIST_8723B(pFwHdr)) { 457554c0a3aSHans de Goede DBG_871X("%s(): Shift for fw header!\n", __func__); 458554c0a3aSHans de Goede /* Shift 32 bytes for FW header */ 459554c0a3aSHans de Goede pFirmwareBuf = pFirmwareBuf + 32; 460554c0a3aSHans de Goede FirmwareLen = FirmwareLen - 32; 461554c0a3aSHans de Goede } 462554c0a3aSHans de Goede 463554c0a3aSHans de Goede /* Suggested by Filen. If 8051 is running in RAM code, driver should inform Fw to reset by itself, */ 464554c0a3aSHans de Goede /* or it will cause download Fw fail. 2010.02.01. by tynli. */ 465554c0a3aSHans de Goede if (rtw_read8(padapter, REG_MCUFWDL) & RAM_DL_SEL) { /* 8051 RAM code */ 466554c0a3aSHans de Goede rtw_write8(padapter, REG_MCUFWDL, 0x00); 467554c0a3aSHans de Goede rtl8723b_FirmwareSelfReset(padapter); 468554c0a3aSHans de Goede } 469554c0a3aSHans de Goede 470554c0a3aSHans de Goede _FWDownloadEnable(padapter, true); 471554c0a3aSHans de Goede fwdl_start_time = jiffies; 472554c0a3aSHans de Goede while ( 473554c0a3aSHans de Goede !padapter->bDriverStopped && 474554c0a3aSHans de Goede !padapter->bSurpriseRemoved && 475554c0a3aSHans de Goede (write_fw++ < 3 || jiffies_to_msecs(jiffies - fwdl_start_time) < 500) 476554c0a3aSHans de Goede ) { 477554c0a3aSHans de Goede /* reset FWDL chksum */ 478554c0a3aSHans de Goede rtw_write8(padapter, REG_MCUFWDL, rtw_read8(padapter, REG_MCUFWDL)|FWDL_ChkSum_rpt); 479554c0a3aSHans de Goede 480554c0a3aSHans de Goede rtStatus = _WriteFW(padapter, pFirmwareBuf, FirmwareLen); 481554c0a3aSHans de Goede if (rtStatus != _SUCCESS) 482554c0a3aSHans de Goede continue; 483554c0a3aSHans de Goede 484554c0a3aSHans de Goede rtStatus = polling_fwdl_chksum(padapter, 5, 50); 485554c0a3aSHans de Goede if (rtStatus == _SUCCESS) 486554c0a3aSHans de Goede break; 487554c0a3aSHans de Goede } 488554c0a3aSHans de Goede _FWDownloadEnable(padapter, false); 489554c0a3aSHans de Goede if (_SUCCESS != rtStatus) 490554c0a3aSHans de Goede goto fwdl_stat; 491554c0a3aSHans de Goede 492554c0a3aSHans de Goede rtStatus = _FWFreeToGo(padapter, 10, 200); 493554c0a3aSHans de Goede if (_SUCCESS != rtStatus) 494554c0a3aSHans de Goede goto fwdl_stat; 495554c0a3aSHans de Goede 496554c0a3aSHans de Goede fwdl_stat: 497554c0a3aSHans de Goede DBG_871X( 498554c0a3aSHans de Goede "FWDL %s. write_fw:%u, %dms\n", 499554c0a3aSHans de Goede (rtStatus == _SUCCESS)?"success":"fail", 500554c0a3aSHans de Goede write_fw, 501554c0a3aSHans de Goede jiffies_to_msecs(jiffies - fwdl_start_time) 502554c0a3aSHans de Goede ); 503554c0a3aSHans de Goede 504554c0a3aSHans de Goede exit: 50593998817SQuytelda Kahja kfree(pFirmware->fw_buffer_sz); 506554c0a3aSHans de Goede kfree(pFirmware); 5077e2b0aaeSLarry Finger release_fw1: 508554c0a3aSHans de Goede kfree(pBTFirmware); 509554c0a3aSHans de Goede DBG_871X(" <=== rtl8723b_FirmwareDownload()\n"); 510554c0a3aSHans de Goede return rtStatus; 511554c0a3aSHans de Goede } 512554c0a3aSHans de Goede 513554c0a3aSHans de Goede void rtl8723b_InitializeFirmwareVars(struct adapter *padapter) 514554c0a3aSHans de Goede { 515554c0a3aSHans de Goede struct hal_com_data *pHalData = GET_HAL_DATA(padapter); 516554c0a3aSHans de Goede 517554c0a3aSHans de Goede /* Init Fw LPS related. */ 518554c0a3aSHans de Goede adapter_to_pwrctl(padapter)->bFwCurrentInPSMode = false; 519554c0a3aSHans de Goede 520554c0a3aSHans de Goede /* Init H2C cmd. */ 521554c0a3aSHans de Goede rtw_write8(padapter, REG_HMETFR, 0x0f); 522554c0a3aSHans de Goede 523554c0a3aSHans de Goede /* Init H2C counter. by tynli. 2009.12.09. */ 524554c0a3aSHans de Goede pHalData->LastHMEBoxNum = 0; 525554c0a3aSHans de Goede /* pHalData->H2CQueueHead = 0; */ 526554c0a3aSHans de Goede /* pHalData->H2CQueueTail = 0; */ 527554c0a3aSHans de Goede /* pHalData->H2CStopInsertQueue = false; */ 528554c0a3aSHans de Goede } 529554c0a3aSHans de Goede 530554c0a3aSHans de Goede static void rtl8723b_free_hal_data(struct adapter *padapter) 531554c0a3aSHans de Goede { 532554c0a3aSHans de Goede } 533554c0a3aSHans de Goede 534554c0a3aSHans de Goede /* */ 535554c0a3aSHans de Goede /* Efuse related code */ 536554c0a3aSHans de Goede /* */ 537554c0a3aSHans de Goede static u8 hal_EfuseSwitchToBank( 538554c0a3aSHans de Goede struct adapter *padapter, u8 bank, bool bPseudoTest 539554c0a3aSHans de Goede ) 540554c0a3aSHans de Goede { 541554c0a3aSHans de Goede u8 bRet = false; 542554c0a3aSHans de Goede u32 value32 = 0; 543554c0a3aSHans de Goede #ifdef HAL_EFUSE_MEMORY 544554c0a3aSHans de Goede struct hal_com_data *pHalData = GET_HAL_DATA(padapter); 5459d3c9ecdSMarco Cesati struct efuse_hal *pEfuseHal = &pHalData->EfuseHal; 546554c0a3aSHans de Goede #endif 547554c0a3aSHans de Goede 548554c0a3aSHans de Goede 549554c0a3aSHans de Goede DBG_8192C("%s: Efuse switch bank to %d\n", __func__, bank); 550554c0a3aSHans de Goede if (bPseudoTest) { 551554c0a3aSHans de Goede #ifdef HAL_EFUSE_MEMORY 552554c0a3aSHans de Goede pEfuseHal->fakeEfuseBank = bank; 553554c0a3aSHans de Goede #else 554554c0a3aSHans de Goede fakeEfuseBank = bank; 555554c0a3aSHans de Goede #endif 556554c0a3aSHans de Goede bRet = true; 557554c0a3aSHans de Goede } else { 558554c0a3aSHans de Goede value32 = rtw_read32(padapter, EFUSE_TEST); 559554c0a3aSHans de Goede bRet = true; 560554c0a3aSHans de Goede switch (bank) { 561554c0a3aSHans de Goede case 0: 562554c0a3aSHans de Goede value32 = (value32 & ~EFUSE_SEL_MASK) | EFUSE_SEL(EFUSE_WIFI_SEL_0); 563554c0a3aSHans de Goede break; 564554c0a3aSHans de Goede case 1: 565554c0a3aSHans de Goede value32 = (value32 & ~EFUSE_SEL_MASK) | EFUSE_SEL(EFUSE_BT_SEL_0); 566554c0a3aSHans de Goede break; 567554c0a3aSHans de Goede case 2: 568554c0a3aSHans de Goede value32 = (value32 & ~EFUSE_SEL_MASK) | EFUSE_SEL(EFUSE_BT_SEL_1); 569554c0a3aSHans de Goede break; 570554c0a3aSHans de Goede case 3: 571554c0a3aSHans de Goede value32 = (value32 & ~EFUSE_SEL_MASK) | EFUSE_SEL(EFUSE_BT_SEL_2); 572554c0a3aSHans de Goede break; 573554c0a3aSHans de Goede default: 574554c0a3aSHans de Goede value32 = (value32 & ~EFUSE_SEL_MASK) | EFUSE_SEL(EFUSE_WIFI_SEL_0); 575554c0a3aSHans de Goede bRet = false; 576554c0a3aSHans de Goede break; 577554c0a3aSHans de Goede } 578554c0a3aSHans de Goede rtw_write32(padapter, EFUSE_TEST, value32); 579554c0a3aSHans de Goede } 580554c0a3aSHans de Goede 581554c0a3aSHans de Goede return bRet; 582554c0a3aSHans de Goede } 583554c0a3aSHans de Goede 584554c0a3aSHans de Goede static void Hal_GetEfuseDefinition( 585554c0a3aSHans de Goede struct adapter *padapter, 586554c0a3aSHans de Goede u8 efuseType, 587554c0a3aSHans de Goede u8 type, 588554c0a3aSHans de Goede void *pOut, 589554c0a3aSHans de Goede bool bPseudoTest 590554c0a3aSHans de Goede ) 591554c0a3aSHans de Goede { 592554c0a3aSHans de Goede switch (type) { 593554c0a3aSHans de Goede case TYPE_EFUSE_MAX_SECTION: 594554c0a3aSHans de Goede { 595554c0a3aSHans de Goede u8 *pMax_section; 5961b98ee33SHimanshu Jha pMax_section = pOut; 597554c0a3aSHans de Goede 598554c0a3aSHans de Goede if (efuseType == EFUSE_WIFI) 599554c0a3aSHans de Goede *pMax_section = EFUSE_MAX_SECTION_8723B; 600554c0a3aSHans de Goede else 601554c0a3aSHans de Goede *pMax_section = EFUSE_BT_MAX_SECTION; 602554c0a3aSHans de Goede } 603554c0a3aSHans de Goede break; 604554c0a3aSHans de Goede 605554c0a3aSHans de Goede case TYPE_EFUSE_REAL_CONTENT_LEN: 606554c0a3aSHans de Goede { 607554c0a3aSHans de Goede u16 *pu2Tmp; 6081b98ee33SHimanshu Jha pu2Tmp = pOut; 609554c0a3aSHans de Goede 610554c0a3aSHans de Goede if (efuseType == EFUSE_WIFI) 611554c0a3aSHans de Goede *pu2Tmp = EFUSE_REAL_CONTENT_LEN_8723B; 612554c0a3aSHans de Goede else 613554c0a3aSHans de Goede *pu2Tmp = EFUSE_BT_REAL_CONTENT_LEN; 614554c0a3aSHans de Goede } 615554c0a3aSHans de Goede break; 616554c0a3aSHans de Goede 617554c0a3aSHans de Goede case TYPE_AVAILABLE_EFUSE_BYTES_BANK: 618554c0a3aSHans de Goede { 619554c0a3aSHans de Goede u16 *pu2Tmp; 6201b98ee33SHimanshu Jha pu2Tmp = pOut; 621554c0a3aSHans de Goede 622554c0a3aSHans de Goede if (efuseType == EFUSE_WIFI) 623554c0a3aSHans de Goede *pu2Tmp = (EFUSE_REAL_CONTENT_LEN_8723B-EFUSE_OOB_PROTECT_BYTES); 624554c0a3aSHans de Goede else 625554c0a3aSHans de Goede *pu2Tmp = (EFUSE_BT_REAL_BANK_CONTENT_LEN-EFUSE_PROTECT_BYTES_BANK); 626554c0a3aSHans de Goede } 627554c0a3aSHans de Goede break; 628554c0a3aSHans de Goede 629554c0a3aSHans de Goede case TYPE_AVAILABLE_EFUSE_BYTES_TOTAL: 630554c0a3aSHans de Goede { 631554c0a3aSHans de Goede u16 *pu2Tmp; 6321b98ee33SHimanshu Jha pu2Tmp = pOut; 633554c0a3aSHans de Goede 634554c0a3aSHans de Goede if (efuseType == EFUSE_WIFI) 635554c0a3aSHans de Goede *pu2Tmp = (EFUSE_REAL_CONTENT_LEN_8723B-EFUSE_OOB_PROTECT_BYTES); 636554c0a3aSHans de Goede else 637554c0a3aSHans de Goede *pu2Tmp = (EFUSE_BT_REAL_CONTENT_LEN-(EFUSE_PROTECT_BYTES_BANK*3)); 638554c0a3aSHans de Goede } 639554c0a3aSHans de Goede break; 640554c0a3aSHans de Goede 641554c0a3aSHans de Goede case TYPE_EFUSE_MAP_LEN: 642554c0a3aSHans de Goede { 643554c0a3aSHans de Goede u16 *pu2Tmp; 6441b98ee33SHimanshu Jha pu2Tmp = pOut; 645554c0a3aSHans de Goede 646554c0a3aSHans de Goede if (efuseType == EFUSE_WIFI) 647554c0a3aSHans de Goede *pu2Tmp = EFUSE_MAX_MAP_LEN; 648554c0a3aSHans de Goede else 649554c0a3aSHans de Goede *pu2Tmp = EFUSE_BT_MAP_LEN; 650554c0a3aSHans de Goede } 651554c0a3aSHans de Goede break; 652554c0a3aSHans de Goede 653554c0a3aSHans de Goede case TYPE_EFUSE_PROTECT_BYTES_BANK: 654554c0a3aSHans de Goede { 655554c0a3aSHans de Goede u8 *pu1Tmp; 6561b98ee33SHimanshu Jha pu1Tmp = pOut; 657554c0a3aSHans de Goede 658554c0a3aSHans de Goede if (efuseType == EFUSE_WIFI) 659554c0a3aSHans de Goede *pu1Tmp = EFUSE_OOB_PROTECT_BYTES; 660554c0a3aSHans de Goede else 661554c0a3aSHans de Goede *pu1Tmp = EFUSE_PROTECT_BYTES_BANK; 662554c0a3aSHans de Goede } 663554c0a3aSHans de Goede break; 664554c0a3aSHans de Goede 665554c0a3aSHans de Goede case TYPE_EFUSE_CONTENT_LEN_BANK: 666554c0a3aSHans de Goede { 667554c0a3aSHans de Goede u16 *pu2Tmp; 6681b98ee33SHimanshu Jha pu2Tmp = pOut; 669554c0a3aSHans de Goede 670554c0a3aSHans de Goede if (efuseType == EFUSE_WIFI) 671554c0a3aSHans de Goede *pu2Tmp = EFUSE_REAL_CONTENT_LEN_8723B; 672554c0a3aSHans de Goede else 673554c0a3aSHans de Goede *pu2Tmp = EFUSE_BT_REAL_BANK_CONTENT_LEN; 674554c0a3aSHans de Goede } 675554c0a3aSHans de Goede break; 676554c0a3aSHans de Goede 677554c0a3aSHans de Goede default: 678554c0a3aSHans de Goede { 679554c0a3aSHans de Goede u8 *pu1Tmp; 6801b98ee33SHimanshu Jha pu1Tmp = pOut; 681554c0a3aSHans de Goede *pu1Tmp = 0; 682554c0a3aSHans de Goede } 683554c0a3aSHans de Goede break; 684554c0a3aSHans de Goede } 685554c0a3aSHans de Goede } 686554c0a3aSHans de Goede 687554c0a3aSHans de Goede #define VOLTAGE_V25 0x03 688554c0a3aSHans de Goede #define LDOE25_SHIFT 28 689554c0a3aSHans de Goede 690554c0a3aSHans de Goede /* */ 691554c0a3aSHans de Goede /* The following is for compile ok */ 692554c0a3aSHans de Goede /* That should be merged with the original in the future */ 693554c0a3aSHans de Goede /* */ 694554c0a3aSHans de Goede #define EFUSE_ACCESS_ON_8723 0x69 /* For RTL8723 only. */ 695554c0a3aSHans de Goede #define EFUSE_ACCESS_OFF_8723 0x00 /* For RTL8723 only. */ 696554c0a3aSHans de Goede #define REG_EFUSE_ACCESS_8723 0x00CF /* Efuse access protection for RTL8723 */ 697554c0a3aSHans de Goede 698554c0a3aSHans de Goede /* */ 699554c0a3aSHans de Goede static void Hal_BT_EfusePowerSwitch( 700554c0a3aSHans de Goede struct adapter *padapter, u8 bWrite, u8 PwrState 701554c0a3aSHans de Goede ) 702554c0a3aSHans de Goede { 703554c0a3aSHans de Goede u8 tempval; 7047036126aSHariprasad Kelam if (PwrState) { 705554c0a3aSHans de Goede /* enable BT power cut */ 706554c0a3aSHans de Goede /* 0x6A[14] = 1 */ 707554c0a3aSHans de Goede tempval = rtw_read8(padapter, 0x6B); 708554c0a3aSHans de Goede tempval |= BIT(6); 709554c0a3aSHans de Goede rtw_write8(padapter, 0x6B, tempval); 710554c0a3aSHans de Goede 711554c0a3aSHans de Goede /* Attention!! Between 0x6A[14] and 0x6A[15] setting need 100us delay */ 71268468503SAndreas Hellmich /* So don't write 0x6A[14]= 1 and 0x6A[15]= 0 together! */ 713554c0a3aSHans de Goede msleep(1); 714554c0a3aSHans de Goede /* disable BT output isolation */ 715554c0a3aSHans de Goede /* 0x6A[15] = 0 */ 716554c0a3aSHans de Goede tempval = rtw_read8(padapter, 0x6B); 717554c0a3aSHans de Goede tempval &= ~BIT(7); 718554c0a3aSHans de Goede rtw_write8(padapter, 0x6B, tempval); 719554c0a3aSHans de Goede } else { 720554c0a3aSHans de Goede /* enable BT output isolation */ 721554c0a3aSHans de Goede /* 0x6A[15] = 1 */ 722554c0a3aSHans de Goede tempval = rtw_read8(padapter, 0x6B); 723554c0a3aSHans de Goede tempval |= BIT(7); 724554c0a3aSHans de Goede rtw_write8(padapter, 0x6B, tempval); 725554c0a3aSHans de Goede 726554c0a3aSHans de Goede /* Attention!! Between 0x6A[14] and 0x6A[15] setting need 100us delay */ 72768468503SAndreas Hellmich /* So don't write 0x6A[14]= 1 and 0x6A[15]= 0 together! */ 728554c0a3aSHans de Goede 729554c0a3aSHans de Goede /* disable BT power cut */ 730554c0a3aSHans de Goede /* 0x6A[14] = 1 */ 731554c0a3aSHans de Goede tempval = rtw_read8(padapter, 0x6B); 732554c0a3aSHans de Goede tempval &= ~BIT(6); 733554c0a3aSHans de Goede rtw_write8(padapter, 0x6B, tempval); 734554c0a3aSHans de Goede } 735554c0a3aSHans de Goede 736554c0a3aSHans de Goede } 737554c0a3aSHans de Goede static void Hal_EfusePowerSwitch( 738554c0a3aSHans de Goede struct adapter *padapter, u8 bWrite, u8 PwrState 739554c0a3aSHans de Goede ) 740554c0a3aSHans de Goede { 741554c0a3aSHans de Goede u8 tempval; 742554c0a3aSHans de Goede u16 tmpV16; 743554c0a3aSHans de Goede 744554c0a3aSHans de Goede 7457036126aSHariprasad Kelam if (PwrState) { 746554c0a3aSHans de Goede /* To avoid cannot access efuse regsiters after disable/enable several times during DTM test. */ 747554c0a3aSHans de Goede /* Suggested by SD1 IsaacHsu. 2013.07.08, added by tynli. */ 748554c0a3aSHans de Goede tempval = rtw_read8(padapter, SDIO_LOCAL_BASE|SDIO_REG_HSUS_CTRL); 749554c0a3aSHans de Goede if (tempval & BIT(0)) { /* SDIO local register is suspend */ 750554c0a3aSHans de Goede u8 count = 0; 751554c0a3aSHans de Goede 752554c0a3aSHans de Goede 753554c0a3aSHans de Goede tempval &= ~BIT(0); 754554c0a3aSHans de Goede rtw_write8(padapter, SDIO_LOCAL_BASE|SDIO_REG_HSUS_CTRL, tempval); 755554c0a3aSHans de Goede 756554c0a3aSHans de Goede /* check 0x86[1:0]= 10'2h, wait power state to leave suspend */ 757554c0a3aSHans de Goede do { 758554c0a3aSHans de Goede tempval = rtw_read8(padapter, SDIO_LOCAL_BASE|SDIO_REG_HSUS_CTRL); 759554c0a3aSHans de Goede tempval &= 0x3; 760554c0a3aSHans de Goede if (tempval == 0x02) 761554c0a3aSHans de Goede break; 762554c0a3aSHans de Goede 763554c0a3aSHans de Goede count++; 764554c0a3aSHans de Goede if (count >= 100) 765554c0a3aSHans de Goede break; 766554c0a3aSHans de Goede 767554c0a3aSHans de Goede mdelay(10); 768554c0a3aSHans de Goede } while (1); 769554c0a3aSHans de Goede 770554c0a3aSHans de Goede if (count >= 100) { 771554c0a3aSHans de Goede DBG_8192C(FUNC_ADPT_FMT ": Leave SDIO local register suspend fail! Local 0x86 =%#X\n", 772554c0a3aSHans de Goede FUNC_ADPT_ARG(padapter), tempval); 773554c0a3aSHans de Goede } else { 774554c0a3aSHans de Goede DBG_8192C(FUNC_ADPT_FMT ": Leave SDIO local register suspend OK! Local 0x86 =%#X\n", 775554c0a3aSHans de Goede FUNC_ADPT_ARG(padapter), tempval); 776554c0a3aSHans de Goede } 777554c0a3aSHans de Goede } 778554c0a3aSHans de Goede 779554c0a3aSHans de Goede rtw_write8(padapter, REG_EFUSE_ACCESS_8723, EFUSE_ACCESS_ON_8723); 780554c0a3aSHans de Goede 781554c0a3aSHans de Goede /* Reset: 0x0000h[28], default valid */ 782554c0a3aSHans de Goede tmpV16 = rtw_read16(padapter, REG_SYS_FUNC_EN); 783554c0a3aSHans de Goede if (!(tmpV16 & FEN_ELDR)) { 784554c0a3aSHans de Goede tmpV16 |= FEN_ELDR; 785554c0a3aSHans de Goede rtw_write16(padapter, REG_SYS_FUNC_EN, tmpV16); 786554c0a3aSHans de Goede } 787554c0a3aSHans de Goede 788554c0a3aSHans de Goede /* Clock: Gated(0x0008h[5]) 8M(0x0008h[1]) clock from ANA, default valid */ 789554c0a3aSHans de Goede tmpV16 = rtw_read16(padapter, REG_SYS_CLKR); 790554c0a3aSHans de Goede if ((!(tmpV16 & LOADER_CLK_EN)) || (!(tmpV16 & ANA8M))) { 791554c0a3aSHans de Goede tmpV16 |= (LOADER_CLK_EN | ANA8M); 792554c0a3aSHans de Goede rtw_write16(padapter, REG_SYS_CLKR, tmpV16); 793554c0a3aSHans de Goede } 794554c0a3aSHans de Goede 7957036126aSHariprasad Kelam if (bWrite) { 796554c0a3aSHans de Goede /* Enable LDO 2.5V before read/write action */ 797554c0a3aSHans de Goede tempval = rtw_read8(padapter, EFUSE_TEST+3); 798554c0a3aSHans de Goede tempval &= 0x0F; 799554c0a3aSHans de Goede tempval |= (VOLTAGE_V25 << 4); 800554c0a3aSHans de Goede rtw_write8(padapter, EFUSE_TEST+3, (tempval | 0x80)); 801554c0a3aSHans de Goede 802554c0a3aSHans de Goede /* rtw_write8(padapter, REG_EFUSE_ACCESS, EFUSE_ACCESS_ON); */ 803554c0a3aSHans de Goede } 804554c0a3aSHans de Goede } else { 805554c0a3aSHans de Goede rtw_write8(padapter, REG_EFUSE_ACCESS, EFUSE_ACCESS_OFF); 806554c0a3aSHans de Goede 8077036126aSHariprasad Kelam if (bWrite) { 808554c0a3aSHans de Goede /* Disable LDO 2.5V after read/write action */ 809554c0a3aSHans de Goede tempval = rtw_read8(padapter, EFUSE_TEST+3); 810554c0a3aSHans de Goede rtw_write8(padapter, EFUSE_TEST+3, (tempval & 0x7F)); 811554c0a3aSHans de Goede } 812554c0a3aSHans de Goede 813554c0a3aSHans de Goede } 814554c0a3aSHans de Goede } 815554c0a3aSHans de Goede 816554c0a3aSHans de Goede static void hal_ReadEFuse_WiFi( 817554c0a3aSHans de Goede struct adapter *padapter, 818554c0a3aSHans de Goede u16 _offset, 819554c0a3aSHans de Goede u16 _size_byte, 820554c0a3aSHans de Goede u8 *pbuf, 821554c0a3aSHans de Goede bool bPseudoTest 822554c0a3aSHans de Goede ) 823554c0a3aSHans de Goede { 824554c0a3aSHans de Goede #ifdef HAL_EFUSE_MEMORY 825554c0a3aSHans de Goede struct hal_com_data *pHalData = GET_HAL_DATA(padapter); 8269d3c9ecdSMarco Cesati struct efuse_hal *pEfuseHal = &pHalData->EfuseHal; 827554c0a3aSHans de Goede #endif 828554c0a3aSHans de Goede u8 *efuseTbl = NULL; 829554c0a3aSHans de Goede u16 eFuse_Addr = 0; 830554c0a3aSHans de Goede u8 offset, wden; 831554c0a3aSHans de Goede u8 efuseHeader, efuseExtHdr, efuseData; 832554c0a3aSHans de Goede u16 i, total, used; 833554c0a3aSHans de Goede u8 efuse_usage = 0; 834554c0a3aSHans de Goede 835554c0a3aSHans de Goede /* DBG_871X("YJ: ====>%s():_offset =%d _size_byte =%d bPseudoTest =%d\n", __func__, _offset, _size_byte, bPseudoTest); */ 836554c0a3aSHans de Goede /* */ 837554c0a3aSHans de Goede /* Do NOT excess total size of EFuse table. Added by Roger, 2008.11.10. */ 838554c0a3aSHans de Goede /* */ 839554c0a3aSHans de Goede if ((_offset+_size_byte) > EFUSE_MAX_MAP_LEN) { 840554c0a3aSHans de Goede DBG_8192C("%s: Invalid offset(%#x) with read bytes(%#x)!!\n", __func__, _offset, _size_byte); 841554c0a3aSHans de Goede return; 842554c0a3aSHans de Goede } 843554c0a3aSHans de Goede 8442ef2b7c2SJoe Perches efuseTbl = rtw_malloc(EFUSE_MAX_MAP_LEN); 845019acabeSHimadri Pandya if (!efuseTbl) { 846554c0a3aSHans de Goede DBG_8192C("%s: alloc efuseTbl fail!\n", __func__); 847554c0a3aSHans de Goede return; 848554c0a3aSHans de Goede } 849554c0a3aSHans de Goede /* 0xff will be efuse default value instead of 0x00. */ 850554c0a3aSHans de Goede memset(efuseTbl, 0xFF, EFUSE_MAX_MAP_LEN); 851554c0a3aSHans de Goede 852554c0a3aSHans de Goede 853f55a6d45SArnd Bergmann #ifdef DEBUG 854554c0a3aSHans de Goede if (0) { 855554c0a3aSHans de Goede for (i = 0; i < 256; i++) 856554c0a3aSHans de Goede efuse_OneByteRead(padapter, i, &efuseTbl[i], false); 857554c0a3aSHans de Goede DBG_871X("Efuse Content:\n"); 858554c0a3aSHans de Goede for (i = 0; i < 256; i++) { 859554c0a3aSHans de Goede if (i % 16 == 0) 860554c0a3aSHans de Goede printk("\n"); 861554c0a3aSHans de Goede printk("%02X ", efuseTbl[i]); 862554c0a3aSHans de Goede } 863554c0a3aSHans de Goede printk("\n"); 864554c0a3aSHans de Goede } 865554c0a3aSHans de Goede #endif 866554c0a3aSHans de Goede 867554c0a3aSHans de Goede 868554c0a3aSHans de Goede /* switch bank back to bank 0 for later BT and wifi use. */ 869554c0a3aSHans de Goede hal_EfuseSwitchToBank(padapter, 0, bPseudoTest); 870554c0a3aSHans de Goede 871554c0a3aSHans de Goede while (AVAILABLE_EFUSE_ADDR(eFuse_Addr)) { 872554c0a3aSHans de Goede efuse_OneByteRead(padapter, eFuse_Addr++, &efuseHeader, bPseudoTest); 873554c0a3aSHans de Goede if (efuseHeader == 0xFF) { 874554c0a3aSHans de Goede DBG_8192C("%s: data end at address =%#x\n", __func__, eFuse_Addr-1); 875554c0a3aSHans de Goede break; 876554c0a3aSHans de Goede } 877554c0a3aSHans de Goede /* DBG_8192C("%s: efuse[0x%X]= 0x%02X\n", __func__, eFuse_Addr-1, efuseHeader); */ 878554c0a3aSHans de Goede 879554c0a3aSHans de Goede /* Check PG header for section num. */ 880554c0a3aSHans de Goede if (EXT_HEADER(efuseHeader)) { /* extended header */ 881554c0a3aSHans de Goede offset = GET_HDR_OFFSET_2_0(efuseHeader); 882554c0a3aSHans de Goede /* DBG_8192C("%s: extended header offset = 0x%X\n", __func__, offset); */ 883554c0a3aSHans de Goede 884554c0a3aSHans de Goede efuse_OneByteRead(padapter, eFuse_Addr++, &efuseExtHdr, bPseudoTest); 885554c0a3aSHans de Goede /* DBG_8192C("%s: efuse[0x%X]= 0x%02X\n", __func__, eFuse_Addr-1, efuseExtHdr); */ 886554c0a3aSHans de Goede if (ALL_WORDS_DISABLED(efuseExtHdr)) 887554c0a3aSHans de Goede continue; 888554c0a3aSHans de Goede 889554c0a3aSHans de Goede offset |= ((efuseExtHdr & 0xF0) >> 1); 890554c0a3aSHans de Goede wden = (efuseExtHdr & 0x0F); 891554c0a3aSHans de Goede } else { 892554c0a3aSHans de Goede offset = ((efuseHeader >> 4) & 0x0f); 893554c0a3aSHans de Goede wden = (efuseHeader & 0x0f); 894554c0a3aSHans de Goede } 895554c0a3aSHans de Goede /* DBG_8192C("%s: Offset =%d Worden = 0x%X\n", __func__, offset, wden); */ 896554c0a3aSHans de Goede 897554c0a3aSHans de Goede if (offset < EFUSE_MAX_SECTION_8723B) { 898554c0a3aSHans de Goede u16 addr; 899554c0a3aSHans de Goede /* Get word enable value from PG header */ 900554c0a3aSHans de Goede /* DBG_8192C("%s: Offset =%d Worden = 0x%X\n", __func__, offset, wden); */ 901554c0a3aSHans de Goede 902554c0a3aSHans de Goede addr = offset * PGPKT_DATA_SIZE; 903554c0a3aSHans de Goede for (i = 0; i < EFUSE_MAX_WORD_UNIT; i++) { 904554c0a3aSHans de Goede /* Check word enable condition in the section */ 905554c0a3aSHans de Goede if (!(wden & (0x01<<i))) { 906554c0a3aSHans de Goede efuse_OneByteRead(padapter, eFuse_Addr++, &efuseData, bPseudoTest); 907554c0a3aSHans de Goede /* DBG_8192C("%s: efuse[%#X]= 0x%02X\n", __func__, eFuse_Addr-1, efuseData); */ 908554c0a3aSHans de Goede efuseTbl[addr] = efuseData; 909554c0a3aSHans de Goede 910554c0a3aSHans de Goede efuse_OneByteRead(padapter, eFuse_Addr++, &efuseData, bPseudoTest); 911554c0a3aSHans de Goede /* DBG_8192C("%s: efuse[%#X]= 0x%02X\n", __func__, eFuse_Addr-1, efuseData); */ 912554c0a3aSHans de Goede efuseTbl[addr+1] = efuseData; 913554c0a3aSHans de Goede } 914554c0a3aSHans de Goede addr += 2; 915554c0a3aSHans de Goede } 916554c0a3aSHans de Goede } else { 917554c0a3aSHans de Goede DBG_8192C(KERN_ERR "%s: offset(%d) is illegal!!\n", __func__, offset); 918554c0a3aSHans de Goede eFuse_Addr += Efuse_CalculateWordCnts(wden)*2; 919554c0a3aSHans de Goede } 920554c0a3aSHans de Goede } 921554c0a3aSHans de Goede 922554c0a3aSHans de Goede /* Copy from Efuse map to output pointer memory!!! */ 923554c0a3aSHans de Goede for (i = 0; i < _size_byte; i++) 924554c0a3aSHans de Goede pbuf[i] = efuseTbl[_offset+i]; 925554c0a3aSHans de Goede 926f55a6d45SArnd Bergmann #ifdef DEBUG 927554c0a3aSHans de Goede if (1) { 928554c0a3aSHans de Goede DBG_871X("Efuse Realmap:\n"); 929554c0a3aSHans de Goede for (i = 0; i < _size_byte; i++) { 930554c0a3aSHans de Goede if (i % 16 == 0) 931554c0a3aSHans de Goede printk("\n"); 932554c0a3aSHans de Goede printk("%02X ", pbuf[i]); 933554c0a3aSHans de Goede } 934554c0a3aSHans de Goede printk("\n"); 935554c0a3aSHans de Goede } 936554c0a3aSHans de Goede #endif 937554c0a3aSHans de Goede /* Calculate Efuse utilization */ 938554c0a3aSHans de Goede EFUSE_GetEfuseDefinition(padapter, EFUSE_WIFI, TYPE_AVAILABLE_EFUSE_BYTES_TOTAL, &total, bPseudoTest); 939554c0a3aSHans de Goede used = eFuse_Addr - 1; 940554c0a3aSHans de Goede efuse_usage = (u8)((used*100)/total); 941554c0a3aSHans de Goede if (bPseudoTest) { 942554c0a3aSHans de Goede #ifdef HAL_EFUSE_MEMORY 943554c0a3aSHans de Goede pEfuseHal->fakeEfuseUsedBytes = used; 944554c0a3aSHans de Goede #else 945554c0a3aSHans de Goede fakeEfuseUsedBytes = used; 946554c0a3aSHans de Goede #endif 947554c0a3aSHans de Goede } else { 948554c0a3aSHans de Goede rtw_hal_set_hwreg(padapter, HW_VAR_EFUSE_BYTES, (u8 *)&used); 949554c0a3aSHans de Goede rtw_hal_set_hwreg(padapter, HW_VAR_EFUSE_USAGE, (u8 *)&efuse_usage); 950554c0a3aSHans de Goede } 951554c0a3aSHans de Goede 952554c0a3aSHans de Goede kfree(efuseTbl); 953554c0a3aSHans de Goede } 954554c0a3aSHans de Goede 955554c0a3aSHans de Goede static void hal_ReadEFuse_BT( 956554c0a3aSHans de Goede struct adapter *padapter, 957554c0a3aSHans de Goede u16 _offset, 958554c0a3aSHans de Goede u16 _size_byte, 959554c0a3aSHans de Goede u8 *pbuf, 960554c0a3aSHans de Goede bool bPseudoTest 961554c0a3aSHans de Goede ) 962554c0a3aSHans de Goede { 963554c0a3aSHans de Goede #ifdef HAL_EFUSE_MEMORY 964554c0a3aSHans de Goede struct hal_com_data *pHalData = GET_HAL_DATA(padapter); 9659d3c9ecdSMarco Cesati struct efuse_hal *pEfuseHal = &pHalData->EfuseHal; 966554c0a3aSHans de Goede #endif 967554c0a3aSHans de Goede u8 *efuseTbl; 968554c0a3aSHans de Goede u8 bank; 969554c0a3aSHans de Goede u16 eFuse_Addr; 970554c0a3aSHans de Goede u8 efuseHeader, efuseExtHdr, efuseData; 971554c0a3aSHans de Goede u8 offset, wden; 972554c0a3aSHans de Goede u16 i, total, used; 973554c0a3aSHans de Goede u8 efuse_usage; 974554c0a3aSHans de Goede 975554c0a3aSHans de Goede 976554c0a3aSHans de Goede /* */ 977554c0a3aSHans de Goede /* Do NOT excess total size of EFuse table. Added by Roger, 2008.11.10. */ 978554c0a3aSHans de Goede /* */ 979554c0a3aSHans de Goede if ((_offset+_size_byte) > EFUSE_BT_MAP_LEN) { 980554c0a3aSHans de Goede DBG_8192C("%s: Invalid offset(%#x) with read bytes(%#x)!!\n", __func__, _offset, _size_byte); 981554c0a3aSHans de Goede return; 982554c0a3aSHans de Goede } 983554c0a3aSHans de Goede 984554c0a3aSHans de Goede efuseTbl = rtw_malloc(EFUSE_BT_MAP_LEN); 98502ca9aa0SHariprasad Kelam if (!efuseTbl) { 986554c0a3aSHans de Goede DBG_8192C("%s: efuseTbl malloc fail!\n", __func__); 987554c0a3aSHans de Goede return; 988554c0a3aSHans de Goede } 989554c0a3aSHans de Goede /* 0xff will be efuse default value instead of 0x00. */ 990554c0a3aSHans de Goede memset(efuseTbl, 0xFF, EFUSE_BT_MAP_LEN); 991554c0a3aSHans de Goede 992554c0a3aSHans de Goede EFUSE_GetEfuseDefinition(padapter, EFUSE_BT, TYPE_AVAILABLE_EFUSE_BYTES_BANK, &total, bPseudoTest); 993554c0a3aSHans de Goede 994554c0a3aSHans de Goede for (bank = 1; bank < 3; bank++) { /* 8723b Max bake 0~2 */ 995554c0a3aSHans de Goede if (hal_EfuseSwitchToBank(padapter, bank, bPseudoTest) == false) { 996554c0a3aSHans de Goede DBG_8192C("%s: hal_EfuseSwitchToBank Fail!!\n", __func__); 997554c0a3aSHans de Goede goto exit; 998554c0a3aSHans de Goede } 999554c0a3aSHans de Goede 1000554c0a3aSHans de Goede eFuse_Addr = 0; 1001554c0a3aSHans de Goede 1002554c0a3aSHans de Goede while (AVAILABLE_EFUSE_ADDR(eFuse_Addr)) { 1003554c0a3aSHans de Goede efuse_OneByteRead(padapter, eFuse_Addr++, &efuseHeader, bPseudoTest); 1004554c0a3aSHans de Goede if (efuseHeader == 0xFF) 1005554c0a3aSHans de Goede break; 1006554c0a3aSHans de Goede DBG_8192C("%s: efuse[%#X]= 0x%02x (header)\n", __func__, (((bank-1)*EFUSE_REAL_CONTENT_LEN_8723B)+eFuse_Addr-1), efuseHeader); 1007554c0a3aSHans de Goede 1008554c0a3aSHans de Goede /* Check PG header for section num. */ 1009554c0a3aSHans de Goede if (EXT_HEADER(efuseHeader)) { /* extended header */ 1010554c0a3aSHans de Goede offset = GET_HDR_OFFSET_2_0(efuseHeader); 1011554c0a3aSHans de Goede DBG_8192C("%s: extended header offset_2_0 = 0x%X\n", __func__, offset); 1012554c0a3aSHans de Goede 1013554c0a3aSHans de Goede efuse_OneByteRead(padapter, eFuse_Addr++, &efuseExtHdr, bPseudoTest); 1014554c0a3aSHans de Goede DBG_8192C("%s: efuse[%#X]= 0x%02x (ext header)\n", __func__, (((bank-1)*EFUSE_REAL_CONTENT_LEN_8723B)+eFuse_Addr-1), efuseExtHdr); 1015554c0a3aSHans de Goede if (ALL_WORDS_DISABLED(efuseExtHdr)) 1016554c0a3aSHans de Goede continue; 1017554c0a3aSHans de Goede 1018554c0a3aSHans de Goede 1019554c0a3aSHans de Goede offset |= ((efuseExtHdr & 0xF0) >> 1); 1020554c0a3aSHans de Goede wden = (efuseExtHdr & 0x0F); 1021554c0a3aSHans de Goede } else { 1022554c0a3aSHans de Goede offset = ((efuseHeader >> 4) & 0x0f); 1023554c0a3aSHans de Goede wden = (efuseHeader & 0x0f); 1024554c0a3aSHans de Goede } 1025554c0a3aSHans de Goede 1026554c0a3aSHans de Goede if (offset < EFUSE_BT_MAX_SECTION) { 1027554c0a3aSHans de Goede u16 addr; 1028554c0a3aSHans de Goede 1029554c0a3aSHans de Goede /* Get word enable value from PG header */ 1030554c0a3aSHans de Goede DBG_8192C("%s: Offset =%d Worden =%#X\n", __func__, offset, wden); 1031554c0a3aSHans de Goede 1032554c0a3aSHans de Goede addr = offset * PGPKT_DATA_SIZE; 1033554c0a3aSHans de Goede for (i = 0; i < EFUSE_MAX_WORD_UNIT; i++) { 1034554c0a3aSHans de Goede /* Check word enable condition in the section */ 1035554c0a3aSHans de Goede if (!(wden & (0x01<<i))) { 1036554c0a3aSHans de Goede efuse_OneByteRead(padapter, eFuse_Addr++, &efuseData, bPseudoTest); 1037554c0a3aSHans de Goede DBG_8192C("%s: efuse[%#X]= 0x%02X\n", __func__, eFuse_Addr-1, efuseData); 1038554c0a3aSHans de Goede efuseTbl[addr] = efuseData; 1039554c0a3aSHans de Goede 1040554c0a3aSHans de Goede efuse_OneByteRead(padapter, eFuse_Addr++, &efuseData, bPseudoTest); 1041554c0a3aSHans de Goede DBG_8192C("%s: efuse[%#X]= 0x%02X\n", __func__, eFuse_Addr-1, efuseData); 1042554c0a3aSHans de Goede efuseTbl[addr+1] = efuseData; 1043554c0a3aSHans de Goede } 1044554c0a3aSHans de Goede addr += 2; 1045554c0a3aSHans de Goede } 1046554c0a3aSHans de Goede } else { 1047554c0a3aSHans de Goede DBG_8192C("%s: offset(%d) is illegal!!\n", __func__, offset); 1048554c0a3aSHans de Goede eFuse_Addr += Efuse_CalculateWordCnts(wden)*2; 1049554c0a3aSHans de Goede } 1050554c0a3aSHans de Goede } 1051554c0a3aSHans de Goede 1052554c0a3aSHans de Goede if ((eFuse_Addr-1) < total) { 1053554c0a3aSHans de Goede DBG_8192C("%s: bank(%d) data end at %#x\n", __func__, bank, eFuse_Addr-1); 1054554c0a3aSHans de Goede break; 1055554c0a3aSHans de Goede } 1056554c0a3aSHans de Goede } 1057554c0a3aSHans de Goede 1058554c0a3aSHans de Goede /* switch bank back to bank 0 for later BT and wifi use. */ 1059554c0a3aSHans de Goede hal_EfuseSwitchToBank(padapter, 0, bPseudoTest); 1060554c0a3aSHans de Goede 1061554c0a3aSHans de Goede /* Copy from Efuse map to output pointer memory!!! */ 1062554c0a3aSHans de Goede for (i = 0; i < _size_byte; i++) 1063554c0a3aSHans de Goede pbuf[i] = efuseTbl[_offset+i]; 1064554c0a3aSHans de Goede 1065554c0a3aSHans de Goede /* */ 1066554c0a3aSHans de Goede /* Calculate Efuse utilization. */ 1067554c0a3aSHans de Goede /* */ 1068554c0a3aSHans de Goede EFUSE_GetEfuseDefinition(padapter, EFUSE_BT, TYPE_AVAILABLE_EFUSE_BYTES_TOTAL, &total, bPseudoTest); 1069554c0a3aSHans de Goede used = (EFUSE_BT_REAL_BANK_CONTENT_LEN*(bank-1)) + eFuse_Addr - 1; 1070554c0a3aSHans de Goede DBG_8192C("%s: bank(%d) data end at %#x , used =%d\n", __func__, bank, eFuse_Addr-1, used); 1071554c0a3aSHans de Goede efuse_usage = (u8)((used*100)/total); 1072554c0a3aSHans de Goede if (bPseudoTest) { 1073554c0a3aSHans de Goede #ifdef HAL_EFUSE_MEMORY 1074554c0a3aSHans de Goede pEfuseHal->fakeBTEfuseUsedBytes = used; 1075554c0a3aSHans de Goede #else 1076554c0a3aSHans de Goede fakeBTEfuseUsedBytes = used; 1077554c0a3aSHans de Goede #endif 1078554c0a3aSHans de Goede } else { 1079554c0a3aSHans de Goede rtw_hal_set_hwreg(padapter, HW_VAR_EFUSE_BT_BYTES, (u8 *)&used); 1080554c0a3aSHans de Goede rtw_hal_set_hwreg(padapter, HW_VAR_EFUSE_BT_USAGE, (u8 *)&efuse_usage); 1081554c0a3aSHans de Goede } 1082554c0a3aSHans de Goede 1083554c0a3aSHans de Goede exit: 1084554c0a3aSHans de Goede kfree(efuseTbl); 1085554c0a3aSHans de Goede } 1086554c0a3aSHans de Goede 1087554c0a3aSHans de Goede static void Hal_ReadEFuse( 1088554c0a3aSHans de Goede struct adapter *padapter, 1089554c0a3aSHans de Goede u8 efuseType, 1090554c0a3aSHans de Goede u16 _offset, 1091554c0a3aSHans de Goede u16 _size_byte, 1092554c0a3aSHans de Goede u8 *pbuf, 1093554c0a3aSHans de Goede bool bPseudoTest 1094554c0a3aSHans de Goede ) 1095554c0a3aSHans de Goede { 1096554c0a3aSHans de Goede if (efuseType == EFUSE_WIFI) 1097554c0a3aSHans de Goede hal_ReadEFuse_WiFi(padapter, _offset, _size_byte, pbuf, bPseudoTest); 1098554c0a3aSHans de Goede else 1099554c0a3aSHans de Goede hal_ReadEFuse_BT(padapter, _offset, _size_byte, pbuf, bPseudoTest); 1100554c0a3aSHans de Goede } 1101554c0a3aSHans de Goede 1102554c0a3aSHans de Goede static u16 hal_EfuseGetCurrentSize_WiFi( 1103554c0a3aSHans de Goede struct adapter *padapter, bool bPseudoTest 1104554c0a3aSHans de Goede ) 1105554c0a3aSHans de Goede { 1106554c0a3aSHans de Goede #ifdef HAL_EFUSE_MEMORY 1107554c0a3aSHans de Goede struct hal_com_data *pHalData = GET_HAL_DATA(padapter); 11089d3c9ecdSMarco Cesati struct efuse_hal *pEfuseHal = &pHalData->EfuseHal; 1109554c0a3aSHans de Goede #endif 1110554c0a3aSHans de Goede u16 efuse_addr = 0; 1111554c0a3aSHans de Goede u16 start_addr = 0; /* for debug */ 1112554c0a3aSHans de Goede u8 hoffset = 0, hworden = 0; 1113554c0a3aSHans de Goede u8 efuse_data, word_cnts = 0; 1114554c0a3aSHans de Goede u32 count = 0; /* for debug */ 1115554c0a3aSHans de Goede 1116554c0a3aSHans de Goede 1117554c0a3aSHans de Goede if (bPseudoTest) { 1118554c0a3aSHans de Goede #ifdef HAL_EFUSE_MEMORY 1119554c0a3aSHans de Goede efuse_addr = (u16)pEfuseHal->fakeEfuseUsedBytes; 1120554c0a3aSHans de Goede #else 1121554c0a3aSHans de Goede efuse_addr = (u16)fakeEfuseUsedBytes; 1122554c0a3aSHans de Goede #endif 1123554c0a3aSHans de Goede } else 1124554c0a3aSHans de Goede rtw_hal_get_hwreg(padapter, HW_VAR_EFUSE_BYTES, (u8 *)&efuse_addr); 1125554c0a3aSHans de Goede 1126554c0a3aSHans de Goede start_addr = efuse_addr; 1127554c0a3aSHans de Goede DBG_8192C("%s: start_efuse_addr = 0x%X\n", __func__, efuse_addr); 1128554c0a3aSHans de Goede 1129554c0a3aSHans de Goede /* switch bank back to bank 0 for later BT and wifi use. */ 1130554c0a3aSHans de Goede hal_EfuseSwitchToBank(padapter, 0, bPseudoTest); 1131554c0a3aSHans de Goede 1132554c0a3aSHans de Goede count = 0; 1133554c0a3aSHans de Goede while (AVAILABLE_EFUSE_ADDR(efuse_addr)) { 1134554c0a3aSHans de Goede if (efuse_OneByteRead(padapter, efuse_addr, &efuse_data, bPseudoTest) == false) { 1135554c0a3aSHans de Goede DBG_8192C(KERN_ERR "%s: efuse_OneByteRead Fail! addr = 0x%X !!\n", __func__, efuse_addr); 1136554c0a3aSHans de Goede goto error; 1137554c0a3aSHans de Goede } 1138554c0a3aSHans de Goede 1139554c0a3aSHans de Goede if (efuse_data == 0xFF) 1140554c0a3aSHans de Goede break; 1141554c0a3aSHans de Goede 1142554c0a3aSHans de Goede if ((start_addr != 0) && (efuse_addr == start_addr)) { 1143554c0a3aSHans de Goede count++; 1144554c0a3aSHans de Goede DBG_8192C(FUNC_ADPT_FMT ": [WARNING] efuse raw 0x%X = 0x%02X not 0xFF!!(%d times)\n", 1145554c0a3aSHans de Goede FUNC_ADPT_ARG(padapter), efuse_addr, efuse_data, count); 1146554c0a3aSHans de Goede 1147554c0a3aSHans de Goede efuse_data = 0xFF; 1148554c0a3aSHans de Goede if (count < 4) { 1149554c0a3aSHans de Goede /* try again! */ 1150554c0a3aSHans de Goede 1151554c0a3aSHans de Goede if (count > 2) { 1152554c0a3aSHans de Goede /* try again form address 0 */ 1153554c0a3aSHans de Goede efuse_addr = 0; 1154554c0a3aSHans de Goede start_addr = 0; 1155554c0a3aSHans de Goede } 1156554c0a3aSHans de Goede 1157554c0a3aSHans de Goede continue; 1158554c0a3aSHans de Goede } 1159554c0a3aSHans de Goede 1160554c0a3aSHans de Goede goto error; 1161554c0a3aSHans de Goede } 1162554c0a3aSHans de Goede 1163554c0a3aSHans de Goede if (EXT_HEADER(efuse_data)) { 1164554c0a3aSHans de Goede hoffset = GET_HDR_OFFSET_2_0(efuse_data); 1165554c0a3aSHans de Goede efuse_addr++; 1166554c0a3aSHans de Goede efuse_OneByteRead(padapter, efuse_addr, &efuse_data, bPseudoTest); 1167554c0a3aSHans de Goede if (ALL_WORDS_DISABLED(efuse_data)) 1168554c0a3aSHans de Goede continue; 1169554c0a3aSHans de Goede 1170554c0a3aSHans de Goede hoffset |= ((efuse_data & 0xF0) >> 1); 1171554c0a3aSHans de Goede hworden = efuse_data & 0x0F; 1172554c0a3aSHans de Goede } else { 1173554c0a3aSHans de Goede hoffset = (efuse_data>>4) & 0x0F; 1174554c0a3aSHans de Goede hworden = efuse_data & 0x0F; 1175554c0a3aSHans de Goede } 1176554c0a3aSHans de Goede 1177554c0a3aSHans de Goede word_cnts = Efuse_CalculateWordCnts(hworden); 1178554c0a3aSHans de Goede efuse_addr += (word_cnts*2)+1; 1179554c0a3aSHans de Goede } 1180554c0a3aSHans de Goede 1181554c0a3aSHans de Goede if (bPseudoTest) { 1182554c0a3aSHans de Goede #ifdef HAL_EFUSE_MEMORY 1183554c0a3aSHans de Goede pEfuseHal->fakeEfuseUsedBytes = efuse_addr; 1184554c0a3aSHans de Goede #else 1185554c0a3aSHans de Goede fakeEfuseUsedBytes = efuse_addr; 1186554c0a3aSHans de Goede #endif 1187554c0a3aSHans de Goede } else 1188554c0a3aSHans de Goede rtw_hal_set_hwreg(padapter, HW_VAR_EFUSE_BYTES, (u8 *)&efuse_addr); 1189554c0a3aSHans de Goede 1190554c0a3aSHans de Goede goto exit; 1191554c0a3aSHans de Goede 1192554c0a3aSHans de Goede error: 119368468503SAndreas Hellmich /* report max size to prevent write efuse */ 1194554c0a3aSHans de Goede EFUSE_GetEfuseDefinition(padapter, EFUSE_WIFI, TYPE_AVAILABLE_EFUSE_BYTES_TOTAL, &efuse_addr, bPseudoTest); 1195554c0a3aSHans de Goede 1196554c0a3aSHans de Goede exit: 1197554c0a3aSHans de Goede DBG_8192C("%s: CurrentSize =%d\n", __func__, efuse_addr); 1198554c0a3aSHans de Goede 1199554c0a3aSHans de Goede return efuse_addr; 1200554c0a3aSHans de Goede } 1201554c0a3aSHans de Goede 1202554c0a3aSHans de Goede static u16 hal_EfuseGetCurrentSize_BT(struct adapter *padapter, u8 bPseudoTest) 1203554c0a3aSHans de Goede { 1204554c0a3aSHans de Goede #ifdef HAL_EFUSE_MEMORY 1205554c0a3aSHans de Goede struct hal_com_data *pHalData = GET_HAL_DATA(padapter); 12069d3c9ecdSMarco Cesati struct efuse_hal *pEfuseHal = &pHalData->EfuseHal; 1207554c0a3aSHans de Goede #endif 1208554c0a3aSHans de Goede u16 btusedbytes; 1209554c0a3aSHans de Goede u16 efuse_addr; 1210554c0a3aSHans de Goede u8 bank, startBank; 1211554c0a3aSHans de Goede u8 hoffset = 0, hworden = 0; 1212554c0a3aSHans de Goede u8 efuse_data, word_cnts = 0; 1213554c0a3aSHans de Goede u16 retU2 = 0; 1214554c0a3aSHans de Goede 1215554c0a3aSHans de Goede if (bPseudoTest) { 1216554c0a3aSHans de Goede #ifdef HAL_EFUSE_MEMORY 1217554c0a3aSHans de Goede btusedbytes = pEfuseHal->fakeBTEfuseUsedBytes; 1218554c0a3aSHans de Goede #else 1219554c0a3aSHans de Goede btusedbytes = fakeBTEfuseUsedBytes; 1220554c0a3aSHans de Goede #endif 1221554c0a3aSHans de Goede } else 1222554c0a3aSHans de Goede rtw_hal_get_hwreg(padapter, HW_VAR_EFUSE_BT_BYTES, (u8 *)&btusedbytes); 1223554c0a3aSHans de Goede 1224554c0a3aSHans de Goede efuse_addr = (u16)((btusedbytes%EFUSE_BT_REAL_BANK_CONTENT_LEN)); 1225554c0a3aSHans de Goede startBank = (u8)(1+(btusedbytes/EFUSE_BT_REAL_BANK_CONTENT_LEN)); 1226554c0a3aSHans de Goede 1227554c0a3aSHans de Goede DBG_8192C("%s: start from bank =%d addr = 0x%X\n", __func__, startBank, efuse_addr); 1228554c0a3aSHans de Goede 1229554c0a3aSHans de Goede EFUSE_GetEfuseDefinition(padapter, EFUSE_BT, TYPE_AVAILABLE_EFUSE_BYTES_BANK, &retU2, bPseudoTest); 1230554c0a3aSHans de Goede 1231554c0a3aSHans de Goede for (bank = startBank; bank < 3; bank++) { 1232554c0a3aSHans de Goede if (hal_EfuseSwitchToBank(padapter, bank, bPseudoTest) == false) { 1233554c0a3aSHans de Goede DBG_8192C(KERN_ERR "%s: switch bank(%d) Fail!!\n", __func__, bank); 1234554c0a3aSHans de Goede /* bank = EFUSE_MAX_BANK; */ 1235554c0a3aSHans de Goede break; 1236554c0a3aSHans de Goede } 1237554c0a3aSHans de Goede 1238554c0a3aSHans de Goede /* only when bank is switched we have to reset the efuse_addr. */ 1239554c0a3aSHans de Goede if (bank != startBank) 1240554c0a3aSHans de Goede efuse_addr = 0; 1241554c0a3aSHans de Goede #if 1 1242554c0a3aSHans de Goede 1243554c0a3aSHans de Goede while (AVAILABLE_EFUSE_ADDR(efuse_addr)) { 1244554c0a3aSHans de Goede if (efuse_OneByteRead(padapter, efuse_addr, &efuse_data, bPseudoTest) == false) { 1245554c0a3aSHans de Goede DBG_8192C(KERN_ERR "%s: efuse_OneByteRead Fail! addr = 0x%X !!\n", __func__, efuse_addr); 1246554c0a3aSHans de Goede /* bank = EFUSE_MAX_BANK; */ 1247554c0a3aSHans de Goede break; 1248554c0a3aSHans de Goede } 1249554c0a3aSHans de Goede DBG_8192C("%s: efuse_OneByteRead ! addr = 0x%X !efuse_data = 0x%X! bank =%d\n", __func__, efuse_addr, efuse_data, bank); 1250554c0a3aSHans de Goede 1251554c0a3aSHans de Goede if (efuse_data == 0xFF) 1252554c0a3aSHans de Goede break; 1253554c0a3aSHans de Goede 1254554c0a3aSHans de Goede if (EXT_HEADER(efuse_data)) { 1255554c0a3aSHans de Goede hoffset = GET_HDR_OFFSET_2_0(efuse_data); 1256554c0a3aSHans de Goede efuse_addr++; 1257554c0a3aSHans de Goede efuse_OneByteRead(padapter, efuse_addr, &efuse_data, bPseudoTest); 1258554c0a3aSHans de Goede DBG_8192C("%s: efuse_OneByteRead EXT_HEADER ! addr = 0x%X !efuse_data = 0x%X! bank =%d\n", __func__, efuse_addr, efuse_data, bank); 1259554c0a3aSHans de Goede 1260554c0a3aSHans de Goede if (ALL_WORDS_DISABLED(efuse_data)) { 1261554c0a3aSHans de Goede efuse_addr++; 1262554c0a3aSHans de Goede continue; 1263554c0a3aSHans de Goede } 1264554c0a3aSHans de Goede 1265554c0a3aSHans de Goede /* hoffset = ((hoffset & 0xE0) >> 5) | ((efuse_data & 0xF0) >> 1); */ 1266554c0a3aSHans de Goede hoffset |= ((efuse_data & 0xF0) >> 1); 1267554c0a3aSHans de Goede hworden = efuse_data & 0x0F; 1268554c0a3aSHans de Goede } else { 1269554c0a3aSHans de Goede hoffset = (efuse_data>>4) & 0x0F; 1270554c0a3aSHans de Goede hworden = efuse_data & 0x0F; 1271554c0a3aSHans de Goede } 1272554c0a3aSHans de Goede 1273554c0a3aSHans de Goede DBG_8192C(FUNC_ADPT_FMT": Offset =%d Worden =%#X\n", 1274554c0a3aSHans de Goede FUNC_ADPT_ARG(padapter), hoffset, hworden); 1275554c0a3aSHans de Goede 1276554c0a3aSHans de Goede word_cnts = Efuse_CalculateWordCnts(hworden); 1277554c0a3aSHans de Goede /* read next header */ 1278554c0a3aSHans de Goede efuse_addr += (word_cnts*2)+1; 1279554c0a3aSHans de Goede } 1280554c0a3aSHans de Goede #else 1281554c0a3aSHans de Goede while ( 1282554c0a3aSHans de Goede bContinual && 1283554c0a3aSHans de Goede efuse_OneByteRead(padapter, efuse_addr, &efuse_data, bPseudoTest) && 1284554c0a3aSHans de Goede AVAILABLE_EFUSE_ADDR(efuse_addr) 1285554c0a3aSHans de Goede ) { 1286554c0a3aSHans de Goede if (efuse_data != 0xFF) { 1287554c0a3aSHans de Goede if ((efuse_data&0x1F) == 0x0F) { /* extended header */ 1288554c0a3aSHans de Goede hoffset = efuse_data; 1289554c0a3aSHans de Goede efuse_addr++; 1290554c0a3aSHans de Goede efuse_OneByteRead(padapter, efuse_addr, &efuse_data, bPseudoTest); 1291554c0a3aSHans de Goede if ((efuse_data & 0x0F) == 0x0F) { 1292554c0a3aSHans de Goede efuse_addr++; 1293554c0a3aSHans de Goede continue; 1294554c0a3aSHans de Goede } else { 1295554c0a3aSHans de Goede hoffset = ((hoffset & 0xE0) >> 5) | ((efuse_data & 0xF0) >> 1); 1296554c0a3aSHans de Goede hworden = efuse_data & 0x0F; 1297554c0a3aSHans de Goede } 1298554c0a3aSHans de Goede } else { 1299554c0a3aSHans de Goede hoffset = (efuse_data>>4) & 0x0F; 1300554c0a3aSHans de Goede hworden = efuse_data & 0x0F; 1301554c0a3aSHans de Goede } 1302554c0a3aSHans de Goede word_cnts = Efuse_CalculateWordCnts(hworden); 1303554c0a3aSHans de Goede /* read next header */ 1304554c0a3aSHans de Goede efuse_addr = efuse_addr + (word_cnts*2)+1; 1305554c0a3aSHans de Goede } else 1306554c0a3aSHans de Goede bContinual = false; 1307554c0a3aSHans de Goede } 1308554c0a3aSHans de Goede #endif 1309554c0a3aSHans de Goede 1310554c0a3aSHans de Goede 1311554c0a3aSHans de Goede /* Check if we need to check next bank efuse */ 1312554c0a3aSHans de Goede if (efuse_addr < retU2) 1313554c0a3aSHans de Goede break; /* don't need to check next bank. */ 1314554c0a3aSHans de Goede } 1315554c0a3aSHans de Goede 1316554c0a3aSHans de Goede retU2 = ((bank-1)*EFUSE_BT_REAL_BANK_CONTENT_LEN)+efuse_addr; 1317554c0a3aSHans de Goede if (bPseudoTest) { 1318554c0a3aSHans de Goede pEfuseHal->fakeBTEfuseUsedBytes = retU2; 1319554c0a3aSHans de Goede /* RT_DISP(FEEPROM, EFUSE_PG, ("Hal_EfuseGetCurrentSize_BT92C(), already use %u bytes\n", pEfuseHal->fakeBTEfuseUsedBytes)); */ 1320554c0a3aSHans de Goede } else { 1321554c0a3aSHans de Goede pEfuseHal->BTEfuseUsedBytes = retU2; 1322554c0a3aSHans de Goede /* RT_DISP(FEEPROM, EFUSE_PG, ("Hal_EfuseGetCurrentSize_BT92C(), already use %u bytes\n", pEfuseHal->BTEfuseUsedBytes)); */ 1323554c0a3aSHans de Goede } 1324554c0a3aSHans de Goede 1325554c0a3aSHans de Goede DBG_8192C("%s: CurrentSize =%d\n", __func__, retU2); 1326554c0a3aSHans de Goede return retU2; 1327554c0a3aSHans de Goede } 1328554c0a3aSHans de Goede 1329554c0a3aSHans de Goede static u16 Hal_EfuseGetCurrentSize( 1330554c0a3aSHans de Goede struct adapter *padapter, u8 efuseType, bool bPseudoTest 1331554c0a3aSHans de Goede ) 1332554c0a3aSHans de Goede { 1333554c0a3aSHans de Goede u16 ret = 0; 1334554c0a3aSHans de Goede 1335554c0a3aSHans de Goede if (efuseType == EFUSE_WIFI) 1336554c0a3aSHans de Goede ret = hal_EfuseGetCurrentSize_WiFi(padapter, bPseudoTest); 1337554c0a3aSHans de Goede else 1338554c0a3aSHans de Goede ret = hal_EfuseGetCurrentSize_BT(padapter, bPseudoTest); 1339554c0a3aSHans de Goede 1340554c0a3aSHans de Goede return ret; 1341554c0a3aSHans de Goede } 1342554c0a3aSHans de Goede 1343554c0a3aSHans de Goede static u8 Hal_EfuseWordEnableDataWrite( 1344554c0a3aSHans de Goede struct adapter *padapter, 1345554c0a3aSHans de Goede u16 efuse_addr, 1346554c0a3aSHans de Goede u8 word_en, 1347554c0a3aSHans de Goede u8 *data, 1348554c0a3aSHans de Goede bool bPseudoTest 1349554c0a3aSHans de Goede ) 1350554c0a3aSHans de Goede { 1351554c0a3aSHans de Goede u16 tmpaddr = 0; 1352554c0a3aSHans de Goede u16 start_addr = efuse_addr; 1353554c0a3aSHans de Goede u8 badworden = 0x0F; 1354554c0a3aSHans de Goede u8 tmpdata[PGPKT_DATA_SIZE]; 1355554c0a3aSHans de Goede 1356554c0a3aSHans de Goede 1357554c0a3aSHans de Goede /* DBG_8192C("%s: efuse_addr =%#x word_en =%#x\n", __func__, efuse_addr, word_en); */ 1358554c0a3aSHans de Goede memset(tmpdata, 0xFF, PGPKT_DATA_SIZE); 1359554c0a3aSHans de Goede 1360554c0a3aSHans de Goede if (!(word_en & BIT(0))) { 1361554c0a3aSHans de Goede tmpaddr = start_addr; 1362554c0a3aSHans de Goede efuse_OneByteWrite(padapter, start_addr++, data[0], bPseudoTest); 1363554c0a3aSHans de Goede efuse_OneByteWrite(padapter, start_addr++, data[1], bPseudoTest); 1364554c0a3aSHans de Goede 1365554c0a3aSHans de Goede efuse_OneByteRead(padapter, tmpaddr, &tmpdata[0], bPseudoTest); 1366554c0a3aSHans de Goede efuse_OneByteRead(padapter, tmpaddr+1, &tmpdata[1], bPseudoTest); 1367554c0a3aSHans de Goede if ((data[0] != tmpdata[0]) || (data[1] != tmpdata[1])) { 1368554c0a3aSHans de Goede badworden &= (~BIT(0)); 1369554c0a3aSHans de Goede } 1370554c0a3aSHans de Goede } 1371554c0a3aSHans de Goede if (!(word_en & BIT(1))) { 1372554c0a3aSHans de Goede tmpaddr = start_addr; 1373554c0a3aSHans de Goede efuse_OneByteWrite(padapter, start_addr++, data[2], bPseudoTest); 1374554c0a3aSHans de Goede efuse_OneByteWrite(padapter, start_addr++, data[3], bPseudoTest); 1375554c0a3aSHans de Goede 1376554c0a3aSHans de Goede efuse_OneByteRead(padapter, tmpaddr, &tmpdata[2], bPseudoTest); 1377554c0a3aSHans de Goede efuse_OneByteRead(padapter, tmpaddr+1, &tmpdata[3], bPseudoTest); 1378554c0a3aSHans de Goede if ((data[2] != tmpdata[2]) || (data[3] != tmpdata[3])) { 1379554c0a3aSHans de Goede badworden &= (~BIT(1)); 1380554c0a3aSHans de Goede } 1381554c0a3aSHans de Goede } 1382554c0a3aSHans de Goede 1383554c0a3aSHans de Goede if (!(word_en & BIT(2))) { 1384554c0a3aSHans de Goede tmpaddr = start_addr; 1385554c0a3aSHans de Goede efuse_OneByteWrite(padapter, start_addr++, data[4], bPseudoTest); 1386554c0a3aSHans de Goede efuse_OneByteWrite(padapter, start_addr++, data[5], bPseudoTest); 1387554c0a3aSHans de Goede 1388554c0a3aSHans de Goede efuse_OneByteRead(padapter, tmpaddr, &tmpdata[4], bPseudoTest); 1389554c0a3aSHans de Goede efuse_OneByteRead(padapter, tmpaddr+1, &tmpdata[5], bPseudoTest); 1390554c0a3aSHans de Goede if ((data[4] != tmpdata[4]) || (data[5] != tmpdata[5])) { 1391554c0a3aSHans de Goede badworden &= (~BIT(2)); 1392554c0a3aSHans de Goede } 1393554c0a3aSHans de Goede } 1394554c0a3aSHans de Goede 1395554c0a3aSHans de Goede if (!(word_en & BIT(3))) { 1396554c0a3aSHans de Goede tmpaddr = start_addr; 1397554c0a3aSHans de Goede efuse_OneByteWrite(padapter, start_addr++, data[6], bPseudoTest); 1398554c0a3aSHans de Goede efuse_OneByteWrite(padapter, start_addr++, data[7], bPseudoTest); 1399554c0a3aSHans de Goede 1400554c0a3aSHans de Goede efuse_OneByteRead(padapter, tmpaddr, &tmpdata[6], bPseudoTest); 1401554c0a3aSHans de Goede efuse_OneByteRead(padapter, tmpaddr+1, &tmpdata[7], bPseudoTest); 1402554c0a3aSHans de Goede if ((data[6] != tmpdata[6]) || (data[7] != tmpdata[7])) { 1403554c0a3aSHans de Goede badworden &= (~BIT(3)); 1404554c0a3aSHans de Goede } 1405554c0a3aSHans de Goede } 1406554c0a3aSHans de Goede 1407554c0a3aSHans de Goede return badworden; 1408554c0a3aSHans de Goede } 1409554c0a3aSHans de Goede 1410554c0a3aSHans de Goede static s32 Hal_EfusePgPacketRead( 1411554c0a3aSHans de Goede struct adapter *padapter, 1412554c0a3aSHans de Goede u8 offset, 1413554c0a3aSHans de Goede u8 *data, 1414554c0a3aSHans de Goede bool bPseudoTest 1415554c0a3aSHans de Goede ) 1416554c0a3aSHans de Goede { 1417554c0a3aSHans de Goede u8 efuse_data, word_cnts = 0; 1418554c0a3aSHans de Goede u16 efuse_addr = 0; 1419554c0a3aSHans de Goede u8 hoffset = 0, hworden = 0; 1420554c0a3aSHans de Goede u8 i; 1421554c0a3aSHans de Goede u8 max_section = 0; 1422554c0a3aSHans de Goede s32 ret; 1423554c0a3aSHans de Goede 1424554c0a3aSHans de Goede 1425019acabeSHimadri Pandya if (!data) 1426554c0a3aSHans de Goede return false; 1427554c0a3aSHans de Goede 1428554c0a3aSHans de Goede EFUSE_GetEfuseDefinition(padapter, EFUSE_WIFI, TYPE_EFUSE_MAX_SECTION, &max_section, bPseudoTest); 1429554c0a3aSHans de Goede if (offset > max_section) { 1430554c0a3aSHans de Goede DBG_8192C("%s: Packet offset(%d) is illegal(>%d)!\n", __func__, offset, max_section); 1431554c0a3aSHans de Goede return false; 1432554c0a3aSHans de Goede } 1433554c0a3aSHans de Goede 1434554c0a3aSHans de Goede memset(data, 0xFF, PGPKT_DATA_SIZE); 1435554c0a3aSHans de Goede ret = true; 1436554c0a3aSHans de Goede 1437554c0a3aSHans de Goede /* */ 1438554c0a3aSHans de Goede /* <Roger_TODO> Efuse has been pre-programmed dummy 5Bytes at the end of Efuse by CP. */ 1439554c0a3aSHans de Goede /* Skip dummy parts to prevent unexpected data read from Efuse. */ 1440554c0a3aSHans de Goede /* By pass right now. 2009.02.19. */ 1441554c0a3aSHans de Goede /* */ 1442554c0a3aSHans de Goede while (AVAILABLE_EFUSE_ADDR(efuse_addr)) { 1443554c0a3aSHans de Goede if (efuse_OneByteRead(padapter, efuse_addr++, &efuse_data, bPseudoTest) == false) { 1444554c0a3aSHans de Goede ret = false; 1445554c0a3aSHans de Goede break; 1446554c0a3aSHans de Goede } 1447554c0a3aSHans de Goede 1448554c0a3aSHans de Goede if (efuse_data == 0xFF) 1449554c0a3aSHans de Goede break; 1450554c0a3aSHans de Goede 1451554c0a3aSHans de Goede if (EXT_HEADER(efuse_data)) { 1452554c0a3aSHans de Goede hoffset = GET_HDR_OFFSET_2_0(efuse_data); 1453554c0a3aSHans de Goede efuse_OneByteRead(padapter, efuse_addr++, &efuse_data, bPseudoTest); 1454554c0a3aSHans de Goede if (ALL_WORDS_DISABLED(efuse_data)) { 1455554c0a3aSHans de Goede DBG_8192C("%s: Error!! All words disabled!\n", __func__); 1456554c0a3aSHans de Goede continue; 1457554c0a3aSHans de Goede } 1458554c0a3aSHans de Goede 1459554c0a3aSHans de Goede hoffset |= ((efuse_data & 0xF0) >> 1); 1460554c0a3aSHans de Goede hworden = efuse_data & 0x0F; 1461554c0a3aSHans de Goede } else { 1462554c0a3aSHans de Goede hoffset = (efuse_data>>4) & 0x0F; 1463554c0a3aSHans de Goede hworden = efuse_data & 0x0F; 1464554c0a3aSHans de Goede } 1465554c0a3aSHans de Goede 1466554c0a3aSHans de Goede if (hoffset == offset) { 1467554c0a3aSHans de Goede for (i = 0; i < EFUSE_MAX_WORD_UNIT; i++) { 1468554c0a3aSHans de Goede /* Check word enable condition in the section */ 1469554c0a3aSHans de Goede if (!(hworden & (0x01<<i))) { 1470554c0a3aSHans de Goede efuse_OneByteRead(padapter, efuse_addr++, &efuse_data, bPseudoTest); 1471554c0a3aSHans de Goede /* DBG_8192C("%s: efuse[%#X]= 0x%02X\n", __func__, efuse_addr+tmpidx, efuse_data); */ 1472554c0a3aSHans de Goede data[i*2] = efuse_data; 1473554c0a3aSHans de Goede 1474554c0a3aSHans de Goede efuse_OneByteRead(padapter, efuse_addr++, &efuse_data, bPseudoTest); 1475554c0a3aSHans de Goede /* DBG_8192C("%s: efuse[%#X]= 0x%02X\n", __func__, efuse_addr+tmpidx, efuse_data); */ 1476554c0a3aSHans de Goede data[(i*2)+1] = efuse_data; 1477554c0a3aSHans de Goede } 1478554c0a3aSHans de Goede } 1479554c0a3aSHans de Goede } else { 1480554c0a3aSHans de Goede word_cnts = Efuse_CalculateWordCnts(hworden); 1481554c0a3aSHans de Goede efuse_addr += word_cnts*2; 1482554c0a3aSHans de Goede } 1483554c0a3aSHans de Goede } 1484554c0a3aSHans de Goede 1485554c0a3aSHans de Goede return ret; 1486554c0a3aSHans de Goede } 1487554c0a3aSHans de Goede 1488554c0a3aSHans de Goede static u8 hal_EfusePgCheckAvailableAddr( 1489554c0a3aSHans de Goede struct adapter *padapter, u8 efuseType, u8 bPseudoTest 1490554c0a3aSHans de Goede ) 1491554c0a3aSHans de Goede { 1492554c0a3aSHans de Goede u16 max_available = 0; 1493554c0a3aSHans de Goede u16 current_size; 1494554c0a3aSHans de Goede 1495554c0a3aSHans de Goede 1496554c0a3aSHans de Goede EFUSE_GetEfuseDefinition(padapter, efuseType, TYPE_AVAILABLE_EFUSE_BYTES_TOTAL, &max_available, bPseudoTest); 1497554c0a3aSHans de Goede /* DBG_8192C("%s: max_available =%d\n", __func__, max_available); */ 1498554c0a3aSHans de Goede 1499554c0a3aSHans de Goede current_size = Efuse_GetCurrentSize(padapter, efuseType, bPseudoTest); 1500554c0a3aSHans de Goede if (current_size >= max_available) { 1501554c0a3aSHans de Goede DBG_8192C("%s: Error!! current_size(%d)>max_available(%d)\n", __func__, current_size, max_available); 1502554c0a3aSHans de Goede return false; 1503554c0a3aSHans de Goede } 1504554c0a3aSHans de Goede return true; 1505554c0a3aSHans de Goede } 1506554c0a3aSHans de Goede 1507554c0a3aSHans de Goede static void hal_EfuseConstructPGPkt( 1508554c0a3aSHans de Goede u8 offset, 1509554c0a3aSHans de Goede u8 word_en, 1510554c0a3aSHans de Goede u8 *pData, 15119d3c9ecdSMarco Cesati struct pgpkt_struct *pTargetPkt 1512554c0a3aSHans de Goede ) 1513554c0a3aSHans de Goede { 1514554c0a3aSHans de Goede memset(pTargetPkt->data, 0xFF, PGPKT_DATA_SIZE); 1515554c0a3aSHans de Goede pTargetPkt->offset = offset; 1516554c0a3aSHans de Goede pTargetPkt->word_en = word_en; 1517554c0a3aSHans de Goede efuse_WordEnableDataRead(word_en, pData, pTargetPkt->data); 1518554c0a3aSHans de Goede pTargetPkt->word_cnts = Efuse_CalculateWordCnts(pTargetPkt->word_en); 1519554c0a3aSHans de Goede } 1520554c0a3aSHans de Goede 1521554c0a3aSHans de Goede static u8 hal_EfusePartialWriteCheck( 1522554c0a3aSHans de Goede struct adapter *padapter, 1523554c0a3aSHans de Goede u8 efuseType, 1524554c0a3aSHans de Goede u16 *pAddr, 15259d3c9ecdSMarco Cesati struct pgpkt_struct *pTargetPkt, 1526554c0a3aSHans de Goede u8 bPseudoTest 1527554c0a3aSHans de Goede ) 1528554c0a3aSHans de Goede { 1529554c0a3aSHans de Goede struct hal_com_data *pHalData = GET_HAL_DATA(padapter); 15309d3c9ecdSMarco Cesati struct efuse_hal *pEfuseHal = &pHalData->EfuseHal; 1531554c0a3aSHans de Goede u8 bRet = false; 1532554c0a3aSHans de Goede u16 startAddr = 0, efuse_max_available_len = 0, efuse_max = 0; 1533554c0a3aSHans de Goede u8 efuse_data = 0; 1534554c0a3aSHans de Goede 1535554c0a3aSHans de Goede EFUSE_GetEfuseDefinition(padapter, efuseType, TYPE_AVAILABLE_EFUSE_BYTES_TOTAL, &efuse_max_available_len, bPseudoTest); 1536554c0a3aSHans de Goede EFUSE_GetEfuseDefinition(padapter, efuseType, TYPE_EFUSE_CONTENT_LEN_BANK, &efuse_max, bPseudoTest); 1537554c0a3aSHans de Goede 1538554c0a3aSHans de Goede if (efuseType == EFUSE_WIFI) { 1539554c0a3aSHans de Goede if (bPseudoTest) { 1540554c0a3aSHans de Goede #ifdef HAL_EFUSE_MEMORY 1541554c0a3aSHans de Goede startAddr = (u16)pEfuseHal->fakeEfuseUsedBytes; 1542554c0a3aSHans de Goede #else 1543554c0a3aSHans de Goede startAddr = (u16)fakeEfuseUsedBytes; 1544554c0a3aSHans de Goede #endif 1545554c0a3aSHans de Goede } else 1546554c0a3aSHans de Goede rtw_hal_get_hwreg(padapter, HW_VAR_EFUSE_BYTES, (u8 *)&startAddr); 1547554c0a3aSHans de Goede } else { 1548554c0a3aSHans de Goede if (bPseudoTest) { 1549554c0a3aSHans de Goede #ifdef HAL_EFUSE_MEMORY 1550554c0a3aSHans de Goede startAddr = (u16)pEfuseHal->fakeBTEfuseUsedBytes; 1551554c0a3aSHans de Goede #else 1552554c0a3aSHans de Goede startAddr = (u16)fakeBTEfuseUsedBytes; 1553554c0a3aSHans de Goede #endif 1554554c0a3aSHans de Goede } else 1555554c0a3aSHans de Goede rtw_hal_get_hwreg(padapter, HW_VAR_EFUSE_BT_BYTES, (u8 *)&startAddr); 1556554c0a3aSHans de Goede } 1557554c0a3aSHans de Goede startAddr %= efuse_max; 1558554c0a3aSHans de Goede DBG_8192C("%s: startAddr =%#X\n", __func__, startAddr); 1559554c0a3aSHans de Goede 1560554c0a3aSHans de Goede while (1) { 1561554c0a3aSHans de Goede if (startAddr >= efuse_max_available_len) { 1562554c0a3aSHans de Goede bRet = false; 1563554c0a3aSHans de Goede DBG_8192C("%s: startAddr(%d) >= efuse_max_available_len(%d)\n", __func__, startAddr, efuse_max_available_len); 1564554c0a3aSHans de Goede break; 1565554c0a3aSHans de Goede } 1566554c0a3aSHans de Goede 1567554c0a3aSHans de Goede if (efuse_OneByteRead(padapter, startAddr, &efuse_data, bPseudoTest) && (efuse_data != 0xFF)) { 1568554c0a3aSHans de Goede #if 1 1569554c0a3aSHans de Goede bRet = false; 1570554c0a3aSHans de Goede DBG_8192C("%s: Something Wrong! last bytes(%#X = 0x%02X) is not 0xFF\n", 1571554c0a3aSHans de Goede __func__, startAddr, efuse_data); 1572554c0a3aSHans de Goede break; 1573554c0a3aSHans de Goede #else 1574554c0a3aSHans de Goede if (EXT_HEADER(efuse_data)) { 1575554c0a3aSHans de Goede cur_header = efuse_data; 1576554c0a3aSHans de Goede startAddr++; 1577554c0a3aSHans de Goede efuse_OneByteRead(padapter, startAddr, &efuse_data, bPseudoTest); 1578554c0a3aSHans de Goede if (ALL_WORDS_DISABLED(efuse_data)) { 1579554c0a3aSHans de Goede DBG_8192C("%s: Error condition, all words disabled!", __func__); 1580554c0a3aSHans de Goede bRet = false; 1581554c0a3aSHans de Goede break; 1582554c0a3aSHans de Goede } else { 1583554c0a3aSHans de Goede curPkt.offset = ((cur_header & 0xE0) >> 5) | ((efuse_data & 0xF0) >> 1); 1584554c0a3aSHans de Goede curPkt.word_en = efuse_data & 0x0F; 1585554c0a3aSHans de Goede } 1586554c0a3aSHans de Goede } else { 1587554c0a3aSHans de Goede cur_header = efuse_data; 1588554c0a3aSHans de Goede curPkt.offset = (cur_header>>4) & 0x0F; 1589554c0a3aSHans de Goede curPkt.word_en = cur_header & 0x0F; 1590554c0a3aSHans de Goede } 1591554c0a3aSHans de Goede 1592554c0a3aSHans de Goede curPkt.word_cnts = Efuse_CalculateWordCnts(curPkt.word_en); 1593554c0a3aSHans de Goede /* if same header is found but no data followed */ 1594554c0a3aSHans de Goede /* write some part of data followed by the header. */ 1595554c0a3aSHans de Goede if ( 1596554c0a3aSHans de Goede (curPkt.offset == pTargetPkt->offset) && 1597554c0a3aSHans de Goede (hal_EfuseCheckIfDatafollowed(padapter, curPkt.word_cnts, startAddr+1, bPseudoTest) == false) && 1598554c0a3aSHans de Goede wordEnMatched(pTargetPkt, &curPkt, &matched_wden) == true 1599554c0a3aSHans de Goede ) { 1600554c0a3aSHans de Goede DBG_8192C("%s: Need to partial write data by the previous wrote header\n", __func__); 1601554c0a3aSHans de Goede /* Here to write partial data */ 1602554c0a3aSHans de Goede badworden = Efuse_WordEnableDataWrite(padapter, startAddr+1, matched_wden, pTargetPkt->data, bPseudoTest); 1603554c0a3aSHans de Goede if (badworden != 0x0F) { 1604554c0a3aSHans de Goede u32 PgWriteSuccess = 0; 1605554c0a3aSHans de Goede /* if write fail on some words, write these bad words again */ 1606554c0a3aSHans de Goede if (efuseType == EFUSE_WIFI) 1607554c0a3aSHans de Goede PgWriteSuccess = Efuse_PgPacketWrite(padapter, pTargetPkt->offset, badworden, pTargetPkt->data, bPseudoTest); 1608554c0a3aSHans de Goede else 1609554c0a3aSHans de Goede PgWriteSuccess = Efuse_PgPacketWrite_BT(padapter, pTargetPkt->offset, badworden, pTargetPkt->data, bPseudoTest); 1610554c0a3aSHans de Goede 1611554c0a3aSHans de Goede if (!PgWriteSuccess) { 1612554c0a3aSHans de Goede bRet = false; /* write fail, return */ 1613554c0a3aSHans de Goede break; 1614554c0a3aSHans de Goede } 1615554c0a3aSHans de Goede } 1616554c0a3aSHans de Goede /* partial write ok, update the target packet for later use */ 1617554c0a3aSHans de Goede for (i = 0; i < 4; i++) { 1618554c0a3aSHans de Goede if ((matched_wden & (0x1<<i)) == 0) { /* this word has been written */ 1619554c0a3aSHans de Goede pTargetPkt->word_en |= (0x1<<i); /* disable the word */ 1620554c0a3aSHans de Goede } 1621554c0a3aSHans de Goede } 1622554c0a3aSHans de Goede pTargetPkt->word_cnts = Efuse_CalculateWordCnts(pTargetPkt->word_en); 1623554c0a3aSHans de Goede } 1624554c0a3aSHans de Goede /* read from next header */ 1625554c0a3aSHans de Goede startAddr = startAddr + (curPkt.word_cnts*2) + 1; 1626554c0a3aSHans de Goede #endif 1627554c0a3aSHans de Goede } else { 1628554c0a3aSHans de Goede /* not used header, 0xff */ 1629554c0a3aSHans de Goede *pAddr = startAddr; 1630554c0a3aSHans de Goede /* DBG_8192C("%s: Started from unused header offset =%d\n", __func__, startAddr)); */ 1631554c0a3aSHans de Goede bRet = true; 1632554c0a3aSHans de Goede break; 1633554c0a3aSHans de Goede } 1634554c0a3aSHans de Goede } 1635554c0a3aSHans de Goede 1636554c0a3aSHans de Goede return bRet; 1637554c0a3aSHans de Goede } 1638554c0a3aSHans de Goede 1639554c0a3aSHans de Goede static u8 hal_EfusePgPacketWrite1ByteHeader( 1640554c0a3aSHans de Goede struct adapter *padapter, 1641554c0a3aSHans de Goede u8 efuseType, 1642554c0a3aSHans de Goede u16 *pAddr, 16439d3c9ecdSMarco Cesati struct pgpkt_struct *pTargetPkt, 1644554c0a3aSHans de Goede u8 bPseudoTest 1645554c0a3aSHans de Goede ) 1646554c0a3aSHans de Goede { 1647554c0a3aSHans de Goede u8 pg_header = 0, tmp_header = 0; 1648554c0a3aSHans de Goede u16 efuse_addr = *pAddr; 1649554c0a3aSHans de Goede u8 repeatcnt = 0; 1650554c0a3aSHans de Goede 1651554c0a3aSHans de Goede pg_header = ((pTargetPkt->offset << 4) & 0xf0) | pTargetPkt->word_en; 1652554c0a3aSHans de Goede 1653554c0a3aSHans de Goede do { 1654554c0a3aSHans de Goede efuse_OneByteWrite(padapter, efuse_addr, pg_header, bPseudoTest); 1655554c0a3aSHans de Goede efuse_OneByteRead(padapter, efuse_addr, &tmp_header, bPseudoTest); 1656554c0a3aSHans de Goede if (tmp_header != 0xFF) 1657554c0a3aSHans de Goede break; 1658554c0a3aSHans de Goede if (repeatcnt++ > EFUSE_REPEAT_THRESHOLD_) { 1659554c0a3aSHans de Goede DBG_8192C("%s: Repeat over limit for pg_header!!\n", __func__); 1660554c0a3aSHans de Goede return false; 1661554c0a3aSHans de Goede } 1662554c0a3aSHans de Goede } while (1); 1663554c0a3aSHans de Goede 1664554c0a3aSHans de Goede if (tmp_header != pg_header) { 1665554c0a3aSHans de Goede DBG_8192C(KERN_ERR "%s: PG Header Fail!!(pg = 0x%02X read = 0x%02X)\n", __func__, pg_header, tmp_header); 1666554c0a3aSHans de Goede return false; 1667554c0a3aSHans de Goede } 1668554c0a3aSHans de Goede 1669554c0a3aSHans de Goede *pAddr = efuse_addr; 1670554c0a3aSHans de Goede 1671554c0a3aSHans de Goede return true; 1672554c0a3aSHans de Goede } 1673554c0a3aSHans de Goede 1674554c0a3aSHans de Goede static u8 hal_EfusePgPacketWrite2ByteHeader( 1675554c0a3aSHans de Goede struct adapter *padapter, 1676554c0a3aSHans de Goede u8 efuseType, 1677554c0a3aSHans de Goede u16 *pAddr, 16789d3c9ecdSMarco Cesati struct pgpkt_struct *pTargetPkt, 1679554c0a3aSHans de Goede u8 bPseudoTest 1680554c0a3aSHans de Goede ) 1681554c0a3aSHans de Goede { 1682554c0a3aSHans de Goede u16 efuse_addr, efuse_max_available_len = 0; 1683554c0a3aSHans de Goede u8 pg_header = 0, tmp_header = 0; 1684554c0a3aSHans de Goede u8 repeatcnt = 0; 1685554c0a3aSHans de Goede 1686554c0a3aSHans de Goede EFUSE_GetEfuseDefinition(padapter, efuseType, TYPE_AVAILABLE_EFUSE_BYTES_BANK, &efuse_max_available_len, bPseudoTest); 1687554c0a3aSHans de Goede 1688554c0a3aSHans de Goede efuse_addr = *pAddr; 1689554c0a3aSHans de Goede if (efuse_addr >= efuse_max_available_len) { 169054f6f4deSColin Ian King DBG_8192C("%s: addr(%d) over available (%d)!!\n", __func__, 169154f6f4deSColin Ian King efuse_addr, efuse_max_available_len); 1692554c0a3aSHans de Goede return false; 1693554c0a3aSHans de Goede } 1694554c0a3aSHans de Goede 1695554c0a3aSHans de Goede pg_header = ((pTargetPkt->offset & 0x07) << 5) | 0x0F; 1696554c0a3aSHans de Goede /* DBG_8192C("%s: pg_header = 0x%x\n", __func__, pg_header); */ 1697554c0a3aSHans de Goede 1698554c0a3aSHans de Goede do { 1699554c0a3aSHans de Goede efuse_OneByteWrite(padapter, efuse_addr, pg_header, bPseudoTest); 1700554c0a3aSHans de Goede efuse_OneByteRead(padapter, efuse_addr, &tmp_header, bPseudoTest); 1701554c0a3aSHans de Goede if (tmp_header != 0xFF) 1702554c0a3aSHans de Goede break; 1703554c0a3aSHans de Goede if (repeatcnt++ > EFUSE_REPEAT_THRESHOLD_) { 1704554c0a3aSHans de Goede DBG_8192C("%s: Repeat over limit for pg_header!!\n", __func__); 1705554c0a3aSHans de Goede return false; 1706554c0a3aSHans de Goede } 1707554c0a3aSHans de Goede } while (1); 1708554c0a3aSHans de Goede 1709554c0a3aSHans de Goede if (tmp_header != pg_header) { 1710554c0a3aSHans de Goede DBG_8192C(KERN_ERR "%s: PG Header Fail!!(pg = 0x%02X read = 0x%02X)\n", __func__, pg_header, tmp_header); 1711554c0a3aSHans de Goede return false; 1712554c0a3aSHans de Goede } 1713554c0a3aSHans de Goede 1714554c0a3aSHans de Goede /* to write ext_header */ 1715554c0a3aSHans de Goede efuse_addr++; 1716554c0a3aSHans de Goede pg_header = ((pTargetPkt->offset & 0x78) << 1) | pTargetPkt->word_en; 1717554c0a3aSHans de Goede 1718554c0a3aSHans de Goede do { 1719554c0a3aSHans de Goede efuse_OneByteWrite(padapter, efuse_addr, pg_header, bPseudoTest); 1720554c0a3aSHans de Goede efuse_OneByteRead(padapter, efuse_addr, &tmp_header, bPseudoTest); 1721554c0a3aSHans de Goede if (tmp_header != 0xFF) 1722554c0a3aSHans de Goede break; 1723554c0a3aSHans de Goede if (repeatcnt++ > EFUSE_REPEAT_THRESHOLD_) { 1724554c0a3aSHans de Goede DBG_8192C("%s: Repeat over limit for ext_header!!\n", __func__); 1725554c0a3aSHans de Goede return false; 1726554c0a3aSHans de Goede } 1727554c0a3aSHans de Goede } while (1); 1728554c0a3aSHans de Goede 1729554c0a3aSHans de Goede if (tmp_header != pg_header) { /* offset PG fail */ 1730554c0a3aSHans de Goede DBG_8192C(KERN_ERR "%s: PG EXT Header Fail!!(pg = 0x%02X read = 0x%02X)\n", __func__, pg_header, tmp_header); 1731554c0a3aSHans de Goede return false; 1732554c0a3aSHans de Goede } 1733554c0a3aSHans de Goede 1734554c0a3aSHans de Goede *pAddr = efuse_addr; 1735554c0a3aSHans de Goede 1736554c0a3aSHans de Goede return true; 1737554c0a3aSHans de Goede } 1738554c0a3aSHans de Goede 1739554c0a3aSHans de Goede static u8 hal_EfusePgPacketWriteHeader( 1740554c0a3aSHans de Goede struct adapter *padapter, 1741554c0a3aSHans de Goede u8 efuseType, 1742554c0a3aSHans de Goede u16 *pAddr, 17439d3c9ecdSMarco Cesati struct pgpkt_struct *pTargetPkt, 1744554c0a3aSHans de Goede u8 bPseudoTest 1745554c0a3aSHans de Goede ) 1746554c0a3aSHans de Goede { 1747554c0a3aSHans de Goede u8 bRet = false; 1748554c0a3aSHans de Goede 1749554c0a3aSHans de Goede if (pTargetPkt->offset >= EFUSE_MAX_SECTION_BASE) 1750554c0a3aSHans de Goede bRet = hal_EfusePgPacketWrite2ByteHeader(padapter, efuseType, pAddr, pTargetPkt, bPseudoTest); 1751554c0a3aSHans de Goede else 1752554c0a3aSHans de Goede bRet = hal_EfusePgPacketWrite1ByteHeader(padapter, efuseType, pAddr, pTargetPkt, bPseudoTest); 1753554c0a3aSHans de Goede 1754554c0a3aSHans de Goede return bRet; 1755554c0a3aSHans de Goede } 1756554c0a3aSHans de Goede 1757554c0a3aSHans de Goede static u8 hal_EfusePgPacketWriteData( 1758554c0a3aSHans de Goede struct adapter *padapter, 1759554c0a3aSHans de Goede u8 efuseType, 1760554c0a3aSHans de Goede u16 *pAddr, 17619d3c9ecdSMarco Cesati struct pgpkt_struct *pTargetPkt, 1762554c0a3aSHans de Goede u8 bPseudoTest 1763554c0a3aSHans de Goede ) 1764554c0a3aSHans de Goede { 1765554c0a3aSHans de Goede u16 efuse_addr; 1766554c0a3aSHans de Goede u8 badworden; 1767554c0a3aSHans de Goede 1768554c0a3aSHans de Goede 1769554c0a3aSHans de Goede efuse_addr = *pAddr; 1770554c0a3aSHans de Goede badworden = Efuse_WordEnableDataWrite(padapter, efuse_addr+1, pTargetPkt->word_en, pTargetPkt->data, bPseudoTest); 1771554c0a3aSHans de Goede if (badworden != 0x0F) { 1772554c0a3aSHans de Goede DBG_8192C("%s: Fail!!\n", __func__); 1773554c0a3aSHans de Goede return false; 1774554c0a3aSHans de Goede } 1775554c0a3aSHans de Goede 1776554c0a3aSHans de Goede /* DBG_8192C("%s: ok\n", __func__); */ 1777554c0a3aSHans de Goede return true; 1778554c0a3aSHans de Goede } 1779554c0a3aSHans de Goede 1780554c0a3aSHans de Goede static s32 Hal_EfusePgPacketWrite( 1781554c0a3aSHans de Goede struct adapter *padapter, 1782554c0a3aSHans de Goede u8 offset, 1783554c0a3aSHans de Goede u8 word_en, 1784554c0a3aSHans de Goede u8 *pData, 1785554c0a3aSHans de Goede bool bPseudoTest 1786554c0a3aSHans de Goede ) 1787554c0a3aSHans de Goede { 17889d3c9ecdSMarco Cesati struct pgpkt_struct targetPkt; 1789554c0a3aSHans de Goede u16 startAddr = 0; 1790554c0a3aSHans de Goede u8 efuseType = EFUSE_WIFI; 1791554c0a3aSHans de Goede 1792554c0a3aSHans de Goede if (!hal_EfusePgCheckAvailableAddr(padapter, efuseType, bPseudoTest)) 1793554c0a3aSHans de Goede return false; 1794554c0a3aSHans de Goede 1795554c0a3aSHans de Goede hal_EfuseConstructPGPkt(offset, word_en, pData, &targetPkt); 1796554c0a3aSHans de Goede 1797554c0a3aSHans de Goede if (!hal_EfusePartialWriteCheck(padapter, efuseType, &startAddr, &targetPkt, bPseudoTest)) 1798554c0a3aSHans de Goede return false; 1799554c0a3aSHans de Goede 1800554c0a3aSHans de Goede if (!hal_EfusePgPacketWriteHeader(padapter, efuseType, &startAddr, &targetPkt, bPseudoTest)) 1801554c0a3aSHans de Goede return false; 1802554c0a3aSHans de Goede 1803554c0a3aSHans de Goede if (!hal_EfusePgPacketWriteData(padapter, efuseType, &startAddr, &targetPkt, bPseudoTest)) 1804554c0a3aSHans de Goede return false; 1805554c0a3aSHans de Goede 1806554c0a3aSHans de Goede return true; 1807554c0a3aSHans de Goede } 1808554c0a3aSHans de Goede 1809554c0a3aSHans de Goede static bool Hal_EfusePgPacketWrite_BT( 1810554c0a3aSHans de Goede struct adapter *padapter, 1811554c0a3aSHans de Goede u8 offset, 1812554c0a3aSHans de Goede u8 word_en, 1813554c0a3aSHans de Goede u8 *pData, 1814554c0a3aSHans de Goede bool bPseudoTest 1815554c0a3aSHans de Goede ) 1816554c0a3aSHans de Goede { 18179d3c9ecdSMarco Cesati struct pgpkt_struct targetPkt; 1818554c0a3aSHans de Goede u16 startAddr = 0; 1819554c0a3aSHans de Goede u8 efuseType = EFUSE_BT; 1820554c0a3aSHans de Goede 1821554c0a3aSHans de Goede if (!hal_EfusePgCheckAvailableAddr(padapter, efuseType, bPseudoTest)) 1822554c0a3aSHans de Goede return false; 1823554c0a3aSHans de Goede 1824554c0a3aSHans de Goede hal_EfuseConstructPGPkt(offset, word_en, pData, &targetPkt); 1825554c0a3aSHans de Goede 1826554c0a3aSHans de Goede if (!hal_EfusePartialWriteCheck(padapter, efuseType, &startAddr, &targetPkt, bPseudoTest)) 1827554c0a3aSHans de Goede return false; 1828554c0a3aSHans de Goede 1829554c0a3aSHans de Goede if (!hal_EfusePgPacketWriteHeader(padapter, efuseType, &startAddr, &targetPkt, bPseudoTest)) 1830554c0a3aSHans de Goede return false; 1831554c0a3aSHans de Goede 1832554c0a3aSHans de Goede if (!hal_EfusePgPacketWriteData(padapter, efuseType, &startAddr, &targetPkt, bPseudoTest)) 1833554c0a3aSHans de Goede return false; 1834554c0a3aSHans de Goede 1835554c0a3aSHans de Goede return true; 1836554c0a3aSHans de Goede } 1837554c0a3aSHans de Goede 183835f25566SMarco Cesati static struct hal_version ReadChipVersion8723B(struct adapter *padapter) 1839554c0a3aSHans de Goede { 1840554c0a3aSHans de Goede u32 value32; 184135f25566SMarco Cesati struct hal_version ChipVersion; 1842554c0a3aSHans de Goede struct hal_com_data *pHalData; 1843554c0a3aSHans de Goede 1844554c0a3aSHans de Goede /* YJ, TODO, move read chip type here */ 1845554c0a3aSHans de Goede pHalData = GET_HAL_DATA(padapter); 1846554c0a3aSHans de Goede 1847554c0a3aSHans de Goede value32 = rtw_read32(padapter, REG_SYS_CFG); 1848554c0a3aSHans de Goede ChipVersion.ICType = CHIP_8723B; 1849554c0a3aSHans de Goede ChipVersion.ChipType = ((value32 & RTL_ID) ? TEST_CHIP : NORMAL_CHIP); 1850554c0a3aSHans de Goede ChipVersion.RFType = RF_TYPE_1T1R; 1851554c0a3aSHans de Goede ChipVersion.VendorType = ((value32 & VENDOR_ID) ? CHIP_VENDOR_UMC : CHIP_VENDOR_TSMC); 1852554c0a3aSHans de Goede ChipVersion.CUTVersion = (value32 & CHIP_VER_RTL_MASK)>>CHIP_VER_RTL_SHIFT; /* IC version (CUT) */ 1853554c0a3aSHans de Goede 1854554c0a3aSHans de Goede /* For regulator mode. by tynli. 2011.01.14 */ 1855554c0a3aSHans de Goede pHalData->RegulatorMode = ((value32 & SPS_SEL) ? RT_LDO_REGULATOR : RT_SWITCHING_REGULATOR); 1856554c0a3aSHans de Goede 1857554c0a3aSHans de Goede value32 = rtw_read32(padapter, REG_GPIO_OUTSTS); 1858554c0a3aSHans de Goede ChipVersion.ROMVer = ((value32 & RF_RL_ID) >> 20); /* ROM code version. */ 1859554c0a3aSHans de Goede 1860554c0a3aSHans de Goede /* For multi-function consideration. Added by Roger, 2010.10.06. */ 1861554c0a3aSHans de Goede pHalData->MultiFunc = RT_MULTI_FUNC_NONE; 1862554c0a3aSHans de Goede value32 = rtw_read32(padapter, REG_MULTI_FUNC_CTRL); 1863554c0a3aSHans de Goede pHalData->MultiFunc |= ((value32 & WL_FUNC_EN) ? RT_MULTI_FUNC_WIFI : 0); 1864554c0a3aSHans de Goede pHalData->MultiFunc |= ((value32 & BT_FUNC_EN) ? RT_MULTI_FUNC_BT : 0); 1865554c0a3aSHans de Goede pHalData->MultiFunc |= ((value32 & GPS_FUNC_EN) ? RT_MULTI_FUNC_GPS : 0); 1866554c0a3aSHans de Goede pHalData->PolarityCtl = ((value32 & WL_HWPDN_SL) ? RT_POLARITY_HIGH_ACT : RT_POLARITY_LOW_ACT); 1867554c0a3aSHans de Goede #if 1 1868554c0a3aSHans de Goede dump_chip_info(ChipVersion); 1869554c0a3aSHans de Goede #endif 1870554c0a3aSHans de Goede pHalData->VersionID = ChipVersion; 1871554c0a3aSHans de Goede if (IS_1T2R(ChipVersion)) 1872554c0a3aSHans de Goede pHalData->rf_type = RF_1T2R; 1873554c0a3aSHans de Goede else if (IS_2T2R(ChipVersion)) 1874554c0a3aSHans de Goede pHalData->rf_type = RF_2T2R; 1875554c0a3aSHans de Goede else 1876554c0a3aSHans de Goede pHalData->rf_type = RF_1T1R; 1877554c0a3aSHans de Goede 1878554c0a3aSHans de Goede MSG_8192C("RF_Type is %x!!\n", pHalData->rf_type); 1879554c0a3aSHans de Goede 1880554c0a3aSHans de Goede return ChipVersion; 1881554c0a3aSHans de Goede } 1882554c0a3aSHans de Goede 1883554c0a3aSHans de Goede static void rtl8723b_read_chip_version(struct adapter *padapter) 1884554c0a3aSHans de Goede { 1885554c0a3aSHans de Goede ReadChipVersion8723B(padapter); 1886554c0a3aSHans de Goede } 1887554c0a3aSHans de Goede 1888554c0a3aSHans de Goede void rtl8723b_InitBeaconParameters(struct adapter *padapter) 1889554c0a3aSHans de Goede { 1890554c0a3aSHans de Goede struct hal_com_data *pHalData = GET_HAL_DATA(padapter); 1891554c0a3aSHans de Goede u16 val16; 1892554c0a3aSHans de Goede u8 val8; 1893554c0a3aSHans de Goede 1894554c0a3aSHans de Goede 1895554c0a3aSHans de Goede val8 = DIS_TSF_UDT; 1896554c0a3aSHans de Goede val16 = val8 | (val8 << 8); /* port0 and port1 */ 1897554c0a3aSHans de Goede 1898554c0a3aSHans de Goede /* Enable prot0 beacon function for PSTDMA */ 1899554c0a3aSHans de Goede val16 |= EN_BCN_FUNCTION; 1900554c0a3aSHans de Goede 1901554c0a3aSHans de Goede rtw_write16(padapter, REG_BCN_CTRL, val16); 1902554c0a3aSHans de Goede 1903554c0a3aSHans de Goede /* TODO: Remove these magic number */ 1904554c0a3aSHans de Goede rtw_write16(padapter, REG_TBTT_PROHIBIT, 0x6404);/* ms */ 1905554c0a3aSHans de Goede /* Firmware will control REG_DRVERLYINT when power saving is enable, */ 1906554c0a3aSHans de Goede /* so don't set this register on STA mode. */ 1907554c0a3aSHans de Goede if (check_fwstate(&padapter->mlmepriv, WIFI_STATION_STATE) == false) 1908554c0a3aSHans de Goede rtw_write8(padapter, REG_DRVERLYINT, DRIVER_EARLY_INT_TIME_8723B); /* 5ms */ 1909554c0a3aSHans de Goede rtw_write8(padapter, REG_BCNDMATIM, BCN_DMA_ATIME_INT_TIME_8723B); /* 2ms */ 1910554c0a3aSHans de Goede 1911554c0a3aSHans de Goede /* Suggested by designer timchen. Change beacon AIFS to the largest number */ 1912554c0a3aSHans de Goede /* beacause test chip does not contension before sending beacon. by tynli. 2009.11.03 */ 1913554c0a3aSHans de Goede rtw_write16(padapter, REG_BCNTCFG, 0x660F); 1914554c0a3aSHans de Goede 1915554c0a3aSHans de Goede pHalData->RegBcnCtrlVal = rtw_read8(padapter, REG_BCN_CTRL); 1916554c0a3aSHans de Goede pHalData->RegTxPause = rtw_read8(padapter, REG_TXPAUSE); 1917554c0a3aSHans de Goede pHalData->RegFwHwTxQCtrl = rtw_read8(padapter, REG_FWHW_TXQ_CTRL+2); 1918554c0a3aSHans de Goede pHalData->RegReg542 = rtw_read8(padapter, REG_TBTT_PROHIBIT+2); 1919554c0a3aSHans de Goede pHalData->RegCR_1 = rtw_read8(padapter, REG_CR+1); 1920554c0a3aSHans de Goede } 1921554c0a3aSHans de Goede 1922554c0a3aSHans de Goede void _InitBurstPktLen_8723BS(struct adapter *Adapter) 1923554c0a3aSHans de Goede { 1924554c0a3aSHans de Goede struct hal_com_data *pHalData = GET_HAL_DATA(Adapter); 1925554c0a3aSHans de Goede 1926554c0a3aSHans de Goede rtw_write8(Adapter, 0x4c7, rtw_read8(Adapter, 0x4c7)|BIT(7)); /* enable single pkt ampdu */ 1927554c0a3aSHans de Goede rtw_write8(Adapter, REG_RX_PKT_LIMIT_8723B, 0x18); /* for VHT packet length 11K */ 1928554c0a3aSHans de Goede rtw_write8(Adapter, REG_MAX_AGGR_NUM_8723B, 0x1F); 1929554c0a3aSHans de Goede rtw_write8(Adapter, REG_PIFS_8723B, 0x00); 1930554c0a3aSHans de Goede rtw_write8(Adapter, REG_FWHW_TXQ_CTRL_8723B, rtw_read8(Adapter, REG_FWHW_TXQ_CTRL)&(~BIT(7))); 1931554c0a3aSHans de Goede if (pHalData->AMPDUBurstMode) 1932554c0a3aSHans de Goede rtw_write8(Adapter, REG_AMPDU_BURST_MODE_8723B, 0x5F); 1933554c0a3aSHans de Goede rtw_write8(Adapter, REG_AMPDU_MAX_TIME_8723B, 0x70); 1934554c0a3aSHans de Goede 1935554c0a3aSHans de Goede /* ARFB table 9 for 11ac 5G 2SS */ 1936554c0a3aSHans de Goede rtw_write32(Adapter, REG_ARFR0_8723B, 0x00000010); 1937554c0a3aSHans de Goede if (IS_NORMAL_CHIP(pHalData->VersionID)) 1938554c0a3aSHans de Goede rtw_write32(Adapter, REG_ARFR0_8723B+4, 0xfffff000); 1939554c0a3aSHans de Goede else 1940554c0a3aSHans de Goede rtw_write32(Adapter, REG_ARFR0_8723B+4, 0x3e0ff000); 1941554c0a3aSHans de Goede 1942554c0a3aSHans de Goede /* ARFB table 10 for 11ac 5G 1SS */ 1943554c0a3aSHans de Goede rtw_write32(Adapter, REG_ARFR1_8723B, 0x00000010); 1944554c0a3aSHans de Goede rtw_write32(Adapter, REG_ARFR1_8723B+4, 0x003ff000); 1945554c0a3aSHans de Goede } 1946554c0a3aSHans de Goede 1947554c0a3aSHans de Goede static void ResumeTxBeacon(struct adapter *padapter) 1948554c0a3aSHans de Goede { 1949554c0a3aSHans de Goede struct hal_com_data *pHalData = GET_HAL_DATA(padapter); 1950554c0a3aSHans de Goede 1951554c0a3aSHans de Goede 1952554c0a3aSHans de Goede /* 2010.03.01. Marked by tynli. No need to call workitem beacause we record the value */ 1953554c0a3aSHans de Goede /* which should be read from register to a global variable. */ 1954554c0a3aSHans de Goede 1955554c0a3aSHans de Goede RT_TRACE(_module_hci_hal_init_c_, _drv_info_, ("+ResumeTxBeacon\n")); 1956554c0a3aSHans de Goede 1957554c0a3aSHans de Goede pHalData->RegFwHwTxQCtrl |= BIT(6); 1958554c0a3aSHans de Goede rtw_write8(padapter, REG_FWHW_TXQ_CTRL+2, pHalData->RegFwHwTxQCtrl); 1959554c0a3aSHans de Goede rtw_write8(padapter, REG_TBTT_PROHIBIT+1, 0xff); 1960554c0a3aSHans de Goede pHalData->RegReg542 |= BIT(0); 1961554c0a3aSHans de Goede rtw_write8(padapter, REG_TBTT_PROHIBIT+2, pHalData->RegReg542); 1962554c0a3aSHans de Goede } 1963554c0a3aSHans de Goede 1964554c0a3aSHans de Goede static void StopTxBeacon(struct adapter *padapter) 1965554c0a3aSHans de Goede { 1966554c0a3aSHans de Goede struct hal_com_data *pHalData = GET_HAL_DATA(padapter); 1967554c0a3aSHans de Goede 1968554c0a3aSHans de Goede 1969554c0a3aSHans de Goede /* 2010.03.01. Marked by tynli. No need to call workitem beacause we record the value */ 1970554c0a3aSHans de Goede /* which should be read from register to a global variable. */ 1971554c0a3aSHans de Goede 1972554c0a3aSHans de Goede RT_TRACE(_module_hci_hal_init_c_, _drv_info_, ("+StopTxBeacon\n")); 1973554c0a3aSHans de Goede 1974554c0a3aSHans de Goede pHalData->RegFwHwTxQCtrl &= ~BIT(6); 1975554c0a3aSHans de Goede rtw_write8(padapter, REG_FWHW_TXQ_CTRL+2, pHalData->RegFwHwTxQCtrl); 1976554c0a3aSHans de Goede rtw_write8(padapter, REG_TBTT_PROHIBIT+1, 0x64); 1977554c0a3aSHans de Goede pHalData->RegReg542 &= ~BIT(0); 1978554c0a3aSHans de Goede rtw_write8(padapter, REG_TBTT_PROHIBIT+2, pHalData->RegReg542); 1979554c0a3aSHans de Goede 1980554c0a3aSHans de Goede CheckFwRsvdPageContent(padapter); /* 2010.06.23. Added by tynli. */ 1981554c0a3aSHans de Goede } 1982554c0a3aSHans de Goede 1983554c0a3aSHans de Goede static void _BeaconFunctionEnable(struct adapter *padapter, u8 Enable, u8 Linked) 1984554c0a3aSHans de Goede { 1985554c0a3aSHans de Goede rtw_write8(padapter, REG_BCN_CTRL, DIS_TSF_UDT | EN_BCN_FUNCTION | DIS_BCNQ_SUB); 1986554c0a3aSHans de Goede rtw_write8(padapter, REG_RD_CTRL+1, 0x6F); 1987554c0a3aSHans de Goede } 1988554c0a3aSHans de Goede 1989554c0a3aSHans de Goede static void rtl8723b_SetBeaconRelatedRegisters(struct adapter *padapter) 1990554c0a3aSHans de Goede { 1991554c0a3aSHans de Goede u8 val8; 1992554c0a3aSHans de Goede u32 value32; 1993554c0a3aSHans de Goede struct mlme_ext_priv *pmlmeext = &padapter->mlmeextpriv; 1994554c0a3aSHans de Goede struct mlme_ext_info *pmlmeinfo = &pmlmeext->mlmext_info; 1995554c0a3aSHans de Goede u32 bcn_ctrl_reg; 1996554c0a3aSHans de Goede 1997554c0a3aSHans de Goede /* reset TSF, enable update TSF, correcting TSF On Beacon */ 1998554c0a3aSHans de Goede 1999554c0a3aSHans de Goede /* REG_BCN_INTERVAL */ 2000554c0a3aSHans de Goede /* REG_BCNDMATIM */ 2001554c0a3aSHans de Goede /* REG_ATIMWND */ 2002554c0a3aSHans de Goede /* REG_TBTT_PROHIBIT */ 2003554c0a3aSHans de Goede /* REG_DRVERLYINT */ 2004554c0a3aSHans de Goede /* REG_BCN_MAX_ERR */ 2005554c0a3aSHans de Goede /* REG_BCNTCFG (0x510) */ 2006554c0a3aSHans de Goede /* REG_DUAL_TSF_RST */ 2007554c0a3aSHans de Goede /* REG_BCN_CTRL (0x550) */ 2008554c0a3aSHans de Goede 2009554c0a3aSHans de Goede 2010554c0a3aSHans de Goede bcn_ctrl_reg = REG_BCN_CTRL; 2011554c0a3aSHans de Goede 2012554c0a3aSHans de Goede /* */ 2013554c0a3aSHans de Goede /* ATIM window */ 2014554c0a3aSHans de Goede /* */ 2015554c0a3aSHans de Goede rtw_write16(padapter, REG_ATIMWND, 2); 2016554c0a3aSHans de Goede 2017554c0a3aSHans de Goede /* */ 2018554c0a3aSHans de Goede /* Beacon interval (in unit of TU). */ 2019554c0a3aSHans de Goede /* */ 2020554c0a3aSHans de Goede rtw_write16(padapter, REG_BCN_INTERVAL, pmlmeinfo->bcn_interval); 2021554c0a3aSHans de Goede 2022554c0a3aSHans de Goede rtl8723b_InitBeaconParameters(padapter); 2023554c0a3aSHans de Goede 2024554c0a3aSHans de Goede rtw_write8(padapter, REG_SLOT, 0x09); 2025554c0a3aSHans de Goede 2026554c0a3aSHans de Goede /* */ 2027554c0a3aSHans de Goede /* Reset TSF Timer to zero, added by Roger. 2008.06.24 */ 2028554c0a3aSHans de Goede /* */ 2029554c0a3aSHans de Goede value32 = rtw_read32(padapter, REG_TCR); 2030554c0a3aSHans de Goede value32 &= ~TSFRST; 2031554c0a3aSHans de Goede rtw_write32(padapter, REG_TCR, value32); 2032554c0a3aSHans de Goede 2033554c0a3aSHans de Goede value32 |= TSFRST; 2034554c0a3aSHans de Goede rtw_write32(padapter, REG_TCR, value32); 2035554c0a3aSHans de Goede 2036554c0a3aSHans de Goede /* NOTE: Fix test chip's bug (about contention windows's randomness) */ 2037554c0a3aSHans de Goede if (check_fwstate(&padapter->mlmepriv, WIFI_ADHOC_STATE|WIFI_ADHOC_MASTER_STATE|WIFI_AP_STATE) == true) { 2038554c0a3aSHans de Goede rtw_write8(padapter, REG_RXTSF_OFFSET_CCK, 0x50); 2039554c0a3aSHans de Goede rtw_write8(padapter, REG_RXTSF_OFFSET_OFDM, 0x50); 2040554c0a3aSHans de Goede } 2041554c0a3aSHans de Goede 2042554c0a3aSHans de Goede _BeaconFunctionEnable(padapter, true, true); 2043554c0a3aSHans de Goede 2044554c0a3aSHans de Goede ResumeTxBeacon(padapter); 2045554c0a3aSHans de Goede val8 = rtw_read8(padapter, bcn_ctrl_reg); 2046554c0a3aSHans de Goede val8 |= DIS_BCNQ_SUB; 2047554c0a3aSHans de Goede rtw_write8(padapter, bcn_ctrl_reg, val8); 2048554c0a3aSHans de Goede } 2049554c0a3aSHans de Goede 2050554c0a3aSHans de Goede static void rtl8723b_GetHalODMVar( 2051554c0a3aSHans de Goede struct adapter *Adapter, 20520ba38840SMarco Cesati enum hal_odm_variable eVariable, 2053554c0a3aSHans de Goede void *pValue1, 2054554c0a3aSHans de Goede void *pValue2 2055554c0a3aSHans de Goede ) 2056554c0a3aSHans de Goede { 2057554c0a3aSHans de Goede GetHalODMVar(Adapter, eVariable, pValue1, pValue2); 2058554c0a3aSHans de Goede } 2059554c0a3aSHans de Goede 2060554c0a3aSHans de Goede static void rtl8723b_SetHalODMVar( 2061554c0a3aSHans de Goede struct adapter *Adapter, 20620ba38840SMarco Cesati enum hal_odm_variable eVariable, 2063554c0a3aSHans de Goede void *pValue1, 2064554c0a3aSHans de Goede bool bSet 2065554c0a3aSHans de Goede ) 2066554c0a3aSHans de Goede { 2067554c0a3aSHans de Goede SetHalODMVar(Adapter, eVariable, pValue1, bSet); 2068554c0a3aSHans de Goede } 2069554c0a3aSHans de Goede 2070554c0a3aSHans de Goede static void hal_notch_filter_8723b(struct adapter *adapter, bool enable) 2071554c0a3aSHans de Goede { 2072554c0a3aSHans de Goede if (enable) { 2073554c0a3aSHans de Goede DBG_871X("Enable notch filter\n"); 2074554c0a3aSHans de Goede rtw_write8(adapter, rOFDM0_RxDSP+1, rtw_read8(adapter, rOFDM0_RxDSP+1) | BIT1); 2075554c0a3aSHans de Goede } else { 2076554c0a3aSHans de Goede DBG_871X("Disable notch filter\n"); 2077554c0a3aSHans de Goede rtw_write8(adapter, rOFDM0_RxDSP+1, rtw_read8(adapter, rOFDM0_RxDSP+1) & ~BIT1); 2078554c0a3aSHans de Goede } 2079554c0a3aSHans de Goede } 2080554c0a3aSHans de Goede 2081554c0a3aSHans de Goede static void UpdateHalRAMask8723B(struct adapter *padapter, u32 mac_id, u8 rssi_level) 2082554c0a3aSHans de Goede { 2083554c0a3aSHans de Goede u32 mask, rate_bitmap; 2084554c0a3aSHans de Goede u8 shortGIrate = false; 2085554c0a3aSHans de Goede struct sta_info *psta; 2086554c0a3aSHans de Goede struct hal_com_data *pHalData = GET_HAL_DATA(padapter); 2087554c0a3aSHans de Goede struct dm_priv *pdmpriv = &pHalData->dmpriv; 2088554c0a3aSHans de Goede struct mlme_ext_priv *pmlmeext = &padapter->mlmeextpriv; 2089554c0a3aSHans de Goede struct mlme_ext_info *pmlmeinfo = &(pmlmeext->mlmext_info); 2090554c0a3aSHans de Goede 2091554c0a3aSHans de Goede DBG_871X("%s(): mac_id =%d rssi_level =%d\n", __func__, mac_id, rssi_level); 2092554c0a3aSHans de Goede 2093554c0a3aSHans de Goede if (mac_id >= NUM_STA) /* CAM_SIZE */ 2094554c0a3aSHans de Goede return; 2095554c0a3aSHans de Goede 2096554c0a3aSHans de Goede psta = pmlmeinfo->FW_sta_info[mac_id].psta; 209702ca9aa0SHariprasad Kelam if (!psta) 2098554c0a3aSHans de Goede return; 2099554c0a3aSHans de Goede 2100554c0a3aSHans de Goede shortGIrate = query_ra_short_GI(psta); 2101554c0a3aSHans de Goede 2102554c0a3aSHans de Goede mask = psta->ra_mask; 2103554c0a3aSHans de Goede 2104554c0a3aSHans de Goede rate_bitmap = 0xffffffff; 2105554c0a3aSHans de Goede rate_bitmap = ODM_Get_Rate_Bitmap(&pHalData->odmpriv, mac_id, mask, rssi_level); 2106554c0a3aSHans de Goede DBG_871X("%s => mac_id:%d, networkType:0x%02x, mask:0x%08x\n\t ==> rssi_level:%d, rate_bitmap:0x%08x\n", 2107554c0a3aSHans de Goede __func__, mac_id, psta->wireless_mode, mask, rssi_level, rate_bitmap); 2108554c0a3aSHans de Goede 2109554c0a3aSHans de Goede mask &= rate_bitmap; 2110554c0a3aSHans de Goede 211169fa65f9SNishka Dasgupta rate_bitmap = hal_btcoex_GetRaMask(padapter); 2112554c0a3aSHans de Goede mask &= ~rate_bitmap; 2113554c0a3aSHans de Goede 21147036126aSHariprasad Kelam if (pHalData->fw_ractrl) { 2115554c0a3aSHans de Goede rtl8723b_set_FwMacIdConfig_cmd(padapter, mac_id, psta->raid, psta->bw_mode, shortGIrate, mask); 2116554c0a3aSHans de Goede } 2117554c0a3aSHans de Goede 2118554c0a3aSHans de Goede /* set correct initial date rate for each mac_id */ 2119554c0a3aSHans de Goede pdmpriv->INIDATA_RATE[mac_id] = psta->init_rate; 2120554c0a3aSHans de Goede DBG_871X("%s(): mac_id =%d raid = 0x%x bw =%d mask = 0x%x init_rate = 0x%x\n", __func__, mac_id, psta->raid, psta->bw_mode, mask, psta->init_rate); 2121554c0a3aSHans de Goede } 2122554c0a3aSHans de Goede 2123554c0a3aSHans de Goede 2124554c0a3aSHans de Goede void rtl8723b_set_hal_ops(struct hal_ops *pHalFunc) 2125554c0a3aSHans de Goede { 2126554c0a3aSHans de Goede pHalFunc->free_hal_data = &rtl8723b_free_hal_data; 2127554c0a3aSHans de Goede 2128554c0a3aSHans de Goede pHalFunc->dm_init = &rtl8723b_init_dm_priv; 2129554c0a3aSHans de Goede 2130554c0a3aSHans de Goede pHalFunc->read_chip_version = &rtl8723b_read_chip_version; 2131554c0a3aSHans de Goede 2132554c0a3aSHans de Goede pHalFunc->UpdateRAMaskHandler = &UpdateHalRAMask8723B; 2133554c0a3aSHans de Goede 2134554c0a3aSHans de Goede pHalFunc->set_bwmode_handler = &PHY_SetBWMode8723B; 2135554c0a3aSHans de Goede pHalFunc->set_channel_handler = &PHY_SwChnl8723B; 2136554c0a3aSHans de Goede pHalFunc->set_chnl_bw_handler = &PHY_SetSwChnlBWMode8723B; 2137554c0a3aSHans de Goede 2138554c0a3aSHans de Goede pHalFunc->set_tx_power_level_handler = &PHY_SetTxPowerLevel8723B; 2139554c0a3aSHans de Goede pHalFunc->get_tx_power_level_handler = &PHY_GetTxPowerLevel8723B; 2140554c0a3aSHans de Goede 2141554c0a3aSHans de Goede pHalFunc->hal_dm_watchdog = &rtl8723b_HalDmWatchDog; 2142554c0a3aSHans de Goede pHalFunc->hal_dm_watchdog_in_lps = &rtl8723b_HalDmWatchDog_in_LPS; 2143554c0a3aSHans de Goede 2144554c0a3aSHans de Goede 2145554c0a3aSHans de Goede pHalFunc->SetBeaconRelatedRegistersHandler = &rtl8723b_SetBeaconRelatedRegisters; 2146554c0a3aSHans de Goede 2147554c0a3aSHans de Goede pHalFunc->Add_RateATid = &rtl8723b_Add_RateATid; 2148554c0a3aSHans de Goede 2149554c0a3aSHans de Goede pHalFunc->run_thread = &rtl8723b_start_thread; 2150554c0a3aSHans de Goede pHalFunc->cancel_thread = &rtl8723b_stop_thread; 2151554c0a3aSHans de Goede 2152554c0a3aSHans de Goede pHalFunc->read_bbreg = &PHY_QueryBBReg_8723B; 2153554c0a3aSHans de Goede pHalFunc->write_bbreg = &PHY_SetBBReg_8723B; 2154554c0a3aSHans de Goede pHalFunc->read_rfreg = &PHY_QueryRFReg_8723B; 2155554c0a3aSHans de Goede pHalFunc->write_rfreg = &PHY_SetRFReg_8723B; 2156554c0a3aSHans de Goede 2157554c0a3aSHans de Goede /* Efuse related function */ 2158554c0a3aSHans de Goede pHalFunc->BTEfusePowerSwitch = &Hal_BT_EfusePowerSwitch; 2159554c0a3aSHans de Goede pHalFunc->EfusePowerSwitch = &Hal_EfusePowerSwitch; 2160554c0a3aSHans de Goede pHalFunc->ReadEFuse = &Hal_ReadEFuse; 2161554c0a3aSHans de Goede pHalFunc->EFUSEGetEfuseDefinition = &Hal_GetEfuseDefinition; 2162554c0a3aSHans de Goede pHalFunc->EfuseGetCurrentSize = &Hal_EfuseGetCurrentSize; 2163554c0a3aSHans de Goede pHalFunc->Efuse_PgPacketRead = &Hal_EfusePgPacketRead; 2164554c0a3aSHans de Goede pHalFunc->Efuse_PgPacketWrite = &Hal_EfusePgPacketWrite; 2165554c0a3aSHans de Goede pHalFunc->Efuse_WordEnableDataWrite = &Hal_EfuseWordEnableDataWrite; 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218568468503SAndreas Hellmich /* Let 8051 take control antenna setting */ 2186554c0a3aSHans de Goede val |= BIT(7); /* DPDT_SEL_EN, 0x4C[23] */ 2187554c0a3aSHans de Goede rtw_write8(padapter, REG_LEDCFG2, val); 2188554c0a3aSHans de Goede } 2189554c0a3aSHans de Goede 2190554c0a3aSHans de Goede void rtl8723b_init_default_value(struct adapter *padapter) 2191554c0a3aSHans de Goede { 2192554c0a3aSHans de Goede struct hal_com_data *pHalData; 2193554c0a3aSHans de Goede struct dm_priv *pdmpriv; 2194554c0a3aSHans de Goede u8 i; 2195554c0a3aSHans de Goede 2196554c0a3aSHans de Goede 2197554c0a3aSHans de Goede pHalData = GET_HAL_DATA(padapter); 2198554c0a3aSHans de Goede pdmpriv = &pHalData->dmpriv; 2199554c0a3aSHans de Goede 2200554c0a3aSHans de Goede padapter->registrypriv.wireless_mode = WIRELESS_11BG_24N; 2201554c0a3aSHans de Goede 2202554c0a3aSHans de Goede /* init default value */ 2203554c0a3aSHans de Goede pHalData->fw_ractrl = false; 2204554c0a3aSHans de Goede pHalData->bIQKInitialized = false; 2205554c0a3aSHans de Goede if (!adapter_to_pwrctl(padapter)->bkeepfwalive) 2206554c0a3aSHans de Goede pHalData->LastHMEBoxNum = 0; 2207554c0a3aSHans de Goede 2208554c0a3aSHans de Goede pHalData->bIQKInitialized = false; 2209554c0a3aSHans de Goede 2210554c0a3aSHans de Goede /* init dm default value */ 2211554c0a3aSHans de Goede pdmpriv->TM_Trigger = 0;/* for IQK */ 2212554c0a3aSHans de Goede /* pdmpriv->binitialized = false; */ 2213554c0a3aSHans de Goede /* pdmpriv->prv_traffic_idx = 3; */ 2214554c0a3aSHans de Goede /* pdmpriv->initialize = 0; */ 2215554c0a3aSHans de Goede 2216554c0a3aSHans de Goede pdmpriv->ThermalValue_HP_index = 0; 2217554c0a3aSHans de Goede for (i = 0; i < HP_THERMAL_NUM; i++) 2218554c0a3aSHans de Goede pdmpriv->ThermalValue_HP[i] = 0; 2219554c0a3aSHans de Goede 2220554c0a3aSHans de Goede /* init Efuse variables */ 2221554c0a3aSHans de Goede pHalData->EfuseUsedBytes = 0; 2222554c0a3aSHans de Goede pHalData->EfuseUsedPercentage = 0; 2223554c0a3aSHans de Goede #ifdef HAL_EFUSE_MEMORY 2224554c0a3aSHans de Goede pHalData->EfuseHal.fakeEfuseBank = 0; 2225554c0a3aSHans de Goede pHalData->EfuseHal.fakeEfuseUsedBytes = 0; 2226554c0a3aSHans de Goede memset(pHalData->EfuseHal.fakeEfuseContent, 0xFF, EFUSE_MAX_HW_SIZE); 2227554c0a3aSHans de Goede memset(pHalData->EfuseHal.fakeEfuseInitMap, 0xFF, EFUSE_MAX_MAP_LEN); 2228554c0a3aSHans de Goede memset(pHalData->EfuseHal.fakeEfuseModifiedMap, 0xFF, EFUSE_MAX_MAP_LEN); 2229554c0a3aSHans de Goede pHalData->EfuseHal.BTEfuseUsedBytes = 0; 2230554c0a3aSHans de Goede pHalData->EfuseHal.BTEfuseUsedPercentage = 0; 2231554c0a3aSHans de Goede memset(pHalData->EfuseHal.BTEfuseContent, 0xFF, EFUSE_MAX_BT_BANK*EFUSE_MAX_HW_SIZE); 2232554c0a3aSHans de Goede memset(pHalData->EfuseHal.BTEfuseInitMap, 0xFF, EFUSE_BT_MAX_MAP_LEN); 2233554c0a3aSHans de Goede memset(pHalData->EfuseHal.BTEfuseModifiedMap, 0xFF, EFUSE_BT_MAX_MAP_LEN); 2234554c0a3aSHans de Goede pHalData->EfuseHal.fakeBTEfuseUsedBytes = 0; 2235554c0a3aSHans de Goede memset(pHalData->EfuseHal.fakeBTEfuseContent, 0xFF, EFUSE_MAX_BT_BANK*EFUSE_MAX_HW_SIZE); 2236554c0a3aSHans de Goede memset(pHalData->EfuseHal.fakeBTEfuseInitMap, 0xFF, EFUSE_BT_MAX_MAP_LEN); 2237554c0a3aSHans de Goede memset(pHalData->EfuseHal.fakeBTEfuseModifiedMap, 0xFF, EFUSE_BT_MAX_MAP_LEN); 2238554c0a3aSHans de Goede #endif 2239554c0a3aSHans de Goede } 2240554c0a3aSHans de Goede 2241554c0a3aSHans de Goede u8 GetEEPROMSize8723B(struct adapter *padapter) 2242554c0a3aSHans de Goede { 2243554c0a3aSHans de Goede u8 size = 0; 2244554c0a3aSHans de Goede u32 cr; 2245554c0a3aSHans de Goede 2246554c0a3aSHans de Goede cr = rtw_read16(padapter, REG_9346CR); 2247554c0a3aSHans de Goede /* 6: EEPROM used is 93C46, 4: boot from E-Fuse. */ 2248554c0a3aSHans de Goede size = (cr & BOOT_FROM_EEPROM) ? 6 : 4; 2249554c0a3aSHans de Goede 2250554c0a3aSHans de Goede MSG_8192C("EEPROM type is %s\n", size == 4 ? "E-FUSE" : "93C46"); 2251554c0a3aSHans de Goede 2252554c0a3aSHans de Goede return size; 2253554c0a3aSHans de Goede } 2254554c0a3aSHans de Goede 2255554c0a3aSHans de Goede /* */ 2256554c0a3aSHans de Goede /* */ 2257554c0a3aSHans de Goede /* LLT R/W/Init function */ 2258554c0a3aSHans de Goede /* */ 2259554c0a3aSHans de Goede /* */ 2260554c0a3aSHans de Goede s32 rtl8723b_InitLLTTable(struct adapter *padapter) 2261554c0a3aSHans de Goede { 2262554c0a3aSHans de Goede unsigned long start, passing_time; 2263554c0a3aSHans de Goede u32 val32; 2264554c0a3aSHans de Goede s32 ret; 2265554c0a3aSHans de Goede 2266554c0a3aSHans de Goede 2267554c0a3aSHans de Goede ret = _FAIL; 2268554c0a3aSHans de Goede 2269554c0a3aSHans de Goede val32 = rtw_read32(padapter, REG_AUTO_LLT); 2270554c0a3aSHans de Goede val32 |= BIT_AUTO_INIT_LLT; 2271554c0a3aSHans de Goede rtw_write32(padapter, REG_AUTO_LLT, val32); 2272554c0a3aSHans de Goede 2273554c0a3aSHans de Goede start = jiffies; 2274554c0a3aSHans de Goede 2275554c0a3aSHans de Goede do { 2276554c0a3aSHans de Goede val32 = rtw_read32(padapter, REG_AUTO_LLT); 2277554c0a3aSHans de Goede if (!(val32 & BIT_AUTO_INIT_LLT)) { 2278554c0a3aSHans de Goede ret = _SUCCESS; 2279554c0a3aSHans de Goede break; 2280554c0a3aSHans de Goede } 2281554c0a3aSHans de Goede 2282554c0a3aSHans de Goede passing_time = jiffies_to_msecs(jiffies - start); 2283554c0a3aSHans de Goede if (passing_time > 1000) { 2284554c0a3aSHans de Goede DBG_8192C( 2285554c0a3aSHans de Goede "%s: FAIL!! REG_AUTO_LLT(0x%X) =%08x\n", 2286554c0a3aSHans de Goede __func__, 2287554c0a3aSHans de Goede REG_AUTO_LLT, 2288554c0a3aSHans de Goede val32 2289554c0a3aSHans de Goede ); 2290554c0a3aSHans de Goede break; 2291554c0a3aSHans de Goede } 2292554c0a3aSHans de Goede 2293554c0a3aSHans de Goede msleep(1); 2294554c0a3aSHans de Goede } while (1); 2295554c0a3aSHans de Goede 2296554c0a3aSHans de Goede return ret; 2297554c0a3aSHans de Goede } 2298554c0a3aSHans de Goede 2299554c0a3aSHans de Goede static bool Hal_GetChnlGroup8723B(u8 Channel, u8 *pGroup) 2300554c0a3aSHans de Goede { 2301554c0a3aSHans de Goede bool bIn24G = true; 2302554c0a3aSHans de Goede 2303554c0a3aSHans de Goede if (Channel <= 14) { 2304554c0a3aSHans de Goede bIn24G = true; 2305554c0a3aSHans de Goede 2306554c0a3aSHans de Goede if (1 <= Channel && Channel <= 2) 2307554c0a3aSHans de Goede *pGroup = 0; 2308554c0a3aSHans de Goede else if (3 <= Channel && Channel <= 5) 2309554c0a3aSHans de Goede *pGroup = 1; 2310554c0a3aSHans de Goede else if (6 <= Channel && Channel <= 8) 2311554c0a3aSHans de Goede *pGroup = 2; 2312554c0a3aSHans de Goede else if (9 <= Channel && Channel <= 11) 2313554c0a3aSHans de Goede *pGroup = 3; 2314554c0a3aSHans de Goede else if (12 <= Channel && Channel <= 14) 2315554c0a3aSHans de Goede *pGroup = 4; 2316554c0a3aSHans de Goede else { 2317554c0a3aSHans de Goede RT_TRACE(_module_hci_hal_init_c_, _drv_notice_, ("==>Hal_GetChnlGroup8723B in 2.4 G, but Channel %d in Group not found\n", Channel)); 2318554c0a3aSHans de Goede } 2319554c0a3aSHans de Goede } else { 2320554c0a3aSHans de Goede bIn24G = false; 2321554c0a3aSHans de Goede 2322554c0a3aSHans de Goede if (36 <= Channel && Channel <= 42) 2323554c0a3aSHans de Goede *pGroup = 0; 2324554c0a3aSHans de Goede else if (44 <= Channel && Channel <= 48) 2325554c0a3aSHans de Goede *pGroup = 1; 2326554c0a3aSHans de Goede else if (50 <= Channel && Channel <= 58) 2327554c0a3aSHans de Goede *pGroup = 2; 2328554c0a3aSHans de Goede else if (60 <= Channel && Channel <= 64) 2329554c0a3aSHans de Goede *pGroup = 3; 2330554c0a3aSHans de Goede else if (100 <= Channel && Channel <= 106) 2331554c0a3aSHans de Goede *pGroup = 4; 2332554c0a3aSHans de Goede else if (108 <= Channel && Channel <= 114) 2333554c0a3aSHans de Goede *pGroup = 5; 2334554c0a3aSHans de Goede else if (116 <= Channel && Channel <= 122) 2335554c0a3aSHans de Goede *pGroup = 6; 2336554c0a3aSHans de Goede else if (124 <= Channel && Channel <= 130) 2337554c0a3aSHans de Goede *pGroup = 7; 2338554c0a3aSHans de Goede else if (132 <= Channel && Channel <= 138) 2339554c0a3aSHans de Goede *pGroup = 8; 2340554c0a3aSHans de Goede else if (140 <= Channel && Channel <= 144) 2341554c0a3aSHans de Goede *pGroup = 9; 2342554c0a3aSHans de Goede else if (149 <= Channel && Channel <= 155) 2343554c0a3aSHans de Goede *pGroup = 10; 2344554c0a3aSHans de Goede else if (157 <= Channel && Channel <= 161) 2345554c0a3aSHans de Goede *pGroup = 11; 2346554c0a3aSHans de Goede else if (165 <= Channel && Channel <= 171) 2347554c0a3aSHans de Goede *pGroup = 12; 2348554c0a3aSHans de Goede else if (173 <= Channel && Channel <= 177) 2349554c0a3aSHans de Goede *pGroup = 13; 2350554c0a3aSHans de Goede else { 2351554c0a3aSHans de Goede RT_TRACE(_module_hci_hal_init_c_, _drv_notice_, ("==>Hal_GetChnlGroup8723B in 5G, but Channel %d in Group not found\n", Channel)); 2352554c0a3aSHans de Goede } 2353554c0a3aSHans de Goede 2354554c0a3aSHans de Goede } 2355554c0a3aSHans de Goede RT_TRACE( 2356554c0a3aSHans de Goede _module_hci_hal_init_c_, 2357554c0a3aSHans de Goede _drv_info_, 2358554c0a3aSHans de Goede ( 2359554c0a3aSHans de Goede "<==Hal_GetChnlGroup8723B, (%s) Channel = %d, Group =%d,\n", 2360554c0a3aSHans de Goede bIn24G ? "2.4G" : "5G", 2361554c0a3aSHans de Goede Channel, 2362554c0a3aSHans de Goede *pGroup 2363554c0a3aSHans de Goede ) 2364554c0a3aSHans de Goede ); 2365554c0a3aSHans de Goede return bIn24G; 2366554c0a3aSHans de Goede } 2367554c0a3aSHans de Goede 2368554c0a3aSHans de Goede void Hal_InitPGData(struct adapter *padapter, u8 *PROMContent) 2369554c0a3aSHans de Goede { 2370554c0a3aSHans de Goede struct eeprom_priv *pEEPROM = GET_EEPROM_EFUSE_PRIV(padapter); 2371554c0a3aSHans de Goede 23727036126aSHariprasad Kelam if (!pEEPROM->bautoload_fail_flag) { /* autoload OK. */ 2373554c0a3aSHans de Goede if (!pEEPROM->EepromOrEfuse) { 2374554c0a3aSHans de Goede /* Read EFUSE real map to shadow. */ 2375554c0a3aSHans de Goede EFUSE_ShadowMapUpdate(padapter, EFUSE_WIFI, false); 2376554c0a3aSHans de Goede memcpy((void *)PROMContent, (void *)pEEPROM->efuse_eeprom_data, HWSET_MAX_SIZE_8723B); 2377554c0a3aSHans de Goede } 2378554c0a3aSHans de Goede } else {/* autoload fail */ 2379554c0a3aSHans de Goede RT_TRACE(_module_hci_hal_init_c_, _drv_notice_, ("AutoLoad Fail reported from CR9346!!\n")); 23807036126aSHariprasad Kelam if (!pEEPROM->EepromOrEfuse) 2381554c0a3aSHans de Goede EFUSE_ShadowMapUpdate(padapter, EFUSE_WIFI, false); 2382554c0a3aSHans de Goede memcpy((void *)PROMContent, (void *)pEEPROM->efuse_eeprom_data, HWSET_MAX_SIZE_8723B); 2383554c0a3aSHans de Goede } 2384554c0a3aSHans de Goede } 2385554c0a3aSHans de Goede 2386554c0a3aSHans de Goede void Hal_EfuseParseIDCode(struct adapter *padapter, u8 *hwinfo) 2387554c0a3aSHans de Goede { 2388554c0a3aSHans de Goede struct eeprom_priv *pEEPROM = GET_EEPROM_EFUSE_PRIV(padapter); 2389554c0a3aSHans de Goede /* struct hal_com_data *pHalData = GET_HAL_DATA(padapter); */ 2390554c0a3aSHans de Goede u16 EEPROMId; 2391554c0a3aSHans de Goede 2392554c0a3aSHans de Goede 2393554c0a3aSHans de Goede /* Checl 0x8129 again for making sure autoload status!! */ 2394554c0a3aSHans de Goede EEPROMId = le16_to_cpu(*((__le16 *)hwinfo)); 2395554c0a3aSHans de Goede if (EEPROMId != RTL_EEPROM_ID) { 2396554c0a3aSHans de Goede DBG_8192C("EEPROM ID(%#x) is invalid!!\n", EEPROMId); 2397554c0a3aSHans de Goede pEEPROM->bautoload_fail_flag = true; 2398554c0a3aSHans de Goede } else 2399554c0a3aSHans de Goede pEEPROM->bautoload_fail_flag = false; 2400554c0a3aSHans de Goede 2401554c0a3aSHans de Goede RT_TRACE(_module_hal_init_c_, _drv_notice_, ("EEPROM ID = 0x%04x\n", EEPROMId)); 2402554c0a3aSHans de Goede } 2403554c0a3aSHans de Goede 2404554c0a3aSHans de Goede static void Hal_ReadPowerValueFromPROM_8723B( 2405554c0a3aSHans de Goede struct adapter *Adapter, 2406554c0a3aSHans de Goede struct TxPowerInfo24G *pwrInfo24G, 2407554c0a3aSHans de Goede u8 *PROMContent, 2408554c0a3aSHans de Goede bool AutoLoadFail 2409554c0a3aSHans de Goede ) 2410554c0a3aSHans de Goede { 2411554c0a3aSHans de Goede struct hal_com_data *pHalData = GET_HAL_DATA(Adapter); 2412554c0a3aSHans de Goede u32 rfPath, eeAddr = EEPROM_TX_PWR_INX_8723B, group, TxCount = 0; 2413554c0a3aSHans de Goede 2414554c0a3aSHans de Goede memset(pwrInfo24G, 0, sizeof(struct TxPowerInfo24G)); 2415554c0a3aSHans de Goede 2416554c0a3aSHans de Goede if (0xFF == PROMContent[eeAddr+1]) 2417554c0a3aSHans de Goede AutoLoadFail = true; 2418554c0a3aSHans de Goede 2419554c0a3aSHans de Goede if (AutoLoadFail) { 2420554c0a3aSHans de Goede DBG_871X("%s(): Use Default value!\n", __func__); 2421554c0a3aSHans de Goede for (rfPath = 0; rfPath < MAX_RF_PATH; rfPath++) { 2422554c0a3aSHans de Goede /* 2.4G default value */ 2423554c0a3aSHans de Goede for (group = 0; group < MAX_CHNL_GROUP_24G; group++) { 2424554c0a3aSHans de Goede pwrInfo24G->IndexCCK_Base[rfPath][group] = EEPROM_DEFAULT_24G_INDEX; 2425554c0a3aSHans de Goede pwrInfo24G->IndexBW40_Base[rfPath][group] = EEPROM_DEFAULT_24G_INDEX; 2426554c0a3aSHans de Goede } 2427554c0a3aSHans de Goede 2428554c0a3aSHans de Goede for (TxCount = 0; TxCount < MAX_TX_COUNT; TxCount++) { 2429554c0a3aSHans de Goede if (TxCount == 0) { 2430554c0a3aSHans de Goede pwrInfo24G->BW20_Diff[rfPath][0] = EEPROM_DEFAULT_24G_HT20_DIFF; 2431554c0a3aSHans de Goede pwrInfo24G->OFDM_Diff[rfPath][0] = EEPROM_DEFAULT_24G_OFDM_DIFF; 2432554c0a3aSHans de Goede } else { 2433554c0a3aSHans de Goede pwrInfo24G->BW20_Diff[rfPath][TxCount] = EEPROM_DEFAULT_DIFF; 2434554c0a3aSHans de Goede pwrInfo24G->BW40_Diff[rfPath][TxCount] = EEPROM_DEFAULT_DIFF; 2435554c0a3aSHans de Goede pwrInfo24G->CCK_Diff[rfPath][TxCount] = EEPROM_DEFAULT_DIFF; 2436554c0a3aSHans de Goede pwrInfo24G->OFDM_Diff[rfPath][TxCount] = EEPROM_DEFAULT_DIFF; 2437554c0a3aSHans de Goede } 2438554c0a3aSHans de Goede } 2439554c0a3aSHans de Goede } 2440554c0a3aSHans de Goede 2441554c0a3aSHans de Goede return; 2442554c0a3aSHans de Goede } 2443554c0a3aSHans de Goede 2444554c0a3aSHans de Goede pHalData->bTXPowerDataReadFromEEPORM = true; /* YJ, move, 120316 */ 2445554c0a3aSHans de Goede 2446554c0a3aSHans de Goede for (rfPath = 0; rfPath < MAX_RF_PATH; rfPath++) { 2447554c0a3aSHans de Goede /* 2 2.4G default value */ 2448554c0a3aSHans de Goede for (group = 0; group < MAX_CHNL_GROUP_24G; group++) { 2449554c0a3aSHans de Goede pwrInfo24G->IndexCCK_Base[rfPath][group] = PROMContent[eeAddr++]; 2450554c0a3aSHans de Goede if (pwrInfo24G->IndexCCK_Base[rfPath][group] == 0xFF) 2451554c0a3aSHans de Goede pwrInfo24G->IndexCCK_Base[rfPath][group] = EEPROM_DEFAULT_24G_INDEX; 2452554c0a3aSHans de Goede } 2453554c0a3aSHans de Goede 2454554c0a3aSHans de Goede for (group = 0; group < MAX_CHNL_GROUP_24G-1; group++) { 2455554c0a3aSHans de Goede pwrInfo24G->IndexBW40_Base[rfPath][group] = PROMContent[eeAddr++]; 2456554c0a3aSHans de Goede if (pwrInfo24G->IndexBW40_Base[rfPath][group] == 0xFF) 2457554c0a3aSHans de Goede pwrInfo24G->IndexBW40_Base[rfPath][group] = EEPROM_DEFAULT_24G_INDEX; 2458554c0a3aSHans de Goede } 2459554c0a3aSHans de Goede 2460554c0a3aSHans de Goede for (TxCount = 0; TxCount < MAX_TX_COUNT; TxCount++) { 2461554c0a3aSHans de Goede if (TxCount == 0) { 2462554c0a3aSHans de Goede pwrInfo24G->BW40_Diff[rfPath][TxCount] = 0; 2463554c0a3aSHans de Goede if (PROMContent[eeAddr] == 0xFF) 2464554c0a3aSHans de Goede pwrInfo24G->BW20_Diff[rfPath][TxCount] = EEPROM_DEFAULT_24G_HT20_DIFF; 2465554c0a3aSHans de Goede else { 2466554c0a3aSHans de Goede pwrInfo24G->BW20_Diff[rfPath][TxCount] = (PROMContent[eeAddr]&0xf0)>>4; 2467554c0a3aSHans de Goede if (pwrInfo24G->BW20_Diff[rfPath][TxCount] & BIT3) /* 4bit sign number to 8 bit sign number */ 2468554c0a3aSHans de Goede pwrInfo24G->BW20_Diff[rfPath][TxCount] |= 0xF0; 2469554c0a3aSHans de Goede } 2470554c0a3aSHans de Goede 2471554c0a3aSHans de Goede if (PROMContent[eeAddr] == 0xFF) 2472554c0a3aSHans de Goede pwrInfo24G->OFDM_Diff[rfPath][TxCount] = EEPROM_DEFAULT_24G_OFDM_DIFF; 2473554c0a3aSHans de Goede else { 2474554c0a3aSHans de Goede pwrInfo24G->OFDM_Diff[rfPath][TxCount] = (PROMContent[eeAddr]&0x0f); 2475554c0a3aSHans de Goede if (pwrInfo24G->OFDM_Diff[rfPath][TxCount] & BIT3) /* 4bit sign number to 8 bit sign number */ 2476554c0a3aSHans de Goede pwrInfo24G->OFDM_Diff[rfPath][TxCount] |= 0xF0; 2477554c0a3aSHans de Goede } 2478554c0a3aSHans de Goede pwrInfo24G->CCK_Diff[rfPath][TxCount] = 0; 2479554c0a3aSHans de Goede eeAddr++; 2480554c0a3aSHans de Goede } else { 2481554c0a3aSHans de Goede if (PROMContent[eeAddr] == 0xFF) 2482554c0a3aSHans de Goede pwrInfo24G->BW40_Diff[rfPath][TxCount] = EEPROM_DEFAULT_DIFF; 2483554c0a3aSHans de Goede else { 2484554c0a3aSHans de Goede pwrInfo24G->BW40_Diff[rfPath][TxCount] = (PROMContent[eeAddr]&0xf0)>>4; 2485554c0a3aSHans de Goede if (pwrInfo24G->BW40_Diff[rfPath][TxCount] & BIT3) /* 4bit sign number to 8 bit sign number */ 2486554c0a3aSHans de Goede pwrInfo24G->BW40_Diff[rfPath][TxCount] |= 0xF0; 2487554c0a3aSHans de Goede } 2488554c0a3aSHans de Goede 2489554c0a3aSHans de Goede if (PROMContent[eeAddr] == 0xFF) 2490554c0a3aSHans de Goede pwrInfo24G->BW20_Diff[rfPath][TxCount] = EEPROM_DEFAULT_DIFF; 2491554c0a3aSHans de Goede else { 2492554c0a3aSHans de Goede pwrInfo24G->BW20_Diff[rfPath][TxCount] = (PROMContent[eeAddr]&0x0f); 2493554c0a3aSHans de Goede if (pwrInfo24G->BW20_Diff[rfPath][TxCount] & BIT3) /* 4bit sign number to 8 bit sign number */ 2494554c0a3aSHans de Goede pwrInfo24G->BW20_Diff[rfPath][TxCount] |= 0xF0; 2495554c0a3aSHans de Goede } 2496554c0a3aSHans de Goede eeAddr++; 2497554c0a3aSHans de Goede 2498554c0a3aSHans de Goede if (PROMContent[eeAddr] == 0xFF) 2499554c0a3aSHans de Goede pwrInfo24G->OFDM_Diff[rfPath][TxCount] = EEPROM_DEFAULT_DIFF; 2500554c0a3aSHans de Goede else { 2501554c0a3aSHans de Goede pwrInfo24G->OFDM_Diff[rfPath][TxCount] = (PROMContent[eeAddr]&0xf0)>>4; 2502554c0a3aSHans de Goede if (pwrInfo24G->OFDM_Diff[rfPath][TxCount] & BIT3) /* 4bit sign number to 8 bit sign number */ 2503554c0a3aSHans de Goede pwrInfo24G->OFDM_Diff[rfPath][TxCount] |= 0xF0; 2504554c0a3aSHans de Goede } 2505554c0a3aSHans de Goede 2506554c0a3aSHans de Goede if (PROMContent[eeAddr] == 0xFF) 2507554c0a3aSHans de Goede pwrInfo24G->CCK_Diff[rfPath][TxCount] = EEPROM_DEFAULT_DIFF; 2508554c0a3aSHans de Goede else { 2509554c0a3aSHans de Goede pwrInfo24G->CCK_Diff[rfPath][TxCount] = (PROMContent[eeAddr]&0x0f); 2510554c0a3aSHans de Goede if (pwrInfo24G->CCK_Diff[rfPath][TxCount] & BIT3) /* 4bit sign number to 8 bit sign number */ 2511554c0a3aSHans de Goede pwrInfo24G->CCK_Diff[rfPath][TxCount] |= 0xF0; 2512554c0a3aSHans de Goede } 2513554c0a3aSHans de Goede eeAddr++; 2514554c0a3aSHans de Goede } 2515554c0a3aSHans de Goede } 2516554c0a3aSHans de Goede } 2517554c0a3aSHans de Goede } 2518554c0a3aSHans de Goede 2519554c0a3aSHans de Goede 2520554c0a3aSHans de Goede void Hal_EfuseParseTxPowerInfo_8723B( 2521554c0a3aSHans de Goede struct adapter *padapter, u8 *PROMContent, bool AutoLoadFail 2522554c0a3aSHans de Goede ) 2523554c0a3aSHans de Goede { 2524554c0a3aSHans de Goede struct hal_com_data *pHalData = GET_HAL_DATA(padapter); 2525554c0a3aSHans de Goede struct TxPowerInfo24G pwrInfo24G; 2526554c0a3aSHans de Goede u8 rfPath, ch, TxCount = 1; 2527554c0a3aSHans de Goede 2528554c0a3aSHans de Goede Hal_ReadPowerValueFromPROM_8723B(padapter, &pwrInfo24G, PROMContent, AutoLoadFail); 2529554c0a3aSHans de Goede for (rfPath = 0 ; rfPath < MAX_RF_PATH ; rfPath++) { 2530554c0a3aSHans de Goede for (ch = 0 ; ch < CHANNEL_MAX_NUMBER; ch++) { 2531554c0a3aSHans de Goede u8 group = 0; 2532554c0a3aSHans de Goede 2533554c0a3aSHans de Goede Hal_GetChnlGroup8723B(ch+1, &group); 2534554c0a3aSHans de Goede 2535554c0a3aSHans de Goede if (ch == 14-1) { 2536554c0a3aSHans de Goede pHalData->Index24G_CCK_Base[rfPath][ch] = pwrInfo24G.IndexCCK_Base[rfPath][5]; 2537554c0a3aSHans de Goede pHalData->Index24G_BW40_Base[rfPath][ch] = pwrInfo24G.IndexBW40_Base[rfPath][group]; 2538554c0a3aSHans de Goede } else { 2539554c0a3aSHans de Goede pHalData->Index24G_CCK_Base[rfPath][ch] = pwrInfo24G.IndexCCK_Base[rfPath][group]; 2540554c0a3aSHans de Goede pHalData->Index24G_BW40_Base[rfPath][ch] = pwrInfo24G.IndexBW40_Base[rfPath][group]; 2541554c0a3aSHans de Goede } 2542f55a6d45SArnd Bergmann #ifdef DEBUG 2543554c0a3aSHans de Goede RT_TRACE(_module_hci_hal_init_c_, _drv_info_, ("======= Path %d, ChannelIndex %d, Group %d =======\n", rfPath, ch, group)); 2544554c0a3aSHans de Goede RT_TRACE(_module_hci_hal_init_c_, _drv_info_, ("Index24G_CCK_Base[%d][%d] = 0x%x\n", rfPath, ch, pHalData->Index24G_CCK_Base[rfPath][ch])); 2545554c0a3aSHans de Goede RT_TRACE(_module_hci_hal_init_c_, _drv_info_, ("Index24G_BW40_Base[%d][%d] = 0x%x\n", rfPath, ch, pHalData->Index24G_BW40_Base[rfPath][ch])); 2546554c0a3aSHans de Goede #endif 2547554c0a3aSHans de Goede } 2548554c0a3aSHans de Goede 2549554c0a3aSHans de Goede for (TxCount = 0; TxCount < MAX_TX_COUNT; TxCount++) { 2550554c0a3aSHans de Goede pHalData->CCK_24G_Diff[rfPath][TxCount] = pwrInfo24G.CCK_Diff[rfPath][TxCount]; 2551554c0a3aSHans de Goede pHalData->OFDM_24G_Diff[rfPath][TxCount] = pwrInfo24G.OFDM_Diff[rfPath][TxCount]; 2552554c0a3aSHans de Goede pHalData->BW20_24G_Diff[rfPath][TxCount] = pwrInfo24G.BW20_Diff[rfPath][TxCount]; 2553554c0a3aSHans de Goede pHalData->BW40_24G_Diff[rfPath][TxCount] = pwrInfo24G.BW40_Diff[rfPath][TxCount]; 2554554c0a3aSHans de Goede 2555f55a6d45SArnd Bergmann #ifdef DEBUG 2556554c0a3aSHans de Goede RT_TRACE(_module_hci_hal_init_c_, _drv_info_, ("--------------------------------------- 2.4G ---------------------------------------\n")); 2557554c0a3aSHans de Goede RT_TRACE(_module_hci_hal_init_c_, _drv_info_, ("CCK_24G_Diff[%d][%d]= %d\n", rfPath, TxCount, pHalData->CCK_24G_Diff[rfPath][TxCount])); 2558554c0a3aSHans de Goede RT_TRACE(_module_hci_hal_init_c_, _drv_info_, ("OFDM_24G_Diff[%d][%d]= %d\n", rfPath, TxCount, pHalData->OFDM_24G_Diff[rfPath][TxCount])); 2559554c0a3aSHans de Goede RT_TRACE(_module_hci_hal_init_c_, _drv_info_, ("BW20_24G_Diff[%d][%d]= %d\n", rfPath, TxCount, pHalData->BW20_24G_Diff[rfPath][TxCount])); 2560554c0a3aSHans de Goede RT_TRACE(_module_hci_hal_init_c_, _drv_info_, ("BW40_24G_Diff[%d][%d]= %d\n", rfPath, TxCount, pHalData->BW40_24G_Diff[rfPath][TxCount])); 2561554c0a3aSHans de Goede #endif 2562554c0a3aSHans de Goede } 2563554c0a3aSHans de Goede } 2564554c0a3aSHans de Goede 2565554c0a3aSHans de Goede /* 2010/10/19 MH Add Regulator recognize for CU. */ 2566554c0a3aSHans de Goede if (!AutoLoadFail) { 2567554c0a3aSHans de Goede pHalData->EEPROMRegulatory = (PROMContent[EEPROM_RF_BOARD_OPTION_8723B]&0x7); /* bit0~2 */ 2568554c0a3aSHans de Goede if (PROMContent[EEPROM_RF_BOARD_OPTION_8723B] == 0xFF) 2569554c0a3aSHans de Goede pHalData->EEPROMRegulatory = (EEPROM_DEFAULT_BOARD_OPTION&0x7); /* bit0~2 */ 2570554c0a3aSHans de Goede } else 2571554c0a3aSHans de Goede pHalData->EEPROMRegulatory = 0; 2572554c0a3aSHans de Goede 2573554c0a3aSHans de Goede RT_TRACE(_module_hci_hal_init_c_, _drv_notice_, ("EEPROMRegulatory = 0x%x\n", pHalData->EEPROMRegulatory)); 2574554c0a3aSHans de Goede } 2575554c0a3aSHans de Goede 2576554c0a3aSHans de Goede void Hal_EfuseParseBTCoexistInfo_8723B( 2577554c0a3aSHans de Goede struct adapter *padapter, u8 *hwinfo, bool AutoLoadFail 2578554c0a3aSHans de Goede ) 2579554c0a3aSHans de Goede { 2580554c0a3aSHans de Goede struct hal_com_data *pHalData = GET_HAL_DATA(padapter); 2581554c0a3aSHans de Goede u8 tempval; 2582554c0a3aSHans de Goede u32 tmpu4; 2583554c0a3aSHans de Goede 2584554c0a3aSHans de Goede if (!AutoLoadFail) { 2585554c0a3aSHans de Goede tmpu4 = rtw_read32(padapter, REG_MULTI_FUNC_CTRL); 2586554c0a3aSHans de Goede if (tmpu4 & BT_FUNC_EN) 2587554c0a3aSHans de Goede pHalData->EEPROMBluetoothCoexist = true; 2588554c0a3aSHans de Goede else 2589554c0a3aSHans de Goede pHalData->EEPROMBluetoothCoexist = false; 2590554c0a3aSHans de Goede 2591554c0a3aSHans de Goede pHalData->EEPROMBluetoothType = BT_RTL8723B; 2592554c0a3aSHans de Goede 2593554c0a3aSHans de Goede tempval = hwinfo[EEPROM_RF_BT_SETTING_8723B]; 2594554c0a3aSHans de Goede if (tempval != 0xFF) { 2595554c0a3aSHans de Goede pHalData->EEPROMBluetoothAntNum = tempval & BIT(0); 2596554c0a3aSHans de Goede /* EFUSE_0xC3[6] == 0, S1(Main)-ODM_RF_PATH_A; */ 2597554c0a3aSHans de Goede /* EFUSE_0xC3[6] == 1, S0(Aux)-ODM_RF_PATH_B */ 2598554c0a3aSHans de Goede pHalData->ant_path = (tempval & BIT(6))?ODM_RF_PATH_B:ODM_RF_PATH_A; 2599554c0a3aSHans de Goede } else { 2600554c0a3aSHans de Goede pHalData->EEPROMBluetoothAntNum = Ant_x1; 2601554c0a3aSHans de Goede if (pHalData->PackageType == PACKAGE_QFN68) 2602554c0a3aSHans de Goede pHalData->ant_path = ODM_RF_PATH_B; 2603554c0a3aSHans de Goede else 2604554c0a3aSHans de Goede pHalData->ant_path = ODM_RF_PATH_A; 2605554c0a3aSHans de Goede } 2606554c0a3aSHans de Goede } else { 2607554c0a3aSHans de Goede pHalData->EEPROMBluetoothCoexist = false; 2608554c0a3aSHans de Goede pHalData->EEPROMBluetoothType = BT_RTL8723B; 2609554c0a3aSHans de Goede pHalData->EEPROMBluetoothAntNum = Ant_x1; 2610554c0a3aSHans de Goede pHalData->ant_path = ODM_RF_PATH_A; 2611554c0a3aSHans de Goede } 2612554c0a3aSHans de Goede 2613554c0a3aSHans de Goede if (padapter->registrypriv.ant_num > 0) { 2614554c0a3aSHans de Goede DBG_8192C( 2615554c0a3aSHans de Goede "%s: Apply driver defined antenna number(%d) to replace origin(%d)\n", 2616554c0a3aSHans de Goede __func__, 2617554c0a3aSHans de Goede padapter->registrypriv.ant_num, 2618554c0a3aSHans de Goede pHalData->EEPROMBluetoothAntNum == Ant_x2 ? 2 : 1 2619554c0a3aSHans de Goede ); 2620554c0a3aSHans de Goede 2621554c0a3aSHans de Goede switch (padapter->registrypriv.ant_num) { 2622554c0a3aSHans de Goede case 1: 2623554c0a3aSHans de Goede pHalData->EEPROMBluetoothAntNum = Ant_x1; 2624554c0a3aSHans de Goede break; 2625554c0a3aSHans de Goede case 2: 2626554c0a3aSHans de Goede pHalData->EEPROMBluetoothAntNum = Ant_x2; 2627554c0a3aSHans de Goede break; 2628554c0a3aSHans de Goede default: 2629554c0a3aSHans de Goede DBG_8192C( 2630554c0a3aSHans de Goede "%s: Discard invalid driver defined antenna number(%d)!\n", 2631554c0a3aSHans de Goede __func__, 2632554c0a3aSHans de Goede padapter->registrypriv.ant_num 2633554c0a3aSHans de Goede ); 2634554c0a3aSHans de Goede break; 2635554c0a3aSHans de Goede } 2636554c0a3aSHans de Goede } 2637554c0a3aSHans de Goede 263853557351SNishka Dasgupta hal_btcoex_SetBTCoexist(padapter, pHalData->EEPROMBluetoothCoexist); 2639efa6b6c9SNishka Dasgupta hal_btcoex_SetChipType(padapter, pHalData->EEPROMBluetoothType); 2640db3592d9SNishka Dasgupta hal_btcoex_SetPgAntNum(padapter, pHalData->EEPROMBluetoothAntNum == Ant_x2 ? 2 : 1); 2641554c0a3aSHans de Goede if (pHalData->EEPROMBluetoothAntNum == Ant_x1) 2642b3a74e04SNishka Dasgupta hal_btcoex_SetSingleAntPath(padapter, pHalData->ant_path); 2643554c0a3aSHans de Goede 2644554c0a3aSHans de Goede DBG_8192C( 2645554c0a3aSHans de Goede "%s: %s BT-coex, ant_num =%d\n", 2646554c0a3aSHans de Goede __func__, 2647554c0a3aSHans de Goede pHalData->EEPROMBluetoothCoexist == true ? "Enable" : "Disable", 2648554c0a3aSHans de Goede pHalData->EEPROMBluetoothAntNum == Ant_x2 ? 2 : 1 2649554c0a3aSHans de Goede ); 2650554c0a3aSHans de Goede } 2651554c0a3aSHans de Goede 2652554c0a3aSHans de Goede void Hal_EfuseParseEEPROMVer_8723B( 2653554c0a3aSHans de Goede struct adapter *padapter, u8 *hwinfo, bool AutoLoadFail 2654554c0a3aSHans de Goede ) 2655554c0a3aSHans de Goede { 2656554c0a3aSHans de Goede struct hal_com_data *pHalData = GET_HAL_DATA(padapter); 2657554c0a3aSHans de Goede 2658554c0a3aSHans de Goede /* RT_TRACE(_module_hci_hal_init_c_, _drv_notice_, ("%s(): AutoLoadFail = %d\n", __func__, AutoLoadFail)); */ 2659554c0a3aSHans de Goede if (!AutoLoadFail) 2660554c0a3aSHans de Goede pHalData->EEPROMVersion = hwinfo[EEPROM_VERSION_8723B]; 2661554c0a3aSHans de Goede else 2662554c0a3aSHans de Goede pHalData->EEPROMVersion = 1; 2663554c0a3aSHans de Goede RT_TRACE(_module_hci_hal_init_c_, _drv_notice_, ("Hal_EfuseParseEEPROMVer(), EEVer = %d\n", 2664554c0a3aSHans de Goede pHalData->EEPROMVersion)); 2665554c0a3aSHans de Goede } 2666554c0a3aSHans de Goede 2667554c0a3aSHans de Goede 2668554c0a3aSHans de Goede 2669554c0a3aSHans de Goede void Hal_EfuseParsePackageType_8723B( 2670554c0a3aSHans de Goede struct adapter *padapter, u8 *hwinfo, bool AutoLoadFail 2671554c0a3aSHans de Goede ) 2672554c0a3aSHans de Goede { 2673554c0a3aSHans de Goede struct hal_com_data *pHalData = GET_HAL_DATA(padapter); 2674554c0a3aSHans de Goede u8 package; 2675554c0a3aSHans de Goede u8 efuseContent; 2676554c0a3aSHans de Goede 2677554c0a3aSHans de Goede Efuse_PowerSwitch(padapter, false, true); 2678554c0a3aSHans de Goede efuse_OneByteRead(padapter, 0x1FB, &efuseContent, false); 2679554c0a3aSHans de Goede DBG_871X("%s phy efuse read 0x1FB =%x\n", __func__, efuseContent); 2680554c0a3aSHans de Goede Efuse_PowerSwitch(padapter, false, false); 2681554c0a3aSHans de Goede 2682554c0a3aSHans de Goede package = efuseContent & 0x7; 2683554c0a3aSHans de Goede switch (package) { 2684554c0a3aSHans de Goede case 0x4: 2685554c0a3aSHans de Goede pHalData->PackageType = PACKAGE_TFBGA79; 2686554c0a3aSHans de Goede break; 2687554c0a3aSHans de Goede case 0x5: 2688554c0a3aSHans de Goede pHalData->PackageType = PACKAGE_TFBGA90; 2689554c0a3aSHans de Goede break; 2690554c0a3aSHans de Goede case 0x6: 2691554c0a3aSHans de Goede pHalData->PackageType = PACKAGE_QFN68; 2692554c0a3aSHans de Goede break; 2693554c0a3aSHans de Goede case 0x7: 2694554c0a3aSHans de Goede pHalData->PackageType = PACKAGE_TFBGA80; 2695554c0a3aSHans de Goede break; 2696554c0a3aSHans de Goede 2697554c0a3aSHans de Goede default: 2698554c0a3aSHans de Goede pHalData->PackageType = PACKAGE_DEFAULT; 2699554c0a3aSHans de Goede break; 2700554c0a3aSHans de Goede } 2701554c0a3aSHans de Goede 2702554c0a3aSHans de Goede DBG_871X("PackageType = 0x%X\n", pHalData->PackageType); 2703554c0a3aSHans de Goede } 2704554c0a3aSHans de Goede 2705554c0a3aSHans de Goede 2706554c0a3aSHans de Goede void Hal_EfuseParseVoltage_8723B( 2707554c0a3aSHans de Goede struct adapter *padapter, u8 *hwinfo, bool AutoLoadFail 2708554c0a3aSHans de Goede ) 2709554c0a3aSHans de Goede { 2710554c0a3aSHans de Goede struct eeprom_priv *pEEPROM = GET_EEPROM_EFUSE_PRIV(padapter); 2711554c0a3aSHans de Goede 2712554c0a3aSHans de Goede /* memcpy(pEEPROM->adjuseVoltageVal, &hwinfo[EEPROM_Voltage_ADDR_8723B], 1); */ 2713554c0a3aSHans de Goede DBG_871X("%s hwinfo[EEPROM_Voltage_ADDR_8723B] =%02x\n", __func__, hwinfo[EEPROM_Voltage_ADDR_8723B]); 2714554c0a3aSHans de Goede pEEPROM->adjuseVoltageVal = (hwinfo[EEPROM_Voltage_ADDR_8723B] & 0xf0) >> 4; 2715554c0a3aSHans de Goede DBG_871X("%s pEEPROM->adjuseVoltageVal =%x\n", __func__, pEEPROM->adjuseVoltageVal); 2716554c0a3aSHans de Goede } 2717554c0a3aSHans de Goede 2718554c0a3aSHans de Goede void Hal_EfuseParseChnlPlan_8723B( 2719554c0a3aSHans de Goede struct adapter *padapter, u8 *hwinfo, bool AutoLoadFail 2720554c0a3aSHans de Goede ) 2721554c0a3aSHans de Goede { 2722554c0a3aSHans de Goede padapter->mlmepriv.ChannelPlan = hal_com_config_channel_plan( 2723554c0a3aSHans de Goede padapter, 2724554c0a3aSHans de Goede hwinfo ? hwinfo[EEPROM_ChannelPlan_8723B] : 0xFF, 2725554c0a3aSHans de Goede padapter->registrypriv.channel_plan, 2726554c0a3aSHans de Goede RT_CHANNEL_DOMAIN_WORLD_NULL, 2727554c0a3aSHans de Goede AutoLoadFail 2728554c0a3aSHans de Goede ); 2729554c0a3aSHans de Goede 2730554c0a3aSHans de Goede Hal_ChannelPlanToRegulation(padapter, padapter->mlmepriv.ChannelPlan); 2731554c0a3aSHans de Goede 2732554c0a3aSHans de Goede RT_TRACE(_module_hci_hal_init_c_, _drv_notice_, ("EEPROM ChannelPlan = 0x%02x\n", padapter->mlmepriv.ChannelPlan)); 2733554c0a3aSHans de Goede } 2734554c0a3aSHans de Goede 2735554c0a3aSHans de Goede void Hal_EfuseParseCustomerID_8723B( 2736554c0a3aSHans de Goede struct adapter *padapter, u8 *hwinfo, bool AutoLoadFail 2737554c0a3aSHans de Goede ) 2738554c0a3aSHans de Goede { 2739554c0a3aSHans de Goede struct hal_com_data *pHalData = GET_HAL_DATA(padapter); 2740554c0a3aSHans de Goede 2741554c0a3aSHans de Goede /* RT_TRACE(_module_hci_hal_init_c_, _drv_notice_, ("%s(): AutoLoadFail = %d\n", __func__, AutoLoadFail)); */ 2742554c0a3aSHans de Goede if (!AutoLoadFail) 2743554c0a3aSHans de Goede pHalData->EEPROMCustomerID = hwinfo[EEPROM_CustomID_8723B]; 2744554c0a3aSHans de Goede else 2745554c0a3aSHans de Goede pHalData->EEPROMCustomerID = 0; 2746554c0a3aSHans de Goede 2747554c0a3aSHans de Goede RT_TRACE(_module_hci_hal_init_c_, _drv_notice_, ("EEPROM Customer ID: 0x%2x\n", pHalData->EEPROMCustomerID)); 2748554c0a3aSHans de Goede } 2749554c0a3aSHans de Goede 2750554c0a3aSHans de Goede void Hal_EfuseParseAntennaDiversity_8723B( 2751554c0a3aSHans de Goede struct adapter *padapter, 2752554c0a3aSHans de Goede u8 *hwinfo, 2753554c0a3aSHans de Goede bool AutoLoadFail 2754554c0a3aSHans de Goede ) 2755554c0a3aSHans de Goede { 2756554c0a3aSHans de Goede } 2757554c0a3aSHans de Goede 2758554c0a3aSHans de Goede void Hal_EfuseParseXtal_8723B( 2759554c0a3aSHans de Goede struct adapter *padapter, u8 *hwinfo, bool AutoLoadFail 2760554c0a3aSHans de Goede ) 2761554c0a3aSHans de Goede { 2762554c0a3aSHans de Goede struct hal_com_data *pHalData = GET_HAL_DATA(padapter); 2763554c0a3aSHans de Goede 2764554c0a3aSHans de Goede /* RT_TRACE(_module_hci_hal_init_c_, _drv_notice_, ("%s(): AutoLoadFail = %d\n", __func__, AutoLoadFail)); */ 2765554c0a3aSHans de Goede if (!AutoLoadFail) { 2766554c0a3aSHans de Goede pHalData->CrystalCap = hwinfo[EEPROM_XTAL_8723B]; 2767554c0a3aSHans de Goede if (pHalData->CrystalCap == 0xFF) 2768554c0a3aSHans de Goede pHalData->CrystalCap = EEPROM_Default_CrystalCap_8723B; /* what value should 8812 set? */ 2769554c0a3aSHans de Goede } else 2770554c0a3aSHans de Goede pHalData->CrystalCap = EEPROM_Default_CrystalCap_8723B; 2771554c0a3aSHans de Goede 2772554c0a3aSHans de Goede RT_TRACE(_module_hci_hal_init_c_, _drv_notice_, ("EEPROM CrystalCap: 0x%2x\n", pHalData->CrystalCap)); 2773554c0a3aSHans de Goede } 2774554c0a3aSHans de Goede 2775554c0a3aSHans de Goede 2776554c0a3aSHans de Goede void Hal_EfuseParseThermalMeter_8723B( 2777554c0a3aSHans de Goede struct adapter *padapter, u8 *PROMContent, u8 AutoLoadFail 2778554c0a3aSHans de Goede ) 2779554c0a3aSHans de Goede { 2780554c0a3aSHans de Goede struct hal_com_data *pHalData = GET_HAL_DATA(padapter); 2781554c0a3aSHans de Goede 2782554c0a3aSHans de Goede /* RT_TRACE(_module_hci_hal_init_c_, _drv_notice_, ("%s(): AutoLoadFail = %d\n", __func__, AutoLoadFail)); */ 2783554c0a3aSHans de Goede /* */ 2784554c0a3aSHans de Goede /* ThermalMeter from EEPROM */ 2785554c0a3aSHans de Goede /* */ 27867036126aSHariprasad Kelam if (!AutoLoadFail) 2787554c0a3aSHans de Goede pHalData->EEPROMThermalMeter = PROMContent[EEPROM_THERMAL_METER_8723B]; 2788554c0a3aSHans de Goede else 2789554c0a3aSHans de Goede pHalData->EEPROMThermalMeter = EEPROM_Default_ThermalMeter_8723B; 2790554c0a3aSHans de Goede 27917036126aSHariprasad Kelam if ((pHalData->EEPROMThermalMeter == 0xff) || AutoLoadFail) { 2792554c0a3aSHans de Goede pHalData->bAPKThermalMeterIgnore = true; 2793554c0a3aSHans de Goede pHalData->EEPROMThermalMeter = EEPROM_Default_ThermalMeter_8723B; 2794554c0a3aSHans de Goede } 2795554c0a3aSHans de Goede 2796554c0a3aSHans de Goede RT_TRACE(_module_hci_hal_init_c_, _drv_notice_, ("EEPROM ThermalMeter = 0x%x\n", pHalData->EEPROMThermalMeter)); 2797554c0a3aSHans de Goede } 2798554c0a3aSHans de Goede 2799554c0a3aSHans de Goede 2800554c0a3aSHans de Goede void Hal_ReadRFGainOffset( 2801554c0a3aSHans de Goede struct adapter *Adapter, u8 *PROMContent, bool AutoloadFail 2802554c0a3aSHans de Goede ) 2803554c0a3aSHans de Goede { 2804554c0a3aSHans de Goede /* */ 2805554c0a3aSHans de Goede /* BB_RF Gain Offset from EEPROM */ 2806554c0a3aSHans de Goede /* */ 2807554c0a3aSHans de Goede 2808554c0a3aSHans de Goede if (!AutoloadFail) { 2809554c0a3aSHans de Goede Adapter->eeprompriv.EEPROMRFGainOffset = PROMContent[EEPROM_RF_GAIN_OFFSET]; 2810554c0a3aSHans de Goede DBG_871X("AutoloadFail =%x,\n", AutoloadFail); 2811554c0a3aSHans de Goede Adapter->eeprompriv.EEPROMRFGainVal = EFUSE_Read1Byte(Adapter, EEPROM_RF_GAIN_VAL); 2812554c0a3aSHans de Goede DBG_871X("Adapter->eeprompriv.EEPROMRFGainVal =%x\n", Adapter->eeprompriv.EEPROMRFGainVal); 2813554c0a3aSHans de Goede } else { 2814554c0a3aSHans de Goede Adapter->eeprompriv.EEPROMRFGainOffset = 0; 2815554c0a3aSHans de Goede Adapter->eeprompriv.EEPROMRFGainVal = 0xFF; 2816554c0a3aSHans de Goede DBG_871X("else AutoloadFail =%x,\n", AutoloadFail); 2817554c0a3aSHans de Goede } 2818554c0a3aSHans de Goede DBG_871X("EEPRORFGainOffset = 0x%02x\n", Adapter->eeprompriv.EEPROMRFGainOffset); 2819554c0a3aSHans de Goede } 2820554c0a3aSHans de Goede 2821554c0a3aSHans de Goede u8 BWMapping_8723B(struct adapter *Adapter, struct pkt_attrib *pattrib) 2822554c0a3aSHans de Goede { 2823554c0a3aSHans de Goede u8 BWSettingOfDesc = 0; 2824554c0a3aSHans de Goede struct hal_com_data *pHalData = GET_HAL_DATA(Adapter); 2825554c0a3aSHans de Goede 2826554c0a3aSHans de Goede /* DBG_871X("BWMapping pHalData->CurrentChannelBW %d, pattrib->bwmode %d\n", pHalData->CurrentChannelBW, pattrib->bwmode); */ 2827554c0a3aSHans de Goede 2828554c0a3aSHans de Goede if (pHalData->CurrentChannelBW == CHANNEL_WIDTH_80) { 2829554c0a3aSHans de Goede if (pattrib->bwmode == CHANNEL_WIDTH_80) 2830554c0a3aSHans de Goede BWSettingOfDesc = 2; 2831554c0a3aSHans de Goede else if (pattrib->bwmode == CHANNEL_WIDTH_40) 2832554c0a3aSHans de Goede BWSettingOfDesc = 1; 2833554c0a3aSHans de Goede else 2834554c0a3aSHans de Goede BWSettingOfDesc = 0; 2835554c0a3aSHans de Goede } else if (pHalData->CurrentChannelBW == CHANNEL_WIDTH_40) { 2836554c0a3aSHans de Goede if ((pattrib->bwmode == CHANNEL_WIDTH_40) || (pattrib->bwmode == CHANNEL_WIDTH_80)) 2837554c0a3aSHans de Goede BWSettingOfDesc = 1; 2838554c0a3aSHans de Goede else 2839554c0a3aSHans de Goede BWSettingOfDesc = 0; 2840554c0a3aSHans de Goede } else 2841554c0a3aSHans de Goede BWSettingOfDesc = 0; 2842554c0a3aSHans de Goede 2843554c0a3aSHans de Goede /* if (pTcb->bBTTxPacket) */ 2844554c0a3aSHans de Goede /* BWSettingOfDesc = 0; */ 2845554c0a3aSHans de Goede 2846554c0a3aSHans de Goede return BWSettingOfDesc; 2847554c0a3aSHans de Goede } 2848554c0a3aSHans de Goede 2849554c0a3aSHans de Goede u8 SCMapping_8723B(struct adapter *Adapter, struct pkt_attrib *pattrib) 2850554c0a3aSHans de Goede { 2851554c0a3aSHans de Goede u8 SCSettingOfDesc = 0; 2852554c0a3aSHans de Goede struct hal_com_data *pHalData = GET_HAL_DATA(Adapter); 2853554c0a3aSHans de Goede 2854554c0a3aSHans de Goede /* DBG_871X("SCMapping: pHalData->CurrentChannelBW %d, pHalData->nCur80MhzPrimeSC %d, pHalData->nCur40MhzPrimeSC %d\n", pHalData->CurrentChannelBW, pHalData->nCur80MhzPrimeSC, pHalData->nCur40MhzPrimeSC); */ 2855554c0a3aSHans de Goede 2856554c0a3aSHans de Goede if (pHalData->CurrentChannelBW == CHANNEL_WIDTH_80) { 2857554c0a3aSHans de Goede if (pattrib->bwmode == CHANNEL_WIDTH_80) { 2858554c0a3aSHans de Goede SCSettingOfDesc = VHT_DATA_SC_DONOT_CARE; 2859554c0a3aSHans de Goede } else if (pattrib->bwmode == CHANNEL_WIDTH_40) { 2860554c0a3aSHans de Goede if (pHalData->nCur80MhzPrimeSC == HAL_PRIME_CHNL_OFFSET_LOWER) 2861554c0a3aSHans de Goede SCSettingOfDesc = VHT_DATA_SC_40_LOWER_OF_80MHZ; 2862554c0a3aSHans de Goede else if (pHalData->nCur80MhzPrimeSC == HAL_PRIME_CHNL_OFFSET_UPPER) 2863554c0a3aSHans de Goede SCSettingOfDesc = VHT_DATA_SC_40_UPPER_OF_80MHZ; 2864554c0a3aSHans de Goede else 2865554c0a3aSHans de Goede DBG_871X("SCMapping: Not Correct Primary40MHz Setting\n"); 2866554c0a3aSHans de Goede } else { 2867554c0a3aSHans de Goede if ((pHalData->nCur40MhzPrimeSC == HAL_PRIME_CHNL_OFFSET_LOWER) && (pHalData->nCur80MhzPrimeSC == HAL_PRIME_CHNL_OFFSET_LOWER)) 2868554c0a3aSHans de Goede SCSettingOfDesc = VHT_DATA_SC_20_LOWEST_OF_80MHZ; 2869554c0a3aSHans de Goede else if ((pHalData->nCur40MhzPrimeSC == HAL_PRIME_CHNL_OFFSET_UPPER) && (pHalData->nCur80MhzPrimeSC == HAL_PRIME_CHNL_OFFSET_LOWER)) 2870554c0a3aSHans de Goede SCSettingOfDesc = VHT_DATA_SC_20_LOWER_OF_80MHZ; 2871554c0a3aSHans de Goede else if ((pHalData->nCur40MhzPrimeSC == HAL_PRIME_CHNL_OFFSET_LOWER) && (pHalData->nCur80MhzPrimeSC == HAL_PRIME_CHNL_OFFSET_UPPER)) 2872554c0a3aSHans de Goede SCSettingOfDesc = VHT_DATA_SC_20_UPPER_OF_80MHZ; 2873554c0a3aSHans de Goede else if ((pHalData->nCur40MhzPrimeSC == HAL_PRIME_CHNL_OFFSET_UPPER) && (pHalData->nCur80MhzPrimeSC == HAL_PRIME_CHNL_OFFSET_UPPER)) 2874554c0a3aSHans de Goede SCSettingOfDesc = VHT_DATA_SC_20_UPPERST_OF_80MHZ; 2875554c0a3aSHans de Goede else 2876554c0a3aSHans de Goede DBG_871X("SCMapping: Not Correct Primary40MHz Setting\n"); 2877554c0a3aSHans de Goede } 2878554c0a3aSHans de Goede } else if (pHalData->CurrentChannelBW == CHANNEL_WIDTH_40) { 2879554c0a3aSHans de Goede /* DBG_871X("SCMapping: HT Case: pHalData->CurrentChannelBW %d, pHalData->nCur40MhzPrimeSC %d\n", pHalData->CurrentChannelBW, pHalData->nCur40MhzPrimeSC); */ 2880554c0a3aSHans de Goede 2881554c0a3aSHans de Goede if (pattrib->bwmode == CHANNEL_WIDTH_40) { 2882554c0a3aSHans de Goede SCSettingOfDesc = VHT_DATA_SC_DONOT_CARE; 2883554c0a3aSHans de Goede } else if (pattrib->bwmode == CHANNEL_WIDTH_20) { 2884554c0a3aSHans de Goede if (pHalData->nCur40MhzPrimeSC == HAL_PRIME_CHNL_OFFSET_UPPER) { 2885554c0a3aSHans de Goede SCSettingOfDesc = VHT_DATA_SC_20_UPPER_OF_80MHZ; 2886554c0a3aSHans de Goede } else if (pHalData->nCur40MhzPrimeSC == HAL_PRIME_CHNL_OFFSET_LOWER) { 2887554c0a3aSHans de Goede SCSettingOfDesc = VHT_DATA_SC_20_LOWER_OF_80MHZ; 2888554c0a3aSHans de Goede } else { 2889554c0a3aSHans de Goede SCSettingOfDesc = VHT_DATA_SC_DONOT_CARE; 2890554c0a3aSHans de Goede } 2891554c0a3aSHans de Goede } 2892554c0a3aSHans de Goede } else { 2893554c0a3aSHans de Goede SCSettingOfDesc = VHT_DATA_SC_DONOT_CARE; 2894554c0a3aSHans de Goede } 2895554c0a3aSHans de Goede 2896554c0a3aSHans de Goede return SCSettingOfDesc; 2897554c0a3aSHans de Goede } 2898554c0a3aSHans de Goede 2899554c0a3aSHans de Goede static void rtl8723b_cal_txdesc_chksum(struct tx_desc *ptxdesc) 2900554c0a3aSHans de Goede { 2901554c0a3aSHans de Goede u16 *usPtr = (u16 *)ptxdesc; 2902554c0a3aSHans de Goede u32 count; 2903554c0a3aSHans de Goede u32 index; 2904554c0a3aSHans de Goede u16 checksum = 0; 2905554c0a3aSHans de Goede 2906554c0a3aSHans de Goede 2907554c0a3aSHans de Goede /* Clear first */ 2908554c0a3aSHans de Goede ptxdesc->txdw7 &= cpu_to_le32(0xffff0000); 2909554c0a3aSHans de Goede 2910554c0a3aSHans de Goede /* checksume is always calculated by first 32 bytes, */ 2911554c0a3aSHans de Goede /* and it doesn't depend on TX DESC length. */ 2912554c0a3aSHans de Goede /* Thomas, Lucas@SD4, 20130515 */ 2913554c0a3aSHans de Goede count = 16; 2914554c0a3aSHans de Goede 2915554c0a3aSHans de Goede for (index = 0; index < count; index++) { 2916554c0a3aSHans de Goede checksum |= le16_to_cpu(*(__le16 *)(usPtr + index)); 2917554c0a3aSHans de Goede } 2918554c0a3aSHans de Goede 2919554c0a3aSHans de Goede ptxdesc->txdw7 |= cpu_to_le32(checksum & 0x0000ffff); 2920554c0a3aSHans de Goede } 2921554c0a3aSHans de Goede 2922554c0a3aSHans de Goede static u8 fill_txdesc_sectype(struct pkt_attrib *pattrib) 2923554c0a3aSHans de Goede { 2924554c0a3aSHans de Goede u8 sectype = 0; 2925554c0a3aSHans de Goede if ((pattrib->encrypt > 0) && !pattrib->bswenc) { 2926554c0a3aSHans de Goede switch (pattrib->encrypt) { 2927554c0a3aSHans de Goede /* SEC_TYPE */ 2928554c0a3aSHans de Goede case _WEP40_: 2929554c0a3aSHans de Goede case _WEP104_: 2930554c0a3aSHans de Goede case _TKIP_: 2931554c0a3aSHans de Goede case _TKIP_WTMIC_: 2932554c0a3aSHans de Goede sectype = 1; 2933554c0a3aSHans de Goede break; 2934554c0a3aSHans de Goede 2935554c0a3aSHans de Goede case _AES_: 2936554c0a3aSHans de Goede sectype = 3; 2937554c0a3aSHans de Goede break; 2938554c0a3aSHans de Goede 2939554c0a3aSHans de Goede case _NO_PRIVACY_: 2940554c0a3aSHans de Goede default: 2941554c0a3aSHans de Goede break; 2942554c0a3aSHans de Goede } 2943554c0a3aSHans de Goede } 2944554c0a3aSHans de Goede return sectype; 2945554c0a3aSHans de Goede } 2946554c0a3aSHans de Goede 2947a85d5137SMarco Cesati static void fill_txdesc_vcs_8723b(struct adapter *padapter, struct pkt_attrib *pattrib, struct txdesc_8723b *ptxdesc) 2948554c0a3aSHans de Goede { 2949554c0a3aSHans de Goede /* DBG_8192C("cvs_mode =%d\n", pattrib->vcs_mode); */ 2950554c0a3aSHans de Goede 2951554c0a3aSHans de Goede if (pattrib->vcs_mode) { 2952554c0a3aSHans de Goede switch (pattrib->vcs_mode) { 2953554c0a3aSHans de Goede case RTS_CTS: 2954554c0a3aSHans de Goede ptxdesc->rtsen = 1; 2955554c0a3aSHans de Goede /* ENABLE HW RTS */ 2956554c0a3aSHans de Goede ptxdesc->hw_rts_en = 1; 2957554c0a3aSHans de Goede break; 2958554c0a3aSHans de Goede 2959554c0a3aSHans de Goede case CTS_TO_SELF: 2960554c0a3aSHans de Goede ptxdesc->cts2self = 1; 2961554c0a3aSHans de Goede break; 2962554c0a3aSHans de Goede 2963554c0a3aSHans de Goede case NONE_VCS: 2964554c0a3aSHans de Goede default: 2965554c0a3aSHans de Goede break; 2966554c0a3aSHans de Goede } 2967554c0a3aSHans de Goede 2968554c0a3aSHans de Goede ptxdesc->rtsrate = 8; /* RTS Rate =24M */ 2969554c0a3aSHans de Goede ptxdesc->rts_ratefb_lmt = 0xF; 2970554c0a3aSHans de Goede 2971554c0a3aSHans de Goede if (padapter->mlmeextpriv.mlmext_info.preamble_mode == PREAMBLE_SHORT) 2972554c0a3aSHans de Goede ptxdesc->rts_short = 1; 2973554c0a3aSHans de Goede 2974554c0a3aSHans de Goede /* Set RTS BW */ 2975554c0a3aSHans de Goede if (pattrib->ht_en) 2976554c0a3aSHans de Goede ptxdesc->rts_sc = SCMapping_8723B(padapter, pattrib); 2977554c0a3aSHans de Goede } 2978554c0a3aSHans de Goede } 2979554c0a3aSHans de Goede 2980a85d5137SMarco Cesati static void fill_txdesc_phy_8723b(struct adapter *padapter, struct pkt_attrib *pattrib, struct txdesc_8723b *ptxdesc) 2981554c0a3aSHans de Goede { 2982554c0a3aSHans de Goede /* DBG_8192C("bwmode =%d, ch_off =%d\n", pattrib->bwmode, pattrib->ch_offset); */ 2983554c0a3aSHans de Goede 2984554c0a3aSHans de Goede if (pattrib->ht_en) { 2985554c0a3aSHans de Goede ptxdesc->data_bw = BWMapping_8723B(padapter, pattrib); 2986554c0a3aSHans de Goede 2987554c0a3aSHans de Goede ptxdesc->data_sc = SCMapping_8723B(padapter, pattrib); 2988554c0a3aSHans de Goede } 2989554c0a3aSHans de Goede } 2990554c0a3aSHans de Goede 2991554c0a3aSHans de Goede static void rtl8723b_fill_default_txdesc( 2992554c0a3aSHans de Goede struct xmit_frame *pxmitframe, u8 *pbuf 2993554c0a3aSHans de Goede ) 2994554c0a3aSHans de Goede { 2995554c0a3aSHans de Goede struct adapter *padapter; 2996554c0a3aSHans de Goede struct hal_com_data *pHalData; 2997554c0a3aSHans de Goede struct mlme_ext_priv *pmlmeext; 2998554c0a3aSHans de Goede struct mlme_ext_info *pmlmeinfo; 2999554c0a3aSHans de Goede struct pkt_attrib *pattrib; 3000a85d5137SMarco Cesati struct txdesc_8723b *ptxdesc; 3001554c0a3aSHans de Goede s32 bmcst; 3002554c0a3aSHans de Goede 3003554c0a3aSHans de Goede memset(pbuf, 0, TXDESC_SIZE); 3004554c0a3aSHans de Goede 3005554c0a3aSHans de Goede padapter = pxmitframe->padapter; 3006554c0a3aSHans de Goede pHalData = GET_HAL_DATA(padapter); 3007554c0a3aSHans de Goede pmlmeext = &padapter->mlmeextpriv; 3008554c0a3aSHans de Goede pmlmeinfo = &(pmlmeext->mlmext_info); 3009554c0a3aSHans de Goede 3010554c0a3aSHans de Goede pattrib = &pxmitframe->attrib; 3011554c0a3aSHans de Goede bmcst = IS_MCAST(pattrib->ra); 3012554c0a3aSHans de Goede 3013a85d5137SMarco Cesati ptxdesc = (struct txdesc_8723b *)pbuf; 3014554c0a3aSHans de Goede 3015554c0a3aSHans de Goede if (pxmitframe->frame_tag == DATA_FRAMETAG) { 3016554c0a3aSHans de Goede u8 drv_userate = 0; 3017554c0a3aSHans de Goede 3018554c0a3aSHans de Goede ptxdesc->macid = pattrib->mac_id; /* CAM_ID(MAC_ID) */ 3019554c0a3aSHans de Goede ptxdesc->rate_id = pattrib->raid; 3020554c0a3aSHans de Goede ptxdesc->qsel = pattrib->qsel; 3021554c0a3aSHans de Goede ptxdesc->seq = pattrib->seqnum; 3022554c0a3aSHans de Goede 3023554c0a3aSHans de Goede ptxdesc->sectype = fill_txdesc_sectype(pattrib); 3024554c0a3aSHans de Goede fill_txdesc_vcs_8723b(padapter, pattrib, ptxdesc); 3025554c0a3aSHans de Goede 3026554c0a3aSHans de Goede if (pattrib->icmp_pkt == 1 && padapter->registrypriv.wifi_spec == 1) 3027554c0a3aSHans de Goede drv_userate = 1; 3028554c0a3aSHans de Goede 3029554c0a3aSHans de Goede if ( 3030554c0a3aSHans de Goede (pattrib->ether_type != 0x888e) && 3031554c0a3aSHans de Goede (pattrib->ether_type != 0x0806) && 3032554c0a3aSHans de Goede (pattrib->ether_type != 0x88B4) && 3033554c0a3aSHans de Goede (pattrib->dhcp_pkt != 1) && 3034554c0a3aSHans de Goede (drv_userate != 1) 3035554c0a3aSHans de Goede ) { 3036554c0a3aSHans de Goede /* Non EAP & ARP & DHCP type data packet */ 3037554c0a3aSHans de Goede 30387036126aSHariprasad Kelam if (pattrib->ampdu_en) { 3039554c0a3aSHans de Goede ptxdesc->agg_en = 1; /* AGG EN */ 3040554c0a3aSHans de Goede ptxdesc->max_agg_num = 0x1f; 3041554c0a3aSHans de Goede ptxdesc->ampdu_density = pattrib->ampdu_spacing; 3042554c0a3aSHans de Goede } else 3043554c0a3aSHans de Goede ptxdesc->bk = 1; /* AGG BK */ 3044554c0a3aSHans de Goede 3045554c0a3aSHans de Goede fill_txdesc_phy_8723b(padapter, pattrib, ptxdesc); 3046554c0a3aSHans de Goede 3047554c0a3aSHans de Goede ptxdesc->data_ratefb_lmt = 0x1F; 3048554c0a3aSHans de Goede 30497036126aSHariprasad Kelam if (!pHalData->fw_ractrl) { 3050554c0a3aSHans de Goede ptxdesc->userate = 1; 3051554c0a3aSHans de Goede 3052554c0a3aSHans de Goede if (pHalData->dmpriv.INIDATA_RATE[pattrib->mac_id] & BIT(7)) 3053554c0a3aSHans de Goede ptxdesc->data_short = 1; 3054554c0a3aSHans de Goede 3055554c0a3aSHans de Goede ptxdesc->datarate = pHalData->dmpriv.INIDATA_RATE[pattrib->mac_id] & 0x7F; 3056554c0a3aSHans de Goede } 3057554c0a3aSHans de Goede 3058554c0a3aSHans de Goede if (padapter->fix_rate != 0xFF) { /* modify data rate by iwpriv */ 3059554c0a3aSHans de Goede ptxdesc->userate = 1; 3060554c0a3aSHans de Goede if (padapter->fix_rate & BIT(7)) 3061554c0a3aSHans de Goede ptxdesc->data_short = 1; 3062554c0a3aSHans de Goede 3063554c0a3aSHans de Goede ptxdesc->datarate = (padapter->fix_rate & 0x7F); 3064554c0a3aSHans de Goede ptxdesc->disdatafb = 1; 3065554c0a3aSHans de Goede } 3066554c0a3aSHans de Goede 3067554c0a3aSHans de Goede if (pattrib->ldpc) 3068554c0a3aSHans de Goede ptxdesc->data_ldpc = 1; 3069554c0a3aSHans de Goede if (pattrib->stbc) 3070554c0a3aSHans de Goede ptxdesc->data_stbc = 1; 3071554c0a3aSHans de Goede } else { 3072554c0a3aSHans de Goede /* EAP data packet and ARP packet. */ 3073554c0a3aSHans de Goede /* Use the 1M data rate to send the EAP/ARP packet. */ 3074554c0a3aSHans de Goede /* This will maybe make the handshake smooth. */ 3075554c0a3aSHans de Goede 3076554c0a3aSHans de Goede ptxdesc->bk = 1; /* AGG BK */ 3077554c0a3aSHans de Goede ptxdesc->userate = 1; /* driver uses rate */ 3078554c0a3aSHans de Goede if (pmlmeinfo->preamble_mode == PREAMBLE_SHORT) 3079554c0a3aSHans de Goede ptxdesc->data_short = 1;/* DATA_SHORT */ 3080554c0a3aSHans de Goede ptxdesc->datarate = MRateToHwRate(pmlmeext->tx_rate); 3081554c0a3aSHans de Goede DBG_871X("YJ: %s(): ARP Data: userate =%d, datarate = 0x%x\n", __func__, ptxdesc->userate, ptxdesc->datarate); 3082554c0a3aSHans de Goede } 3083554c0a3aSHans de Goede 3084554c0a3aSHans de Goede ptxdesc->usb_txagg_num = pxmitframe->agg_num; 3085554c0a3aSHans de Goede } else if (pxmitframe->frame_tag == MGNT_FRAMETAG) { 3086554c0a3aSHans de Goede /* RT_TRACE(_module_hal_xmit_c_, _drv_notice_, ("%s: MGNT_FRAMETAG\n", __func__)); */ 3087554c0a3aSHans de Goede 3088554c0a3aSHans de Goede ptxdesc->macid = pattrib->mac_id; /* CAM_ID(MAC_ID) */ 3089554c0a3aSHans de Goede ptxdesc->qsel = pattrib->qsel; 3090554c0a3aSHans de Goede ptxdesc->rate_id = pattrib->raid; /* Rate ID */ 3091554c0a3aSHans de Goede ptxdesc->seq = pattrib->seqnum; 3092554c0a3aSHans de Goede ptxdesc->userate = 1; /* driver uses rate, 1M */ 3093554c0a3aSHans de Goede 3094554c0a3aSHans de Goede ptxdesc->mbssid = pattrib->mbssid & 0xF; 3095554c0a3aSHans de Goede 3096554c0a3aSHans de Goede ptxdesc->rty_lmt_en = 1; /* retry limit enable */ 30977036126aSHariprasad Kelam if (pattrib->retry_ctrl) { 3098554c0a3aSHans de Goede ptxdesc->data_rt_lmt = 6; 3099554c0a3aSHans de Goede } else { 3100554c0a3aSHans de Goede ptxdesc->data_rt_lmt = 12; 3101554c0a3aSHans de Goede } 3102554c0a3aSHans de Goede 3103554c0a3aSHans de Goede ptxdesc->datarate = MRateToHwRate(pmlmeext->tx_rate); 3104554c0a3aSHans de Goede 3105554c0a3aSHans de Goede /* CCX-TXRPT ack for xmit mgmt frames. */ 3106554c0a3aSHans de Goede if (pxmitframe->ack_report) { 3107554c0a3aSHans de Goede #ifdef DBG_CCX 3108554c0a3aSHans de Goede DBG_8192C("%s set spe_rpt\n", __func__); 3109554c0a3aSHans de Goede #endif 3110554c0a3aSHans de Goede ptxdesc->spe_rpt = 1; 3111554c0a3aSHans de Goede ptxdesc->sw_define = (u8)(GET_PRIMARY_ADAPTER(padapter)->xmitpriv.seq_no); 3112554c0a3aSHans de Goede } 3113554c0a3aSHans de Goede } else if (pxmitframe->frame_tag == TXAGG_FRAMETAG) { 3114554c0a3aSHans de Goede RT_TRACE(_module_hal_xmit_c_, _drv_warning_, ("%s: TXAGG_FRAMETAG\n", __func__)); 3115554c0a3aSHans de Goede } else { 3116554c0a3aSHans de Goede RT_TRACE(_module_hal_xmit_c_, _drv_warning_, ("%s: frame_tag = 0x%x\n", __func__, pxmitframe->frame_tag)); 3117554c0a3aSHans de Goede 3118554c0a3aSHans de Goede ptxdesc->macid = pattrib->mac_id; /* CAM_ID(MAC_ID) */ 3119554c0a3aSHans de Goede ptxdesc->rate_id = pattrib->raid; /* Rate ID */ 3120554c0a3aSHans de Goede ptxdesc->qsel = pattrib->qsel; 3121554c0a3aSHans de Goede ptxdesc->seq = pattrib->seqnum; 3122554c0a3aSHans de Goede ptxdesc->userate = 1; /* driver uses rate */ 3123554c0a3aSHans de Goede ptxdesc->datarate = MRateToHwRate(pmlmeext->tx_rate); 3124554c0a3aSHans de Goede } 3125554c0a3aSHans de Goede 3126554c0a3aSHans de Goede ptxdesc->pktlen = pattrib->last_txcmdsz; 3127554c0a3aSHans de Goede ptxdesc->offset = TXDESC_SIZE + OFFSET_SZ; 3128554c0a3aSHans de Goede 3129554c0a3aSHans de Goede if (bmcst) 3130554c0a3aSHans de Goede ptxdesc->bmc = 1; 3131554c0a3aSHans de Goede 31324d17363dSAndreas Hellmich /* 2009.11.05. tynli_test. Suggested by SD4 Filen for FW LPS. 31334d17363dSAndreas Hellmich * (1) The sequence number of each non-Qos frame / broadcast / 31344d17363dSAndreas Hellmich * multicast / mgnt frame should be controlled by Hw because Fw 31354d17363dSAndreas Hellmich * will also send null data which we cannot control when Fw LPS 31364d17363dSAndreas Hellmich * enable. 31374d17363dSAndreas Hellmich * --> default enable non-Qos data sequense number. 2010.06.23. 31384d17363dSAndreas Hellmich * by tynli. 31394d17363dSAndreas Hellmich * (2) Enable HW SEQ control for beacon packet, because we use 31404d17363dSAndreas Hellmich * Hw beacon. 31414d17363dSAndreas Hellmich * (3) Use HW Qos SEQ to control the seq num of Ext port non-Qos 31424d17363dSAndreas Hellmich * packets. 31434d17363dSAndreas Hellmich * 2010.06.23. Added by tynli. 31444d17363dSAndreas Hellmich */ 3145554c0a3aSHans de Goede if (!pattrib->qos_en) /* Hw set sequence number */ 3146554c0a3aSHans de Goede ptxdesc->en_hwseq = 1; /* HWSEQ_EN */ 3147554c0a3aSHans de Goede } 3148554c0a3aSHans de Goede 31494d17363dSAndreas Hellmich /* Description: 3150554c0a3aSHans de Goede * 3151554c0a3aSHans de Goede * Parameters: 3152554c0a3aSHans de Goede * pxmitframe xmitframe 3153554c0a3aSHans de Goede * pbuf where to fill tx desc 3154554c0a3aSHans de Goede */ 3155554c0a3aSHans de Goede void rtl8723b_update_txdesc(struct xmit_frame *pxmitframe, u8 *pbuf) 3156554c0a3aSHans de Goede { 3157554c0a3aSHans de Goede struct tx_desc *pdesc; 3158554c0a3aSHans de Goede 3159554c0a3aSHans de Goede rtl8723b_fill_default_txdesc(pxmitframe, pbuf); 3160554c0a3aSHans de Goede 3161554c0a3aSHans de Goede pdesc = (struct tx_desc *)pbuf; 3162554c0a3aSHans de Goede pdesc->txdw0 = pdesc->txdw0; 3163554c0a3aSHans de Goede pdesc->txdw1 = pdesc->txdw1; 3164554c0a3aSHans de Goede pdesc->txdw2 = pdesc->txdw2; 3165554c0a3aSHans de Goede pdesc->txdw3 = pdesc->txdw3; 3166554c0a3aSHans de Goede pdesc->txdw4 = pdesc->txdw4; 3167554c0a3aSHans de Goede pdesc->txdw5 = pdesc->txdw5; 3168554c0a3aSHans de Goede pdesc->txdw6 = pdesc->txdw6; 3169554c0a3aSHans de Goede pdesc->txdw7 = pdesc->txdw7; 3170554c0a3aSHans de Goede pdesc->txdw8 = pdesc->txdw8; 3171554c0a3aSHans de Goede pdesc->txdw9 = pdesc->txdw9; 3172554c0a3aSHans de Goede 3173554c0a3aSHans de Goede rtl8723b_cal_txdesc_chksum(pdesc); 3174554c0a3aSHans de Goede } 3175554c0a3aSHans de Goede 3176554c0a3aSHans de Goede /* */ 3177554c0a3aSHans de Goede /* Description: In normal chip, we should send some packet to Hw which will be used by Fw */ 3178554c0a3aSHans de Goede /* in FW LPS mode. The function is to fill the Tx descriptor of this packets, then */ 3179554c0a3aSHans de Goede /* Fw can tell Hw to send these packet derectly. */ 3180554c0a3aSHans de Goede /* Added by tynli. 2009.10.15. */ 3181554c0a3aSHans de Goede /* */ 3182554c0a3aSHans de Goede /* type1:pspoll, type2:null */ 3183554c0a3aSHans de Goede void rtl8723b_fill_fake_txdesc( 3184554c0a3aSHans de Goede struct adapter *padapter, 3185554c0a3aSHans de Goede u8 *pDesc, 3186554c0a3aSHans de Goede u32 BufferLen, 3187554c0a3aSHans de Goede u8 IsPsPoll, 3188554c0a3aSHans de Goede u8 IsBTQosNull, 3189554c0a3aSHans de Goede u8 bDataFrame 3190554c0a3aSHans de Goede ) 3191554c0a3aSHans de Goede { 3192554c0a3aSHans de Goede /* Clear all status */ 3193554c0a3aSHans de Goede memset(pDesc, 0, TXDESC_SIZE); 3194554c0a3aSHans de Goede 3195554c0a3aSHans de Goede SET_TX_DESC_FIRST_SEG_8723B(pDesc, 1); /* bFirstSeg; */ 3196554c0a3aSHans de Goede SET_TX_DESC_LAST_SEG_8723B(pDesc, 1); /* bLastSeg; */ 3197554c0a3aSHans de Goede 3198554c0a3aSHans de Goede SET_TX_DESC_OFFSET_8723B(pDesc, 0x28); /* Offset = 32 */ 3199554c0a3aSHans de Goede 3200554c0a3aSHans de Goede SET_TX_DESC_PKT_SIZE_8723B(pDesc, BufferLen); /* Buffer size + command header */ 3201554c0a3aSHans de Goede SET_TX_DESC_QUEUE_SEL_8723B(pDesc, QSLT_MGNT); /* Fixed queue of Mgnt queue */ 3202554c0a3aSHans de Goede 3203554c0a3aSHans de Goede /* Set NAVUSEHDR to prevent Ps-poll AId filed to be changed to error vlaue by Hw. */ 32047036126aSHariprasad Kelam if (IsPsPoll) { 3205554c0a3aSHans de Goede SET_TX_DESC_NAV_USE_HDR_8723B(pDesc, 1); 3206554c0a3aSHans de Goede } else { 3207554c0a3aSHans de Goede SET_TX_DESC_HWSEQ_EN_8723B(pDesc, 1); /* Hw set sequence number */ 3208554c0a3aSHans de Goede SET_TX_DESC_HWSEQ_SEL_8723B(pDesc, 0); 3209554c0a3aSHans de Goede } 3210554c0a3aSHans de Goede 32117036126aSHariprasad Kelam if (IsBTQosNull) { 3212554c0a3aSHans de Goede SET_TX_DESC_BT_INT_8723B(pDesc, 1); 3213554c0a3aSHans de Goede } 3214554c0a3aSHans de Goede 3215554c0a3aSHans de Goede SET_TX_DESC_USE_RATE_8723B(pDesc, 1); /* use data rate which is set by Sw */ 3216554c0a3aSHans de Goede SET_TX_DESC_OWN_8723B((u8 *)pDesc, 1); 3217554c0a3aSHans de Goede 3218554c0a3aSHans de Goede SET_TX_DESC_TX_RATE_8723B(pDesc, DESC8723B_RATE1M); 3219554c0a3aSHans de Goede 3220554c0a3aSHans de Goede /* */ 3221554c0a3aSHans de Goede /* Encrypt the data frame if under security mode excepct null data. Suggested by CCW. */ 3222554c0a3aSHans de Goede /* */ 32237036126aSHariprasad Kelam if (bDataFrame) { 3224554c0a3aSHans de Goede u32 EncAlg; 3225554c0a3aSHans de Goede 3226554c0a3aSHans de Goede EncAlg = padapter->securitypriv.dot11PrivacyAlgrthm; 3227554c0a3aSHans de Goede switch (EncAlg) { 3228554c0a3aSHans de Goede case _NO_PRIVACY_: 3229554c0a3aSHans de Goede SET_TX_DESC_SEC_TYPE_8723B(pDesc, 0x0); 3230554c0a3aSHans de Goede break; 3231554c0a3aSHans de Goede case _WEP40_: 3232554c0a3aSHans de Goede case _WEP104_: 3233554c0a3aSHans de Goede case _TKIP_: 3234554c0a3aSHans de Goede SET_TX_DESC_SEC_TYPE_8723B(pDesc, 0x1); 3235554c0a3aSHans de Goede break; 3236554c0a3aSHans de Goede case _SMS4_: 3237554c0a3aSHans de Goede SET_TX_DESC_SEC_TYPE_8723B(pDesc, 0x2); 3238554c0a3aSHans de Goede break; 3239554c0a3aSHans de Goede case _AES_: 3240554c0a3aSHans de Goede SET_TX_DESC_SEC_TYPE_8723B(pDesc, 0x3); 3241554c0a3aSHans de Goede break; 3242554c0a3aSHans de Goede default: 3243554c0a3aSHans de Goede SET_TX_DESC_SEC_TYPE_8723B(pDesc, 0x0); 3244554c0a3aSHans de Goede break; 3245554c0a3aSHans de Goede } 3246554c0a3aSHans de Goede } 3247554c0a3aSHans de Goede 3248554c0a3aSHans de Goede /* USB interface drop packet if the checksum of descriptor isn't correct. */ 3249554c0a3aSHans de Goede /* Using this checksum can let hardware recovery from packet bulk out error (e.g. Cancel URC, Bulk out error.). */ 3250554c0a3aSHans de Goede rtl8723b_cal_txdesc_chksum((struct tx_desc *)pDesc); 3251554c0a3aSHans de Goede } 3252554c0a3aSHans de Goede 3253554c0a3aSHans de Goede static void hw_var_set_opmode(struct adapter *padapter, u8 variable, u8 *val) 3254554c0a3aSHans de Goede { 3255554c0a3aSHans de Goede u8 val8; 3256554c0a3aSHans de Goede u8 mode = *((u8 *)val); 3257554c0a3aSHans de Goede 3258554c0a3aSHans de Goede { 3259554c0a3aSHans de Goede /* disable Port0 TSF update */ 3260554c0a3aSHans de Goede val8 = rtw_read8(padapter, REG_BCN_CTRL); 3261554c0a3aSHans de Goede val8 |= DIS_TSF_UDT; 3262554c0a3aSHans de Goede rtw_write8(padapter, REG_BCN_CTRL, val8); 3263554c0a3aSHans de Goede 3264554c0a3aSHans de Goede /* set net_type */ 3265554c0a3aSHans de Goede Set_MSR(padapter, mode); 3266554c0a3aSHans de Goede DBG_871X("#### %s() -%d iface_type(0) mode = %d ####\n", __func__, __LINE__, mode); 3267554c0a3aSHans de Goede 3268554c0a3aSHans de Goede if ((mode == _HW_STATE_STATION_) || (mode == _HW_STATE_NOLINK_)) { 3269554c0a3aSHans de Goede { 3270554c0a3aSHans de Goede StopTxBeacon(padapter); 3271554c0a3aSHans de Goede } 3272554c0a3aSHans de Goede 3273554c0a3aSHans de Goede /* disable atim wnd */ 3274554c0a3aSHans de Goede rtw_write8(padapter, REG_BCN_CTRL, DIS_TSF_UDT|EN_BCN_FUNCTION|DIS_ATIM); 3275554c0a3aSHans de Goede /* rtw_write8(padapter, REG_BCN_CTRL, 0x18); */ 3276961d1935SNathan Chancellor } else if (mode == _HW_STATE_ADHOC_) { 3277554c0a3aSHans de Goede ResumeTxBeacon(padapter); 3278554c0a3aSHans de Goede rtw_write8(padapter, REG_BCN_CTRL, DIS_TSF_UDT|EN_BCN_FUNCTION|DIS_BCNQ_SUB); 3279554c0a3aSHans de Goede } else if (mode == _HW_STATE_AP_) { 3280554c0a3aSHans de Goede 3281554c0a3aSHans de Goede ResumeTxBeacon(padapter); 3282554c0a3aSHans de Goede 3283554c0a3aSHans de Goede rtw_write8(padapter, REG_BCN_CTRL, DIS_TSF_UDT|DIS_BCNQ_SUB); 3284554c0a3aSHans de Goede 3285554c0a3aSHans de Goede /* Set RCR */ 3286554c0a3aSHans de Goede rtw_write32(padapter, REG_RCR, 0x7000208e);/* CBSSID_DATA must set to 0, reject ICV_ERR packet */ 3287554c0a3aSHans de Goede /* enable to rx data frame */ 3288554c0a3aSHans de Goede rtw_write16(padapter, REG_RXFLTMAP2, 0xFFFF); 3289554c0a3aSHans de Goede /* enable to rx ps-poll */ 3290554c0a3aSHans de Goede rtw_write16(padapter, REG_RXFLTMAP1, 0x0400); 3291554c0a3aSHans de Goede 3292554c0a3aSHans de Goede /* Beacon Control related register for first time */ 3293554c0a3aSHans de Goede rtw_write8(padapter, REG_BCNDMATIM, 0x02); /* 2ms */ 3294554c0a3aSHans de Goede 3295554c0a3aSHans de Goede /* rtw_write8(padapter, REG_BCN_MAX_ERR, 0xFF); */ 3296554c0a3aSHans de Goede rtw_write8(padapter, REG_ATIMWND, 0x0a); /* 10ms */ 3297554c0a3aSHans de Goede rtw_write16(padapter, REG_BCNTCFG, 0x00); 3298554c0a3aSHans de Goede rtw_write16(padapter, REG_TBTT_PROHIBIT, 0xff04); 3299554c0a3aSHans de Goede rtw_write16(padapter, REG_TSFTR_SYN_OFFSET, 0x7fff);/* +32767 (~32ms) */ 3300554c0a3aSHans de Goede 3301554c0a3aSHans de Goede /* reset TSF */ 3302554c0a3aSHans de Goede rtw_write8(padapter, REG_DUAL_TSF_RST, BIT(0)); 3303554c0a3aSHans de Goede 3304554c0a3aSHans de Goede /* enable BCN0 Function for if1 */ 3305554c0a3aSHans de Goede /* don't enable update TSF0 for if1 (due to TSF update when beacon/probe rsp are received) */ 3306554c0a3aSHans de Goede rtw_write8(padapter, REG_BCN_CTRL, (DIS_TSF_UDT|EN_BCN_FUNCTION|EN_TXBCN_RPT|DIS_BCNQ_SUB)); 3307554c0a3aSHans de Goede 3308554c0a3aSHans de Goede /* SW_BCN_SEL - Port0 */ 3309554c0a3aSHans de Goede /* rtw_write8(Adapter, REG_DWBCN1_CTRL_8192E+2, rtw_read8(Adapter, REG_DWBCN1_CTRL_8192E+2) & ~BIT4); */ 3310554c0a3aSHans de Goede rtw_hal_set_hwreg(padapter, HW_VAR_DL_BCN_SEL, NULL); 3311554c0a3aSHans de Goede 3312554c0a3aSHans de Goede /* select BCN on port 0 */ 3313554c0a3aSHans de Goede rtw_write8( 3314554c0a3aSHans de Goede padapter, 3315554c0a3aSHans de Goede REG_CCK_CHECK_8723B, 3316554c0a3aSHans de Goede (rtw_read8(padapter, REG_CCK_CHECK_8723B)&~BIT_BCN_PORT_SEL) 3317554c0a3aSHans de Goede ); 3318554c0a3aSHans de Goede 3319554c0a3aSHans de Goede /* dis BCN1 ATIM WND if if2 is station */ 3320554c0a3aSHans de Goede val8 = rtw_read8(padapter, REG_BCN_CTRL_1); 3321554c0a3aSHans de Goede val8 |= DIS_ATIM; 3322554c0a3aSHans de Goede rtw_write8(padapter, REG_BCN_CTRL_1, val8); 3323554c0a3aSHans de Goede } 3324554c0a3aSHans de Goede } 3325554c0a3aSHans de Goede } 3326554c0a3aSHans de Goede 3327554c0a3aSHans de Goede static void hw_var_set_macaddr(struct adapter *padapter, u8 variable, u8 *val) 3328554c0a3aSHans de Goede { 3329554c0a3aSHans de Goede u8 idx = 0; 3330554c0a3aSHans de Goede u32 reg_macid; 3331554c0a3aSHans de Goede 3332554c0a3aSHans de Goede reg_macid = REG_MACID; 3333554c0a3aSHans de Goede 3334554c0a3aSHans de Goede for (idx = 0 ; idx < 6; idx++) 3335554c0a3aSHans de Goede rtw_write8(GET_PRIMARY_ADAPTER(padapter), (reg_macid+idx), val[idx]); 3336554c0a3aSHans de Goede } 3337554c0a3aSHans de Goede 3338554c0a3aSHans de Goede static void hw_var_set_bssid(struct adapter *padapter, u8 variable, u8 *val) 3339554c0a3aSHans de Goede { 3340554c0a3aSHans de Goede u8 idx = 0; 3341554c0a3aSHans de Goede u32 reg_bssid; 3342554c0a3aSHans de Goede 3343554c0a3aSHans de Goede reg_bssid = REG_BSSID; 3344554c0a3aSHans de Goede 3345554c0a3aSHans de Goede for (idx = 0 ; idx < 6; idx++) 3346554c0a3aSHans de Goede rtw_write8(padapter, (reg_bssid+idx), val[idx]); 3347554c0a3aSHans de Goede } 3348554c0a3aSHans de Goede 3349554c0a3aSHans de Goede static void hw_var_set_bcn_func(struct adapter *padapter, u8 variable, u8 *val) 3350554c0a3aSHans de Goede { 3351554c0a3aSHans de Goede u32 bcn_ctrl_reg; 3352554c0a3aSHans de Goede 3353554c0a3aSHans de Goede bcn_ctrl_reg = REG_BCN_CTRL; 3354554c0a3aSHans de Goede 3355554c0a3aSHans de Goede if (*(u8 *)val) 3356554c0a3aSHans de Goede rtw_write8(padapter, bcn_ctrl_reg, (EN_BCN_FUNCTION | EN_TXBCN_RPT)); 3357554c0a3aSHans de Goede else { 3358554c0a3aSHans de Goede u8 val8; 3359554c0a3aSHans de Goede val8 = rtw_read8(padapter, bcn_ctrl_reg); 3360554c0a3aSHans de Goede val8 &= ~(EN_BCN_FUNCTION | EN_TXBCN_RPT); 3361554c0a3aSHans de Goede 3362554c0a3aSHans de Goede /* Always enable port0 beacon function for PSTDMA */ 3363554c0a3aSHans de Goede if (REG_BCN_CTRL == bcn_ctrl_reg) 3364554c0a3aSHans de Goede val8 |= EN_BCN_FUNCTION; 3365554c0a3aSHans de Goede 3366554c0a3aSHans de Goede rtw_write8(padapter, bcn_ctrl_reg, val8); 3367554c0a3aSHans de Goede } 3368554c0a3aSHans de Goede } 3369554c0a3aSHans de Goede 3370554c0a3aSHans de Goede static void hw_var_set_correct_tsf(struct adapter *padapter, u8 variable, u8 *val) 3371554c0a3aSHans de Goede { 3372554c0a3aSHans de Goede u8 val8; 3373554c0a3aSHans de Goede u64 tsf; 3374554c0a3aSHans de Goede struct mlme_ext_priv *pmlmeext; 3375554c0a3aSHans de Goede struct mlme_ext_info *pmlmeinfo; 3376554c0a3aSHans de Goede 3377554c0a3aSHans de Goede 3378554c0a3aSHans de Goede pmlmeext = &padapter->mlmeextpriv; 3379554c0a3aSHans de Goede pmlmeinfo = &pmlmeext->mlmext_info; 3380554c0a3aSHans de Goede 33819b1fd9b0SNishka Dasgupta tsf = pmlmeext->TSFValue-do_div(pmlmeext->TSFValue, (pmlmeinfo->bcn_interval*1024))-1024; /* us */ 3382554c0a3aSHans de Goede 3383554c0a3aSHans de Goede if ( 3384554c0a3aSHans de Goede ((pmlmeinfo->state&0x03) == WIFI_FW_ADHOC_STATE) || 3385554c0a3aSHans de Goede ((pmlmeinfo->state&0x03) == WIFI_FW_AP_STATE) 3386554c0a3aSHans de Goede ) 3387554c0a3aSHans de Goede StopTxBeacon(padapter); 3388554c0a3aSHans de Goede 3389554c0a3aSHans de Goede { 3390554c0a3aSHans de Goede /* disable related TSF function */ 3391554c0a3aSHans de Goede val8 = rtw_read8(padapter, REG_BCN_CTRL); 3392554c0a3aSHans de Goede val8 &= ~EN_BCN_FUNCTION; 3393554c0a3aSHans de Goede rtw_write8(padapter, REG_BCN_CTRL, val8); 3394554c0a3aSHans de Goede 3395554c0a3aSHans de Goede rtw_write32(padapter, REG_TSFTR, tsf); 3396554c0a3aSHans de Goede rtw_write32(padapter, REG_TSFTR+4, tsf>>32); 3397554c0a3aSHans de Goede 3398554c0a3aSHans de Goede /* enable related TSF function */ 3399554c0a3aSHans de Goede val8 = rtw_read8(padapter, REG_BCN_CTRL); 3400554c0a3aSHans de Goede val8 |= EN_BCN_FUNCTION; 3401554c0a3aSHans de Goede rtw_write8(padapter, REG_BCN_CTRL, val8); 3402554c0a3aSHans de Goede } 3403554c0a3aSHans de Goede 3404554c0a3aSHans de Goede if ( 3405554c0a3aSHans de Goede ((pmlmeinfo->state&0x03) == WIFI_FW_ADHOC_STATE) || 3406554c0a3aSHans de Goede ((pmlmeinfo->state&0x03) == WIFI_FW_AP_STATE) 3407554c0a3aSHans de Goede ) 3408554c0a3aSHans de Goede ResumeTxBeacon(padapter); 3409554c0a3aSHans de Goede } 3410554c0a3aSHans de Goede 3411554c0a3aSHans de Goede static void hw_var_set_mlme_disconnect(struct adapter *padapter, u8 variable, u8 *val) 3412554c0a3aSHans de Goede { 3413554c0a3aSHans de Goede u8 val8; 3414554c0a3aSHans de Goede 3415554c0a3aSHans de Goede /* Set RCR to not to receive data frame when NO LINK state */ 3416554c0a3aSHans de Goede /* rtw_write32(padapter, REG_RCR, rtw_read32(padapter, REG_RCR) & ~RCR_ADF); */ 3417554c0a3aSHans de Goede /* reject all data frames */ 3418554c0a3aSHans de Goede rtw_write16(padapter, REG_RXFLTMAP2, 0); 3419554c0a3aSHans de Goede 3420554c0a3aSHans de Goede /* reset TSF */ 3421554c0a3aSHans de Goede rtw_write8(padapter, REG_DUAL_TSF_RST, BIT(0)); 3422554c0a3aSHans de Goede 3423554c0a3aSHans de Goede /* disable update TSF */ 3424554c0a3aSHans de Goede val8 = rtw_read8(padapter, REG_BCN_CTRL); 3425554c0a3aSHans de Goede val8 |= DIS_TSF_UDT; 3426554c0a3aSHans de Goede rtw_write8(padapter, REG_BCN_CTRL, val8); 3427554c0a3aSHans de Goede } 3428554c0a3aSHans de Goede 3429554c0a3aSHans de Goede static void hw_var_set_mlme_sitesurvey(struct adapter *padapter, u8 variable, u8 *val) 3430554c0a3aSHans de Goede { 3431554c0a3aSHans de Goede u32 value_rcr, rcr_clear_bit, reg_bcn_ctl; 3432554c0a3aSHans de Goede u16 value_rxfltmap2; 3433554c0a3aSHans de Goede u8 val8; 3434554c0a3aSHans de Goede struct hal_com_data *pHalData; 3435554c0a3aSHans de Goede struct mlme_priv *pmlmepriv; 3436554c0a3aSHans de Goede 3437554c0a3aSHans de Goede 3438554c0a3aSHans de Goede pHalData = GET_HAL_DATA(padapter); 3439554c0a3aSHans de Goede pmlmepriv = &padapter->mlmepriv; 3440554c0a3aSHans de Goede 3441554c0a3aSHans de Goede reg_bcn_ctl = REG_BCN_CTRL; 3442554c0a3aSHans de Goede 3443554c0a3aSHans de Goede rcr_clear_bit = RCR_CBSSID_BCN; 3444554c0a3aSHans de Goede 3445554c0a3aSHans de Goede /* config RCR to receive different BSSID & not to receive data frame */ 3446554c0a3aSHans de Goede value_rxfltmap2 = 0; 3447554c0a3aSHans de Goede 3448554c0a3aSHans de Goede if ((check_fwstate(pmlmepriv, WIFI_AP_STATE) == true)) 3449554c0a3aSHans de Goede rcr_clear_bit = RCR_CBSSID_BCN; 3450554c0a3aSHans de Goede 3451554c0a3aSHans de Goede value_rcr = rtw_read32(padapter, REG_RCR); 3452554c0a3aSHans de Goede 3453554c0a3aSHans de Goede if (*((u8 *)val)) { 3454554c0a3aSHans de Goede /* under sitesurvey */ 3455554c0a3aSHans de Goede value_rcr &= ~(rcr_clear_bit); 3456554c0a3aSHans de Goede rtw_write32(padapter, REG_RCR, value_rcr); 3457554c0a3aSHans de Goede 3458554c0a3aSHans de Goede rtw_write16(padapter, REG_RXFLTMAP2, value_rxfltmap2); 3459554c0a3aSHans de Goede 3460554c0a3aSHans de Goede if (check_fwstate(pmlmepriv, WIFI_STATION_STATE | WIFI_ADHOC_STATE | WIFI_ADHOC_MASTER_STATE)) { 3461554c0a3aSHans de Goede /* disable update TSF */ 3462554c0a3aSHans de Goede val8 = rtw_read8(padapter, reg_bcn_ctl); 3463554c0a3aSHans de Goede val8 |= DIS_TSF_UDT; 3464554c0a3aSHans de Goede rtw_write8(padapter, reg_bcn_ctl, val8); 3465554c0a3aSHans de Goede } 3466554c0a3aSHans de Goede 346768468503SAndreas Hellmich /* Save original RRSR setting. */ 3468554c0a3aSHans de Goede pHalData->RegRRSR = rtw_read16(padapter, REG_RRSR); 3469554c0a3aSHans de Goede } else { 3470554c0a3aSHans de Goede /* sitesurvey done */ 3471554c0a3aSHans de Goede if (check_fwstate(pmlmepriv, (_FW_LINKED|WIFI_AP_STATE))) 3472554c0a3aSHans de Goede /* enable to rx data frame */ 3473554c0a3aSHans de Goede rtw_write16(padapter, REG_RXFLTMAP2, 0xFFFF); 3474554c0a3aSHans de Goede 3475554c0a3aSHans de Goede if (check_fwstate(pmlmepriv, WIFI_STATION_STATE | WIFI_ADHOC_STATE | WIFI_ADHOC_MASTER_STATE)) { 3476554c0a3aSHans de Goede /* enable update TSF */ 3477554c0a3aSHans de Goede val8 = rtw_read8(padapter, reg_bcn_ctl); 3478554c0a3aSHans de Goede val8 &= ~DIS_TSF_UDT; 3479554c0a3aSHans de Goede rtw_write8(padapter, reg_bcn_ctl, val8); 3480554c0a3aSHans de Goede } 3481554c0a3aSHans de Goede 3482554c0a3aSHans de Goede value_rcr |= rcr_clear_bit; 3483554c0a3aSHans de Goede rtw_write32(padapter, REG_RCR, value_rcr); 3484554c0a3aSHans de Goede 348568468503SAndreas Hellmich /* Restore original RRSR setting. */ 3486554c0a3aSHans de Goede rtw_write16(padapter, REG_RRSR, pHalData->RegRRSR); 3487554c0a3aSHans de Goede } 3488554c0a3aSHans de Goede } 3489554c0a3aSHans de Goede 3490554c0a3aSHans de Goede static void hw_var_set_mlme_join(struct adapter *padapter, u8 variable, u8 *val) 3491554c0a3aSHans de Goede { 3492554c0a3aSHans de Goede u8 val8; 3493554c0a3aSHans de Goede u16 val16; 3494554c0a3aSHans de Goede u32 val32; 3495554c0a3aSHans de Goede u8 RetryLimit; 3496554c0a3aSHans de Goede u8 type; 3497554c0a3aSHans de Goede struct mlme_priv *pmlmepriv; 3498554c0a3aSHans de Goede struct eeprom_priv *pEEPROM; 3499554c0a3aSHans de Goede 3500554c0a3aSHans de Goede 3501554c0a3aSHans de Goede RetryLimit = 0x30; 3502554c0a3aSHans de Goede type = *(u8 *)val; 3503554c0a3aSHans de Goede pmlmepriv = &padapter->mlmepriv; 3504554c0a3aSHans de Goede pEEPROM = GET_EEPROM_EFUSE_PRIV(padapter); 3505554c0a3aSHans de Goede 3506554c0a3aSHans de Goede if (type == 0) { /* prepare to join */ 3507554c0a3aSHans de Goede /* enable to rx data frame.Accept all data frame */ 3508554c0a3aSHans de Goede /* rtw_write32(padapter, REG_RCR, rtw_read32(padapter, REG_RCR)|RCR_ADF); */ 3509554c0a3aSHans de Goede rtw_write16(padapter, REG_RXFLTMAP2, 0xFFFF); 3510554c0a3aSHans de Goede 3511554c0a3aSHans de Goede val32 = rtw_read32(padapter, REG_RCR); 3512554c0a3aSHans de Goede if (padapter->in_cta_test) 3513554c0a3aSHans de Goede val32 &= ~(RCR_CBSSID_DATA | RCR_CBSSID_BCN);/* RCR_ADF */ 3514554c0a3aSHans de Goede else 3515554c0a3aSHans de Goede val32 |= RCR_CBSSID_DATA|RCR_CBSSID_BCN; 3516554c0a3aSHans de Goede rtw_write32(padapter, REG_RCR, val32); 3517554c0a3aSHans de Goede 3518554c0a3aSHans de Goede if (check_fwstate(pmlmepriv, WIFI_STATION_STATE) == true) 3519554c0a3aSHans de Goede RetryLimit = (pEEPROM->CustomerID == RT_CID_CCX) ? 7 : 48; 3520554c0a3aSHans de Goede else /* Ad-hoc Mode */ 3521554c0a3aSHans de Goede RetryLimit = 0x7; 3522554c0a3aSHans de Goede } else if (type == 1) /* joinbss_event call back when join res < 0 */ 3523554c0a3aSHans de Goede rtw_write16(padapter, REG_RXFLTMAP2, 0x00); 3524554c0a3aSHans de Goede else if (type == 2) { /* sta add event call back */ 3525554c0a3aSHans de Goede /* enable update TSF */ 3526554c0a3aSHans de Goede val8 = rtw_read8(padapter, REG_BCN_CTRL); 3527554c0a3aSHans de Goede val8 &= ~DIS_TSF_UDT; 3528554c0a3aSHans de Goede rtw_write8(padapter, REG_BCN_CTRL, val8); 3529554c0a3aSHans de Goede 3530554c0a3aSHans de Goede if (check_fwstate(pmlmepriv, WIFI_ADHOC_STATE|WIFI_ADHOC_MASTER_STATE)) 3531554c0a3aSHans de Goede RetryLimit = 0x7; 3532554c0a3aSHans de Goede } 3533554c0a3aSHans de Goede 3534554c0a3aSHans de Goede val16 = (RetryLimit << RETRY_LIMIT_SHORT_SHIFT) | (RetryLimit << RETRY_LIMIT_LONG_SHIFT); 3535554c0a3aSHans de Goede rtw_write16(padapter, REG_RL, val16); 3536554c0a3aSHans de Goede } 3537554c0a3aSHans de Goede 3538554c0a3aSHans de Goede void CCX_FwC2HTxRpt_8723b(struct adapter *padapter, u8 *pdata, u8 len) 3539554c0a3aSHans de Goede { 3540554c0a3aSHans de Goede u8 seq_no; 3541554c0a3aSHans de Goede 3542554c0a3aSHans de Goede #define GET_8723B_C2H_TX_RPT_LIFE_TIME_OVER(_Header) LE_BITS_TO_1BYTE((_Header + 0), 6, 1) 3543554c0a3aSHans de Goede #define GET_8723B_C2H_TX_RPT_RETRY_OVER(_Header) LE_BITS_TO_1BYTE((_Header + 0), 7, 1) 3544554c0a3aSHans de Goede 3545554c0a3aSHans de Goede /* DBG_871X("%s, 0x%x, 0x%x, 0x%x, 0x%x, 0x%x, 0x%x, 0x%x, 0x%x\n", __func__, */ 3546554c0a3aSHans de Goede /* *pdata, *(pdata+1), *(pdata+2), *(pdata+3), *(pdata+4), *(pdata+5), *(pdata+6), *(pdata+7)); */ 3547554c0a3aSHans de Goede 3548554c0a3aSHans de Goede seq_no = *(pdata+6); 3549554c0a3aSHans de Goede 3550554c0a3aSHans de Goede if (GET_8723B_C2H_TX_RPT_RETRY_OVER(pdata) | GET_8723B_C2H_TX_RPT_LIFE_TIME_OVER(pdata)) { 3551554c0a3aSHans de Goede rtw_ack_tx_done(&padapter->xmitpriv, RTW_SCTX_DONE_CCX_PKT_FAIL); 3552554c0a3aSHans de Goede } 3553554c0a3aSHans de Goede /* 3554554c0a3aSHans de Goede else if (seq_no != padapter->xmitpriv.seq_no) { 3555554c0a3aSHans de Goede DBG_871X("tx_seq_no =%d, rpt_seq_no =%d\n", padapter->xmitpriv.seq_no, seq_no); 3556554c0a3aSHans de Goede rtw_ack_tx_done(&padapter->xmitpriv, RTW_SCTX_DONE_CCX_PKT_FAIL); 3557554c0a3aSHans de Goede } 3558554c0a3aSHans de Goede */ 3559554c0a3aSHans de Goede else 3560554c0a3aSHans de Goede rtw_ack_tx_done(&padapter->xmitpriv, RTW_SCTX_DONE_SUCCESS); 3561554c0a3aSHans de Goede } 3562554c0a3aSHans de Goede 3563554c0a3aSHans de Goede s32 c2h_id_filter_ccx_8723b(u8 *buf) 3564554c0a3aSHans de Goede { 3565554c0a3aSHans de Goede struct c2h_evt_hdr_88xx *c2h_evt = (struct c2h_evt_hdr_88xx *)buf; 3566554c0a3aSHans de Goede s32 ret = false; 3567554c0a3aSHans de Goede if (c2h_evt->id == C2H_CCX_TX_RPT) 3568554c0a3aSHans de Goede ret = true; 3569554c0a3aSHans de Goede 3570554c0a3aSHans de Goede return ret; 3571554c0a3aSHans de Goede } 3572554c0a3aSHans de Goede 3573554c0a3aSHans de Goede 3574554c0a3aSHans de Goede s32 c2h_handler_8723b(struct adapter *padapter, u8 *buf) 3575554c0a3aSHans de Goede { 3576554c0a3aSHans de Goede struct c2h_evt_hdr_88xx *pC2hEvent = (struct c2h_evt_hdr_88xx *)buf; 3577554c0a3aSHans de Goede s32 ret = _SUCCESS; 3578554c0a3aSHans de Goede u8 index = 0; 3579554c0a3aSHans de Goede 3580019acabeSHimadri Pandya if (!pC2hEvent) { 3581554c0a3aSHans de Goede DBG_8192C("%s(): pC2hEventis NULL\n", __func__); 3582554c0a3aSHans de Goede ret = _FAIL; 3583554c0a3aSHans de Goede goto exit; 3584554c0a3aSHans de Goede } 3585554c0a3aSHans de Goede 3586554c0a3aSHans de Goede switch (pC2hEvent->id) { 3587554c0a3aSHans de Goede case C2H_AP_RPT_RSP: 3588554c0a3aSHans de Goede break; 3589554c0a3aSHans de Goede case C2H_DBG: 3590554c0a3aSHans de Goede { 3591554c0a3aSHans de Goede RT_TRACE(_module_hal_init_c_, _drv_info_, ("c2h_handler_8723b: %s\n", pC2hEvent->payload)); 3592554c0a3aSHans de Goede } 3593554c0a3aSHans de Goede break; 3594554c0a3aSHans de Goede 3595554c0a3aSHans de Goede case C2H_CCX_TX_RPT: 3596554c0a3aSHans de Goede /* CCX_FwC2HTxRpt(padapter, QueueID, pC2hEvent->payload); */ 3597554c0a3aSHans de Goede break; 3598554c0a3aSHans de Goede 3599554c0a3aSHans de Goede case C2H_EXT_RA_RPT: 3600554c0a3aSHans de Goede /* C2HExtRaRptHandler(padapter, pC2hEvent->payload, C2hEvent.CmdLen); */ 3601554c0a3aSHans de Goede break; 3602554c0a3aSHans de Goede 3603554c0a3aSHans de Goede case C2H_HW_INFO_EXCH: 3604554c0a3aSHans de Goede RT_TRACE(_module_hal_init_c_, _drv_info_, ("[BT], C2H_HW_INFO_EXCH\n")); 3605554c0a3aSHans de Goede for (index = 0; index < pC2hEvent->plen; index++) { 3606554c0a3aSHans de Goede RT_TRACE(_module_hal_init_c_, _drv_info_, ("[BT], tmpBuf[%d]= 0x%x\n", index, pC2hEvent->payload[index])); 3607554c0a3aSHans de Goede } 3608554c0a3aSHans de Goede break; 3609554c0a3aSHans de Goede 3610554c0a3aSHans de Goede case C2H_8723B_BT_INFO: 3611aa0963a1SNishka Dasgupta hal_btcoex_BtInfoNotify(padapter, pC2hEvent->plen, pC2hEvent->payload); 3612554c0a3aSHans de Goede break; 3613554c0a3aSHans de Goede 3614554c0a3aSHans de Goede default: 3615554c0a3aSHans de Goede break; 3616554c0a3aSHans de Goede } 3617554c0a3aSHans de Goede 3618554c0a3aSHans de Goede /* Clear event to notify FW we have read the command. */ 3619554c0a3aSHans de Goede /* Note: */ 3620554c0a3aSHans de Goede /* If this field isn't clear, the FW won't update the next command message. */ 3621554c0a3aSHans de Goede /* rtw_write8(padapter, REG_C2HEVT_CLEAR, C2H_EVT_HOST_CLOSE); */ 3622554c0a3aSHans de Goede exit: 3623554c0a3aSHans de Goede return ret; 3624554c0a3aSHans de Goede } 3625554c0a3aSHans de Goede 362630bd370fSMarco Cesati static void process_c2h_event(struct adapter *padapter, struct c2h_evt_hdr_t *pC2hEvent, u8 *c2hBuf) 3627554c0a3aSHans de Goede { 3628554c0a3aSHans de Goede u8 index = 0; 3629554c0a3aSHans de Goede 3630019acabeSHimadri Pandya if (!c2hBuf) { 3631554c0a3aSHans de Goede DBG_8192C("%s c2hbuff is NULL\n", __func__); 3632554c0a3aSHans de Goede return; 3633554c0a3aSHans de Goede } 3634554c0a3aSHans de Goede 3635554c0a3aSHans de Goede switch (pC2hEvent->CmdID) { 3636554c0a3aSHans de Goede case C2H_AP_RPT_RSP: 3637554c0a3aSHans de Goede break; 3638554c0a3aSHans de Goede case C2H_DBG: 3639554c0a3aSHans de Goede { 3640554c0a3aSHans de Goede RT_TRACE(_module_hal_init_c_, _drv_info_, ("C2HCommandHandler: %s\n", c2hBuf)); 3641554c0a3aSHans de Goede } 3642554c0a3aSHans de Goede break; 3643554c0a3aSHans de Goede 3644554c0a3aSHans de Goede case C2H_CCX_TX_RPT: 3645554c0a3aSHans de Goede /* CCX_FwC2HTxRpt(padapter, QueueID, tmpBuf); */ 3646554c0a3aSHans de Goede break; 3647554c0a3aSHans de Goede 3648554c0a3aSHans de Goede case C2H_EXT_RA_RPT: 3649554c0a3aSHans de Goede /* C2HExtRaRptHandler(padapter, tmpBuf, C2hEvent.CmdLen); */ 3650554c0a3aSHans de Goede break; 3651554c0a3aSHans de Goede 3652554c0a3aSHans de Goede case C2H_HW_INFO_EXCH: 3653554c0a3aSHans de Goede RT_TRACE(_module_hal_init_c_, _drv_info_, ("[BT], C2H_HW_INFO_EXCH\n")); 3654554c0a3aSHans de Goede for (index = 0; index < pC2hEvent->CmdLen; index++) { 3655554c0a3aSHans de Goede RT_TRACE(_module_hal_init_c_, _drv_info_, ("[BT], tmpBuf[%d]= 0x%x\n", index, c2hBuf[index])); 3656554c0a3aSHans de Goede } 3657554c0a3aSHans de Goede break; 3658554c0a3aSHans de Goede 3659554c0a3aSHans de Goede case C2H_8723B_BT_INFO: 3660aa0963a1SNishka Dasgupta hal_btcoex_BtInfoNotify(padapter, pC2hEvent->CmdLen, c2hBuf); 3661554c0a3aSHans de Goede break; 3662554c0a3aSHans de Goede 3663554c0a3aSHans de Goede default: 3664554c0a3aSHans de Goede break; 3665554c0a3aSHans de Goede } 3666554c0a3aSHans de Goede } 3667554c0a3aSHans de Goede 3668554c0a3aSHans de Goede void C2HPacketHandler_8723B(struct adapter *padapter, u8 *pbuffer, u16 length) 3669554c0a3aSHans de Goede { 367030bd370fSMarco Cesati struct c2h_evt_hdr_t C2hEvent; 3671554c0a3aSHans de Goede u8 *tmpBuf = NULL; 3672554c0a3aSHans de Goede C2hEvent.CmdID = pbuffer[0]; 3673554c0a3aSHans de Goede C2hEvent.CmdSeq = pbuffer[1]; 3674554c0a3aSHans de Goede C2hEvent.CmdLen = length-2; 3675554c0a3aSHans de Goede tmpBuf = pbuffer+2; 3676554c0a3aSHans de Goede 3677554c0a3aSHans de Goede /* DBG_871X("%s C2hEvent.CmdID:%x C2hEvent.CmdLen:%x C2hEvent.CmdSeq:%x\n", */ 3678554c0a3aSHans de Goede /* __func__, C2hEvent.CmdID, C2hEvent.CmdLen, C2hEvent.CmdSeq); */ 3679*d8365ba3SFabio Aiuto print_hex_dump_debug(DRIVER_PREFIX ": C2HPacketHandler_8723B(): Command Content:\n", 3680*d8365ba3SFabio Aiuto DUMP_PREFIX_NONE, 16, 1, tmpBuf, C2hEvent.CmdLen, false); 3681554c0a3aSHans de Goede 3682554c0a3aSHans de Goede process_c2h_event(padapter, &C2hEvent, tmpBuf); 3683554c0a3aSHans de Goede /* c2h_handler_8723b(padapter,&C2hEvent); */ 3684554c0a3aSHans de Goede } 3685554c0a3aSHans de Goede 3686554c0a3aSHans de Goede void SetHwReg8723B(struct adapter *padapter, u8 variable, u8 *val) 3687554c0a3aSHans de Goede { 3688554c0a3aSHans de Goede struct hal_com_data *pHalData = GET_HAL_DATA(padapter); 3689554c0a3aSHans de Goede u8 val8; 3690554c0a3aSHans de Goede u32 val32; 3691554c0a3aSHans de Goede 3692554c0a3aSHans de Goede switch (variable) { 3693554c0a3aSHans de Goede case HW_VAR_MEDIA_STATUS: 3694554c0a3aSHans de Goede val8 = rtw_read8(padapter, MSR) & 0x0c; 3695554c0a3aSHans de Goede val8 |= *val; 3696554c0a3aSHans de Goede rtw_write8(padapter, MSR, val8); 3697554c0a3aSHans de Goede break; 3698554c0a3aSHans de Goede 3699554c0a3aSHans de Goede case HW_VAR_MEDIA_STATUS1: 3700554c0a3aSHans de Goede val8 = rtw_read8(padapter, MSR) & 0x03; 3701554c0a3aSHans de Goede val8 |= *val << 2; 3702554c0a3aSHans de Goede rtw_write8(padapter, MSR, val8); 3703554c0a3aSHans de Goede break; 3704554c0a3aSHans de Goede 3705554c0a3aSHans de Goede case HW_VAR_SET_OPMODE: 3706554c0a3aSHans de Goede hw_var_set_opmode(padapter, variable, val); 3707554c0a3aSHans de Goede break; 3708554c0a3aSHans de Goede 3709554c0a3aSHans de Goede case HW_VAR_MAC_ADDR: 3710554c0a3aSHans de Goede hw_var_set_macaddr(padapter, variable, val); 3711554c0a3aSHans de Goede break; 3712554c0a3aSHans de Goede 3713554c0a3aSHans de Goede case HW_VAR_BSSID: 3714554c0a3aSHans de Goede hw_var_set_bssid(padapter, variable, val); 3715554c0a3aSHans de Goede break; 3716554c0a3aSHans de Goede 3717554c0a3aSHans de Goede case HW_VAR_BASIC_RATE: 3718554c0a3aSHans de Goede { 3719554c0a3aSHans de Goede struct mlme_ext_info *mlmext_info = &padapter->mlmeextpriv.mlmext_info; 3720554c0a3aSHans de Goede u16 input_b = 0, masked = 0, ioted = 0, BrateCfg = 0; 3721554c0a3aSHans de Goede u16 rrsr_2g_force_mask = (RRSR_11M|RRSR_5_5M|RRSR_1M); 3722554c0a3aSHans de Goede u16 rrsr_2g_allow_mask = (RRSR_24M|RRSR_12M|RRSR_6M|RRSR_CCK_RATES); 3723554c0a3aSHans de Goede 3724554c0a3aSHans de Goede HalSetBrateCfg(padapter, val, &BrateCfg); 3725554c0a3aSHans de Goede input_b = BrateCfg; 3726554c0a3aSHans de Goede 3727554c0a3aSHans de Goede /* apply force and allow mask */ 3728554c0a3aSHans de Goede BrateCfg |= rrsr_2g_force_mask; 3729554c0a3aSHans de Goede BrateCfg &= rrsr_2g_allow_mask; 3730554c0a3aSHans de Goede masked = BrateCfg; 3731554c0a3aSHans de Goede 3732554c0a3aSHans de Goede /* IOT consideration */ 3733554c0a3aSHans de Goede if (mlmext_info->assoc_AP_vendor == HT_IOT_PEER_CISCO) { 3734554c0a3aSHans de Goede /* if peer is cisco and didn't use ofdm rate, we enable 6M ack */ 3735554c0a3aSHans de Goede if ((BrateCfg & (RRSR_24M|RRSR_12M|RRSR_6M)) == 0) 3736554c0a3aSHans de Goede BrateCfg |= RRSR_6M; 3737554c0a3aSHans de Goede } 3738554c0a3aSHans de Goede ioted = BrateCfg; 3739554c0a3aSHans de Goede 3740554c0a3aSHans de Goede pHalData->BasicRateSet = BrateCfg; 3741554c0a3aSHans de Goede 3742554c0a3aSHans de Goede DBG_8192C("HW_VAR_BASIC_RATE: %#x -> %#x -> %#x\n", input_b, masked, ioted); 3743554c0a3aSHans de Goede 3744554c0a3aSHans de Goede /* Set RRSR rate table. */ 3745554c0a3aSHans de Goede rtw_write16(padapter, REG_RRSR, BrateCfg); 3746554c0a3aSHans de Goede rtw_write8(padapter, REG_RRSR+2, rtw_read8(padapter, REG_RRSR+2)&0xf0); 3747554c0a3aSHans de Goede } 3748554c0a3aSHans de Goede break; 3749554c0a3aSHans de Goede 3750554c0a3aSHans de Goede case HW_VAR_TXPAUSE: 3751554c0a3aSHans de Goede rtw_write8(padapter, REG_TXPAUSE, *val); 3752554c0a3aSHans de Goede break; 3753554c0a3aSHans de Goede 3754554c0a3aSHans de Goede case HW_VAR_BCN_FUNC: 3755554c0a3aSHans de Goede hw_var_set_bcn_func(padapter, variable, val); 3756554c0a3aSHans de Goede break; 3757554c0a3aSHans de Goede 3758554c0a3aSHans de Goede case HW_VAR_CORRECT_TSF: 3759554c0a3aSHans de Goede hw_var_set_correct_tsf(padapter, variable, val); 3760554c0a3aSHans de Goede break; 3761554c0a3aSHans de Goede 3762554c0a3aSHans de Goede case HW_VAR_CHECK_BSSID: 3763554c0a3aSHans de Goede { 3764554c0a3aSHans de Goede u32 val32; 3765554c0a3aSHans de Goede val32 = rtw_read32(padapter, REG_RCR); 3766554c0a3aSHans de Goede if (*val) 3767554c0a3aSHans de Goede val32 |= RCR_CBSSID_DATA|RCR_CBSSID_BCN; 3768554c0a3aSHans de Goede else 3769554c0a3aSHans de Goede val32 &= ~(RCR_CBSSID_DATA|RCR_CBSSID_BCN); 3770554c0a3aSHans de Goede rtw_write32(padapter, REG_RCR, val32); 3771554c0a3aSHans de Goede } 3772554c0a3aSHans de Goede break; 3773554c0a3aSHans de Goede 3774554c0a3aSHans de Goede case HW_VAR_MLME_DISCONNECT: 3775554c0a3aSHans de Goede hw_var_set_mlme_disconnect(padapter, variable, val); 3776554c0a3aSHans de Goede break; 3777554c0a3aSHans de Goede 3778554c0a3aSHans de Goede case HW_VAR_MLME_SITESURVEY: 3779554c0a3aSHans de Goede hw_var_set_mlme_sitesurvey(padapter, variable, val); 3780554c0a3aSHans de Goede 3781a47a70c2SNishka Dasgupta hal_btcoex_ScanNotify(padapter, *val?true:false); 3782554c0a3aSHans de Goede break; 3783554c0a3aSHans de Goede 3784554c0a3aSHans de Goede case HW_VAR_MLME_JOIN: 3785554c0a3aSHans de Goede hw_var_set_mlme_join(padapter, variable, val); 3786554c0a3aSHans de Goede 3787554c0a3aSHans de Goede switch (*val) { 3788554c0a3aSHans de Goede case 0: 3789554c0a3aSHans de Goede /* prepare to join */ 37908739e064SNishka Dasgupta hal_btcoex_ConnectNotify(padapter, true); 3791554c0a3aSHans de Goede break; 3792554c0a3aSHans de Goede case 1: 3793554c0a3aSHans de Goede /* joinbss_event callback when join res < 0 */ 37948739e064SNishka Dasgupta hal_btcoex_ConnectNotify(padapter, false); 3795554c0a3aSHans de Goede break; 3796554c0a3aSHans de Goede case 2: 3797554c0a3aSHans de Goede /* sta add event callback */ 3798554c0a3aSHans de Goede /* rtw_btcoex_MediaStatusNotify(padapter, RT_MEDIA_CONNECT); */ 3799554c0a3aSHans de Goede break; 3800554c0a3aSHans de Goede } 3801554c0a3aSHans de Goede break; 3802554c0a3aSHans de Goede 3803554c0a3aSHans de Goede case HW_VAR_ON_RCR_AM: 3804554c0a3aSHans de Goede val32 = rtw_read32(padapter, REG_RCR); 3805554c0a3aSHans de Goede val32 |= RCR_AM; 3806554c0a3aSHans de Goede rtw_write32(padapter, REG_RCR, val32); 3807554c0a3aSHans de Goede DBG_8192C("%s, %d, RCR = %x\n", __func__, __LINE__, rtw_read32(padapter, REG_RCR)); 3808554c0a3aSHans de Goede break; 3809554c0a3aSHans de Goede 3810554c0a3aSHans de Goede case HW_VAR_OFF_RCR_AM: 3811554c0a3aSHans de Goede val32 = rtw_read32(padapter, REG_RCR); 3812554c0a3aSHans de Goede val32 &= ~RCR_AM; 3813554c0a3aSHans de Goede rtw_write32(padapter, REG_RCR, val32); 3814554c0a3aSHans de Goede DBG_8192C("%s, %d, RCR = %x\n", __func__, __LINE__, rtw_read32(padapter, REG_RCR)); 3815554c0a3aSHans de Goede break; 3816554c0a3aSHans de Goede 3817554c0a3aSHans de Goede case HW_VAR_BEACON_INTERVAL: 3818554c0a3aSHans de Goede rtw_write16(padapter, REG_BCN_INTERVAL, *((u16 *)val)); 3819554c0a3aSHans de Goede break; 3820554c0a3aSHans de Goede 3821554c0a3aSHans de Goede case HW_VAR_SLOT_TIME: 3822554c0a3aSHans de Goede rtw_write8(padapter, REG_SLOT, *val); 3823554c0a3aSHans de Goede break; 3824554c0a3aSHans de Goede 3825554c0a3aSHans de Goede case HW_VAR_RESP_SIFS: 3826554c0a3aSHans de Goede /* SIFS_Timer = 0x0a0a0808; */ 3827554c0a3aSHans de Goede /* RESP_SIFS for CCK */ 3828554c0a3aSHans de Goede rtw_write8(padapter, REG_RESP_SIFS_CCK, val[0]); /* SIFS_T2T_CCK (0x08) */ 3829554c0a3aSHans de Goede rtw_write8(padapter, REG_RESP_SIFS_CCK+1, val[1]); /* SIFS_R2T_CCK(0x08) */ 3830554c0a3aSHans de Goede /* RESP_SIFS for OFDM */ 3831554c0a3aSHans de Goede rtw_write8(padapter, REG_RESP_SIFS_OFDM, val[2]); /* SIFS_T2T_OFDM (0x0a) */ 3832554c0a3aSHans de Goede rtw_write8(padapter, REG_RESP_SIFS_OFDM+1, val[3]); /* SIFS_R2T_OFDM(0x0a) */ 3833554c0a3aSHans de Goede break; 3834554c0a3aSHans de Goede 3835554c0a3aSHans de Goede case HW_VAR_ACK_PREAMBLE: 3836554c0a3aSHans de Goede { 3837554c0a3aSHans de Goede u8 regTmp; 3838554c0a3aSHans de Goede u8 bShortPreamble = *val; 3839554c0a3aSHans de Goede 3840554c0a3aSHans de Goede /* Joseph marked out for Netgear 3500 TKIP channel 7 issue.(Temporarily) */ 3841554c0a3aSHans de Goede /* regTmp = (pHalData->nCur40MhzPrimeSC)<<5; */ 3842554c0a3aSHans de Goede regTmp = 0; 3843554c0a3aSHans de Goede if (bShortPreamble) 3844554c0a3aSHans de Goede regTmp |= 0x80; 3845554c0a3aSHans de Goede rtw_write8(padapter, REG_RRSR+2, regTmp); 3846554c0a3aSHans de Goede } 3847554c0a3aSHans de Goede break; 3848554c0a3aSHans de Goede 3849554c0a3aSHans de Goede case HW_VAR_CAM_EMPTY_ENTRY: 3850554c0a3aSHans de Goede { 3851554c0a3aSHans de Goede u8 ucIndex = *val; 3852554c0a3aSHans de Goede u8 i; 3853554c0a3aSHans de Goede u32 ulCommand = 0; 3854554c0a3aSHans de Goede u32 ulContent = 0; 3855554c0a3aSHans de Goede u32 ulEncAlgo = CAM_AES; 3856554c0a3aSHans de Goede 3857554c0a3aSHans de Goede for (i = 0; i < CAM_CONTENT_COUNT; i++) { 3858554c0a3aSHans de Goede /* filled id in CAM config 2 byte */ 3859554c0a3aSHans de Goede if (i == 0) { 3860554c0a3aSHans de Goede ulContent |= (ucIndex & 0x03) | ((u16)(ulEncAlgo)<<2); 3861554c0a3aSHans de Goede /* ulContent |= CAM_VALID; */ 3862554c0a3aSHans de Goede } else 3863554c0a3aSHans de Goede ulContent = 0; 3864554c0a3aSHans de Goede 3865554c0a3aSHans de Goede /* polling bit, and No Write enable, and address */ 3866554c0a3aSHans de Goede ulCommand = CAM_CONTENT_COUNT*ucIndex+i; 3867554c0a3aSHans de Goede ulCommand = ulCommand | CAM_POLLINIG | CAM_WRITE; 3868554c0a3aSHans de Goede /* write content 0 is equall to mark invalid */ 3869554c0a3aSHans de Goede rtw_write32(padapter, WCAMI, ulContent); /* mdelay(40); */ 3870554c0a3aSHans de Goede /* RT_TRACE(COMP_SEC, DBG_LOUD, ("CAM_empty_entry(): WRITE A4: %lx\n", ulContent)); */ 3871554c0a3aSHans de Goede rtw_write32(padapter, RWCAM, ulCommand); /* mdelay(40); */ 3872554c0a3aSHans de Goede /* RT_TRACE(COMP_SEC, DBG_LOUD, ("CAM_empty_entry(): WRITE A0: %lx\n", ulCommand)); */ 3873554c0a3aSHans de Goede } 3874554c0a3aSHans de Goede } 3875554c0a3aSHans de Goede break; 3876554c0a3aSHans de Goede 3877554c0a3aSHans de Goede case HW_VAR_CAM_INVALID_ALL: 3878554c0a3aSHans de Goede rtw_write32(padapter, RWCAM, BIT(31)|BIT(30)); 3879554c0a3aSHans de Goede break; 3880554c0a3aSHans de Goede 3881554c0a3aSHans de Goede case HW_VAR_CAM_WRITE: 3882554c0a3aSHans de Goede { 3883554c0a3aSHans de Goede u32 cmd; 3884554c0a3aSHans de Goede u32 *cam_val = (u32 *)val; 3885554c0a3aSHans de Goede 3886554c0a3aSHans de Goede rtw_write32(padapter, WCAMI, cam_val[0]); 3887554c0a3aSHans de Goede 3888554c0a3aSHans de Goede cmd = CAM_POLLINIG | CAM_WRITE | cam_val[1]; 3889554c0a3aSHans de Goede rtw_write32(padapter, RWCAM, cmd); 3890554c0a3aSHans de Goede } 3891554c0a3aSHans de Goede break; 3892554c0a3aSHans de Goede 3893554c0a3aSHans de Goede case HW_VAR_AC_PARAM_VO: 3894554c0a3aSHans de Goede rtw_write32(padapter, REG_EDCA_VO_PARAM, *((u32 *)val)); 3895554c0a3aSHans de Goede break; 3896554c0a3aSHans de Goede 3897554c0a3aSHans de Goede case HW_VAR_AC_PARAM_VI: 3898554c0a3aSHans de Goede rtw_write32(padapter, REG_EDCA_VI_PARAM, *((u32 *)val)); 3899554c0a3aSHans de Goede break; 3900554c0a3aSHans de Goede 3901554c0a3aSHans de Goede case HW_VAR_AC_PARAM_BE: 3902554c0a3aSHans de Goede pHalData->AcParam_BE = ((u32 *)(val))[0]; 3903554c0a3aSHans de Goede rtw_write32(padapter, REG_EDCA_BE_PARAM, *((u32 *)val)); 3904554c0a3aSHans de Goede break; 3905554c0a3aSHans de Goede 3906554c0a3aSHans de Goede case HW_VAR_AC_PARAM_BK: 3907554c0a3aSHans de Goede rtw_write32(padapter, REG_EDCA_BK_PARAM, *((u32 *)val)); 3908554c0a3aSHans de Goede break; 3909554c0a3aSHans de Goede 3910554c0a3aSHans de Goede case HW_VAR_ACM_CTRL: 3911554c0a3aSHans de Goede { 3912554c0a3aSHans de Goede u8 ctrl = *((u8 *)val); 3913554c0a3aSHans de Goede u8 hwctrl = 0; 3914554c0a3aSHans de Goede 3915554c0a3aSHans de Goede if (ctrl != 0) { 3916554c0a3aSHans de Goede hwctrl |= AcmHw_HwEn; 3917554c0a3aSHans de Goede 3918554c0a3aSHans de Goede if (ctrl & BIT(1)) /* BE */ 3919554c0a3aSHans de Goede hwctrl |= AcmHw_BeqEn; 3920554c0a3aSHans de Goede 3921554c0a3aSHans de Goede if (ctrl & BIT(2)) /* VI */ 3922554c0a3aSHans de Goede hwctrl |= AcmHw_ViqEn; 3923554c0a3aSHans de Goede 3924554c0a3aSHans de Goede if (ctrl & BIT(3)) /* VO */ 3925554c0a3aSHans de Goede hwctrl |= AcmHw_VoqEn; 3926554c0a3aSHans de Goede } 3927554c0a3aSHans de Goede 3928554c0a3aSHans de Goede DBG_8192C("[HW_VAR_ACM_CTRL] Write 0x%02X\n", hwctrl); 3929554c0a3aSHans de Goede rtw_write8(padapter, REG_ACMHWCTRL, hwctrl); 3930554c0a3aSHans de Goede } 3931554c0a3aSHans de Goede break; 3932554c0a3aSHans de Goede 3933554c0a3aSHans de Goede case HW_VAR_AMPDU_FACTOR: 3934554c0a3aSHans de Goede { 3935554c0a3aSHans de Goede u32 AMPDULen = (*((u8 *)val)); 3936554c0a3aSHans de Goede 3937554c0a3aSHans de Goede if (AMPDULen < HT_AGG_SIZE_32K) 3938554c0a3aSHans de Goede AMPDULen = (0x2000 << (*((u8 *)val)))-1; 3939554c0a3aSHans de Goede else 3940554c0a3aSHans de Goede AMPDULen = 0x7fff; 3941554c0a3aSHans de Goede 3942554c0a3aSHans de Goede rtw_write32(padapter, REG_AMPDU_MAX_LENGTH_8723B, AMPDULen); 3943554c0a3aSHans de Goede } 3944554c0a3aSHans de Goede break; 3945554c0a3aSHans de Goede 3946554c0a3aSHans de Goede case HW_VAR_H2C_FW_PWRMODE: 3947554c0a3aSHans de Goede { 3948554c0a3aSHans de Goede u8 psmode = *val; 3949554c0a3aSHans de Goede 3950554c0a3aSHans de Goede /* Forece leave RF low power mode for 1T1R to prevent conficting setting in Fw power */ 3951554c0a3aSHans de Goede /* saving sequence. 2010.06.07. Added by tynli. Suggested by SD3 yschang. */ 3952554c0a3aSHans de Goede if (psmode != PS_MODE_ACTIVE) { 3953554c0a3aSHans de Goede ODM_RF_Saving(&pHalData->odmpriv, true); 3954554c0a3aSHans de Goede } 3955554c0a3aSHans de Goede 3956554c0a3aSHans de Goede /* if (psmode != PS_MODE_ACTIVE) { */ 3957554c0a3aSHans de Goede /* rtl8723b_set_lowpwr_lps_cmd(padapter, true); */ 3958554c0a3aSHans de Goede /* else { */ 3959554c0a3aSHans de Goede /* rtl8723b_set_lowpwr_lps_cmd(padapter, false); */ 3960554c0a3aSHans de Goede /* */ 3961554c0a3aSHans de Goede rtl8723b_set_FwPwrMode_cmd(padapter, psmode); 3962554c0a3aSHans de Goede } 3963554c0a3aSHans de Goede break; 3964554c0a3aSHans de Goede case HW_VAR_H2C_PS_TUNE_PARAM: 3965554c0a3aSHans de Goede rtl8723b_set_FwPsTuneParam_cmd(padapter); 3966554c0a3aSHans de Goede break; 3967554c0a3aSHans de Goede 3968554c0a3aSHans de Goede case HW_VAR_H2C_FW_JOINBSSRPT: 3969554c0a3aSHans de Goede rtl8723b_set_FwJoinBssRpt_cmd(padapter, *val); 3970554c0a3aSHans de Goede break; 3971554c0a3aSHans de Goede 3972554c0a3aSHans de Goede case HW_VAR_INITIAL_GAIN: 3973554c0a3aSHans de Goede { 397486d6c0aeSMarco Cesati struct dig_t *pDigTable = &pHalData->odmpriv.DM_DigTable; 3975554c0a3aSHans de Goede u32 rx_gain = *(u32 *)val; 3976554c0a3aSHans de Goede 3977554c0a3aSHans de Goede if (rx_gain == 0xff) {/* restore rx gain */ 3978554c0a3aSHans de Goede ODM_Write_DIG(&pHalData->odmpriv, pDigTable->BackupIGValue); 3979554c0a3aSHans de Goede } else { 3980554c0a3aSHans de Goede pDigTable->BackupIGValue = pDigTable->CurIGValue; 3981554c0a3aSHans de Goede ODM_Write_DIG(&pHalData->odmpriv, rx_gain); 3982554c0a3aSHans de Goede } 3983554c0a3aSHans de Goede } 3984554c0a3aSHans de Goede break; 3985554c0a3aSHans de Goede 3986554c0a3aSHans de Goede case HW_VAR_EFUSE_USAGE: 3987554c0a3aSHans de Goede pHalData->EfuseUsedPercentage = *val; 3988554c0a3aSHans de Goede break; 3989554c0a3aSHans de Goede 3990554c0a3aSHans de Goede case HW_VAR_EFUSE_BYTES: 3991554c0a3aSHans de Goede pHalData->EfuseUsedBytes = *((u16 *)val); 3992554c0a3aSHans de Goede break; 3993554c0a3aSHans de Goede 3994554c0a3aSHans de Goede case HW_VAR_EFUSE_BT_USAGE: 3995554c0a3aSHans de Goede #ifdef HAL_EFUSE_MEMORY 3996554c0a3aSHans de Goede pHalData->EfuseHal.BTEfuseUsedPercentage = *val; 3997554c0a3aSHans de Goede #endif 3998554c0a3aSHans de Goede break; 3999554c0a3aSHans de Goede 4000554c0a3aSHans de Goede case HW_VAR_EFUSE_BT_BYTES: 4001554c0a3aSHans de Goede #ifdef HAL_EFUSE_MEMORY 4002554c0a3aSHans de Goede pHalData->EfuseHal.BTEfuseUsedBytes = *((u16 *)val); 4003554c0a3aSHans de Goede #else 4004554c0a3aSHans de Goede BTEfuseUsedBytes = *((u16 *)val); 4005554c0a3aSHans de Goede #endif 4006554c0a3aSHans de Goede break; 4007554c0a3aSHans de Goede 4008554c0a3aSHans de Goede case HW_VAR_FIFO_CLEARN_UP: 4009554c0a3aSHans de Goede { 4010554c0a3aSHans de Goede #define RW_RELEASE_EN BIT(18) 4011554c0a3aSHans de Goede #define RXDMA_IDLE BIT(17) 4012554c0a3aSHans de Goede 4013554c0a3aSHans de Goede struct pwrctrl_priv *pwrpriv = adapter_to_pwrctl(padapter); 4014554c0a3aSHans de Goede u8 trycnt = 100; 4015554c0a3aSHans de Goede 4016554c0a3aSHans de Goede /* pause tx */ 4017554c0a3aSHans de Goede rtw_write8(padapter, REG_TXPAUSE, 0xff); 4018554c0a3aSHans de Goede 4019554c0a3aSHans de Goede /* keep sn */ 4020554c0a3aSHans de Goede padapter->xmitpriv.nqos_ssn = rtw_read16(padapter, REG_NQOS_SEQ); 4021554c0a3aSHans de Goede 40227036126aSHariprasad Kelam if (!pwrpriv->bkeepfwalive) { 4023554c0a3aSHans de Goede /* RX DMA stop */ 4024554c0a3aSHans de Goede val32 = rtw_read32(padapter, REG_RXPKT_NUM); 4025554c0a3aSHans de Goede val32 |= RW_RELEASE_EN; 4026554c0a3aSHans de Goede rtw_write32(padapter, REG_RXPKT_NUM, val32); 4027554c0a3aSHans de Goede do { 4028554c0a3aSHans de Goede val32 = rtw_read32(padapter, REG_RXPKT_NUM); 4029554c0a3aSHans de Goede val32 &= RXDMA_IDLE; 4030554c0a3aSHans de Goede if (val32) 4031554c0a3aSHans de Goede break; 4032554c0a3aSHans de Goede 4033554c0a3aSHans de Goede DBG_871X("%s: [HW_VAR_FIFO_CLEARN_UP] val =%x times:%d\n", __func__, val32, trycnt); 4034554c0a3aSHans de Goede } while (--trycnt); 4035554c0a3aSHans de Goede 4036554c0a3aSHans de Goede if (trycnt == 0) { 4037554c0a3aSHans de Goede DBG_8192C("[HW_VAR_FIFO_CLEARN_UP] Stop RX DMA failed......\n"); 4038554c0a3aSHans de Goede } 4039554c0a3aSHans de Goede 4040554c0a3aSHans de Goede /* RQPN Load 0 */ 4041554c0a3aSHans de Goede rtw_write16(padapter, REG_RQPN_NPQ, 0); 4042554c0a3aSHans de Goede rtw_write32(padapter, REG_RQPN, 0x80000000); 4043554c0a3aSHans de Goede mdelay(2); 4044554c0a3aSHans de Goede } 4045554c0a3aSHans de Goede } 4046554c0a3aSHans de Goede break; 4047554c0a3aSHans de Goede 4048554c0a3aSHans de Goede case HW_VAR_APFM_ON_MAC: 4049554c0a3aSHans de Goede pHalData->bMacPwrCtrlOn = *val; 4050554c0a3aSHans de Goede DBG_8192C("%s: bMacPwrCtrlOn =%d\n", __func__, pHalData->bMacPwrCtrlOn); 4051554c0a3aSHans de Goede break; 4052554c0a3aSHans de Goede 4053554c0a3aSHans de Goede case HW_VAR_NAV_UPPER: 4054554c0a3aSHans de Goede { 4055554c0a3aSHans de Goede u32 usNavUpper = *((u32 *)val); 4056554c0a3aSHans de Goede 4057554c0a3aSHans de Goede if (usNavUpper > HAL_NAV_UPPER_UNIT_8723B * 0xFF) { 4058554c0a3aSHans de Goede RT_TRACE(_module_hal_init_c_, _drv_notice_, ("The setting value (0x%08X us) of NAV_UPPER is larger than (%d * 0xFF)!!!\n", usNavUpper, HAL_NAV_UPPER_UNIT_8723B)); 4059554c0a3aSHans de Goede break; 4060554c0a3aSHans de Goede } 4061554c0a3aSHans de Goede 406280741191SWambui Karuga usNavUpper = DIV_ROUND_UP(usNavUpper, 406380741191SWambui Karuga HAL_NAV_UPPER_UNIT_8723B); 4064554c0a3aSHans de Goede rtw_write8(padapter, REG_NAV_UPPER, (u8)usNavUpper); 4065554c0a3aSHans de Goede } 4066554c0a3aSHans de Goede break; 4067554c0a3aSHans de Goede 4068554c0a3aSHans de Goede case HW_VAR_H2C_MEDIA_STATUS_RPT: 4069554c0a3aSHans de Goede { 4070554c0a3aSHans de Goede u16 mstatus_rpt = (*(u16 *)val); 4071554c0a3aSHans de Goede u8 mstatus, macId; 4072554c0a3aSHans de Goede 4073554c0a3aSHans de Goede mstatus = (u8) (mstatus_rpt & 0xFF); 4074554c0a3aSHans de Goede macId = (u8)(mstatus_rpt >> 8); 4075554c0a3aSHans de Goede rtl8723b_set_FwMediaStatusRpt_cmd(padapter, mstatus, macId); 4076554c0a3aSHans de Goede } 4077554c0a3aSHans de Goede break; 4078554c0a3aSHans de Goede case HW_VAR_BCN_VALID: 4079554c0a3aSHans de Goede { 4080554c0a3aSHans de Goede /* BCN_VALID, BIT16 of REG_TDECTRL = BIT0 of REG_TDECTRL+2, write 1 to clear, Clear by sw */ 4081554c0a3aSHans de Goede val8 = rtw_read8(padapter, REG_TDECTRL+2); 4082554c0a3aSHans de Goede val8 |= BIT(0); 4083554c0a3aSHans de Goede rtw_write8(padapter, REG_TDECTRL+2, val8); 4084554c0a3aSHans de Goede } 4085554c0a3aSHans de Goede break; 4086554c0a3aSHans de Goede 4087554c0a3aSHans de Goede case HW_VAR_DL_BCN_SEL: 4088554c0a3aSHans de Goede { 4089554c0a3aSHans de Goede /* SW_BCN_SEL - Port0 */ 4090554c0a3aSHans de Goede val8 = rtw_read8(padapter, REG_DWBCN1_CTRL_8723B+2); 4091554c0a3aSHans de Goede val8 &= ~BIT(4); 4092554c0a3aSHans de Goede rtw_write8(padapter, REG_DWBCN1_CTRL_8723B+2, val8); 4093554c0a3aSHans de Goede } 4094554c0a3aSHans de Goede break; 4095554c0a3aSHans de Goede 4096554c0a3aSHans de Goede case HW_VAR_DO_IQK: 4097554c0a3aSHans de Goede pHalData->bNeedIQK = true; 4098554c0a3aSHans de Goede break; 4099554c0a3aSHans de Goede 4100554c0a3aSHans de Goede case HW_VAR_DL_RSVD_PAGE: 4101554c0a3aSHans de Goede if (check_fwstate(&padapter->mlmepriv, WIFI_AP_STATE) == true) 4102554c0a3aSHans de Goede rtl8723b_download_BTCoex_AP_mode_rsvd_page(padapter); 4103554c0a3aSHans de Goede else 4104554c0a3aSHans de Goede rtl8723b_download_rsvd_page(padapter, RT_MEDIA_CONNECT); 4105554c0a3aSHans de Goede break; 4106554c0a3aSHans de Goede 4107554c0a3aSHans de Goede case HW_VAR_MACID_SLEEP: 4108554c0a3aSHans de Goede /* Input is MACID */ 4109554c0a3aSHans de Goede val32 = *(u32 *)val; 4110554c0a3aSHans de Goede if (val32 > 31) { 4111554c0a3aSHans de Goede DBG_8192C(FUNC_ADPT_FMT ": [HW_VAR_MACID_SLEEP] Invalid macid(%d)\n", 4112554c0a3aSHans de Goede FUNC_ADPT_ARG(padapter), val32); 4113554c0a3aSHans de Goede break; 4114554c0a3aSHans de Goede } 4115554c0a3aSHans de Goede val8 = (u8)val32; /* macid is between 0~31 */ 4116554c0a3aSHans de Goede 4117554c0a3aSHans de Goede val32 = rtw_read32(padapter, REG_MACID_SLEEP); 4118554c0a3aSHans de Goede DBG_8192C(FUNC_ADPT_FMT ": [HW_VAR_MACID_SLEEP] macid =%d, org MACID_SLEEP = 0x%08X\n", 4119554c0a3aSHans de Goede FUNC_ADPT_ARG(padapter), val8, val32); 4120554c0a3aSHans de Goede if (val32 & BIT(val8)) 4121554c0a3aSHans de Goede break; 4122554c0a3aSHans de Goede val32 |= BIT(val8); 4123554c0a3aSHans de Goede rtw_write32(padapter, REG_MACID_SLEEP, val32); 4124554c0a3aSHans de Goede break; 4125554c0a3aSHans de Goede 4126554c0a3aSHans de Goede case HW_VAR_MACID_WAKEUP: 4127554c0a3aSHans de Goede /* Input is MACID */ 4128554c0a3aSHans de Goede val32 = *(u32 *)val; 4129554c0a3aSHans de Goede if (val32 > 31) { 4130554c0a3aSHans de Goede DBG_8192C(FUNC_ADPT_FMT ": [HW_VAR_MACID_WAKEUP] Invalid macid(%d)\n", 4131554c0a3aSHans de Goede FUNC_ADPT_ARG(padapter), val32); 4132554c0a3aSHans de Goede break; 4133554c0a3aSHans de Goede } 4134554c0a3aSHans de Goede val8 = (u8)val32; /* macid is between 0~31 */ 4135554c0a3aSHans de Goede 4136554c0a3aSHans de Goede val32 = rtw_read32(padapter, REG_MACID_SLEEP); 4137554c0a3aSHans de Goede DBG_8192C(FUNC_ADPT_FMT ": [HW_VAR_MACID_WAKEUP] macid =%d, org MACID_SLEEP = 0x%08X\n", 4138554c0a3aSHans de Goede FUNC_ADPT_ARG(padapter), val8, val32); 4139554c0a3aSHans de Goede if (!(val32 & BIT(val8))) 4140554c0a3aSHans de Goede break; 4141554c0a3aSHans de Goede val32 &= ~BIT(val8); 4142554c0a3aSHans de Goede rtw_write32(padapter, REG_MACID_SLEEP, val32); 4143554c0a3aSHans de Goede break; 4144554c0a3aSHans de Goede 4145554c0a3aSHans de Goede default: 4146554c0a3aSHans de Goede SetHwReg(padapter, variable, val); 4147554c0a3aSHans de Goede break; 4148554c0a3aSHans de Goede } 4149554c0a3aSHans de Goede } 4150554c0a3aSHans de Goede 4151554c0a3aSHans de Goede void GetHwReg8723B(struct adapter *padapter, u8 variable, u8 *val) 4152554c0a3aSHans de Goede { 4153554c0a3aSHans de Goede struct hal_com_data *pHalData = GET_HAL_DATA(padapter); 4154554c0a3aSHans de Goede u8 val8; 4155554c0a3aSHans de Goede u16 val16; 4156554c0a3aSHans de Goede 4157554c0a3aSHans de Goede switch (variable) { 4158554c0a3aSHans de Goede case HW_VAR_TXPAUSE: 4159554c0a3aSHans de Goede *val = rtw_read8(padapter, REG_TXPAUSE); 4160554c0a3aSHans de Goede break; 4161554c0a3aSHans de Goede 4162554c0a3aSHans de Goede case HW_VAR_BCN_VALID: 4163554c0a3aSHans de Goede { 4164554c0a3aSHans de Goede /* BCN_VALID, BIT16 of REG_TDECTRL = BIT0 of REG_TDECTRL+2 */ 4165554c0a3aSHans de Goede val8 = rtw_read8(padapter, REG_TDECTRL+2); 4166554c0a3aSHans de Goede *val = (BIT(0) & val8) ? true : false; 4167554c0a3aSHans de Goede } 4168554c0a3aSHans de Goede break; 4169554c0a3aSHans de Goede 4170554c0a3aSHans de Goede case HW_VAR_FWLPS_RF_ON: 4171554c0a3aSHans de Goede { 4172554c0a3aSHans de Goede /* When we halt NIC, we should check if FW LPS is leave. */ 4173554c0a3aSHans de Goede u32 valRCR; 4174554c0a3aSHans de Goede 4175554c0a3aSHans de Goede if ( 41767036126aSHariprasad Kelam padapter->bSurpriseRemoved || 4177554c0a3aSHans de Goede (adapter_to_pwrctl(padapter)->rf_pwrstate == rf_off) 4178554c0a3aSHans de Goede ) { 4179554c0a3aSHans de Goede /* If it is in HW/SW Radio OFF or IPS state, we do not check Fw LPS Leave, */ 4180554c0a3aSHans de Goede /* because Fw is unload. */ 4181554c0a3aSHans de Goede *val = true; 4182554c0a3aSHans de Goede } else { 4183554c0a3aSHans de Goede valRCR = rtw_read32(padapter, REG_RCR); 4184554c0a3aSHans de Goede valRCR &= 0x00070000; 4185554c0a3aSHans de Goede if (valRCR) 4186554c0a3aSHans de Goede *val = false; 4187554c0a3aSHans de Goede else 4188554c0a3aSHans de Goede *val = true; 4189554c0a3aSHans de Goede } 4190554c0a3aSHans de Goede } 4191554c0a3aSHans de Goede break; 4192554c0a3aSHans de Goede 4193554c0a3aSHans de Goede case HW_VAR_EFUSE_USAGE: 4194554c0a3aSHans de Goede *val = pHalData->EfuseUsedPercentage; 4195554c0a3aSHans de Goede break; 4196554c0a3aSHans de Goede 4197554c0a3aSHans de Goede case HW_VAR_EFUSE_BYTES: 4198554c0a3aSHans de Goede *((u16 *)val) = pHalData->EfuseUsedBytes; 4199554c0a3aSHans de Goede break; 4200554c0a3aSHans de Goede 4201554c0a3aSHans de Goede case HW_VAR_EFUSE_BT_USAGE: 4202554c0a3aSHans de Goede #ifdef HAL_EFUSE_MEMORY 4203554c0a3aSHans de Goede *val = pHalData->EfuseHal.BTEfuseUsedPercentage; 4204554c0a3aSHans de Goede #endif 4205554c0a3aSHans de Goede break; 4206554c0a3aSHans de Goede 4207554c0a3aSHans de Goede case HW_VAR_EFUSE_BT_BYTES: 4208554c0a3aSHans de Goede #ifdef HAL_EFUSE_MEMORY 4209554c0a3aSHans de Goede *((u16 *)val) = pHalData->EfuseHal.BTEfuseUsedBytes; 4210554c0a3aSHans de Goede #else 4211554c0a3aSHans de Goede *((u16 *)val) = BTEfuseUsedBytes; 4212554c0a3aSHans de Goede #endif 4213554c0a3aSHans de Goede break; 4214554c0a3aSHans de Goede 4215554c0a3aSHans de Goede case HW_VAR_APFM_ON_MAC: 4216554c0a3aSHans de Goede *val = pHalData->bMacPwrCtrlOn; 4217554c0a3aSHans de Goede break; 4218554c0a3aSHans de Goede case HW_VAR_CHK_HI_QUEUE_EMPTY: 4219554c0a3aSHans de Goede val16 = rtw_read16(padapter, REG_TXPKT_EMPTY); 4220554c0a3aSHans de Goede *val = (val16 & BIT(10)) ? true:false; 4221554c0a3aSHans de Goede break; 4222554c0a3aSHans de Goede default: 4223554c0a3aSHans de Goede GetHwReg(padapter, variable, val); 4224554c0a3aSHans de Goede break; 4225554c0a3aSHans de Goede } 4226554c0a3aSHans de Goede } 4227554c0a3aSHans de Goede 42284d17363dSAndreas Hellmich /* Description: 4229554c0a3aSHans de Goede * Change default setting of specified variable. 4230554c0a3aSHans de Goede */ 42310ba38840SMarco Cesati u8 SetHalDefVar8723B(struct adapter *padapter, enum hal_def_variable variable, void *pval) 4232554c0a3aSHans de Goede { 4233554c0a3aSHans de Goede u8 bResult; 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