1 /*
2  * Copyright 2013 Red Hat Inc.
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20  * OTHER DEALINGS IN THE SOFTWARE.
21  *
22  * Authors: Ben Skeggs <bskeggs@redhat.com>
23  */
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25 
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28 
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30  * PGRAPH context register lists
31  ******************************************************************************/
32 
33 static const struct gf100_gr_init
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220 	{ 0x000809,   1, 0x01, 0x00000007 },
221 	{ 0x00c221,   1, 0x01, 0x00000040 },
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225 	{ 0x00c401,   1, 0x01, 0x00000001 },
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274 	{}
275 };
276 
277 const struct gf100_gr_pack
278 gk104_grctx_pack_icmd[] = {
279 	{ gk104_grctx_init_icmd_0 },
280 	{}
281 };
282 
283 const struct gf100_gr_init
284 gk104_grctx_init_a097_0[] = {
285 	{ 0x000800,   8, 0x40, 0x00000000 },
286 	{ 0x000804,   8, 0x40, 0x00000000 },
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289 	{ 0x000810,   1, 0x04, 0x000000cf },
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292 	{ 0x000818,   8, 0x40, 0x00000001 },
293 	{ 0x00081c,   8, 0x40, 0x00000000 },
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298 	{ 0x001c0c,  16, 0x10, 0x00000000 },
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300 	{ 0x001d04,  16, 0x10, 0x00000000 },
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310 	{ 0x0020c0,   1, 0x04, 0x00000030 },
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323 	{ 0x00038c,   4, 0x20, 0x00000000 },
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339 	{ 0x000d04,   8, 0x08, 0xffff0000 },
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341 	{ 0x000e04,  16, 0x10, 0xffff0000 },
342 	{ 0x000e08,  16, 0x10, 0xffff0000 },
343 	{ 0x000d40,   4, 0x08, 0x00000000 },
344 	{ 0x000d44,   4, 0x08, 0x00000000 },
345 	{ 0x001e00,   8, 0x20, 0x00000001 },
346 	{ 0x001e04,   8, 0x20, 0x00000001 },
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348 	{ 0x001e0c,   8, 0x20, 0x00000001 },
349 	{ 0x001e10,   8, 0x20, 0x00000001 },
350 	{ 0x001e14,   8, 0x20, 0x00000002 },
351 	{ 0x001e18,   8, 0x20, 0x00000001 },
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363 	{ 0x000ff0,   1, 0x04, 0x00000000 },
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365 	{ 0x001228,   1, 0x04, 0x00000400 },
366 	{ 0x00122c,   1, 0x04, 0x00000300 },
367 	{ 0x001230,   1, 0x04, 0x00010001 },
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370 	{ 0x0015cc,   1, 0x04, 0x00000000 },
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372 	{ 0x000fb0,   1, 0x04, 0x00000000 },
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391 	{ 0x0017dc,   1, 0x04, 0x00000000 },
392 	{ 0x0015f4,   2, 0x04, 0x00000000 },
393 	{ 0x001434,   2, 0x04, 0x00000000 },
394 	{ 0x000d74,   1, 0x04, 0x00000000 },
395 	{ 0x000dec,   1, 0x04, 0x00000001 },
396 	{ 0x0013a4,   1, 0x04, 0x00000000 },
397 	{ 0x001318,   1, 0x04, 0x00000001 },
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399 	{ 0x000748,   1, 0x04, 0x00000000 },
400 	{ 0x000de8,   1, 0x04, 0x00000000 },
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403 	{ 0x001120,   4, 0x04, 0x00000000 },
404 	{ 0x001118,   1, 0x04, 0x00000000 },
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406 	{ 0x001658,   1, 0x04, 0x00000000 },
407 	{ 0x001910,   1, 0x04, 0x00000290 },
408 	{ 0x001518,   1, 0x04, 0x00000000 },
409 	{ 0x00165c,   1, 0x04, 0x00000001 },
410 	{ 0x001520,   1, 0x04, 0x00000000 },
411 	{ 0x001604,   1, 0x04, 0x00000000 },
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624 	{ 0x404680,   8, 0x04, 0x00000000 },
625 	{ 0x4046a0,   1, 0x04, 0x007f0080 },
626 	{ 0x4046a4,   8, 0x04, 0x00000000 },
627 	{ 0x4046c8,   3, 0x04, 0x00000000 },
628 	{ 0x404700,   3, 0x04, 0x00000000 },
629 	{ 0x404718,   7, 0x04, 0x00000000 },
630 	{ 0x404734,   1, 0x04, 0x00000100 },
631 	{ 0x404738,   2, 0x04, 0x00000000 },
632 	{ 0x404744,   2, 0x04, 0x00000000 },
633 	{ 0x404754,   1, 0x04, 0x00000000 },
634 	{}
635 };
636 
637 const struct gf100_gr_init
638 gk104_grctx_init_ds_0[] = {
639 	{ 0x405800,   1, 0x04, 0x0f8000bf },
640 	{ 0x405830,   1, 0x04, 0x02180648 },
641 	{ 0x405834,   1, 0x04, 0x08000000 },
642 	{ 0x405838,   1, 0x04, 0x00000000 },
643 	{ 0x405854,   1, 0x04, 0x00000000 },
644 	{ 0x405870,   4, 0x04, 0x00000001 },
645 	{ 0x405a00,   2, 0x04, 0x00000000 },
646 	{ 0x405a18,   1, 0x04, 0x00000000 },
647 	{}
648 };
649 
650 static const struct gf100_gr_init
651 gk104_grctx_init_cwd_0[] = {
652 	{ 0x405b00,   1, 0x04, 0x00000000 },
653 	{ 0x405b10,   1, 0x04, 0x00001000 },
654 	{}
655 };
656 
657 static const struct gf100_gr_init
658 gk104_grctx_init_pd_0[] = {
659 	{ 0x406020,   1, 0x04, 0x004103c1 },
660 	{ 0x406028,   4, 0x04, 0x00000001 },
661 	{ 0x4064a8,   1, 0x04, 0x00000000 },
662 	{ 0x4064ac,   1, 0x04, 0x00003fff },
663 	{ 0x4064b4,   2, 0x04, 0x00000000 },
664 	{ 0x4064c0,   1, 0x04, 0x801a00f0 },
665 	{ 0x4064c4,   1, 0x04, 0x0192ffff },
666 	{ 0x4064c8,   1, 0x04, 0x01800600 },
667 	{ 0x4064cc,   9, 0x04, 0x00000000 },
668 	{ 0x4064fc,   1, 0x04, 0x0000022a },
669 	{}
670 };
671 
672 static const struct gf100_gr_init
673 gk104_grctx_init_sked_0[] = {
674 	{ 0x407040,   1, 0x04, 0x00000000 },
675 	{}
676 };
677 
678 const struct gf100_gr_init
679 gk104_grctx_init_scc_0[] = {
680 	{ 0x408000,   2, 0x04, 0x00000000 },
681 	{ 0x408008,   1, 0x04, 0x00000030 },
682 	{ 0x40800c,   2, 0x04, 0x00000000 },
683 	{ 0x408014,   1, 0x04, 0x00000069 },
684 	{ 0x408018,   1, 0x04, 0xe100e100 },
685 	{ 0x408064,   1, 0x04, 0x00000000 },
686 	{}
687 };
688 
689 static const struct gf100_gr_init
690 gk104_grctx_init_be_0[] = {
691 	{ 0x408800,   1, 0x04, 0x02802a3c },
692 	{ 0x408804,   1, 0x04, 0x00000040 },
693 	{ 0x408808,   1, 0x04, 0x1043e005 },
694 	{ 0x408840,   1, 0x04, 0x0000000b },
695 	{ 0x408900,   1, 0x04, 0x3080b801 },
696 	{ 0x408904,   1, 0x04, 0x62000001 },
697 	{ 0x408908,   1, 0x04, 0x00c8102f },
698 	{ 0x408980,   1, 0x04, 0x0000011d },
699 	{}
700 };
701 
702 const struct gf100_gr_pack
703 gk104_grctx_pack_hub[] = {
704 	{ gf100_grctx_init_main_0 },
705 	{ gk104_grctx_init_fe_0 },
706 	{ gf100_grctx_init_pri_0 },
707 	{ gk104_grctx_init_memfmt_0 },
708 	{ gk104_grctx_init_ds_0 },
709 	{ gk104_grctx_init_cwd_0 },
710 	{ gk104_grctx_init_pd_0 },
711 	{ gk104_grctx_init_sked_0 },
712 	{ gf100_grctx_init_rstr2d_0 },
713 	{ gk104_grctx_init_scc_0 },
714 	{ gk104_grctx_init_be_0 },
715 	{}
716 };
717 
718 static const struct gf100_gr_init
719 gk104_grctx_init_setup_0[] = {
720 	{ 0x418800,   1, 0x04, 0x7006860a },
721 	{ 0x418808,   3, 0x04, 0x00000000 },
722 	{ 0x418828,   1, 0x04, 0x00000044 },
723 	{ 0x418830,   1, 0x04, 0x10000001 },
724 	{ 0x4188d8,   1, 0x04, 0x00000008 },
725 	{ 0x4188e0,   1, 0x04, 0x01000000 },
726 	{ 0x4188e8,   5, 0x04, 0x00000000 },
727 	{ 0x4188fc,   1, 0x04, 0x20100018 },
728 	{}
729 };
730 
731 const struct gf100_gr_init
732 gk104_grctx_init_gpm_0[] = {
733 	{ 0x418c08,   1, 0x04, 0x00000001 },
734 	{ 0x418c10,   8, 0x04, 0x00000000 },
735 	{ 0x418c40,   1, 0x04, 0xffffffff },
736 	{ 0x418c6c,   1, 0x04, 0x00000001 },
737 	{ 0x418c80,   1, 0x04, 0x20200004 },
738 	{ 0x418c8c,   1, 0x04, 0x00000001 },
739 	{}
740 };
741 
742 static const struct gf100_gr_pack
743 gk104_grctx_pack_gpc_0[] = {
744 	{ gf100_grctx_init_gpc_unk_0 },
745 	{ gf119_grctx_init_prop_0 },
746 	{ gf119_grctx_init_gpc_unk_1 },
747 	{ gk104_grctx_init_setup_0 },
748 	{ gf100_grctx_init_zcull_0 },
749 	{}
750 };
751 
752 static const struct gf100_gr_pack
753 gk104_grctx_pack_gpc_1[] = {
754 	{ gf119_grctx_init_crstr_0 },
755 	{ gk104_grctx_init_gpm_0 },
756 	{ gf100_grctx_init_gcc_0 },
757 	{}
758 };
759 
760 static const struct gf100_gr_init
761 gk104_grctx_init_tex_0[] = {
762 	{ 0x419a00,   1, 0x04, 0x000000f0 },
763 	{ 0x419a04,   1, 0x04, 0x00000001 },
764 	{ 0x419a08,   1, 0x04, 0x00000021 },
765 	{ 0x419a0c,   1, 0x04, 0x00020000 },
766 	{ 0x419a10,   1, 0x04, 0x00000000 },
767 	{ 0x419a14,   1, 0x04, 0x00000200 },
768 	{ 0x419a1c,   1, 0x04, 0x0000c000 },
769 	{ 0x419a20,   1, 0x04, 0x00000800 },
770 	{ 0x419a30,   1, 0x04, 0x00000001 },
771 	{ 0x419ac4,   1, 0x04, 0x0037f440 },
772 	{}
773 };
774 
775 static const struct gf100_gr_init
776 gk104_grctx_init_mpc_0[] = {
777 	{ 0x419c00,   1, 0x04, 0x0000000a },
778 	{ 0x419c04,   1, 0x04, 0x80000006 },
779 	{ 0x419c08,   1, 0x04, 0x00000002 },
780 	{ 0x419c20,   1, 0x04, 0x00000000 },
781 	{ 0x419c24,   1, 0x04, 0x00084210 },
782 	{ 0x419c28,   1, 0x04, 0x3efbefbe },
783 	{}
784 };
785 
786 static const struct gf100_gr_init
787 gk104_grctx_init_l1c_0[] = {
788 	{ 0x419ce8,   1, 0x04, 0x00000000 },
789 	{ 0x419cf4,   1, 0x04, 0x00003203 },
790 	{}
791 };
792 
793 static const struct gf100_gr_init
794 gk104_grctx_init_sm_0[] = {
795 	{ 0x419e04,   3, 0x04, 0x00000000 },
796 	{ 0x419e10,   1, 0x04, 0x00000402 },
797 	{ 0x419e44,   1, 0x04, 0x0013eff2 },
798 	{ 0x419e48,   1, 0x04, 0x00000000 },
799 	{ 0x419e4c,   1, 0x04, 0x0000007f },
800 	{ 0x419e50,  19, 0x04, 0x00000000 },
801 	{ 0x419eac,   1, 0x04, 0x00001f8f },
802 	{ 0x419eb0,   1, 0x04, 0x00000d3f },
803 	{ 0x419ec8,   1, 0x04, 0x0001304f },
804 	{ 0x419f30,   8, 0x04, 0x00000000 },
805 	{ 0x419f58,   1, 0x04, 0x00000000 },
806 	{ 0x419f70,   1, 0x04, 0x00000000 },
807 	{ 0x419f78,   1, 0x04, 0x0000000b },
808 	{ 0x419f7c,   1, 0x04, 0x0000027c },
809 	{}
810 };
811 
812 const struct gf100_gr_pack
813 gk104_grctx_pack_tpc[] = {
814 	{ gf117_grctx_init_pe_0 },
815 	{ gk104_grctx_init_tex_0 },
816 	{ gk104_grctx_init_mpc_0 },
817 	{ gk104_grctx_init_l1c_0 },
818 	{ gk104_grctx_init_sm_0 },
819 	{}
820 };
821 
822 const struct gf100_gr_init
823 gk104_grctx_init_pes_0[] = {
824 	{ 0x41be24,   1, 0x04, 0x00000006 },
825 	{}
826 };
827 
828 static const struct gf100_gr_init
829 gk104_grctx_init_cbm_0[] = {
830 	{ 0x41bec0,   1, 0x04, 0x12180000 },
831 	{ 0x41bec4,   1, 0x04, 0x00037f7f },
832 	{ 0x41bee4,   1, 0x04, 0x06480430 },
833 	{}
834 };
835 
836 const struct gf100_gr_pack
837 gk104_grctx_pack_ppc[] = {
838 	{ gk104_grctx_init_pes_0 },
839 	{ gk104_grctx_init_cbm_0 },
840 	{ gf117_grctx_init_wwdx_0 },
841 	{}
842 };
843 
844 /*******************************************************************************
845  * PGRAPH context implementation
846  ******************************************************************************/
847 
848 void
849 gk104_grctx_generate_r418800(struct gf100_gr *gr)
850 {
851 	struct nvkm_device *device = gr->base.engine.subdev.device;
852 	/*XXX: Not real sure where to apply these, there doesn't seem
853 	 *     to be any pattern to which chipsets it's done on.
854 	 *
855 	 *     Perhaps a VBIOS tweak?
856 	 */
857 	if (0) {
858 		nvkm_mask(device, 0x418800, 0x00200000, 0x00200000);
859 		nvkm_mask(device, 0x41be10, 0x00800000, 0x00800000);
860 	}
861 }
862 
863 void
864 gk104_grctx_generate_patch_ltc(struct gf100_grctx *info)
865 {
866 	struct nvkm_device *device = info->gr->base.engine.subdev.device;
867 	u32 data0 = nvkm_rd32(device, 0x17e91c);
868 	u32 data1 = nvkm_rd32(device, 0x17e920);
869 	/*XXX: Figure out how to modify this correctly! */
870 	mmio_wr32(info, 0x17e91c, data0);
871 	mmio_wr32(info, 0x17e920, data1);
872 }
873 
874 void
875 gk104_grctx_generate_bundle(struct gf100_grctx *info)
876 {
877 	const struct gf100_grctx_func *grctx = info->gr->func->grctx;
878 	const u32 state_limit = min(grctx->bundle_min_gpm_fifo_depth,
879 				    grctx->bundle_size / 0x20);
880 	const u32 token_limit = grctx->bundle_token_limit;
881 	const int s = 8;
882 	const int b = mmio_vram(info, grctx->bundle_size, (1 << s), true);
883 	mmio_refn(info, 0x408004, 0x00000000, s, b);
884 	mmio_wr32(info, 0x408008, 0x80000000 | (grctx->bundle_size >> s));
885 	mmio_refn(info, 0x418808, 0x00000000, s, b);
886 	mmio_wr32(info, 0x41880c, 0x80000000 | (grctx->bundle_size >> s));
887 	mmio_wr32(info, 0x4064c8, (state_limit << 16) | token_limit);
888 }
889 
890 void
891 gk104_grctx_generate_pagepool(struct gf100_grctx *info)
892 {
893 	const struct gf100_grctx_func *grctx = info->gr->func->grctx;
894 	const int s = 8;
895 	const int b = mmio_vram(info, grctx->pagepool_size, (1 << s), true);
896 	mmio_refn(info, 0x40800c, 0x00000000, s, b);
897 	mmio_wr32(info, 0x408010, 0x80000000);
898 	mmio_refn(info, 0x419004, 0x00000000, s, b);
899 	mmio_wr32(info, 0x419008, 0x00000000);
900 	mmio_wr32(info, 0x4064cc, 0x80000000);
901 }
902 
903 void
904 gk104_grctx_generate_unkn(struct gf100_gr *gr)
905 {
906 	struct nvkm_device *device = gr->base.engine.subdev.device;
907 	nvkm_mask(device, 0x418c6c, 0x00000001, 0x00000001);
908 	nvkm_mask(device, 0x41980c, 0x00000010, 0x00000010);
909 	nvkm_mask(device, 0x41be08, 0x00000004, 0x00000004);
910 	nvkm_mask(device, 0x4064c0, 0x80000000, 0x80000000);
911 	nvkm_mask(device, 0x405800, 0x08000000, 0x08000000);
912 	nvkm_mask(device, 0x419c00, 0x00000008, 0x00000008);
913 }
914 
915 static void
916 gk104_grctx_generate_r419f78(struct gf100_gr *gr)
917 {
918 	struct nvkm_device *device = gr->base.engine.subdev.device;
919 	nvkm_mask(device, 0x419f78, 0x00000001, 0x00000000);
920 }
921 
922 void
923 gk104_grctx_generate_gpc_tpc_nr(struct gf100_gr *gr)
924 {
925 	struct nvkm_device *device = gr->base.engine.subdev.device;
926 	nvkm_wr32(device, 0x405b00, (gr->tpc_total << 8) | gr->gpc_nr);
927 }
928 
929 void
930 gk104_grctx_generate_alpha_beta_tables(struct gf100_gr *gr)
931 {
932 	struct nvkm_device *device = gr->base.engine.subdev.device;
933 	int i, j, gpc, ppc;
934 
935 	for (i = 0; i < 32; i++) {
936 		u32 atarget = max_t(u32, gr->tpc_total * i / 32, 1);
937 		u32 btarget = gr->tpc_total - atarget;
938 		bool alpha = atarget < btarget;
939 		u64 amask = 0, bmask = 0;
940 
941 		for (gpc = 0; gpc < gr->gpc_nr; gpc++) {
942 			for (ppc = 0; ppc < gr->func->ppc_nr; ppc++) {
943 				u32 ppc_tpcs = gr->ppc_tpc_nr[gpc][ppc];
944 				u32 abits, bbits, pmask;
945 
946 				if (alpha) {
947 					abits = atarget ? ppc_tpcs : 0;
948 					bbits = ppc_tpcs - abits;
949 				} else {
950 					bbits = btarget ? ppc_tpcs : 0;
951 					abits = ppc_tpcs - bbits;
952 				}
953 
954 				pmask = gr->ppc_tpc_mask[gpc][ppc];
955 				while (ppc_tpcs-- > abits)
956 					pmask &= pmask - 1;
957 				amask |= (u64)pmask << (gpc * 8);
958 
959 				pmask ^= gr->ppc_tpc_mask[gpc][ppc];
960 				bmask |= (u64)pmask << (gpc * 8);
961 
962 				atarget -= min(abits, atarget);
963 				btarget -= min(bbits, btarget);
964 				if ((abits > 0) || (bbits > 0))
965 					alpha = !alpha;
966 			}
967 		}
968 
969 		for (j = 0; j < gr->gpc_nr; j += 4, amask >>= 32, bmask >>= 32) {
970 			nvkm_wr32(device, 0x406800 + (i * 0x20) + j, amask);
971 			nvkm_wr32(device, 0x406c00 + (i * 0x20) + j, bmask);
972 		}
973 	}
974 }
975 
976 const struct gf100_grctx_func
977 gk104_grctx = {
978 	.main  = gf100_grctx_generate_main,
979 	.unkn  = gk104_grctx_generate_unkn,
980 	.hub   = gk104_grctx_pack_hub,
981 	.gpc_0 = gk104_grctx_pack_gpc_0,
982 	.gpc_1 = gk104_grctx_pack_gpc_1,
983 	.zcull = gf100_grctx_pack_zcull,
984 	.tpc   = gk104_grctx_pack_tpc,
985 	.ppc   = gk104_grctx_pack_ppc,
986 	.icmd  = gk104_grctx_pack_icmd,
987 	.mthd  = gk104_grctx_pack_mthd,
988 	.bundle = gk104_grctx_generate_bundle,
989 	.bundle_size = 0x3000,
990 	.bundle_min_gpm_fifo_depth = 0x180,
991 	.bundle_token_limit = 0x600,
992 	.pagepool = gk104_grctx_generate_pagepool,
993 	.pagepool_size = 0x8000,
994 	.attrib = gf117_grctx_generate_attrib,
995 	.attrib_nr_max = 0x324,
996 	.attrib_nr = 0x218,
997 	.alpha_nr_max = 0x7ff,
998 	.alpha_nr = 0x648,
999 	.patch_ltc = gk104_grctx_generate_patch_ltc,
1000 	.sm_id = gf100_grctx_generate_sm_id,
1001 	.tpc_nr = gf100_grctx_generate_tpc_nr,
1002 	.rop_mapping = gf117_grctx_generate_rop_mapping,
1003 	.alpha_beta_tables = gk104_grctx_generate_alpha_beta_tables,
1004 	.dist_skip_table = gf117_grctx_generate_dist_skip_table,
1005 	.gpc_tpc_nr = gk104_grctx_generate_gpc_tpc_nr,
1006 	.r419f78 = gk104_grctx_generate_r419f78,
1007 	.r418800 = gk104_grctx_generate_r418800,
1008 };
1009