1 /*
2  * Copyright 2010 Red Hat Inc.
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20  * OTHER DEALINGS IN THE SOFTWARE.
21  *
22  * Authors: Ben Skeggs
23  */
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25 
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29 
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31  * PGRAPH context register lists
32  ******************************************************************************/
33 
34 static const struct gf100_gr_init
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220 	{ 0x00080f,   1, 0x01, 0x00000001 },
221 	{ 0x000823,   1, 0x01, 0x00000002 },
222 	{ 0x000824,   2, 0x01, 0x00000100 },
223 	{ 0x000826,   1, 0x01, 0x00000001 },
224 	{ 0x00095d,   1, 0x01, 0x00000001 },
225 	{ 0x00082b,   1, 0x01, 0x00000004 },
226 	{ 0x000942,   1, 0x01, 0x00010001 },
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229 	{ 0x0007c5,   1, 0x01, 0x00010001 },
230 	{ 0x000834,   1, 0x01, 0x00000001 },
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268 	{ 0x01e100,   1, 0x01, 0x00000001 },
269 	{}
270 };
271 
272 const struct gf100_gr_pack
273 gf100_grctx_pack_icmd[] = {
274 	{ gf100_grctx_init_icmd_0 },
275 	{}
276 };
277 
278 static const struct gf100_gr_init
279 gf100_grctx_init_9097_0[] = {
280 	{ 0x000800,   8, 0x40, 0x00000000 },
281 	{ 0x000804,   8, 0x40, 0x00000000 },
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283 	{ 0x00080c,   8, 0x40, 0x00000300 },
284 	{ 0x000810,   1, 0x04, 0x000000cf },
285 	{ 0x000850,   7, 0x40, 0x00000000 },
286 	{ 0x000814,   8, 0x40, 0x00000040 },
287 	{ 0x000818,   8, 0x40, 0x00000001 },
288 	{ 0x00081c,   8, 0x40, 0x00000000 },
289 	{ 0x000820,   8, 0x40, 0x00000000 },
290 	{ 0x002700,   8, 0x20, 0x00000000 },
291 	{ 0x002704,   8, 0x20, 0x00000000 },
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293 	{ 0x00270c,   8, 0x20, 0x00000000 },
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299 	{ 0x001c0c,  16, 0x10, 0x00000000 },
300 	{ 0x001d00,  16, 0x10, 0x00000000 },
301 	{ 0x001d04,  16, 0x10, 0x00000000 },
302 	{ 0x001d08,  16, 0x10, 0x00000000 },
303 	{ 0x001d0c,  16, 0x10, 0x00000000 },
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305 	{ 0x001f04,  16, 0x08, 0x00000000 },
306 	{ 0x001f80,  16, 0x08, 0x00000000 },
307 	{ 0x001f84,  16, 0x08, 0x00000000 },
308 	{ 0x002200,   5, 0x10, 0x00000022 },
309 	{ 0x002000,   1, 0x04, 0x00000000 },
310 	{ 0x002040,   1, 0x04, 0x00000011 },
311 	{ 0x002080,   1, 0x04, 0x00000020 },
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313 	{ 0x002100,   1, 0x04, 0x00000040 },
314 	{ 0x002140,   1, 0x04, 0x00000051 },
315 	{ 0x00200c,   6, 0x40, 0x00000001 },
316 	{ 0x002010,   1, 0x04, 0x00000000 },
317 	{ 0x002050,   1, 0x04, 0x00000000 },
318 	{ 0x002090,   1, 0x04, 0x00000001 },
319 	{ 0x0020d0,   1, 0x04, 0x00000002 },
320 	{ 0x002110,   1, 0x04, 0x00000003 },
321 	{ 0x002150,   1, 0x04, 0x00000004 },
322 	{ 0x000380,   4, 0x20, 0x00000000 },
323 	{ 0x000384,   4, 0x20, 0x00000000 },
324 	{ 0x000388,   4, 0x20, 0x00000000 },
325 	{ 0x00038c,   4, 0x20, 0x00000000 },
326 	{ 0x000700,   4, 0x10, 0x00000000 },
327 	{ 0x000704,   4, 0x10, 0x00000000 },
328 	{ 0x000708,   4, 0x10, 0x00000000 },
329 	{ 0x002800, 128, 0x04, 0x00000000 },
330 	{ 0x000a00,  16, 0x20, 0x00000000 },
331 	{ 0x000a04,  16, 0x20, 0x00000000 },
332 	{ 0x000a08,  16, 0x20, 0x00000000 },
333 	{ 0x000a0c,  16, 0x20, 0x00000000 },
334 	{ 0x000a10,  16, 0x20, 0x00000000 },
335 	{ 0x000a14,  16, 0x20, 0x00000000 },
336 	{ 0x000c00,  16, 0x10, 0x00000000 },
337 	{ 0x000c04,  16, 0x10, 0x00000000 },
338 	{ 0x000c08,  16, 0x10, 0x00000000 },
339 	{ 0x000c0c,  16, 0x10, 0x3f800000 },
340 	{ 0x000d00,   8, 0x08, 0xffff0000 },
341 	{ 0x000d04,   8, 0x08, 0xffff0000 },
342 	{ 0x000e00,  16, 0x10, 0x00000000 },
343 	{ 0x000e04,  16, 0x10, 0xffff0000 },
344 	{ 0x000e08,  16, 0x10, 0xffff0000 },
345 	{ 0x000d40,   4, 0x08, 0x00000000 },
346 	{ 0x000d44,   4, 0x08, 0x00000000 },
347 	{ 0x001e00,   8, 0x20, 0x00000001 },
348 	{ 0x001e04,   8, 0x20, 0x00000001 },
349 	{ 0x001e08,   8, 0x20, 0x00000002 },
350 	{ 0x001e0c,   8, 0x20, 0x00000001 },
351 	{ 0x001e10,   8, 0x20, 0x00000001 },
352 	{ 0x001e14,   8, 0x20, 0x00000002 },
353 	{ 0x001e18,   8, 0x20, 0x00000001 },
354 	{ 0x003400, 128, 0x04, 0x00000000 },
355 	{ 0x00030c,   1, 0x04, 0x00000001 },
356 	{ 0x001944,   1, 0x04, 0x00000000 },
357 	{ 0x001514,   1, 0x04, 0x00000000 },
358 	{ 0x000d68,   1, 0x04, 0x0000ffff },
359 	{ 0x00121c,   1, 0x04, 0x0fac6881 },
360 	{ 0x000fac,   1, 0x04, 0x00000001 },
361 	{ 0x001538,   1, 0x04, 0x00000001 },
362 	{ 0x000fe0,   2, 0x04, 0x00000000 },
363 	{ 0x000fe8,   1, 0x04, 0x00000014 },
364 	{ 0x000fec,   1, 0x04, 0x00000040 },
365 	{ 0x000ff0,   1, 0x04, 0x00000000 },
366 	{ 0x00179c,   1, 0x04, 0x00000000 },
367 	{ 0x001228,   1, 0x04, 0x00000400 },
368 	{ 0x00122c,   1, 0x04, 0x00000300 },
369 	{ 0x001230,   1, 0x04, 0x00010001 },
370 	{ 0x0007f8,   1, 0x04, 0x00000000 },
371 	{ 0x0015b4,   1, 0x04, 0x00000001 },
372 	{ 0x0015cc,   1, 0x04, 0x00000000 },
373 	{ 0x001534,   1, 0x04, 0x00000000 },
374 	{ 0x000fb0,   1, 0x04, 0x00000000 },
375 	{ 0x0015d0,   1, 0x04, 0x00000000 },
376 	{ 0x00153c,   1, 0x04, 0x00000000 },
377 	{ 0x0016b4,   1, 0x04, 0x00000003 },
378 	{ 0x000fbc,   4, 0x04, 0x0000ffff },
379 	{ 0x000df8,   2, 0x04, 0x00000000 },
380 	{ 0x001948,   1, 0x04, 0x00000000 },
381 	{ 0x001970,   1, 0x04, 0x00000001 },
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383 	{ 0x000dcc,   1, 0x04, 0x00000010 },
384 	{ 0x00163c,   1, 0x04, 0x00000000 },
385 	{ 0x0015e4,   1, 0x04, 0x00000000 },
386 	{ 0x001160,  32, 0x04, 0x25e00040 },
387 	{ 0x001880,  32, 0x04, 0x00000000 },
388 	{ 0x000f84,   2, 0x04, 0x00000000 },
389 	{ 0x0017c8,   2, 0x04, 0x00000000 },
390 	{ 0x0017d0,   1, 0x04, 0x000000ff },
391 	{ 0x0017d4,   1, 0x04, 0xffffffff },
392 	{ 0x0017d8,   1, 0x04, 0x00000002 },
393 	{ 0x0017dc,   1, 0x04, 0x00000000 },
394 	{ 0x0015f4,   2, 0x04, 0x00000000 },
395 	{ 0x001434,   2, 0x04, 0x00000000 },
396 	{ 0x000d74,   1, 0x04, 0x00000000 },
397 	{ 0x000dec,   1, 0x04, 0x00000001 },
398 	{ 0x0013a4,   1, 0x04, 0x00000000 },
399 	{ 0x001318,   1, 0x04, 0x00000001 },
400 	{ 0x001644,   1, 0x04, 0x00000000 },
401 	{ 0x000748,   1, 0x04, 0x00000000 },
402 	{ 0x000de8,   1, 0x04, 0x00000000 },
403 	{ 0x001648,   1, 0x04, 0x00000000 },
404 	{ 0x0012a4,   1, 0x04, 0x00000000 },
405 	{ 0x001120,   4, 0x04, 0x00000000 },
406 	{ 0x001118,   1, 0x04, 0x00000000 },
407 	{ 0x00164c,   1, 0x04, 0x00000000 },
408 	{ 0x001658,   1, 0x04, 0x00000000 },
409 	{ 0x001910,   1, 0x04, 0x00000290 },
410 	{ 0x001518,   1, 0x04, 0x00000000 },
411 	{ 0x00165c,   1, 0x04, 0x00000001 },
412 	{ 0x001520,   1, 0x04, 0x00000000 },
413 	{ 0x001604,   1, 0x04, 0x00000000 },
414 	{ 0x001570,   1, 0x04, 0x00000000 },
415 	{ 0x0013b0,   2, 0x04, 0x3f800000 },
416 	{ 0x00020c,   1, 0x04, 0x00000000 },
417 	{ 0x001670,   1, 0x04, 0x30201000 },
418 	{ 0x001674,   1, 0x04, 0x70605040 },
419 	{ 0x001678,   1, 0x04, 0xb8a89888 },
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609 const struct gf100_gr_init
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626 
627 const struct gf100_gr_pack
628 gf100_grctx_pack_mthd[] = {
629 	{ gf100_grctx_init_9097_0, 0x9097 },
630 	{ gf100_grctx_init_902d_0, 0x902d },
631 	{ gf100_grctx_init_9039_0, 0x9039 },
632 	{ gf100_grctx_init_90c0_0, 0x90c0 },
633 	{}
634 };
635 
636 const struct gf100_gr_init
637 gf100_grctx_init_main_0[] = {
638 	{ 0x400204,   2, 0x04, 0x00000000 },
639 	{}
640 };
641 
642 const struct gf100_gr_init
643 gf100_grctx_init_fe_0[] = {
644 	{ 0x404004,  11, 0x04, 0x00000000 },
645 	{ 0x404044,   1, 0x04, 0x00000000 },
646 	{ 0x404094,  13, 0x04, 0x00000000 },
647 	{ 0x4040c8,   1, 0x04, 0xf0000087 },
648 	{ 0x4040d0,   6, 0x04, 0x00000000 },
649 	{ 0x4040e8,   1, 0x04, 0x00001000 },
650 	{ 0x4040f8,   1, 0x04, 0x00000000 },
651 	{ 0x404130,   2, 0x04, 0x00000000 },
652 	{ 0x404138,   1, 0x04, 0x20000040 },
653 	{ 0x404150,   1, 0x04, 0x0000002e },
654 	{ 0x404154,   1, 0x04, 0x00000400 },
655 	{ 0x404158,   1, 0x04, 0x00000200 },
656 	{ 0x404164,   1, 0x04, 0x00000055 },
657 	{ 0x404168,   1, 0x04, 0x00000000 },
658 	{ 0x404174,   3, 0x04, 0x00000000 },
659 	{ 0x404200,   8, 0x04, 0x00000000 },
660 	{}
661 };
662 
663 const struct gf100_gr_init
664 gf100_grctx_init_pri_0[] = {
665 	{ 0x404404,  14, 0x04, 0x00000000 },
666 	{ 0x404460,   2, 0x04, 0x00000000 },
667 	{ 0x404468,   1, 0x04, 0x00ffffff },
668 	{ 0x40446c,   1, 0x04, 0x00000000 },
669 	{ 0x404480,   1, 0x04, 0x00000001 },
670 	{ 0x404498,   1, 0x04, 0x00000001 },
671 	{}
672 };
673 
674 const struct gf100_gr_init
675 gf100_grctx_init_memfmt_0[] = {
676 	{ 0x404604,   1, 0x04, 0x00000015 },
677 	{ 0x404608,   1, 0x04, 0x00000000 },
678 	{ 0x40460c,   1, 0x04, 0x00002e00 },
679 	{ 0x404610,   1, 0x04, 0x00000100 },
680 	{ 0x404618,   8, 0x04, 0x00000000 },
681 	{ 0x404638,   1, 0x04, 0x00000004 },
682 	{ 0x40463c,   8, 0x04, 0x00000000 },
683 	{ 0x40465c,   1, 0x04, 0x007f0100 },
684 	{ 0x404660,   7, 0x04, 0x00000000 },
685 	{ 0x40467c,   1, 0x04, 0x00000002 },
686 	{ 0x404680,   8, 0x04, 0x00000000 },
687 	{ 0x4046a0,   1, 0x04, 0x007f0080 },
688 	{ 0x4046a4,  18, 0x04, 0x00000000 },
689 	{ 0x4046f0,   2, 0x04, 0x00000000 },
690 	{ 0x404700,  13, 0x04, 0x00000000 },
691 	{ 0x404734,   1, 0x04, 0x00000100 },
692 	{ 0x404738,   8, 0x04, 0x00000000 },
693 	{}
694 };
695 
696 static const struct gf100_gr_init
697 gf100_grctx_init_ds_0[] = {
698 	{ 0x405800,   1, 0x04, 0x078000bf },
699 	{ 0x405830,   1, 0x04, 0x02180000 },
700 	{ 0x405834,   2, 0x04, 0x00000000 },
701 	{ 0x405854,   1, 0x04, 0x00000000 },
702 	{ 0x405870,   4, 0x04, 0x00000001 },
703 	{ 0x405a00,   2, 0x04, 0x00000000 },
704 	{ 0x405a18,   1, 0x04, 0x00000000 },
705 	{}
706 };
707 
708 static const struct gf100_gr_init
709 gf100_grctx_init_pd_0[] = {
710 	{ 0x406020,   1, 0x04, 0x000103c1 },
711 	{ 0x406028,   4, 0x04, 0x00000001 },
712 	{ 0x4064a8,   1, 0x04, 0x00000000 },
713 	{ 0x4064ac,   1, 0x04, 0x00003fff },
714 	{ 0x4064b4,   2, 0x04, 0x00000000 },
715 	{}
716 };
717 
718 const struct gf100_gr_init
719 gf100_grctx_init_rstr2d_0[] = {
720 	{ 0x407804,   1, 0x04, 0x00000023 },
721 	{ 0x40780c,   1, 0x04, 0x0a418820 },
722 	{ 0x407810,   1, 0x04, 0x062080e6 },
723 	{ 0x407814,   1, 0x04, 0x020398a4 },
724 	{ 0x407818,   1, 0x04, 0x0e629062 },
725 	{ 0x40781c,   1, 0x04, 0x0a418820 },
726 	{ 0x407820,   1, 0x04, 0x000000e6 },
727 	{ 0x4078bc,   1, 0x04, 0x00000103 },
728 	{}
729 };
730 
731 const struct gf100_gr_init
732 gf100_grctx_init_scc_0[] = {
733 	{ 0x408000,   2, 0x04, 0x00000000 },
734 	{ 0x408008,   1, 0x04, 0x00000018 },
735 	{ 0x40800c,   2, 0x04, 0x00000000 },
736 	{ 0x408014,   1, 0x04, 0x00000069 },
737 	{ 0x408018,   1, 0x04, 0xe100e100 },
738 	{ 0x408064,   1, 0x04, 0x00000000 },
739 	{}
740 };
741 
742 static const struct gf100_gr_init
743 gf100_grctx_init_be_0[] = {
744 	{ 0x408800,   1, 0x04, 0x02802a3c },
745 	{ 0x408804,   1, 0x04, 0x00000040 },
746 	{ 0x408808,   1, 0x04, 0x0003e00d },
747 	{ 0x408900,   1, 0x04, 0x3080b801 },
748 	{ 0x408904,   1, 0x04, 0x02000001 },
749 	{ 0x408908,   1, 0x04, 0x00c80929 },
750 	{ 0x408980,   1, 0x04, 0x0000011d },
751 	{}
752 };
753 
754 const struct gf100_gr_pack
755 gf100_grctx_pack_hub[] = {
756 	{ gf100_grctx_init_main_0 },
757 	{ gf100_grctx_init_fe_0 },
758 	{ gf100_grctx_init_pri_0 },
759 	{ gf100_grctx_init_memfmt_0 },
760 	{ gf100_grctx_init_ds_0 },
761 	{ gf100_grctx_init_pd_0 },
762 	{ gf100_grctx_init_rstr2d_0 },
763 	{ gf100_grctx_init_scc_0 },
764 	{ gf100_grctx_init_be_0 },
765 	{}
766 };
767 
768 const struct gf100_gr_init
769 gf100_grctx_init_gpc_unk_0[] = {
770 	{ 0x418380,   1, 0x04, 0x00000016 },
771 	{}
772 };
773 
774 const struct gf100_gr_init
775 gf100_grctx_init_prop_0[] = {
776 	{ 0x418400,   1, 0x04, 0x38004e00 },
777 	{ 0x418404,   1, 0x04, 0x71e0ffff },
778 	{ 0x418408,   1, 0x04, 0x00000000 },
779 	{ 0x41840c,   1, 0x04, 0x00001008 },
780 	{ 0x418410,   1, 0x04, 0x0fff0fff },
781 	{ 0x418414,   1, 0x04, 0x00200fff },
782 	{ 0x418450,   6, 0x04, 0x00000000 },
783 	{ 0x418468,   1, 0x04, 0x00000001 },
784 	{ 0x41846c,   2, 0x04, 0x00000000 },
785 	{}
786 };
787 
788 const struct gf100_gr_init
789 gf100_grctx_init_gpc_unk_1[] = {
790 	{ 0x418600,   1, 0x04, 0x0000001f },
791 	{ 0x418684,   1, 0x04, 0x0000000f },
792 	{ 0x418700,   1, 0x04, 0x00000002 },
793 	{ 0x418704,   1, 0x04, 0x00000080 },
794 	{ 0x418708,   1, 0x04, 0x00000000 },
795 	{ 0x41870c,   1, 0x04, 0x07c80000 },
796 	{ 0x418710,   1, 0x04, 0x00000000 },
797 	{}
798 };
799 
800 static const struct gf100_gr_init
801 gf100_grctx_init_setup_0[] = {
802 	{ 0x418800,   1, 0x04, 0x0006860a },
803 	{ 0x418808,   3, 0x04, 0x00000000 },
804 	{ 0x418828,   1, 0x04, 0x00008442 },
805 	{ 0x418830,   1, 0x04, 0x00000001 },
806 	{ 0x4188d8,   1, 0x04, 0x00000008 },
807 	{ 0x4188e0,   1, 0x04, 0x01000000 },
808 	{ 0x4188e8,   5, 0x04, 0x00000000 },
809 	{ 0x4188fc,   1, 0x04, 0x00100000 },
810 	{}
811 };
812 
813 const struct gf100_gr_init
814 gf100_grctx_init_zcull_0[] = {
815 	{ 0x41891c,   1, 0x04, 0x00ff00ff },
816 	{ 0x418924,   1, 0x04, 0x00000000 },
817 	{ 0x418928,   1, 0x04, 0x00ffff00 },
818 	{ 0x41892c,   1, 0x04, 0x0000ff00 },
819 	{}
820 };
821 
822 const struct gf100_gr_init
823 gf100_grctx_init_crstr_0[] = {
824 	{ 0x418b00,   1, 0x04, 0x00000000 },
825 	{ 0x418b08,   1, 0x04, 0x0a418820 },
826 	{ 0x418b0c,   1, 0x04, 0x062080e6 },
827 	{ 0x418b10,   1, 0x04, 0x020398a4 },
828 	{ 0x418b14,   1, 0x04, 0x0e629062 },
829 	{ 0x418b18,   1, 0x04, 0x0a418820 },
830 	{ 0x418b1c,   1, 0x04, 0x000000e6 },
831 	{ 0x418bb8,   1, 0x04, 0x00000103 },
832 	{}
833 };
834 
835 const struct gf100_gr_init
836 gf100_grctx_init_gpm_0[] = {
837 	{ 0x418c08,   1, 0x04, 0x00000001 },
838 	{ 0x418c10,   8, 0x04, 0x00000000 },
839 	{ 0x418c80,   1, 0x04, 0x20200004 },
840 	{ 0x418c8c,   1, 0x04, 0x00000001 },
841 	{}
842 };
843 
844 const struct gf100_gr_init
845 gf100_grctx_init_gcc_0[] = {
846 	{ 0x419000,   1, 0x04, 0x00000780 },
847 	{ 0x419004,   2, 0x04, 0x00000000 },
848 	{ 0x419014,   1, 0x04, 0x00000004 },
849 	{}
850 };
851 
852 const struct gf100_gr_pack
853 gf100_grctx_pack_gpc[] = {
854 	{ gf100_grctx_init_gpc_unk_0 },
855 	{ gf100_grctx_init_prop_0 },
856 	{ gf100_grctx_init_gpc_unk_1 },
857 	{ gf100_grctx_init_setup_0 },
858 	{ gf100_grctx_init_zcull_0 },
859 	{ gf100_grctx_init_crstr_0 },
860 	{ gf100_grctx_init_gpm_0 },
861 	{ gf100_grctx_init_gcc_0 },
862 	{}
863 };
864 
865 static const struct gf100_gr_init
866 gf100_grctx_init_zcullr_0[] = {
867 	{ 0x418a00,   3, 0x04, 0x00000000 },
868 	{ 0x418a0c,   1, 0x04, 0x00010000 },
869 	{ 0x418a10,   3, 0x04, 0x00000000 },
870 	{ 0x418a20,   3, 0x04, 0x00000000 },
871 	{ 0x418a2c,   1, 0x04, 0x00010000 },
872 	{ 0x418a30,   3, 0x04, 0x00000000 },
873 	{ 0x418a40,   3, 0x04, 0x00000000 },
874 	{ 0x418a4c,   1, 0x04, 0x00010000 },
875 	{ 0x418a50,   3, 0x04, 0x00000000 },
876 	{ 0x418a60,   3, 0x04, 0x00000000 },
877 	{ 0x418a6c,   1, 0x04, 0x00010000 },
878 	{ 0x418a70,   3, 0x04, 0x00000000 },
879 	{ 0x418a80,   3, 0x04, 0x00000000 },
880 	{ 0x418a8c,   1, 0x04, 0x00010000 },
881 	{ 0x418a90,   3, 0x04, 0x00000000 },
882 	{ 0x418aa0,   3, 0x04, 0x00000000 },
883 	{ 0x418aac,   1, 0x04, 0x00010000 },
884 	{ 0x418ab0,   3, 0x04, 0x00000000 },
885 	{ 0x418ac0,   3, 0x04, 0x00000000 },
886 	{ 0x418acc,   1, 0x04, 0x00010000 },
887 	{ 0x418ad0,   3, 0x04, 0x00000000 },
888 	{ 0x418ae0,   3, 0x04, 0x00000000 },
889 	{ 0x418aec,   1, 0x04, 0x00010000 },
890 	{ 0x418af0,   3, 0x04, 0x00000000 },
891 	{}
892 };
893 
894 const struct gf100_gr_pack
895 gf100_grctx_pack_zcull[] = {
896 	{ gf100_grctx_init_zcullr_0 },
897 	{}
898 };
899 
900 const struct gf100_gr_init
901 gf100_grctx_init_pe_0[] = {
902 	{ 0x419818,   1, 0x04, 0x00000000 },
903 	{ 0x41983c,   1, 0x04, 0x00038bc7 },
904 	{ 0x419848,   1, 0x04, 0x00000000 },
905 	{ 0x419864,   1, 0x04, 0x0000012a },
906 	{ 0x419888,   1, 0x04, 0x00000000 },
907 	{}
908 };
909 
910 static const struct gf100_gr_init
911 gf100_grctx_init_tex_0[] = {
912 	{ 0x419a00,   1, 0x04, 0x000001f0 },
913 	{ 0x419a04,   1, 0x04, 0x00000001 },
914 	{ 0x419a08,   1, 0x04, 0x00000023 },
915 	{ 0x419a0c,   1, 0x04, 0x00020000 },
916 	{ 0x419a10,   1, 0x04, 0x00000000 },
917 	{ 0x419a14,   1, 0x04, 0x00000200 },
918 	{}
919 };
920 
921 const struct gf100_gr_init
922 gf100_grctx_init_wwdx_0[] = {
923 	{ 0x419b00,   1, 0x04, 0x0a418820 },
924 	{ 0x419b04,   1, 0x04, 0x062080e6 },
925 	{ 0x419b08,   1, 0x04, 0x020398a4 },
926 	{ 0x419b0c,   1, 0x04, 0x0e629062 },
927 	{ 0x419b10,   1, 0x04, 0x0a418820 },
928 	{ 0x419b14,   1, 0x04, 0x000000e6 },
929 	{ 0x419bd0,   1, 0x04, 0x00900103 },
930 	{ 0x419be0,   1, 0x04, 0x00000001 },
931 	{ 0x419be4,   1, 0x04, 0x00000000 },
932 	{}
933 };
934 
935 const struct gf100_gr_init
936 gf100_grctx_init_mpc_0[] = {
937 	{ 0x419c00,   1, 0x04, 0x00000002 },
938 	{ 0x419c04,   1, 0x04, 0x00000006 },
939 	{ 0x419c08,   1, 0x04, 0x00000002 },
940 	{ 0x419c20,   1, 0x04, 0x00000000 },
941 	{}
942 };
943 
944 static const struct gf100_gr_init
945 gf100_grctx_init_l1c_0[] = {
946 	{ 0x419cb0,   1, 0x04, 0x00060048 },
947 	{ 0x419ce8,   1, 0x04, 0x00000000 },
948 	{ 0x419cf4,   1, 0x04, 0x00000183 },
949 	{}
950 };
951 
952 const struct gf100_gr_init
953 gf100_grctx_init_tpccs_0[] = {
954 	{ 0x419d20,   1, 0x04, 0x02180000 },
955 	{ 0x419d24,   1, 0x04, 0x00001fff },
956 	{}
957 };
958 
959 static const struct gf100_gr_init
960 gf100_grctx_init_sm_0[] = {
961 	{ 0x419e04,   3, 0x04, 0x00000000 },
962 	{ 0x419e10,   1, 0x04, 0x00000002 },
963 	{ 0x419e44,   1, 0x04, 0x001beff2 },
964 	{ 0x419e48,   1, 0x04, 0x00000000 },
965 	{ 0x419e4c,   1, 0x04, 0x0000000f },
966 	{ 0x419e50,  17, 0x04, 0x00000000 },
967 	{ 0x419e98,   1, 0x04, 0x00000000 },
968 	{ 0x419f50,   2, 0x04, 0x00000000 },
969 	{}
970 };
971 
972 const struct gf100_gr_pack
973 gf100_grctx_pack_tpc[] = {
974 	{ gf100_grctx_init_pe_0 },
975 	{ gf100_grctx_init_tex_0 },
976 	{ gf100_grctx_init_wwdx_0 },
977 	{ gf100_grctx_init_mpc_0 },
978 	{ gf100_grctx_init_l1c_0 },
979 	{ gf100_grctx_init_tpccs_0 },
980 	{ gf100_grctx_init_sm_0 },
981 	{}
982 };
983 
984 /*******************************************************************************
985  * PGRAPH context implementation
986  ******************************************************************************/
987 
988 int
989 gf100_grctx_mmio_data(struct gf100_grctx *info, u32 size, u32 align, bool priv)
990 {
991 	if (info->data) {
992 		info->buffer[info->buffer_nr] = round_up(info->addr, align);
993 		info->addr = info->buffer[info->buffer_nr] + size;
994 		info->data->size = size;
995 		info->data->align = align;
996 		info->data->priv = priv;
997 		info->data++;
998 		return info->buffer_nr++;
999 	}
1000 	return -1;
1001 }
1002 
1003 void
1004 gf100_grctx_mmio_item(struct gf100_grctx *info, u32 addr, u32 data,
1005 		      int shift, int buffer)
1006 {
1007 	struct nvkm_device *device = info->gr->base.engine.subdev.device;
1008 	if (info->data) {
1009 		if (shift >= 0) {
1010 			info->mmio->addr = addr;
1011 			info->mmio->data = data;
1012 			info->mmio->shift = shift;
1013 			info->mmio->buffer = buffer;
1014 			if (buffer >= 0)
1015 				data |= info->buffer[buffer] >> shift;
1016 			info->mmio++;
1017 		} else
1018 			return;
1019 	} else {
1020 		if (buffer >= 0)
1021 			return;
1022 	}
1023 
1024 	nvkm_wr32(device, addr, data);
1025 }
1026 
1027 void
1028 gf100_grctx_generate_bundle(struct gf100_grctx *info)
1029 {
1030 	const struct gf100_grctx_func *grctx = info->gr->func->grctx;
1031 	const int s = 8;
1032 	const int b = mmio_vram(info, grctx->bundle_size, (1 << s), true);
1033 	mmio_refn(info, 0x408004, 0x00000000, s, b);
1034 	mmio_wr32(info, 0x408008, 0x80000000 | (grctx->bundle_size >> s));
1035 	mmio_refn(info, 0x418808, 0x00000000, s, b);
1036 	mmio_wr32(info, 0x41880c, 0x80000000 | (grctx->bundle_size >> s));
1037 }
1038 
1039 void
1040 gf100_grctx_generate_pagepool(struct gf100_grctx *info)
1041 {
1042 	const struct gf100_grctx_func *grctx = info->gr->func->grctx;
1043 	const int s = 8;
1044 	const int b = mmio_vram(info, grctx->pagepool_size, (1 << s), true);
1045 	mmio_refn(info, 0x40800c, 0x00000000, s, b);
1046 	mmio_wr32(info, 0x408010, 0x80000000);
1047 	mmio_refn(info, 0x419004, 0x00000000, s, b);
1048 	mmio_wr32(info, 0x419008, 0x00000000);
1049 }
1050 
1051 void
1052 gf100_grctx_generate_attrib(struct gf100_grctx *info)
1053 {
1054 	struct gf100_gr *gr = info->gr;
1055 	const struct gf100_grctx_func *grctx = gr->func->grctx;
1056 	const u32 attrib = grctx->attrib_nr;
1057 	const u32   size = 0x20 * (grctx->attrib_nr_max + grctx->alpha_nr_max);
1058 	const int s = 12;
1059 	const int b = mmio_vram(info, size * gr->tpc_total, (1 << s), false);
1060 	int gpc, tpc;
1061 	u32 bo = 0;
1062 
1063 	mmio_refn(info, 0x418810, 0x80000000, s, b);
1064 	mmio_refn(info, 0x419848, 0x10000000, s, b);
1065 	mmio_wr32(info, 0x405830, (attrib << 16));
1066 
1067 	for (gpc = 0; gpc < gr->gpc_nr; gpc++) {
1068 		for (tpc = 0; tpc < gr->tpc_nr[gpc]; tpc++) {
1069 			const u32 o = TPC_UNIT(gpc, tpc, 0x0520);
1070 			mmio_skip(info, o, (attrib << 16) | ++bo);
1071 			mmio_wr32(info, o, (attrib << 16) | --bo);
1072 			bo += grctx->attrib_nr_max;
1073 		}
1074 	}
1075 }
1076 
1077 void
1078 gf100_grctx_generate_unkn(struct gf100_gr *gr)
1079 {
1080 }
1081 
1082 void
1083 gf100_grctx_generate_tpcid(struct gf100_gr *gr)
1084 {
1085 	struct nvkm_device *device = gr->base.engine.subdev.device;
1086 	int gpc, tpc, id;
1087 
1088 	for (tpc = 0, id = 0; tpc < 4; tpc++) {
1089 		for (gpc = 0; gpc < gr->gpc_nr; gpc++) {
1090 			if (tpc < gr->tpc_nr[gpc]) {
1091 				nvkm_wr32(device, TPC_UNIT(gpc, tpc, 0x698), id);
1092 				nvkm_wr32(device, TPC_UNIT(gpc, tpc, 0x4e8), id);
1093 				nvkm_wr32(device, GPC_UNIT(gpc, 0x0c10 + tpc * 4), id);
1094 				nvkm_wr32(device, TPC_UNIT(gpc, tpc, 0x088), id);
1095 				id++;
1096 			}
1097 
1098 			nvkm_wr32(device, GPC_UNIT(gpc, 0x0c08), gr->tpc_nr[gpc]);
1099 			nvkm_wr32(device, GPC_UNIT(gpc, 0x0c8c), gr->tpc_nr[gpc]);
1100 		}
1101 	}
1102 }
1103 
1104 void
1105 gf100_grctx_generate_r406028(struct gf100_gr *gr)
1106 {
1107 	struct nvkm_device *device = gr->base.engine.subdev.device;
1108 	u32 tmp[GPC_MAX / 8] = {}, i = 0;
1109 	for (i = 0; i < gr->gpc_nr; i++)
1110 		tmp[i / 8] |= gr->tpc_nr[i] << ((i % 8) * 4);
1111 	for (i = 0; i < 4; i++) {
1112 		nvkm_wr32(device, 0x406028 + (i * 4), tmp[i]);
1113 		nvkm_wr32(device, 0x405870 + (i * 4), tmp[i]);
1114 	}
1115 }
1116 
1117 void
1118 gf100_grctx_generate_r4060a8(struct gf100_gr *gr)
1119 {
1120 	struct nvkm_device *device = gr->base.engine.subdev.device;
1121 	u8  tpcnr[GPC_MAX], data[TPC_MAX];
1122 	int gpc, tpc, i;
1123 
1124 	memcpy(tpcnr, gr->tpc_nr, sizeof(gr->tpc_nr));
1125 	memset(data, 0x1f, sizeof(data));
1126 
1127 	gpc = -1;
1128 	for (tpc = 0; tpc < gr->tpc_total; tpc++) {
1129 		do {
1130 			gpc = (gpc + 1) % gr->gpc_nr;
1131 		} while (!tpcnr[gpc]);
1132 		tpcnr[gpc]--;
1133 		data[tpc] = gpc;
1134 	}
1135 
1136 	for (i = 0; i < 4; i++)
1137 		nvkm_wr32(device, 0x4060a8 + (i * 4), ((u32 *)data)[i]);
1138 }
1139 
1140 void
1141 gf100_grctx_generate_r418bb8(struct gf100_gr *gr)
1142 {
1143 	struct nvkm_device *device = gr->base.engine.subdev.device;
1144 	u32 data[6] = {}, data2[2] = {};
1145 	u8  tpcnr[GPC_MAX];
1146 	u8  shift, ntpcv;
1147 	int gpc, tpc, i;
1148 
1149 	/* calculate first set of magics */
1150 	memcpy(tpcnr, gr->tpc_nr, sizeof(gr->tpc_nr));
1151 
1152 	gpc = -1;
1153 	for (tpc = 0; tpc < gr->tpc_total; tpc++) {
1154 		do {
1155 			gpc = (gpc + 1) % gr->gpc_nr;
1156 		} while (!tpcnr[gpc]);
1157 		tpcnr[gpc]--;
1158 
1159 		data[tpc / 6] |= gpc << ((tpc % 6) * 5);
1160 	}
1161 
1162 	for (; tpc < 32; tpc++)
1163 		data[tpc / 6] |= 7 << ((tpc % 6) * 5);
1164 
1165 	/* and the second... */
1166 	shift = 0;
1167 	ntpcv = gr->tpc_total;
1168 	while (!(ntpcv & (1 << 4))) {
1169 		ntpcv <<= 1;
1170 		shift++;
1171 	}
1172 
1173 	data2[0]  = (ntpcv << 16);
1174 	data2[0] |= (shift << 21);
1175 	data2[0] |= (((1 << (0 + 5)) % ntpcv) << 24);
1176 	for (i = 1; i < 7; i++)
1177 		data2[1] |= ((1 << (i + 5)) % ntpcv) << ((i - 1) * 5);
1178 
1179 	/* GPC_BROADCAST */
1180 	nvkm_wr32(device, 0x418bb8, (gr->tpc_total << 8) |
1181 				     gr->screen_tile_row_offset);
1182 	for (i = 0; i < 6; i++)
1183 		nvkm_wr32(device, 0x418b08 + (i * 4), data[i]);
1184 
1185 	/* GPC_BROADCAST.TP_BROADCAST */
1186 	nvkm_wr32(device, 0x419bd0, (gr->tpc_total << 8) |
1187 				     gr->screen_tile_row_offset | data2[0]);
1188 	nvkm_wr32(device, 0x419be4, data2[1]);
1189 	for (i = 0; i < 6; i++)
1190 		nvkm_wr32(device, 0x419b00 + (i * 4), data[i]);
1191 
1192 	/* UNK78xx */
1193 	nvkm_wr32(device, 0x4078bc, (gr->tpc_total << 8) |
1194 				     gr->screen_tile_row_offset);
1195 	for (i = 0; i < 6; i++)
1196 		nvkm_wr32(device, 0x40780c + (i * 4), data[i]);
1197 }
1198 
1199 void
1200 gf100_grctx_generate_r406800(struct gf100_gr *gr)
1201 {
1202 	struct nvkm_device *device = gr->base.engine.subdev.device;
1203 	u64 tpc_mask = 0, tpc_set = 0;
1204 	u8  tpcnr[GPC_MAX];
1205 	int gpc, tpc;
1206 	int i, a, b;
1207 
1208 	memcpy(tpcnr, gr->tpc_nr, sizeof(gr->tpc_nr));
1209 	for (gpc = 0; gpc < gr->gpc_nr; gpc++)
1210 		tpc_mask |= ((1ULL << gr->tpc_nr[gpc]) - 1) << (gpc * 8);
1211 
1212 	for (i = 0, gpc = -1, b = -1; i < 32; i++) {
1213 		a = (i * (gr->tpc_total - 1)) / 32;
1214 		if (a != b) {
1215 			b = a;
1216 			do {
1217 				gpc = (gpc + 1) % gr->gpc_nr;
1218 			} while (!tpcnr[gpc]);
1219 			tpc = gr->tpc_nr[gpc] - tpcnr[gpc]--;
1220 
1221 			tpc_set |= 1ULL << ((gpc * 8) + tpc);
1222 		}
1223 
1224 		nvkm_wr32(device, 0x406800 + (i * 0x20), lower_32_bits(tpc_set));
1225 		nvkm_wr32(device, 0x406c00 + (i * 0x20), lower_32_bits(tpc_set ^ tpc_mask));
1226 		if (gr->gpc_nr > 4) {
1227 			nvkm_wr32(device, 0x406804 + (i * 0x20), upper_32_bits(tpc_set));
1228 			nvkm_wr32(device, 0x406c04 + (i * 0x20), upper_32_bits(tpc_set ^ tpc_mask));
1229 		}
1230 	}
1231 }
1232 
1233 void
1234 gf100_grctx_generate_main(struct gf100_gr *gr, struct gf100_grctx *info)
1235 {
1236 	struct nvkm_device *device = gr->base.engine.subdev.device;
1237 	const struct gf100_grctx_func *grctx = gr->func->grctx;
1238 	u32 idle_timeout;
1239 
1240 	nvkm_mc_unk260(device, 0);
1241 
1242 	gf100_gr_mmio(gr, grctx->hub);
1243 	gf100_gr_mmio(gr, grctx->gpc);
1244 	gf100_gr_mmio(gr, grctx->zcull);
1245 	gf100_gr_mmio(gr, grctx->tpc);
1246 	gf100_gr_mmio(gr, grctx->ppc);
1247 
1248 	idle_timeout = nvkm_mask(device, 0x404154, 0xffffffff, 0x00000000);
1249 
1250 	grctx->bundle(info);
1251 	grctx->pagepool(info);
1252 	grctx->attrib(info);
1253 	grctx->unkn(gr);
1254 
1255 	gf100_grctx_generate_tpcid(gr);
1256 	gf100_grctx_generate_r406028(gr);
1257 	gf100_grctx_generate_r4060a8(gr);
1258 	gf100_grctx_generate_r418bb8(gr);
1259 	gf100_grctx_generate_r406800(gr);
1260 
1261 	gf100_gr_icmd(gr, grctx->icmd);
1262 	nvkm_wr32(device, 0x404154, idle_timeout);
1263 	gf100_gr_mthd(gr, grctx->mthd);
1264 	nvkm_mc_unk260(device, 1);
1265 }
1266 
1267 #define CB_RESERVED 0x80000
1268 
1269 int
1270 gf100_grctx_generate(struct gf100_gr *gr)
1271 {
1272 	const struct gf100_grctx_func *grctx = gr->func->grctx;
1273 	struct nvkm_subdev *subdev = &gr->base.engine.subdev;
1274 	struct nvkm_device *device = subdev->device;
1275 	struct nvkm_memory *inst = NULL;
1276 	struct nvkm_memory *data = NULL;
1277 	struct nvkm_vmm *vmm = NULL;
1278 	struct nvkm_vma *ctx = NULL;
1279 	struct gf100_grctx info;
1280 	int ret, i;
1281 	u64 addr;
1282 
1283 	/* Allocate memory to for a "channel", which we'll use to generate
1284 	 * the default context values.
1285 	 */
1286 	ret = nvkm_memory_new(device, NVKM_MEM_TARGET_INST,
1287 			      0x1000, 0x1000, true, &inst);
1288 	if (ret)
1289 		goto done;
1290 
1291 	ret = nvkm_vmm_new(device, 0, 0, NULL, 0, NULL, "grctx", &vmm);
1292 	if (ret)
1293 		goto done;
1294 
1295 	vmm->debug = subdev->debug;
1296 
1297 	ret = nvkm_vmm_join(vmm, inst);
1298 	if (ret)
1299 		goto done;
1300 
1301 	ret = nvkm_memory_new(device, NVKM_MEM_TARGET_INST,
1302 			      CB_RESERVED + gr->size, 0, true, &data);
1303 	if (ret)
1304 		goto done;
1305 
1306 	ret = nvkm_vmm_get(vmm, 0, nvkm_memory_size(data), &ctx);
1307 	if (ret)
1308 		goto done;
1309 
1310 	ret = nvkm_memory_map(data, 0, vmm, ctx, NULL, 0);
1311 	if (ret)
1312 		goto done;
1313 
1314 
1315 	/* Setup context pointer. */
1316 	nvkm_kmap(inst);
1317 	nvkm_wo32(inst, 0x0210, lower_32_bits(ctx->addr + CB_RESERVED) | 4);
1318 	nvkm_wo32(inst, 0x0214, upper_32_bits(ctx->addr + CB_RESERVED));
1319 	nvkm_done(inst);
1320 
1321 	/* Setup default state for mmio list construction. */
1322 	info.gr = gr;
1323 	info.data = gr->mmio_data;
1324 	info.mmio = gr->mmio_list;
1325 	info.addr = ctx->addr;
1326 	info.buffer_nr = 0;
1327 
1328 	/* Make channel current. */
1329 	addr = nvkm_memory_addr(inst) >> 12;
1330 	if (gr->firmware) {
1331 		nvkm_wr32(device, 0x409840, 0x00000030);
1332 		nvkm_wr32(device, 0x409500, 0x80000000 | addr);
1333 		nvkm_wr32(device, 0x409504, 0x00000003);
1334 		nvkm_msec(device, 2000,
1335 			if (nvkm_rd32(device, 0x409800) & 0x00000010)
1336 				break;
1337 		);
1338 
1339 		nvkm_kmap(data);
1340 		nvkm_wo32(data, 0x1c, 1);
1341 		nvkm_wo32(data, 0x20, 0);
1342 		nvkm_wo32(data, 0x28, 0);
1343 		nvkm_wo32(data, 0x2c, 0);
1344 		nvkm_done(data);
1345 	} else {
1346 		nvkm_wr32(device, 0x409840, 0x80000000);
1347 		nvkm_wr32(device, 0x409500, 0x80000000 | addr);
1348 		nvkm_wr32(device, 0x409504, 0x00000001);
1349 		nvkm_msec(device, 2000,
1350 			if (nvkm_rd32(device, 0x409800) & 0x80000000)
1351 				break;
1352 		);
1353 	}
1354 
1355 	grctx->main(gr, &info);
1356 
1357 	/* Trigger a context unload by unsetting the "next channel valid" bit
1358 	 * and faking a context switch interrupt.
1359 	 */
1360 	nvkm_mask(device, 0x409b04, 0x80000000, 0x00000000);
1361 	nvkm_wr32(device, 0x409000, 0x00000100);
1362 	if (nvkm_msec(device, 2000,
1363 		if (!(nvkm_rd32(device, 0x409b00) & 0x80000000))
1364 			break;
1365 	) < 0) {
1366 		ret = -EBUSY;
1367 		goto done;
1368 	}
1369 
1370 	gr->data = kmalloc(gr->size, GFP_KERNEL);
1371 	if (gr->data) {
1372 		nvkm_kmap(data);
1373 		for (i = 0; i < gr->size; i += 4)
1374 			gr->data[i / 4] = nvkm_ro32(data, CB_RESERVED + i);
1375 		nvkm_done(data);
1376 		ret = 0;
1377 	} else {
1378 		ret = -ENOMEM;
1379 	}
1380 
1381 done:
1382 	nvkm_vmm_put(vmm, &ctx);
1383 	nvkm_memory_unref(&data);
1384 	nvkm_vmm_part(vmm, inst);
1385 	nvkm_vmm_unref(&vmm);
1386 	nvkm_memory_unref(&inst);
1387 	return ret;
1388 }
1389 
1390 const struct gf100_grctx_func
1391 gf100_grctx = {
1392 	.main  = gf100_grctx_generate_main,
1393 	.unkn  = gf100_grctx_generate_unkn,
1394 	.hub   = gf100_grctx_pack_hub,
1395 	.gpc   = gf100_grctx_pack_gpc,
1396 	.zcull = gf100_grctx_pack_zcull,
1397 	.tpc   = gf100_grctx_pack_tpc,
1398 	.icmd  = gf100_grctx_pack_icmd,
1399 	.mthd  = gf100_grctx_pack_mthd,
1400 	.bundle = gf100_grctx_generate_bundle,
1401 	.bundle_size = 0x1800,
1402 	.pagepool = gf100_grctx_generate_pagepool,
1403 	.pagepool_size = 0x8000,
1404 	.attrib = gf100_grctx_generate_attrib,
1405 	.attrib_nr_max = 0x324,
1406 	.attrib_nr = 0x218,
1407 };
1408