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64 switch (env->misa_mxl_max) { in riscv_cpu_gdb_read_register()83 switch (env->misa_mxl_max) { in riscv_cpu_gdb_write_register()221 int bitsize = 16 << env->misa_mxl_max; in riscv_gen_dynamic_csr_xml()329 switch (env->misa_mxl_max) { in riscv_cpu_register_gdb_regs_for_features()
184 return env->misa_mxl_max == MXL_RV128; in rv128_needed()375 VMSTATE_UINT32(env.misa_mxl_max, RISCVCPU),
65 RISCVMXL misa_mxl_max; member163 #define get_xl_max(ctx) ((ctx)->misa_mxl_max)1191 ctx->misa_mxl_max = env->misa_mxl_max; in riscv_tr_init_disas_context()
172 uint32_t misa_mxl_max; /* max mxl for this cpu */ member
279 env->misa_mxl_max = env->misa_mxl = mxl; in riscv_cpu_set_misa()848 env->misa_mxl = env->misa_mxl_max; in riscv_cpu_reset_hold()
158 switch (env->misa_mxl_max) { in riscv_cpu_validate_misa_mxl()172 if (env->misa_mxl_max != env->misa_mxl) { in riscv_cpu_validate_misa_mxl()462 if (riscv_has_ext(env, RVF) && env->misa_mxl_max == MXL_RV32) { in riscv_cpu_validate_set_extensions()470 if (riscv_has_ext(env, RVF) && env->misa_mxl_max == MXL_RV32) { in riscv_cpu_validate_set_extensions()478 if (env->misa_mxl_max != MXL_RV32 && cpu->cfg.ext_zcf) { in riscv_cpu_validate_set_extensions()
39 return harts->harts[0].env.misa_mxl_max == MXL_RV32; in riscv_is_32bit()
1507 env->misa_mxl_max = env->misa_mxl = MXL_RV32; in riscv_host_cpu_init()1509 env->misa_mxl_max = env->misa_mxl = MXL_RV64; in riscv_host_cpu_init()