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121 #define DRA7_PCIE_PCIE2_CLKCTRL DRA7_PCIE_CLKCTRL_INDEX(0xb8) macro
264 clocks = <&pcie_clkctrl DRA7_PCIE_PCIE2_CLKCTRL 0>,265 <&pcie_clkctrl DRA7_PCIE_PCIE2_CLKCTRL 9>,266 <&pcie_clkctrl DRA7_PCIE_PCIE2_CLKCTRL 10>;
359 <&pcie_clkctrl DRA7_PCIE_PCIE2_CLKCTRL 8>,360 <&pcie_clkctrl DRA7_PCIE_PCIE2_CLKCTRL 9>,361 <&pcie_clkctrl DRA7_PCIE_PCIE2_CLKCTRL 10>,
436 { DRA7_PCIE_PCIE2_CLKCTRL, dra7_pcie2_bit_data, CLKF_SW_SUP, "l4_root_clk_div" },