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120 #define DRA7_PCIE_PCIE1_CLKCTRL DRA7_PCIE_CLKCTRL_INDEX(0xb0) macro
193 clocks = <&pcie_clkctrl DRA7_PCIE_PCIE1_CLKCTRL 0>,194 <&pcie_clkctrl DRA7_PCIE_PCIE1_CLKCTRL 9>,195 <&pcie_clkctrl DRA7_PCIE_PCIE1_CLKCTRL 10>;
339 <&pcie_clkctrl DRA7_PCIE_PCIE1_CLKCTRL 8>,340 <&pcie_clkctrl DRA7_PCIE_PCIE1_CLKCTRL 9>,341 <&pcie_clkctrl DRA7_PCIE_PCIE1_CLKCTRL 10>,
435 { DRA7_PCIE_PCIE1_CLKCTRL, dra7_pcie1_bit_data, CLKF_SW_SUP, "l4_root_clk_div" },