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37 #define DCR_TCE (1 << 3) /* Time Counter Enable */ macro167 if (!(__raw_readl(&data.regs->dcr) & DCR_TCE)) { in di_init()168 rc = DI_WRITE_WAIT(__raw_readl(&data.regs->dcr) | DCR_TCE, dcr); in di_init()
52 #define DCR_TCE (1 << 3) /* Time Counter Enable */ macro302 if (!(dcr & DCR_TCE)) { in di_handle_invalid_state()329 di_write_busy_wait(imxdi, dcr | DCR_TCE, DCR); in di_handle_invalid_state()564 if (!(dcr & DCR_TCE) || (dsr & DSR_SVF)) { in dryice_rtc_set_time()586 return di_write_wait(imxdi, readl(imxdi->ioaddr + DCR) | DCR_TCE, DCR); in dryice_rtc_set_time()