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9 #define ACPIIRQEN	0x31e0	/* 32bit */
11 #define PMSYNC_CONFIG	0x33c4	/* 32bit */
12 #define PMSYNC_CONFIG2	0x33cc	/* 32bit */
14 #define DEEP_S3_POL	0x3328	/* 32bit */
15 #define  DEEP_S3_EN_AC		(1 << 0)
17 #define DEEP_S5_POL	0x3330	/* 32bit */
20 #define DEEP_SX_CONFIG	0x3334	/* 32bit */
23 #define  DEEP_SX_GP27_PIN_EN	(1 << 0)
24 #define PMSYNC_CONFIG	0x33c4	/* 32bit */
25 #define PMSYNC_CONFIG2	0x33cc	/* 32bit */
27 #define RC		0x3400	/* 32bit */
28 #define HPTC		0x3404	/* 32bit */
29 #define GCS		0x3410	/* 32bit */
30 #define BUC		0x3414	/* 32bit */
32 #define FD		0x3418	/* 32bit */
33 #define FDSW		0x3420	/* 8bit */
34 #define DISPBDF		0x3424  /* 16bit */
35 #define FD2		0x3428	/* 32bit */
36 #define CG		0x341c	/* 32bit */
38 /* Function Disable 1 RCBA 0x3418 */
39 #define PCH_DISABLE_ALWAYS	(1 << 0)
52 /* Function Disable 2 RCBA 0x3428 */
57 #define PCH_ENABLE_DBDF		(1 << 0)