Lines Matching +full:0 +full:xe6180000
5 #define GLOBAL_TIMER_BASE_ADDR (0xF0000200)
6 #define MERAM_BASE (0xE5580000)
9 #define GIC_BASE (0xF0000100)
13 #define LIFEC_SEC_SRC (0xE6110008)
16 #define RWDT_BASE (0xE6020000)
19 #define HPB_BASE (0xE6001010)
22 #define HPBSCR_BASE (0xE6001600)
25 #define SBSC1_BASE (0xFE400000)
26 #define SDMRA1A (SBSC1_BASE + 0x100000)
27 #define SDMRA2A (SBSC1_BASE + 0x1C0000)
28 #define SDMRA3A (SBSC1_BASE + 0x104000)
31 #define SBSC2_BASE (0xFB400000)
32 #define SDMRA1B (SBSC2_BASE + 0x100000)
33 #define SDMRA2B (SBSC2_BASE + 0x1C0000)
34 #define SDMRA3B (SBSC2_BASE + 0x104000)
37 #define CPG_BASE (0xE6150000)
38 #define CPG_SRCR_BASE (CPG_BASE + 0x80A0)
39 #define WUPCR (CPG_BASE + 0x1010)
40 #define SRESCR (CPG_BASE + 0x1018)
41 #define PCLKCR (CPG_BASE + 0x1020)
44 #define SYSC_BASE (0xE6180000)
45 #define RESCNT2 (SYSC_BASE + 0x8020)
48 #define BSC_BASE (0xFEC10000)
51 #define SCIF0_BASE (0xE6C40000)
52 #define SCIF1_BASE (0xE6C50000)
53 #define SCIF2_BASE (0xE6C60000)
54 #define SCIF3_BASE (0xE6C70000)
55 #define SCIF4_BASE (0xE6C80000)
56 #define SCIF5_BASE (0xE6CB0000)
57 #define SCIF6_BASE (0xE6CC0000)
58 #define SCIF7_BASE (0xE6CD0000)
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67 u16 rwtcsra0; /* 0x04 */
68 u16 dummy1; /* 0x06 */
69 u16 rwtcsrb0; /* 0x08 */
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87 u32 mpsrc; /* 0x00 */
88 u32 mpacctl; /* 0x04 */
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