Lines Matching defs:hdmi_regs
17 struct hdmi_regs { struct
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20 u8 revision_id; /* 0x001 */
21 u8 product_id0; /* 0x002 */
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50 u8 reserved3[0x75];
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361 u8 reserved14[0xcd];
363 u8 aud_conf0; /* 0x3100 */
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370 u8 aud_n3; /* 0x3202 */
371 u8 aud_cts1; /* 0x3203 */
372 u8 aud_cts2; /* 0x3204 */
373 u8 aud_cts3; /* 0x3205 */
374 u8 aud_inputclkfs; /* 0x3206 */
375 u8 reserved16[0xfb];
376 u8 aud_spdifint; /* 0x3302 */
377 u8 reserved17[0xfd];
378 u8 aud_conf0_hbr; /* 0x3400 */
379 u8 aud_hbr_status; /* 0x3401 */
380 u8 aud_hbr_int; /* 0x3402 */
381 u8 aud_hbr_pol; /* 0x3403 */
382 u8 aud_hbr_mask; /* 0x3404 */
383 u8 reserved18[0xfb];
388 u8 gp_conf0; /* 0x3500 */
389 u8 gp_conf1; /* 0x3501 */
390 u8 gp_conf2; /* 0x3502 */
391 u8 gp_stat; /* 0x3503 */
392 u8 gp_int; /* 0x3504 */
393 u8 gp_mask; /* 0x3505 */
394 u8 gp_pol; /* 0x3506 */
395 u8 reserved19[0xf9];
397 u8 ahb_dma_conf0; /* 0x3600 */
398 u8 ahb_dma_start; /* 0x3601 */
399 u8 ahb_dma_stop; /* 0x3602 */
400 u8 ahb_dma_thrsld; /* 0x3603 */
401 u8 ahb_dma_straddr0; /* 0x3604 */
402 u8 ahb_dma_straddr1; /* 0x3605 */
403 u8 ahb_dma_straddr2; /* 0x3606 */
404 u8 ahb_dma_straddr3; /* 0x3607 */
405 u8 ahb_dma_stpaddr0; /* 0x3608 */
406 u8 ahb_dma_stpaddr1; /* 0x3609 */
407 u8 ahb_dma_stpaddr2; /* 0x360a */
408 u8 ahb_dma_stpaddr3; /* 0x360b */
409 u8 ahb_dma_bstaddr0; /* 0x360c */
410 u8 ahb_dma_bstaddr1; /* 0x360d */
411 u8 ahb_dma_bstaddr2; /* 0x360e */
412 u8 ahb_dma_bstaddr3; /* 0x360f */
413 u8 ahb_dma_mblength0; /* 0x3610 */
414 u8 ahb_dma_mblength1; /* 0x3611 */
415 u8 ahb_dma_stat; /* 0x3612 */
416 u8 ahb_dma_int; /* 0x3613 */
417 u8 ahb_dma_mask; /* 0x3614 */
418 u8 ahb_dma_pol; /* 0x3615 */
419 u8 ahb_dma_conf1; /* 0x3616 */
420 u8 ahb_dma_buffstat; /* 0x3617 */
421 u8 ahb_dma_buffint; /* 0x3618 */
422 u8 ahb_dma_buffmask; /* 0x3619 */
423 u8 ahb_dma_buffpol; /* 0x361a */
424 u8 reserved20[0x9e5];
426 u8 mc_sfrdiv; /* 0x4000 */
427 u8 mc_clkdis; /* 0x4001 */
428 u8 mc_swrstz; /* 0x4002 */
429 u8 mc_opctrl; /* 0x4003 */
430 u8 mc_flowctrl; /* 0x4004 */
431 u8 mc_phyrstz; /* 0x4005 */
432 u8 mc_lockonclock; /* 0x4006 */
433 u8 mc_heacphy_rst; /* 0x4007 */
434 u8 reserved21[0xf8];
436 u8 csc_cfg; /* 0x4100 */
437 u8 csc_scale; /* 0x4101 */
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439 u8 csc_coef_a1_lsb; /* 0x4103 */
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441 u8 csc_coef_a2_lsb; /* 0x4105 */
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443 u8 csc_coef_a3_lsb; /* 0x4107 */
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445 u8 csc_coef_a4_lsb; /* 0x4109 */
446 u8 csc_coef_b1_msb; /* 0x410a */
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449 u8 csc_coef_b2_lsb; /* 0x410d */
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451 u8 csc_coef_b3_lsb; /* 0x410f */
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453 u8 csc_coef_b4_lsb; /* 0x4111 */
454 u8 csc_coef_c1_msb; /* 0x4112 */
455 u8 csc_coef_c1_lsb; /* 0x4113 */
456 u8 csc_coef_c2_msb; /* 0x4114 */
457 u8 csc_coef_c2_lsb; /* 0x4115 */
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459 u8 csc_coef_c3_lsb; /* 0x4117 */
460 u8 csc_coef_c4_msb; /* 0x4118 */
461 u8 csc_coef_c4_lsb; /* 0x4119 */
462 u8 reserved22[0xee6];
464 u8 a_hdcpcfg0; /* 0x5000 */
465 u8 a_hdcpcfg1; /* 0x5001 */
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467 u8 a_hdcpobs1; /* 0x5003 */
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470 u8 a_apiintclr; /* 0x5006 */
471 u8 a_apiintstat; /* 0x5007 */
472 u8 a_apiintmsk; /* 0x5008 */
473 u8 a_vidpolcfg; /* 0x5009 */
474 u8 a_oesswcfg; /* 0x500a */
475 u8 a_timer1setup0; /* 0x500b */
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477 u8 a_timer2setup0; /* 0x500d */
478 u8 a_timer2setup1; /* 0x500e */
479 u8 a_100mscfg; /* 0x500f */
480 u8 a_2scfg0; /* 0x5010 */
481 u8 a_2scfg1; /* 0x5011 */
482 u8 a_5scfg0; /* 0x5012 */
483 u8 a_5scfg1; /* 0x5013 */
484 u8 a_srmverlsb; /* 0x5014 */
485 u8 a_srmvermsb; /* 0x5015 */
486 u8 a_srmctrl; /* 0x5016 */
487 u8 a_sfrsetup; /* 0x5017 */
488 u8 a_i2chsetup; /* 0x5018 */
489 u8 a_intsetup; /* 0x5019 */
490 u8 a_presetup; /* 0x501a */
491 u8 reserved23[0x5];
492 u8 a_srm_base; /* 0x5020 */
493 u8 reserved24[0x2cdf];
495 u8 cec_ctrl; /* 0x7d00 */
496 u8 cec_stat; /* 0x7d01 */
497 u8 cec_mask; /* 0x7d02 */
498 u8 cec_polarity; /* 0x7d03 */
499 u8 cec_int; /* 0x7d04 */
500 u8 cec_addr_l; /* 0x7d05 */
501 u8 cec_addr_h; /* 0x7d06 */
502 u8 cec_tx_cnt; /* 0x7d07 */
503 u8 cec_rx_cnt; /* 0x7d08 */
504 u8 reserved25[0x7];
505 u8 cec_tx_data0; /* 0x7d10 */
506 u8 cec_tx_data1; /* 0x7d11 */
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513 u8 cec_tx_data8; /* 0x7d18 */
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519 u8 cec_tx_data14; /* 0x7d1e */
520 u8 cec_tx_data15; /* 0x7d1f */
521 u8 cec_rx_data0; /* 0x7d20 */
522 u8 cec_rx_data1; /* 0x7d21 */
523 u8 cec_rx_data2; /* 0x7d22 */
524 u8 cec_rx_data3; /* 0x7d23 */
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528 u8 cec_rx_data7; /* 0x7d27 */
529 u8 cec_rx_data8; /* 0x7d28 */
530 u8 cec_rx_data9; /* 0x7d29 */
531 u8 cec_rx_data10; /* 0x7d2a */
532 u8 cec_rx_data11; /* 0x7d2b */
533 u8 cec_rx_data12; /* 0x7d2c */
534 u8 cec_rx_data13; /* 0x7d2d */
535 u8 cec_rx_data14; /* 0x7d2e */
536 u8 cec_rx_data15; /* 0x7d2f */
537 u8 cec_lock; /* 0x7d30 */
538 u8 cec_wkupctrl; /* 0x7d31 */
539 u8 reserved26[0xce];
541 u8 i2cm_slave; /* 0x7e00 */
542 u8 i2cmess; /* 0x7e01 */
543 u8 i2cm_datao; /* 0x7e02 */
544 u8 i2cm_datai; /* 0x7e03 */
545 u8 i2cm_operation; /* 0x7e04 */
546 u8 i2cm_int; /* 0x7e05 */
547 u8 i2cm_ctlint; /* 0x7e06 */
548 u8 i2cm_div; /* 0x7e07 */
549 u8 i2cm_segaddr; /* 0x7e08 */
550 u8 i2cm_softrstz; /* 0x7e09 */
551 u8 i2cm_segptr; /* 0x7e0a */
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559 u8 i2cm_fs_scl_lcnt_0_addr; /* 0x7e12 */
560 u8 reserved27[0x1ed];
562 u8 rng_base; /* 0x8000 */