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51 #define IMX_GPIO_BASE (0x1C000 + IMX_IO_BASE) macro
111 #define DDIR(x) __REG2(IMX_GPIO_BASE + 0x00, ((x) & 3) << 8)
112 #define OCR1(x) __REG2(IMX_GPIO_BASE + 0x04, ((x) & 3) << 8)
113 #define OCR2(x) __REG2(IMX_GPIO_BASE + 0x08, ((x) & 3) << 8)
114 #define ICONFA1(x) __REG2(IMX_GPIO_BASE + 0x0c, ((x) & 3) << 8)
115 #define ICONFA2(x) __REG2(IMX_GPIO_BASE + 0x10, ((x) & 3) << 8)
116 #define ICONFB1(x) __REG2(IMX_GPIO_BASE + 0x14, ((x) & 3) << 8)
117 #define ICONFB2(x) __REG2(IMX_GPIO_BASE + 0x18, ((x) & 3) << 8)
118 #define DR(x) __REG2(IMX_GPIO_BASE + 0x1c, ((x) & 3) << 8)
119 #define GIUS(x) __REG2(IMX_GPIO_BASE + 0x20, ((x) & 3) << 8)
120 #define SSR(x) __REG2(IMX_GPIO_BASE + 0x24, ((x) & 3) << 8)
121 #define ICR1(x) __REG2(IMX_GPIO_BASE + 0x28, ((x) & 3) << 8)
122 #define ICR2(x) __REG2(IMX_GPIO_BASE + 0x2c, ((x) & 3) << 8)
123 #define IMR(x) __REG2(IMX_GPIO_BASE + 0x30, ((x) & 3) << 8)
124 #define ISR(x) __REG2(IMX_GPIO_BASE + 0x34, ((x) & 3) << 8)
125 #define GPR(x) __REG2(IMX_GPIO_BASE + 0x38, ((x) & 3) << 8)
126 #define SWR(x) __REG2(IMX_GPIO_BASE + 0x3c, ((x) & 3) << 8)
127 #define PUEN(x) __REG2(IMX_GPIO_BASE + 0x40, ((x) & 3) << 8)